雄介 太田 / mbed

mbed(SerialHalfDuplex入り)

Fork of mbed by mbed official

TARGET_TEENSY3_1/MK20DX256.h@93:e188a91d3eaa, 2015-02-03 (annotated)

Committer:
Kojto
Date:
Tue Feb 03 15:31:20 2015 +0000
Revision:
93:e188a91d3eaa
Release 93 of the mbed library



Main changes:



- Renesas RZ_A1H bugfixes - i2c, ticker

- new targets - Nucleo F303RE, Nucleo F070RB, BLE SMURFS,

                Dragonfly 411RE,

- BusXXX - is connected method, plus operators addition

- LPC8xx - I2c fixes

- timestamp_t reverted to uint32_t

- RTX - fixes regarding stack (alignment, magic word)

Who changed what in which revision?

UserRevisionLine numberNew contents of line
Kojto 93:e188a91d3eaa 1 /*
Kojto 93:e188a91d3eaa 2 ** ###################################################################
Kojto 93:e188a91d3eaa 3 ** Processors: MK20DX64VLH7
Kojto 93:e188a91d3eaa 4 ** MK20DX128VLH7
Kojto 93:e188a91d3eaa 5 ** MK20DX256VLH7
Kojto 93:e188a91d3eaa 6 ** MK20DX64VLK7
Kojto 93:e188a91d3eaa 7 ** MK20DX128VLK7
Kojto 93:e188a91d3eaa 8 ** MK20DX256VLK7
Kojto 93:e188a91d3eaa 9 ** MK20DX128VLL7
Kojto 93:e188a91d3eaa 10 ** MK20DX256VLL7
Kojto 93:e188a91d3eaa 11 ** MK20DX64VMB7
Kojto 93:e188a91d3eaa 12 ** MK20DX128VMB7
Kojto 93:e188a91d3eaa 13 ** MK20DX256VMB7
Kojto 93:e188a91d3eaa 14 ** MK20DX128VML7
Kojto 93:e188a91d3eaa 15 ** MK20DX256VML7
Kojto 93:e188a91d3eaa 16 **
Kojto 93:e188a91d3eaa 17 ** Compilers: ARM Compiler
Kojto 93:e188a91d3eaa 18 ** Freescale C/C++ for Embedded ARM
Kojto 93:e188a91d3eaa 19 ** GNU C Compiler
Kojto 93:e188a91d3eaa 20 ** IAR ANSI C/C++ Compiler for ARM
Kojto 93:e188a91d3eaa 21 **
Kojto 93:e188a91d3eaa 22 ** Reference manual: Kxx (P1 silicon) Sub-Family Reference Manual Rev. 0, draft A Oct 2011
Kojto 93:e188a91d3eaa 23 ** Version: rev. 1.0, 2012-01-15
Kojto 93:e188a91d3eaa 24 **
Kojto 93:e188a91d3eaa 25 ** Abstract:
Kojto 93:e188a91d3eaa 26 ** Provides a system configuration function and a global variable that
Kojto 93:e188a91d3eaa 27 ** contains the system frequency. It configures the device and initializes
Kojto 93:e188a91d3eaa 28 ** the oscillator (PLL) that is part of the microcontroller device.
Kojto 93:e188a91d3eaa 29 **
Kojto 93:e188a91d3eaa 30 ** Copyright: 2015 Freescale Semiconductor, Inc. All Rights Reserved.
Kojto 93:e188a91d3eaa 31 **
Kojto 93:e188a91d3eaa 32 ** http: www.freescale.com
Kojto 93:e188a91d3eaa 33 ** mail: support@freescale.com
Kojto 93:e188a91d3eaa 34 **
Kojto 93:e188a91d3eaa 35 ** Revisions:
Kojto 93:e188a91d3eaa 36 ** - rev. 1.0 (2012-01-15)
Kojto 93:e188a91d3eaa 37 ** Initial public version.
Kojto 93:e188a91d3eaa 38 **
Kojto 93:e188a91d3eaa 39 ** ###################################################################
Kojto 93:e188a91d3eaa 40 */
Kojto 93:e188a91d3eaa 41
Kojto 93:e188a91d3eaa 42 /**
Kojto 93:e188a91d3eaa 43 * @file MK20DX256.h
Kojto 93:e188a91d3eaa 44 * @version 2.0
Kojto 93:e188a91d3eaa 45 * @date 2012-03-19
Kojto 93:e188a91d3eaa 46 * @brief CMSIS Peripheral Access Layer for MK20DX256
Kojto 93:e188a91d3eaa 47 *
Kojto 93:e188a91d3eaa 48 * CMSIS Peripheral Access Layer for MK20DX256
Kojto 93:e188a91d3eaa 49 */
Kojto 93:e188a91d3eaa 50
Kojto 93:e188a91d3eaa 51 #if !defined(MK20DX256_H_)
Kojto 93:e188a91d3eaa 52 #define MK20DX256_H_ /**< Symbol preventing repeated inclusion */
Kojto 93:e188a91d3eaa 53 #define MCU_MK20DX256
Kojto 93:e188a91d3eaa 54 /** Memory map major version (memory maps with equal major version number are
Kojto 93:e188a91d3eaa 55 * compatible) */
Kojto 93:e188a91d3eaa 56 #define MCU_MEM_MAP_VERSION 0x0200u
Kojto 93:e188a91d3eaa 57 /** Memory map minor version */
Kojto 93:e188a91d3eaa 58 #define MCU_MEM_MAP_VERSION_MINOR 0x0000u
Kojto 93:e188a91d3eaa 59
Kojto 93:e188a91d3eaa 60 /**
Kojto 93:e188a91d3eaa 61 * @brief Macro to access a single bit of a peripheral register (bit band region
Kojto 93:e188a91d3eaa 62 * 0x40000000 to 0x400FFFFF) using the bit-band alias region access.
Kojto 93:e188a91d3eaa 63 * @param Reg Register to access.
Kojto 93:e188a91d3eaa 64 * @param Bit Bit number to access.
Kojto 93:e188a91d3eaa 65 * @return Value of the targeted bit in the bit band region.
Kojto 93:e188a91d3eaa 66 */
Kojto 93:e188a91d3eaa 67 #define BITBAND_REG(Reg,Bit) (*((uint32_t volatile*)(0x42000000u + (32u*((uint32_t)&(Reg) - (uint32_t)0x40000000u)) + (4u*((uint32_t)(Bit))))))
Kojto 93:e188a91d3eaa 68
Kojto 93:e188a91d3eaa 69 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 70 -- Interrupt vector numbers
Kojto 93:e188a91d3eaa 71 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 72
Kojto 93:e188a91d3eaa 73 /**
Kojto 93:e188a91d3eaa 74 * @addtogroup Interrupt_vector_numbers Interrupt vector numbers
Kojto 93:e188a91d3eaa 75 * @{
Kojto 93:e188a91d3eaa 76 */
Kojto 93:e188a91d3eaa 77
Kojto 93:e188a91d3eaa 78 /** Interrupt Number Definitions */
Kojto 93:e188a91d3eaa 79 typedef enum IRQn {
Kojto 93:e188a91d3eaa 80 /* Core interrupts */
Kojto 93:e188a91d3eaa 81 NonMaskableInt_IRQn = -14, /**< Non Maskable Interrupt */
Kojto 93:e188a91d3eaa 82 MemoryManagement_IRQn = -12, /**< Cortex-M4 Memory Management Interrupt */
Kojto 93:e188a91d3eaa 83 BusFault_IRQn = -11, /**< Cortex-M4 Bus Fault Interrupt */
Kojto 93:e188a91d3eaa 84 UsageFault_IRQn = -10, /**< Cortex-M4 Usage Fault Interrupt */
Kojto 93:e188a91d3eaa 85 SVCall_IRQn = -5, /**< Cortex-M4 SV Call Interrupt */
Kojto 93:e188a91d3eaa 86 DebugMonitor_IRQn = -4, /**< Cortex-M4 Debug Monitor Interrupt */
Kojto 93:e188a91d3eaa 87 PendSV_IRQn = -2, /**< Cortex-M4 Pend SV Interrupt */
Kojto 93:e188a91d3eaa 88 SysTick_IRQn = -1, /**< Cortex-M4 System Tick Interrupt */
Kojto 93:e188a91d3eaa 89
Kojto 93:e188a91d3eaa 90 /* Device specific interrupts */
Kojto 93:e188a91d3eaa 91
Kojto 93:e188a91d3eaa 92 DMA0_IRQn = 0, /**< DMA channel 0 transfer complete interrupt */
Kojto 93:e188a91d3eaa 93 DMA1_IRQn = 1, /**< DMA channel 1 transfer complete interrupt */
Kojto 93:e188a91d3eaa 94 DMA2_IRQn = 2, /**< DMA channel 2 transfer complete interrupt */
Kojto 93:e188a91d3eaa 95 DMA3_IRQn = 3, /**< DMA channel 3 transfer complete interrupt */
Kojto 93:e188a91d3eaa 96 DMA4_IRQn = 4,
Kojto 93:e188a91d3eaa 97 DMA5_IRQn = 5,
Kojto 93:e188a91d3eaa 98 DMA6_IRQn = 6,
Kojto 93:e188a91d3eaa 99 DMA7_IRQn = 7,
Kojto 93:e188a91d3eaa 100 DMA8_IRQn = 8,
Kojto 93:e188a91d3eaa 101 DMA9_IRQn = 9,
Kojto 93:e188a91d3eaa 102 DMA10_IRQn = 10,
Kojto 93:e188a91d3eaa 103 DMA11_IRQn = 11,
Kojto 93:e188a91d3eaa 104 DMA12_IRQn = 12,
Kojto 93:e188a91d3eaa 105 DMA13_IRQn = 13,
Kojto 93:e188a91d3eaa 106 DMA14_IRQn = 14,
Kojto 93:e188a91d3eaa 107 DMA15_IRQn = 15,
Kojto 93:e188a91d3eaa 108 DMA_Error_IRQn = 16, /**< DMA error interrupt */
Kojto 93:e188a91d3eaa 109 Reserved33_IRQn = 17,
Kojto 93:e188a91d3eaa 110 FTFL_IRQn = 18, /**< FTFL interrupt */
Kojto 93:e188a91d3eaa 111 Read_Collision_IRQn = 19, /**< Read collision interrupt */
Kojto 93:e188a91d3eaa 112 LVD_LVW_IRQn = 20, /**< Low Voltage Detect, Low Voltage Warning */
Kojto 93:e188a91d3eaa 113 LLW_IRQn = 21, /**< Low Leakage Wakeup */
Kojto 93:e188a91d3eaa 114 Watchdog_IRQn = 22, /**< WDOG interrupt */
Kojto 93:e188a91d3eaa 115 Reserved39_IRQn = 23,
Kojto 93:e188a91d3eaa 116 I2C0_IRQn = 24, /**< I2C0 interrupt */
Kojto 93:e188a91d3eaa 117 I2C1_IRQn = 25,
Kojto 93:e188a91d3eaa 118 SPI0_IRQn = 26, /**< SPI0 interrupt */
Kojto 93:e188a91d3eaa 119 SPI1_IRQn = 27,
Kojto 93:e188a91d3eaa 120 Reserved44_IRQn = 28,
Kojto 93:e188a91d3eaa 121 CAN0_ORed_Message_buffer_IRQn = 29, /**< CAN0 OR'd message buffers interrupt */
Kojto 93:e188a91d3eaa 122 CAN0_Bus_Off_IRQn = 30, /**< CAN0 bus off interrupt */
Kojto 93:e188a91d3eaa 123 CAN0_Error_IRQn = 31, /**< CAN0 error interrupt */
Kojto 93:e188a91d3eaa 124 CAN0_Tx_Warning_IRQn = 32, /**< CAN0 Tx warning interrupt */
Kojto 93:e188a91d3eaa 125 CAN0_Rx_Warning_IRQn = 33, /**< CAN0 Rx warning interrupt */
Kojto 93:e188a91d3eaa 126 CAN0_Wake_Up_IRQn = 34, /**< CAN0 wake up interrupt */
Kojto 93:e188a91d3eaa 127 I2S0_Tx_IRQn = 35, /**< I2S0 transmit interrupt */
Kojto 93:e188a91d3eaa 128 I2S0_Rx_IRQn = 36, /**< I2S0 receive interrupt */
Kojto 93:e188a91d3eaa 129 Reserved53_IRQn = 37,
Kojto 93:e188a91d3eaa 130 Reserved54_IRQn = 38,
Kojto 93:e188a91d3eaa 131 Reserved55_IRQn = 39,
Kojto 93:e188a91d3eaa 132 Reserved56_IRQn = 40,
Kojto 93:e188a91d3eaa 133 Reserved57_IRQn = 41,
Kojto 93:e188a91d3eaa 134 Reserved58_IRQn = 42,
Kojto 93:e188a91d3eaa 135 Reserved59_IRQn = 43,
Kojto 93:e188a91d3eaa 136 UART0_LON_IRQn = 44, /**< UART0 LON interrupt */
Kojto 93:e188a91d3eaa 137 UART0_RX_TX_IRQn = 45, /**< UART0 receive/transmit interrupt */
Kojto 93:e188a91d3eaa 138 UART0_ERR_IRQn = 46, /**< UART0 error interrupt */
Kojto 93:e188a91d3eaa 139 UART1_RX_TX_IRQn = 47, /**< UART1 receive/transmit interrupt */
Kojto 93:e188a91d3eaa 140 UART1_ERR_IRQn = 48, /**< UART1 error interrupt */
Kojto 93:e188a91d3eaa 141 UART2_RX_TX_IRQn = 49, /**< UART2 receive/transmit interrupt */
Kojto 93:e188a91d3eaa 142 UART2_ERR_IRQn = 50, /**< UART2 error interrupt */
Kojto 93:e188a91d3eaa 143 Reserved67_IRQn = 51,
Kojto 93:e188a91d3eaa 144 Reserved68_IRQn = 52,
Kojto 93:e188a91d3eaa 145 Reserved69_IRQn = 53,
Kojto 93:e188a91d3eaa 146 Reserved70_IRQn = 54,
Kojto 93:e188a91d3eaa 147 Reserved71_IRQn = 55,
Kojto 93:e188a91d3eaa 148 Reserved72_IRQn = 56,
Kojto 93:e188a91d3eaa 149 ADC0_IRQn = 57, /**< ADC0 interrupt */
Kojto 93:e188a91d3eaa 150 ADC1_IRQn = 58,
Kojto 93:e188a91d3eaa 151 CMP0_IRQn = 59, /**< CMP0 interrupt */
Kojto 93:e188a91d3eaa 152 CMP1_IRQn = 60, /**< CMP1 interrupt */
Kojto 93:e188a91d3eaa 153 CMP2_IRQn = 61,
Kojto 93:e188a91d3eaa 154 FTM0_IRQn = 62, /**< FTM0 fault, overflow and channels interrupt */
Kojto 93:e188a91d3eaa 155 FTM1_IRQn = 63, /**< FTM1 fault, overflow and channels interrupt */
Kojto 93:e188a91d3eaa 156 FTM2_IRQn = 64,
Kojto 93:e188a91d3eaa 157 CMT_IRQn = 65, /**< CMT interrupt */
Kojto 93:e188a91d3eaa 158 RTC_IRQn = 66, /**< RTC interrupt */
Kojto 93:e188a91d3eaa 159 RTC_Seconds_IRQn = 67, /**< RTC seconds interrupt */
Kojto 93:e188a91d3eaa 160 PIT0_IRQn = 68, /**< PIT timer channel 0 interrupt */
Kojto 93:e188a91d3eaa 161 PIT1_IRQn = 69, /**< PIT timer channel 1 interrupt */
Kojto 93:e188a91d3eaa 162 PIT2_IRQn = 70, /**< PIT timer channel 2 interrupt */
Kojto 93:e188a91d3eaa 163 PIT3_IRQn = 71, /**< PIT timer channel 3 interrupt */
Kojto 93:e188a91d3eaa 164 PDB0_IRQn = 72, /**< PDB0 interrupt */
Kojto 93:e188a91d3eaa 165 USB0_IRQn = 73, /**< USB0 interrupt */
Kojto 93:e188a91d3eaa 166 USBDCD_IRQn = 74, /**< USBDCD interrupt */
Kojto 93:e188a91d3eaa 167 Reserved91_IRQn = 75,
Kojto 93:e188a91d3eaa 168 Reserved92_IRQn = 76,
Kojto 93:e188a91d3eaa 169 Reserved93_IRQn = 77,
Kojto 93:e188a91d3eaa 170 Reserved94_IRQn = 78,
Kojto 93:e188a91d3eaa 171 Reserved95_IRQn = 79,
Kojto 93:e188a91d3eaa 172 Reserved96_IRQn = 80,
Kojto 93:e188a91d3eaa 173 DAC0_IRQn = 81,
Kojto 93:e188a91d3eaa 174 Reserved98_IRQn = 82,
Kojto 93:e188a91d3eaa 175 TSI0_IRQn = 83, /**< TSI0 interrupt */
Kojto 93:e188a91d3eaa 176 MCG_IRQn = 84, /**< MCG interrupt */
Kojto 93:e188a91d3eaa 177 LPTimer_IRQn = 85, /**< LPTimer interrupt */
Kojto 93:e188a91d3eaa 178 Reserved102_IRQn = 86,
Kojto 93:e188a91d3eaa 179 PORTA_IRQn = 87, /**< Port A interrupt */
Kojto 93:e188a91d3eaa 180 PORTB_IRQn = 88, /**< Port B interrupt */
Kojto 93:e188a91d3eaa 181 PORTC_IRQn = 89, /**< Port C interrupt */
Kojto 93:e188a91d3eaa 182 PORTD_IRQn = 90, /**< Port D interrupt */
Kojto 93:e188a91d3eaa 183 PORTE_IRQn = 91, /**< Port E interrupt */
Kojto 93:e188a91d3eaa 184 Reserved108_IRQn = 92,
Kojto 93:e188a91d3eaa 185 Reserved109_IRQn = 93,
Kojto 93:e188a91d3eaa 186 SWI_IRQn = 94 /**< Software interrupt */
Kojto 93:e188a91d3eaa 187
Kojto 93:e188a91d3eaa 188 } IRQn_Type;
Kojto 93:e188a91d3eaa 189
Kojto 93:e188a91d3eaa 190 /**
Kojto 93:e188a91d3eaa 191 * @}
Kojto 93:e188a91d3eaa 192 */ /* end of group Interrupt_vector_numbers */
Kojto 93:e188a91d3eaa 193
Kojto 93:e188a91d3eaa 194
Kojto 93:e188a91d3eaa 195 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 196 -- Cortex M4 Core Configuration
Kojto 93:e188a91d3eaa 197 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 198
Kojto 93:e188a91d3eaa 199 /**
Kojto 93:e188a91d3eaa 200 * @addtogroup Cortex_Core_Configuration Cortex M4 Core Configuration
Kojto 93:e188a91d3eaa 201 * @{
Kojto 93:e188a91d3eaa 202 */
Kojto 93:e188a91d3eaa 203
Kojto 93:e188a91d3eaa 204 #define __MPU_PRESENT 0 /**< Defines if an MPU is present or not */
Kojto 93:e188a91d3eaa 205 #define __NVIC_PRIO_BITS 4 /**< Number of priority bits implemented in the NVIC */
Kojto 93:e188a91d3eaa 206 #define __Vendor_SysTickConfig 0 /**< Vendor specific implementation of SysTickConfig is defined */
Kojto 93:e188a91d3eaa 207
Kojto 93:e188a91d3eaa 208 #include "core_cm4.h" /* Core Peripheral Access Layer */
Kojto 93:e188a91d3eaa 209 #include "system_MK20DX256.h" /* Device specific configuration file */
Kojto 93:e188a91d3eaa 210
Kojto 93:e188a91d3eaa 211 /**
Kojto 93:e188a91d3eaa 212 * @}
Kojto 93:e188a91d3eaa 213 */ /* end of group Cortex_Core_Configuration */
Kojto 93:e188a91d3eaa 214
Kojto 93:e188a91d3eaa 215
Kojto 93:e188a91d3eaa 216 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 217 -- Device Peripheral Access Layer
Kojto 93:e188a91d3eaa 218 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 219
Kojto 93:e188a91d3eaa 220 /**
Kojto 93:e188a91d3eaa 221 * @addtogroup Peripheral_access_layer Device Peripheral Access Layer
Kojto 93:e188a91d3eaa 222 * @{
Kojto 93:e188a91d3eaa 223 */
Kojto 93:e188a91d3eaa 224
Kojto 93:e188a91d3eaa 225
Kojto 93:e188a91d3eaa 226 /*
Kojto 93:e188a91d3eaa 227 ** Start of section using anonymous unions
Kojto 93:e188a91d3eaa 228 */
Kojto 93:e188a91d3eaa 229
Kojto 93:e188a91d3eaa 230 #if defined(__ARMCC_VERSION)
Kojto 93:e188a91d3eaa 231 #pragma push
Kojto 93:e188a91d3eaa 232 #pragma anon_unions
Kojto 93:e188a91d3eaa 233 #elif defined(__CWCC__)
Kojto 93:e188a91d3eaa 234 #pragma push
Kojto 93:e188a91d3eaa 235 #pragma cpp_extensions on
Kojto 93:e188a91d3eaa 236 #elif defined(__GNUC__)
Kojto 93:e188a91d3eaa 237 /* anonymous unions are enabled by default */
Kojto 93:e188a91d3eaa 238 #elif defined(__IAR_SYSTEMS_ICC__)
Kojto 93:e188a91d3eaa 239 #pragma language=extended
Kojto 93:e188a91d3eaa 240 #else
Kojto 93:e188a91d3eaa 241 #error Not supported compiler type
Kojto 93:e188a91d3eaa 242 #endif
Kojto 93:e188a91d3eaa 243
Kojto 93:e188a91d3eaa 244 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 245 -- ADC Peripheral Access Layer
Kojto 93:e188a91d3eaa 246 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 247
Kojto 93:e188a91d3eaa 248 /**
Kojto 93:e188a91d3eaa 249 * @addtogroup ADC_Peripheral_Access_Layer ADC Peripheral Access Layer
Kojto 93:e188a91d3eaa 250 * @{
Kojto 93:e188a91d3eaa 251 */
Kojto 93:e188a91d3eaa 252
Kojto 93:e188a91d3eaa 253 /** ADC - Register Layout Typedef */
Kojto 93:e188a91d3eaa 254 typedef struct {
Kojto 93:e188a91d3eaa 255 __IO uint32_t SC1[2]; /**< ADC status and control registers 1, array offset: 0x0, array step: 0x4 */
Kojto 93:e188a91d3eaa 256 __IO uint32_t CFG1; /**< ADC configuration register 1, offset: 0x8 */
Kojto 93:e188a91d3eaa 257 __IO uint32_t CFG2; /**< Configuration register 2, offset: 0xC */
Kojto 93:e188a91d3eaa 258 __I uint32_t R[2]; /**< ADC data result register, array offset: 0x10, array step: 0x4 */
Kojto 93:e188a91d3eaa 259 __IO uint32_t CV1; /**< Compare value registers, offset: 0x18 */
Kojto 93:e188a91d3eaa 260 __IO uint32_t CV2; /**< Compare value registers, offset: 0x1C */
Kojto 93:e188a91d3eaa 261 __IO uint32_t SC2; /**< Status and control register 2, offset: 0x20 */
Kojto 93:e188a91d3eaa 262 __IO uint32_t SC3; /**< Status and control register 3, offset: 0x24 */
Kojto 93:e188a91d3eaa 263 __IO uint32_t OFS; /**< ADC offset correction register, offset: 0x28 */
Kojto 93:e188a91d3eaa 264 __IO uint32_t PG; /**< ADC plus-side gain register, offset: 0x2C */
Kojto 93:e188a91d3eaa 265 __IO uint32_t MG; /**< ADC minus-side gain register, offset: 0x30 */
Kojto 93:e188a91d3eaa 266 __IO uint32_t CLPD; /**< ADC plus-side general calibration value register, offset: 0x34 */
Kojto 93:e188a91d3eaa 267 __IO uint32_t CLPS; /**< ADC plus-side general calibration value register, offset: 0x38 */
Kojto 93:e188a91d3eaa 268 __IO uint32_t CLP4; /**< ADC plus-side general calibration value register, offset: 0x3C */
Kojto 93:e188a91d3eaa 269 __IO uint32_t CLP3; /**< ADC plus-side general calibration value register, offset: 0x40 */
Kojto 93:e188a91d3eaa 270 __IO uint32_t CLP2; /**< ADC plus-side general calibration value register, offset: 0x44 */
Kojto 93:e188a91d3eaa 271 __IO uint32_t CLP1; /**< ADC plus-side general calibration value register, offset: 0x48 */
Kojto 93:e188a91d3eaa 272 __IO uint32_t CLP0; /**< ADC plus-side general calibration value register, offset: 0x4C */
Kojto 93:e188a91d3eaa 273 uint8_t RESERVED_0[4];
Kojto 93:e188a91d3eaa 274 __IO uint32_t CLMD; /**< ADC minus-side general calibration value register, offset: 0x54 */
Kojto 93:e188a91d3eaa 275 __IO uint32_t CLMS; /**< ADC minus-side general calibration value register, offset: 0x58 */
Kojto 93:e188a91d3eaa 276 __IO uint32_t CLM4; /**< ADC minus-side general calibration value register, offset: 0x5C */
Kojto 93:e188a91d3eaa 277 __IO uint32_t CLM3; /**< ADC minus-side general calibration value register, offset: 0x60 */
Kojto 93:e188a91d3eaa 278 __IO uint32_t CLM2; /**< ADC minus-side general calibration value register, offset: 0x64 */
Kojto 93:e188a91d3eaa 279 __IO uint32_t CLM1; /**< ADC minus-side general calibration value register, offset: 0x68 */
Kojto 93:e188a91d3eaa 280 __IO uint32_t CLM0; /**< ADC minus-side general calibration value register, offset: 0x6C */
Kojto 93:e188a91d3eaa 281 } ADC_Type;
Kojto 93:e188a91d3eaa 282
Kojto 93:e188a91d3eaa 283 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 284 -- ADC Register Masks
Kojto 93:e188a91d3eaa 285 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 286
Kojto 93:e188a91d3eaa 287 /**
Kojto 93:e188a91d3eaa 288 * @addtogroup ADC_Register_Masks ADC Register Masks
Kojto 93:e188a91d3eaa 289 * @{
Kojto 93:e188a91d3eaa 290 */
Kojto 93:e188a91d3eaa 291
Kojto 93:e188a91d3eaa 292 /* SC1 Bit Fields */
Kojto 93:e188a91d3eaa 293 #define ADC_SC1_ADCH_MASK 0x1Fu
Kojto 93:e188a91d3eaa 294 #define ADC_SC1_ADCH_SHIFT 0
Kojto 93:e188a91d3eaa 295 #define ADC_SC1_ADCH(x) (((uint32_t)(((uint32_t)(x))<<ADC_SC1_ADCH_SHIFT))&ADC_SC1_ADCH_MASK)
Kojto 93:e188a91d3eaa 296 #define ADC_SC1_DIFF_MASK 0x20u
Kojto 93:e188a91d3eaa 297 #define ADC_SC1_DIFF_SHIFT 5
Kojto 93:e188a91d3eaa 298 #define ADC_SC1_AIEN_MASK 0x40u
Kojto 93:e188a91d3eaa 299 #define ADC_SC1_AIEN_SHIFT 6
Kojto 93:e188a91d3eaa 300 #define ADC_SC1_COCO_MASK 0x80u
Kojto 93:e188a91d3eaa 301 #define ADC_SC1_COCO_SHIFT 7
Kojto 93:e188a91d3eaa 302 /* CFG1 Bit Fields */
Kojto 93:e188a91d3eaa 303 #define ADC_CFG1_ADICLK_MASK 0x3u
Kojto 93:e188a91d3eaa 304 #define ADC_CFG1_ADICLK_SHIFT 0
Kojto 93:e188a91d3eaa 305 #define ADC_CFG1_ADICLK(x) (((uint32_t)(((uint32_t)(x))<<ADC_CFG1_ADICLK_SHIFT))&ADC_CFG1_ADICLK_MASK)
Kojto 93:e188a91d3eaa 306 #define ADC_CFG1_MODE_MASK 0xCu
Kojto 93:e188a91d3eaa 307 #define ADC_CFG1_MODE_SHIFT 2
Kojto 93:e188a91d3eaa 308 #define ADC_CFG1_MODE(x) (((uint32_t)(((uint32_t)(x))<<ADC_CFG1_MODE_SHIFT))&ADC_CFG1_MODE_MASK)
Kojto 93:e188a91d3eaa 309 #define ADC_CFG1_ADLSMP_MASK 0x10u
Kojto 93:e188a91d3eaa 310 #define ADC_CFG1_ADLSMP_SHIFT 4
Kojto 93:e188a91d3eaa 311 #define ADC_CFG1_ADIV_MASK 0x60u
Kojto 93:e188a91d3eaa 312 #define ADC_CFG1_ADIV_SHIFT 5
Kojto 93:e188a91d3eaa 313 #define ADC_CFG1_ADIV(x) (((uint32_t)(((uint32_t)(x))<<ADC_CFG1_ADIV_SHIFT))&ADC_CFG1_ADIV_MASK)
Kojto 93:e188a91d3eaa 314 #define ADC_CFG1_ADLPC_MASK 0x80u
Kojto 93:e188a91d3eaa 315 #define ADC_CFG1_ADLPC_SHIFT 7
Kojto 93:e188a91d3eaa 316 /* CFG2 Bit Fields */
Kojto 93:e188a91d3eaa 317 #define ADC_CFG2_ADLSTS_MASK 0x3u
Kojto 93:e188a91d3eaa 318 #define ADC_CFG2_ADLSTS_SHIFT 0
Kojto 93:e188a91d3eaa 319 #define ADC_CFG2_ADLSTS(x) (((uint32_t)(((uint32_t)(x))<<ADC_CFG2_ADLSTS_SHIFT))&ADC_CFG2_ADLSTS_MASK)
Kojto 93:e188a91d3eaa 320 #define ADC_CFG2_ADHSC_MASK 0x4u
Kojto 93:e188a91d3eaa 321 #define ADC_CFG2_ADHSC_SHIFT 2
Kojto 93:e188a91d3eaa 322 #define ADC_CFG2_ADACKEN_MASK 0x8u
Kojto 93:e188a91d3eaa 323 #define ADC_CFG2_ADACKEN_SHIFT 3
Kojto 93:e188a91d3eaa 324 #define ADC_CFG2_MUXSEL_MASK 0x10u
Kojto 93:e188a91d3eaa 325 #define ADC_CFG2_MUXSEL_SHIFT 4
Kojto 93:e188a91d3eaa 326 /* R Bit Fields */
Kojto 93:e188a91d3eaa 327 #define ADC_R_D_MASK 0xFFFFu
Kojto 93:e188a91d3eaa 328 #define ADC_R_D_SHIFT 0
Kojto 93:e188a91d3eaa 329 #define ADC_R_D(x) (((uint32_t)(((uint32_t)(x))<<ADC_R_D_SHIFT))&ADC_R_D_MASK)
Kojto 93:e188a91d3eaa 330 /* CV1 Bit Fields */
Kojto 93:e188a91d3eaa 331 #define ADC_CV1_CV_MASK 0xFFFFu
Kojto 93:e188a91d3eaa 332 #define ADC_CV1_CV_SHIFT 0
Kojto 93:e188a91d3eaa 333 #define ADC_CV1_CV(x) (((uint32_t)(((uint32_t)(x))<<ADC_CV1_CV_SHIFT))&ADC_CV1_CV_MASK)
Kojto 93:e188a91d3eaa 334 /* CV2 Bit Fields */
Kojto 93:e188a91d3eaa 335 #define ADC_CV2_CV_MASK 0xFFFFu
Kojto 93:e188a91d3eaa 336 #define ADC_CV2_CV_SHIFT 0
Kojto 93:e188a91d3eaa 337 #define ADC_CV2_CV(x) (((uint32_t)(((uint32_t)(x))<<ADC_CV2_CV_SHIFT))&ADC_CV2_CV_MASK)
Kojto 93:e188a91d3eaa 338 /* SC2 Bit Fields */
Kojto 93:e188a91d3eaa 339 #define ADC_SC2_REFSEL_MASK 0x3u
Kojto 93:e188a91d3eaa 340 #define ADC_SC2_REFSEL_SHIFT 0
Kojto 93:e188a91d3eaa 341 #define ADC_SC2_REFSEL(x) (((uint32_t)(((uint32_t)(x))<<ADC_SC2_REFSEL_SHIFT))&ADC_SC2_REFSEL_MASK)
Kojto 93:e188a91d3eaa 342 #define ADC_SC2_DMAEN_MASK 0x4u
Kojto 93:e188a91d3eaa 343 #define ADC_SC2_DMAEN_SHIFT 2
Kojto 93:e188a91d3eaa 344 #define ADC_SC2_ACREN_MASK 0x8u
Kojto 93:e188a91d3eaa 345 #define ADC_SC2_ACREN_SHIFT 3
Kojto 93:e188a91d3eaa 346 #define ADC_SC2_ACFGT_MASK 0x10u
Kojto 93:e188a91d3eaa 347 #define ADC_SC2_ACFGT_SHIFT 4
Kojto 93:e188a91d3eaa 348 #define ADC_SC2_ACFE_MASK 0x20u
Kojto 93:e188a91d3eaa 349 #define ADC_SC2_ACFE_SHIFT 5
Kojto 93:e188a91d3eaa 350 #define ADC_SC2_ADTRG_MASK 0x40u
Kojto 93:e188a91d3eaa 351 #define ADC_SC2_ADTRG_SHIFT 6
Kojto 93:e188a91d3eaa 352 #define ADC_SC2_ADACT_MASK 0x80u
Kojto 93:e188a91d3eaa 353 #define ADC_SC2_ADACT_SHIFT 7
Kojto 93:e188a91d3eaa 354 /* SC3 Bit Fields */
Kojto 93:e188a91d3eaa 355 #define ADC_SC3_AVGS_MASK 0x3u
Kojto 93:e188a91d3eaa 356 #define ADC_SC3_AVGS_SHIFT 0
Kojto 93:e188a91d3eaa 357 #define ADC_SC3_AVGS(x) (((uint32_t)(((uint32_t)(x))<<ADC_SC3_AVGS_SHIFT))&ADC_SC3_AVGS_MASK)
Kojto 93:e188a91d3eaa 358 #define ADC_SC3_AVGE_MASK 0x4u
Kojto 93:e188a91d3eaa 359 #define ADC_SC3_AVGE_SHIFT 2
Kojto 93:e188a91d3eaa 360 #define ADC_SC3_ADCO_MASK 0x8u
Kojto 93:e188a91d3eaa 361 #define ADC_SC3_ADCO_SHIFT 3
Kojto 93:e188a91d3eaa 362 #define ADC_SC3_CALF_MASK 0x40u
Kojto 93:e188a91d3eaa 363 #define ADC_SC3_CALF_SHIFT 6
Kojto 93:e188a91d3eaa 364 #define ADC_SC3_CAL_MASK 0x80u
Kojto 93:e188a91d3eaa 365 #define ADC_SC3_CAL_SHIFT 7
Kojto 93:e188a91d3eaa 366 /* OFS Bit Fields */
Kojto 93:e188a91d3eaa 367 #define ADC_OFS_OFS_MASK 0xFFFFu
Kojto 93:e188a91d3eaa 368 #define ADC_OFS_OFS_SHIFT 0
Kojto 93:e188a91d3eaa 369 #define ADC_OFS_OFS(x) (((uint32_t)(((uint32_t)(x))<<ADC_OFS_OFS_SHIFT))&ADC_OFS_OFS_MASK)
Kojto 93:e188a91d3eaa 370 /* PG Bit Fields */
Kojto 93:e188a91d3eaa 371 #define ADC_PG_PG_MASK 0xFFFFu
Kojto 93:e188a91d3eaa 372 #define ADC_PG_PG_SHIFT 0
Kojto 93:e188a91d3eaa 373 #define ADC_PG_PG(x) (((uint32_t)(((uint32_t)(x))<<ADC_PG_PG_SHIFT))&ADC_PG_PG_MASK)
Kojto 93:e188a91d3eaa 374 /* MG Bit Fields */
Kojto 93:e188a91d3eaa 375 #define ADC_MG_MG_MASK 0xFFFFu
Kojto 93:e188a91d3eaa 376 #define ADC_MG_MG_SHIFT 0
Kojto 93:e188a91d3eaa 377 #define ADC_MG_MG(x) (((uint32_t)(((uint32_t)(x))<<ADC_MG_MG_SHIFT))&ADC_MG_MG_MASK)
Kojto 93:e188a91d3eaa 378 /* CLPD Bit Fields */
Kojto 93:e188a91d3eaa 379 #define ADC_CLPD_CLPD_MASK 0x3Fu
Kojto 93:e188a91d3eaa 380 #define ADC_CLPD_CLPD_SHIFT 0
Kojto 93:e188a91d3eaa 381 #define ADC_CLPD_CLPD(x) (((uint32_t)(((uint32_t)(x))<<ADC_CLPD_CLPD_SHIFT))&ADC_CLPD_CLPD_MASK)
Kojto 93:e188a91d3eaa 382 /* CLPS Bit Fields */
Kojto 93:e188a91d3eaa 383 #define ADC_CLPS_CLPS_MASK 0x3Fu
Kojto 93:e188a91d3eaa 384 #define ADC_CLPS_CLPS_SHIFT 0
Kojto 93:e188a91d3eaa 385 #define ADC_CLPS_CLPS(x) (((uint32_t)(((uint32_t)(x))<<ADC_CLPS_CLPS_SHIFT))&ADC_CLPS_CLPS_MASK)
Kojto 93:e188a91d3eaa 386 /* CLP4 Bit Fields */
Kojto 93:e188a91d3eaa 387 #define ADC_CLP4_CLP4_MASK 0x3FFu
Kojto 93:e188a91d3eaa 388 #define ADC_CLP4_CLP4_SHIFT 0
Kojto 93:e188a91d3eaa 389 #define ADC_CLP4_CLP4(x) (((uint32_t)(((uint32_t)(x))<<ADC_CLP4_CLP4_SHIFT))&ADC_CLP4_CLP4_MASK)
Kojto 93:e188a91d3eaa 390 /* CLP3 Bit Fields */
Kojto 93:e188a91d3eaa 391 #define ADC_CLP3_CLP3_MASK 0x1FFu
Kojto 93:e188a91d3eaa 392 #define ADC_CLP3_CLP3_SHIFT 0
Kojto 93:e188a91d3eaa 393 #define ADC_CLP3_CLP3(x) (((uint32_t)(((uint32_t)(x))<<ADC_CLP3_CLP3_SHIFT))&ADC_CLP3_CLP3_MASK)
Kojto 93:e188a91d3eaa 394 /* CLP2 Bit Fields */
Kojto 93:e188a91d3eaa 395 #define ADC_CLP2_CLP2_MASK 0xFFu
Kojto 93:e188a91d3eaa 396 #define ADC_CLP2_CLP2_SHIFT 0
Kojto 93:e188a91d3eaa 397 #define ADC_CLP2_CLP2(x) (((uint32_t)(((uint32_t)(x))<<ADC_CLP2_CLP2_SHIFT))&ADC_CLP2_CLP2_MASK)
Kojto 93:e188a91d3eaa 398 /* CLP1 Bit Fields */
Kojto 93:e188a91d3eaa 399 #define ADC_CLP1_CLP1_MASK 0x7Fu
Kojto 93:e188a91d3eaa 400 #define ADC_CLP1_CLP1_SHIFT 0
Kojto 93:e188a91d3eaa 401 #define ADC_CLP1_CLP1(x) (((uint32_t)(((uint32_t)(x))<<ADC_CLP1_CLP1_SHIFT))&ADC_CLP1_CLP1_MASK)
Kojto 93:e188a91d3eaa 402 /* CLP0 Bit Fields */
Kojto 93:e188a91d3eaa 403 #define ADC_CLP0_CLP0_MASK 0x3Fu
Kojto 93:e188a91d3eaa 404 #define ADC_CLP0_CLP0_SHIFT 0
Kojto 93:e188a91d3eaa 405 #define ADC_CLP0_CLP0(x) (((uint32_t)(((uint32_t)(x))<<ADC_CLP0_CLP0_SHIFT))&ADC_CLP0_CLP0_MASK)
Kojto 93:e188a91d3eaa 406 /* CLMD Bit Fields */
Kojto 93:e188a91d3eaa 407 #define ADC_CLMD_CLMD_MASK 0x3Fu
Kojto 93:e188a91d3eaa 408 #define ADC_CLMD_CLMD_SHIFT 0
Kojto 93:e188a91d3eaa 409 #define ADC_CLMD_CLMD(x) (((uint32_t)(((uint32_t)(x))<<ADC_CLMD_CLMD_SHIFT))&ADC_CLMD_CLMD_MASK)
Kojto 93:e188a91d3eaa 410 /* CLMS Bit Fields */
Kojto 93:e188a91d3eaa 411 #define ADC_CLMS_CLMS_MASK 0x3Fu
Kojto 93:e188a91d3eaa 412 #define ADC_CLMS_CLMS_SHIFT 0
Kojto 93:e188a91d3eaa 413 #define ADC_CLMS_CLMS(x) (((uint32_t)(((uint32_t)(x))<<ADC_CLMS_CLMS_SHIFT))&ADC_CLMS_CLMS_MASK)
Kojto 93:e188a91d3eaa 414 /* CLM4 Bit Fields */
Kojto 93:e188a91d3eaa 415 #define ADC_CLM4_CLM4_MASK 0x3FFu
Kojto 93:e188a91d3eaa 416 #define ADC_CLM4_CLM4_SHIFT 0
Kojto 93:e188a91d3eaa 417 #define ADC_CLM4_CLM4(x) (((uint32_t)(((uint32_t)(x))<<ADC_CLM4_CLM4_SHIFT))&ADC_CLM4_CLM4_MASK)
Kojto 93:e188a91d3eaa 418 /* CLM3 Bit Fields */
Kojto 93:e188a91d3eaa 419 #define ADC_CLM3_CLM3_MASK 0x1FFu
Kojto 93:e188a91d3eaa 420 #define ADC_CLM3_CLM3_SHIFT 0
Kojto 93:e188a91d3eaa 421 #define ADC_CLM3_CLM3(x) (((uint32_t)(((uint32_t)(x))<<ADC_CLM3_CLM3_SHIFT))&ADC_CLM3_CLM3_MASK)
Kojto 93:e188a91d3eaa 422 /* CLM2 Bit Fields */
Kojto 93:e188a91d3eaa 423 #define ADC_CLM2_CLM2_MASK 0xFFu
Kojto 93:e188a91d3eaa 424 #define ADC_CLM2_CLM2_SHIFT 0
Kojto 93:e188a91d3eaa 425 #define ADC_CLM2_CLM2(x) (((uint32_t)(((uint32_t)(x))<<ADC_CLM2_CLM2_SHIFT))&ADC_CLM2_CLM2_MASK)
Kojto 93:e188a91d3eaa 426 /* CLM1 Bit Fields */
Kojto 93:e188a91d3eaa 427 #define ADC_CLM1_CLM1_MASK 0x7Fu
Kojto 93:e188a91d3eaa 428 #define ADC_CLM1_CLM1_SHIFT 0
Kojto 93:e188a91d3eaa 429 #define ADC_CLM1_CLM1(x) (((uint32_t)(((uint32_t)(x))<<ADC_CLM1_CLM1_SHIFT))&ADC_CLM1_CLM1_MASK)
Kojto 93:e188a91d3eaa 430 /* CLM0 Bit Fields */
Kojto 93:e188a91d3eaa 431 #define ADC_CLM0_CLM0_MASK 0x3Fu
Kojto 93:e188a91d3eaa 432 #define ADC_CLM0_CLM0_SHIFT 0
Kojto 93:e188a91d3eaa 433 #define ADC_CLM0_CLM0(x) (((uint32_t)(((uint32_t)(x))<<ADC_CLM0_CLM0_SHIFT))&ADC_CLM0_CLM0_MASK)
Kojto 93:e188a91d3eaa 434
Kojto 93:e188a91d3eaa 435 /**
Kojto 93:e188a91d3eaa 436 * @}
Kojto 93:e188a91d3eaa 437 */ /* end of group ADC_Register_Masks */
Kojto 93:e188a91d3eaa 438
Kojto 93:e188a91d3eaa 439
Kojto 93:e188a91d3eaa 440 /* ADC - Peripheral instance base addresses */
Kojto 93:e188a91d3eaa 441 /** Peripheral ADC0 base address */
Kojto 93:e188a91d3eaa 442 #define ADC0_BASE (0x4003B000u)
Kojto 93:e188a91d3eaa 443 /** Peripheral ADC0 base pointer */
Kojto 93:e188a91d3eaa 444 #define ADC0 ((ADC_Type *)ADC0_BASE)
Kojto 93:e188a91d3eaa 445
Kojto 93:e188a91d3eaa 446 /**
Kojto 93:e188a91d3eaa 447 * @}
Kojto 93:e188a91d3eaa 448 */ /* end of group ADC_Peripheral_Access_Layer */
Kojto 93:e188a91d3eaa 449
Kojto 93:e188a91d3eaa 450
Kojto 93:e188a91d3eaa 451 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 452 -- CMP Peripheral Access Layer
Kojto 93:e188a91d3eaa 453 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 454
Kojto 93:e188a91d3eaa 455 /**
Kojto 93:e188a91d3eaa 456 * @addtogroup CMP_Peripheral_Access_Layer CMP Peripheral Access Layer
Kojto 93:e188a91d3eaa 457 * @{
Kojto 93:e188a91d3eaa 458 */
Kojto 93:e188a91d3eaa 459
Kojto 93:e188a91d3eaa 460 /** CMP - Register Layout Typedef */
Kojto 93:e188a91d3eaa 461 typedef struct {
Kojto 93:e188a91d3eaa 462 __IO uint8_t CR0; /**< CMP Control Register 0, offset: 0x0 */
Kojto 93:e188a91d3eaa 463 __IO uint8_t CR1; /**< CMP Control Register 1, offset: 0x1 */
Kojto 93:e188a91d3eaa 464 __IO uint8_t FPR; /**< CMP Filter Period Register, offset: 0x2 */
Kojto 93:e188a91d3eaa 465 __IO uint8_t SCR; /**< CMP Status and Control Register, offset: 0x3 */
Kojto 93:e188a91d3eaa 466 __IO uint8_t DACCR; /**< DAC Control Register, offset: 0x4 */
Kojto 93:e188a91d3eaa 467 __IO uint8_t MUXCR; /**< MUX Control Register, offset: 0x5 */
Kojto 93:e188a91d3eaa 468 } CMP_Type;
Kojto 93:e188a91d3eaa 469
Kojto 93:e188a91d3eaa 470 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 471 -- CMP Register Masks
Kojto 93:e188a91d3eaa 472 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 473
Kojto 93:e188a91d3eaa 474 /**
Kojto 93:e188a91d3eaa 475 * @addtogroup CMP_Register_Masks CMP Register Masks
Kojto 93:e188a91d3eaa 476 * @{
Kojto 93:e188a91d3eaa 477 */
Kojto 93:e188a91d3eaa 478
Kojto 93:e188a91d3eaa 479 /* CR0 Bit Fields */
Kojto 93:e188a91d3eaa 480 #define CMP_CR0_HYSTCTR_MASK 0x3u
Kojto 93:e188a91d3eaa 481 #define CMP_CR0_HYSTCTR_SHIFT 0
Kojto 93:e188a91d3eaa 482 #define CMP_CR0_HYSTCTR(x) (((uint8_t)(((uint8_t)(x))<<CMP_CR0_HYSTCTR_SHIFT))&CMP_CR0_HYSTCTR_MASK)
Kojto 93:e188a91d3eaa 483 #define CMP_CR0_FILTER_CNT_MASK 0x70u
Kojto 93:e188a91d3eaa 484 #define CMP_CR0_FILTER_CNT_SHIFT 4
Kojto 93:e188a91d3eaa 485 #define CMP_CR0_FILTER_CNT(x) (((uint8_t)(((uint8_t)(x))<<CMP_CR0_FILTER_CNT_SHIFT))&CMP_CR0_FILTER_CNT_MASK)
Kojto 93:e188a91d3eaa 486 /* CR1 Bit Fields */
Kojto 93:e188a91d3eaa 487 #define CMP_CR1_EN_MASK 0x1u
Kojto 93:e188a91d3eaa 488 #define CMP_CR1_EN_SHIFT 0
Kojto 93:e188a91d3eaa 489 #define CMP_CR1_OPE_MASK 0x2u
Kojto 93:e188a91d3eaa 490 #define CMP_CR1_OPE_SHIFT 1
Kojto 93:e188a91d3eaa 491 #define CMP_CR1_COS_MASK 0x4u
Kojto 93:e188a91d3eaa 492 #define CMP_CR1_COS_SHIFT 2
Kojto 93:e188a91d3eaa 493 #define CMP_CR1_INV_MASK 0x8u
Kojto 93:e188a91d3eaa 494 #define CMP_CR1_INV_SHIFT 3
Kojto 93:e188a91d3eaa 495 #define CMP_CR1_PMODE_MASK 0x10u
Kojto 93:e188a91d3eaa 496 #define CMP_CR1_PMODE_SHIFT 4
Kojto 93:e188a91d3eaa 497 #define CMP_CR1_WE_MASK 0x40u
Kojto 93:e188a91d3eaa 498 #define CMP_CR1_WE_SHIFT 6
Kojto 93:e188a91d3eaa 499 #define CMP_CR1_SE_MASK 0x80u
Kojto 93:e188a91d3eaa 500 #define CMP_CR1_SE_SHIFT 7
Kojto 93:e188a91d3eaa 501 /* FPR Bit Fields */
Kojto 93:e188a91d3eaa 502 #define CMP_FPR_FILT_PER_MASK 0xFFu
Kojto 93:e188a91d3eaa 503 #define CMP_FPR_FILT_PER_SHIFT 0
Kojto 93:e188a91d3eaa 504 #define CMP_FPR_FILT_PER(x) (((uint8_t)(((uint8_t)(x))<<CMP_FPR_FILT_PER_SHIFT))&CMP_FPR_FILT_PER_MASK)
Kojto 93:e188a91d3eaa 505 /* SCR Bit Fields */
Kojto 93:e188a91d3eaa 506 #define CMP_SCR_COUT_MASK 0x1u
Kojto 93:e188a91d3eaa 507 #define CMP_SCR_COUT_SHIFT 0
Kojto 93:e188a91d3eaa 508 #define CMP_SCR_CFF_MASK 0x2u
Kojto 93:e188a91d3eaa 509 #define CMP_SCR_CFF_SHIFT 1
Kojto 93:e188a91d3eaa 510 #define CMP_SCR_CFR_MASK 0x4u
Kojto 93:e188a91d3eaa 511 #define CMP_SCR_CFR_SHIFT 2
Kojto 93:e188a91d3eaa 512 #define CMP_SCR_IEF_MASK 0x8u
Kojto 93:e188a91d3eaa 513 #define CMP_SCR_IEF_SHIFT 3
Kojto 93:e188a91d3eaa 514 #define CMP_SCR_IER_MASK 0x10u
Kojto 93:e188a91d3eaa 515 #define CMP_SCR_IER_SHIFT 4
Kojto 93:e188a91d3eaa 516 #define CMP_SCR_DMAEN_MASK 0x40u
Kojto 93:e188a91d3eaa 517 #define CMP_SCR_DMAEN_SHIFT 6
Kojto 93:e188a91d3eaa 518 /* DACCR Bit Fields */
Kojto 93:e188a91d3eaa 519 #define CMP_DACCR_VOSEL_MASK 0x3Fu
Kojto 93:e188a91d3eaa 520 #define CMP_DACCR_VOSEL_SHIFT 0
Kojto 93:e188a91d3eaa 521 #define CMP_DACCR_VOSEL(x) (((uint8_t)(((uint8_t)(x))<<CMP_DACCR_VOSEL_SHIFT))&CMP_DACCR_VOSEL_MASK)
Kojto 93:e188a91d3eaa 522 #define CMP_DACCR_VRSEL_MASK 0x40u
Kojto 93:e188a91d3eaa 523 #define CMP_DACCR_VRSEL_SHIFT 6
Kojto 93:e188a91d3eaa 524 #define CMP_DACCR_DACEN_MASK 0x80u
Kojto 93:e188a91d3eaa 525 #define CMP_DACCR_DACEN_SHIFT 7
Kojto 93:e188a91d3eaa 526 /* MUXCR Bit Fields */
Kojto 93:e188a91d3eaa 527 #define CMP_MUXCR_MSEL_MASK 0x7u
Kojto 93:e188a91d3eaa 528 #define CMP_MUXCR_MSEL_SHIFT 0
Kojto 93:e188a91d3eaa 529 #define CMP_MUXCR_MSEL(x) (((uint8_t)(((uint8_t)(x))<<CMP_MUXCR_MSEL_SHIFT))&CMP_MUXCR_MSEL_MASK)
Kojto 93:e188a91d3eaa 530 #define CMP_MUXCR_PSEL_MASK 0x38u
Kojto 93:e188a91d3eaa 531 #define CMP_MUXCR_PSEL_SHIFT 3
Kojto 93:e188a91d3eaa 532 #define CMP_MUXCR_PSEL(x) (((uint8_t)(((uint8_t)(x))<<CMP_MUXCR_PSEL_SHIFT))&CMP_MUXCR_PSEL_MASK)
Kojto 93:e188a91d3eaa 533
Kojto 93:e188a91d3eaa 534 /**
Kojto 93:e188a91d3eaa 535 * @}
Kojto 93:e188a91d3eaa 536 */ /* end of group CMP_Register_Masks */
Kojto 93:e188a91d3eaa 537
Kojto 93:e188a91d3eaa 538
Kojto 93:e188a91d3eaa 539 /* CMP - Peripheral instance base addresses */
Kojto 93:e188a91d3eaa 540 /** Peripheral CMP0 base address */
Kojto 93:e188a91d3eaa 541 #define CMP0_BASE (0x40073000u)
Kojto 93:e188a91d3eaa 542 /** Peripheral CMP0 base pointer */
Kojto 93:e188a91d3eaa 543 #define CMP0 ((CMP_Type *)CMP0_BASE)
Kojto 93:e188a91d3eaa 544 /** Peripheral CMP1 base address */
Kojto 93:e188a91d3eaa 545 #define CMP1_BASE (0x40073008u)
Kojto 93:e188a91d3eaa 546 /** Peripheral CMP1 base pointer */
Kojto 93:e188a91d3eaa 547 #define CMP1 ((CMP_Type *)CMP1_BASE)
Kojto 93:e188a91d3eaa 548
Kojto 93:e188a91d3eaa 549 /**
Kojto 93:e188a91d3eaa 550 * @}
Kojto 93:e188a91d3eaa 551 */ /* end of group CMP_Peripheral_Access_Layer */
Kojto 93:e188a91d3eaa 552
Kojto 93:e188a91d3eaa 553
Kojto 93:e188a91d3eaa 554 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 555 -- CMT Peripheral Access Layer
Kojto 93:e188a91d3eaa 556 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 557
Kojto 93:e188a91d3eaa 558 /**
Kojto 93:e188a91d3eaa 559 * @addtogroup CMT_Peripheral_Access_Layer CMT Peripheral Access Layer
Kojto 93:e188a91d3eaa 560 * @{
Kojto 93:e188a91d3eaa 561 */
Kojto 93:e188a91d3eaa 562
Kojto 93:e188a91d3eaa 563 /** CMT - Register Layout Typedef */
Kojto 93:e188a91d3eaa 564 typedef struct {
Kojto 93:e188a91d3eaa 565 __IO uint8_t CGH1; /**< CMT Carrier Generator High Data Register 1, offset: 0x0 */
Kojto 93:e188a91d3eaa 566 __IO uint8_t CGL1; /**< CMT Carrier Generator Low Data Register 1, offset: 0x1 */
Kojto 93:e188a91d3eaa 567 __IO uint8_t CGH2; /**< CMT Carrier Generator High Data Register 2, offset: 0x2 */
Kojto 93:e188a91d3eaa 568 __IO uint8_t CGL2; /**< CMT Carrier Generator Low Data Register 2, offset: 0x3 */
Kojto 93:e188a91d3eaa 569 __IO uint8_t OC; /**< CMT Output Control Register, offset: 0x4 */
Kojto 93:e188a91d3eaa 570 __IO uint8_t MSC; /**< CMT Modulator Status and Control Register, offset: 0x5 */
Kojto 93:e188a91d3eaa 571 __IO uint8_t CMD1; /**< CMT Modulator Data Register Mark High, offset: 0x6 */
Kojto 93:e188a91d3eaa 572 __IO uint8_t CMD2; /**< CMT Modulator Data Register Mark Low, offset: 0x7 */
Kojto 93:e188a91d3eaa 573 __IO uint8_t CMD3; /**< CMT Modulator Data Register Space High, offset: 0x8 */
Kojto 93:e188a91d3eaa 574 __IO uint8_t CMD4; /**< CMT Modulator Data Register Space Low, offset: 0x9 */
Kojto 93:e188a91d3eaa 575 __IO uint8_t PPS; /**< CMT Primary Prescaler Register, offset: 0xA */
Kojto 93:e188a91d3eaa 576 __IO uint8_t DMA; /**< CMT Direct Memory Access, offset: 0xB */
Kojto 93:e188a91d3eaa 577 } CMT_Type;
Kojto 93:e188a91d3eaa 578
Kojto 93:e188a91d3eaa 579 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 580 -- CMT Register Masks
Kojto 93:e188a91d3eaa 581 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 582
Kojto 93:e188a91d3eaa 583 /**
Kojto 93:e188a91d3eaa 584 * @addtogroup CMT_Register_Masks CMT Register Masks
Kojto 93:e188a91d3eaa 585 * @{
Kojto 93:e188a91d3eaa 586 */
Kojto 93:e188a91d3eaa 587
Kojto 93:e188a91d3eaa 588 /* CGH1 Bit Fields */
Kojto 93:e188a91d3eaa 589 #define CMT_CGH1_PH_MASK 0xFFu
Kojto 93:e188a91d3eaa 590 #define CMT_CGH1_PH_SHIFT 0
Kojto 93:e188a91d3eaa 591 #define CMT_CGH1_PH(x) (((uint8_t)(((uint8_t)(x))<<CMT_CGH1_PH_SHIFT))&CMT_CGH1_PH_MASK)
Kojto 93:e188a91d3eaa 592 /* CGL1 Bit Fields */
Kojto 93:e188a91d3eaa 593 #define CMT_CGL1_PL_MASK 0xFFu
Kojto 93:e188a91d3eaa 594 #define CMT_CGL1_PL_SHIFT 0
Kojto 93:e188a91d3eaa 595 #define CMT_CGL1_PL(x) (((uint8_t)(((uint8_t)(x))<<CMT_CGL1_PL_SHIFT))&CMT_CGL1_PL_MASK)
Kojto 93:e188a91d3eaa 596 /* CGH2 Bit Fields */
Kojto 93:e188a91d3eaa 597 #define CMT_CGH2_SH_MASK 0xFFu
Kojto 93:e188a91d3eaa 598 #define CMT_CGH2_SH_SHIFT 0
Kojto 93:e188a91d3eaa 599 #define CMT_CGH2_SH(x) (((uint8_t)(((uint8_t)(x))<<CMT_CGH2_SH_SHIFT))&CMT_CGH2_SH_MASK)
Kojto 93:e188a91d3eaa 600 /* CGL2 Bit Fields */
Kojto 93:e188a91d3eaa 601 #define CMT_CGL2_SL_MASK 0xFFu
Kojto 93:e188a91d3eaa 602 #define CMT_CGL2_SL_SHIFT 0
Kojto 93:e188a91d3eaa 603 #define CMT_CGL2_SL(x) (((uint8_t)(((uint8_t)(x))<<CMT_CGL2_SL_SHIFT))&CMT_CGL2_SL_MASK)
Kojto 93:e188a91d3eaa 604 /* OC Bit Fields */
Kojto 93:e188a91d3eaa 605 #define CMT_OC_IROPEN_MASK 0x20u
Kojto 93:e188a91d3eaa 606 #define CMT_OC_IROPEN_SHIFT 5
Kojto 93:e188a91d3eaa 607 #define CMT_OC_CMTPOL_MASK 0x40u
Kojto 93:e188a91d3eaa 608 #define CMT_OC_CMTPOL_SHIFT 6
Kojto 93:e188a91d3eaa 609 #define CMT_OC_IROL_MASK 0x80u
Kojto 93:e188a91d3eaa 610 #define CMT_OC_IROL_SHIFT 7
Kojto 93:e188a91d3eaa 611 /* MSC Bit Fields */
Kojto 93:e188a91d3eaa 612 #define CMT_MSC_MCGEN_MASK 0x1u
Kojto 93:e188a91d3eaa 613 #define CMT_MSC_MCGEN_SHIFT 0
Kojto 93:e188a91d3eaa 614 #define CMT_MSC_EOCIE_MASK 0x2u
Kojto 93:e188a91d3eaa 615 #define CMT_MSC_EOCIE_SHIFT 1
Kojto 93:e188a91d3eaa 616 #define CMT_MSC_FSK_MASK 0x4u
Kojto 93:e188a91d3eaa 617 #define CMT_MSC_FSK_SHIFT 2
Kojto 93:e188a91d3eaa 618 #define CMT_MSC_BASE_MASK 0x8u
Kojto 93:e188a91d3eaa 619 #define CMT_MSC_BASE_SHIFT 3
Kojto 93:e188a91d3eaa 620 #define CMT_MSC_EXSPC_MASK 0x10u
Kojto 93:e188a91d3eaa 621 #define CMT_MSC_EXSPC_SHIFT 4
Kojto 93:e188a91d3eaa 622 #define CMT_MSC_CMTDIV_MASK 0x60u
Kojto 93:e188a91d3eaa 623 #define CMT_MSC_CMTDIV_SHIFT 5
Kojto 93:e188a91d3eaa 624 #define CMT_MSC_CMTDIV(x) (((uint8_t)(((uint8_t)(x))<<CMT_MSC_CMTDIV_SHIFT))&CMT_MSC_CMTDIV_MASK)
Kojto 93:e188a91d3eaa 625 #define CMT_MSC_EOCF_MASK 0x80u
Kojto 93:e188a91d3eaa 626 #define CMT_MSC_EOCF_SHIFT 7
Kojto 93:e188a91d3eaa 627 /* CMD1 Bit Fields */
Kojto 93:e188a91d3eaa 628 #define CMT_CMD1_MB_MASK 0xFFu
Kojto 93:e188a91d3eaa 629 #define CMT_CMD1_MB_SHIFT 0
Kojto 93:e188a91d3eaa 630 #define CMT_CMD1_MB(x) (((uint8_t)(((uint8_t)(x))<<CMT_CMD1_MB_SHIFT))&CMT_CMD1_MB_MASK)
Kojto 93:e188a91d3eaa 631 /* CMD2 Bit Fields */
Kojto 93:e188a91d3eaa 632 #define CMT_CMD2_MB_MASK 0xFFu
Kojto 93:e188a91d3eaa 633 #define CMT_CMD2_MB_SHIFT 0
Kojto 93:e188a91d3eaa 634 #define CMT_CMD2_MB(x) (((uint8_t)(((uint8_t)(x))<<CMT_CMD2_MB_SHIFT))&CMT_CMD2_MB_MASK)
Kojto 93:e188a91d3eaa 635 /* CMD3 Bit Fields */
Kojto 93:e188a91d3eaa 636 #define CMT_CMD3_SB_MASK 0xFFu
Kojto 93:e188a91d3eaa 637 #define CMT_CMD3_SB_SHIFT 0
Kojto 93:e188a91d3eaa 638 #define CMT_CMD3_SB(x) (((uint8_t)(((uint8_t)(x))<<CMT_CMD3_SB_SHIFT))&CMT_CMD3_SB_MASK)
Kojto 93:e188a91d3eaa 639 /* CMD4 Bit Fields */
Kojto 93:e188a91d3eaa 640 #define CMT_CMD4_SB_MASK 0xFFu
Kojto 93:e188a91d3eaa 641 #define CMT_CMD4_SB_SHIFT 0
Kojto 93:e188a91d3eaa 642 #define CMT_CMD4_SB(x) (((uint8_t)(((uint8_t)(x))<<CMT_CMD4_SB_SHIFT))&CMT_CMD4_SB_MASK)
Kojto 93:e188a91d3eaa 643 /* PPS Bit Fields */
Kojto 93:e188a91d3eaa 644 #define CMT_PPS_PPSDIV_MASK 0xFu
Kojto 93:e188a91d3eaa 645 #define CMT_PPS_PPSDIV_SHIFT 0
Kojto 93:e188a91d3eaa 646 #define CMT_PPS_PPSDIV(x) (((uint8_t)(((uint8_t)(x))<<CMT_PPS_PPSDIV_SHIFT))&CMT_PPS_PPSDIV_MASK)
Kojto 93:e188a91d3eaa 647 /* DMA Bit Fields */
Kojto 93:e188a91d3eaa 648 #define CMT_DMA_DMA_MASK 0x1u
Kojto 93:e188a91d3eaa 649 #define CMT_DMA_DMA_SHIFT 0
Kojto 93:e188a91d3eaa 650
Kojto 93:e188a91d3eaa 651 /**
Kojto 93:e188a91d3eaa 652 * @}
Kojto 93:e188a91d3eaa 653 */ /* end of group CMT_Register_Masks */
Kojto 93:e188a91d3eaa 654
Kojto 93:e188a91d3eaa 655
Kojto 93:e188a91d3eaa 656 /* CMT - Peripheral instance base addresses */
Kojto 93:e188a91d3eaa 657 /** Peripheral CMT base address */
Kojto 93:e188a91d3eaa 658 #define CMT_BASE (0x40062000u)
Kojto 93:e188a91d3eaa 659 /** Peripheral CMT base pointer */
Kojto 93:e188a91d3eaa 660 #define CMT ((CMT_Type *)CMT_BASE)
Kojto 93:e188a91d3eaa 661
Kojto 93:e188a91d3eaa 662 /**
Kojto 93:e188a91d3eaa 663 * @}
Kojto 93:e188a91d3eaa 664 */ /* end of group CMT_Peripheral_Access_Layer */
Kojto 93:e188a91d3eaa 665
Kojto 93:e188a91d3eaa 666
Kojto 93:e188a91d3eaa 667 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 668 -- CRC Peripheral Access Layer
Kojto 93:e188a91d3eaa 669 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 670
Kojto 93:e188a91d3eaa 671 /**
Kojto 93:e188a91d3eaa 672 * @addtogroup CRC_Peripheral_Access_Layer CRC Peripheral Access Layer
Kojto 93:e188a91d3eaa 673 * @{
Kojto 93:e188a91d3eaa 674 */
Kojto 93:e188a91d3eaa 675
Kojto 93:e188a91d3eaa 676 /** CRC - Register Layout Typedef */
Kojto 93:e188a91d3eaa 677 typedef struct {
Kojto 93:e188a91d3eaa 678 union { /* offset: 0x0 */
Kojto 93:e188a91d3eaa 679 struct { /* offset: 0x0 */
Kojto 93:e188a91d3eaa 680 __IO uint16_t CRCL; /**< CRC_CRCL register., offset: 0x0 */
Kojto 93:e188a91d3eaa 681 __IO uint16_t CRCH; /**< CRC_CRCH register., offset: 0x2 */
Kojto 93:e188a91d3eaa 682 } ACCESS16BIT;
Kojto 93:e188a91d3eaa 683 __IO uint32_t CRC; /**< CRC Data Register, offset: 0x0 */
Kojto 93:e188a91d3eaa 684 struct { /* offset: 0x0 */
Kojto 93:e188a91d3eaa 685 __IO uint8_t CRCLL; /**< CRC_CRCLL register., offset: 0x0 */
Kojto 93:e188a91d3eaa 686 __IO uint8_t CRCLU; /**< CRC_CRCLU register., offset: 0x1 */
Kojto 93:e188a91d3eaa 687 __IO uint8_t CRCHL; /**< CRC_CRCHL register., offset: 0x2 */
Kojto 93:e188a91d3eaa 688 __IO uint8_t CRCHU; /**< CRC_CRCHU register., offset: 0x3 */
Kojto 93:e188a91d3eaa 689 } ACCESS8BIT;
Kojto 93:e188a91d3eaa 690 };
Kojto 93:e188a91d3eaa 691 union { /* offset: 0x4 */
Kojto 93:e188a91d3eaa 692 struct { /* offset: 0x4 */
Kojto 93:e188a91d3eaa 693 __IO uint16_t GPOLYL; /**< CRC_GPOLYL register., offset: 0x4 */
Kojto 93:e188a91d3eaa 694 __IO uint16_t GPOLYH; /**< CRC_GPOLYH register., offset: 0x6 */
Kojto 93:e188a91d3eaa 695 } GPOLY_ACCESS16BIT;
Kojto 93:e188a91d3eaa 696 __IO uint32_t GPOLY; /**< CRC Polynomial Register, offset: 0x4 */
Kojto 93:e188a91d3eaa 697 struct { /* offset: 0x4 */
Kojto 93:e188a91d3eaa 698 __IO uint8_t GPOLYLL; /**< CRC_GPOLYLL register., offset: 0x4 */
Kojto 93:e188a91d3eaa 699 __IO uint8_t GPOLYLU; /**< CRC_GPOLYLU register., offset: 0x5 */
Kojto 93:e188a91d3eaa 700 __IO uint8_t GPOLYHL; /**< CRC_GPOLYHL register., offset: 0x6 */
Kojto 93:e188a91d3eaa 701 __IO uint8_t GPOLYHU; /**< CRC_GPOLYHU register., offset: 0x7 */
Kojto 93:e188a91d3eaa 702 } GPOLY_ACCESS8BIT;
Kojto 93:e188a91d3eaa 703 };
Kojto 93:e188a91d3eaa 704 union { /* offset: 0x8 */
Kojto 93:e188a91d3eaa 705 __IO uint32_t CTRL; /**< CRC Control Register, offset: 0x8 */
Kojto 93:e188a91d3eaa 706 struct { /* offset: 0x8 */
Kojto 93:e188a91d3eaa 707 uint8_t RESERVED_0[3];
Kojto 93:e188a91d3eaa 708 __IO uint8_t CTRLHU; /**< CRC_CTRLHU register., offset: 0xB */
Kojto 93:e188a91d3eaa 709 } CTRL_ACCESS8BIT;
Kojto 93:e188a91d3eaa 710 };
Kojto 93:e188a91d3eaa 711 } CRC_Type;
Kojto 93:e188a91d3eaa 712
Kojto 93:e188a91d3eaa 713 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 714 -- CRC Register Masks
Kojto 93:e188a91d3eaa 715 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 716
Kojto 93:e188a91d3eaa 717 /**
Kojto 93:e188a91d3eaa 718 * @addtogroup CRC_Register_Masks CRC Register Masks
Kojto 93:e188a91d3eaa 719 * @{
Kojto 93:e188a91d3eaa 720 */
Kojto 93:e188a91d3eaa 721
Kojto 93:e188a91d3eaa 722 /* CRCL Bit Fields */
Kojto 93:e188a91d3eaa 723 #define CRC_CRCL_CRCL_MASK 0xFFFFu
Kojto 93:e188a91d3eaa 724 #define CRC_CRCL_CRCL_SHIFT 0
Kojto 93:e188a91d3eaa 725 #define CRC_CRCL_CRCL(x) (((uint16_t)(((uint16_t)(x))<<CRC_CRCL_CRCL_SHIFT))&CRC_CRCL_CRCL_MASK)
Kojto 93:e188a91d3eaa 726 /* CRCH Bit Fields */
Kojto 93:e188a91d3eaa 727 #define CRC_CRCH_CRCH_MASK 0xFFFFu
Kojto 93:e188a91d3eaa 728 #define CRC_CRCH_CRCH_SHIFT 0
Kojto 93:e188a91d3eaa 729 #define CRC_CRCH_CRCH(x) (((uint16_t)(((uint16_t)(x))<<CRC_CRCH_CRCH_SHIFT))&CRC_CRCH_CRCH_MASK)
Kojto 93:e188a91d3eaa 730 /* CRC Bit Fields */
Kojto 93:e188a91d3eaa 731 #define CRC_CRC_LL_MASK 0xFFu
Kojto 93:e188a91d3eaa 732 #define CRC_CRC_LL_SHIFT 0
Kojto 93:e188a91d3eaa 733 #define CRC_CRC_LL(x) (((uint32_t)(((uint32_t)(x))<<CRC_CRC_LL_SHIFT))&CRC_CRC_LL_MASK)
Kojto 93:e188a91d3eaa 734 #define CRC_CRC_LU_MASK 0xFF00u
Kojto 93:e188a91d3eaa 735 #define CRC_CRC_LU_SHIFT 8
Kojto 93:e188a91d3eaa 736 #define CRC_CRC_LU(x) (((uint32_t)(((uint32_t)(x))<<CRC_CRC_LU_SHIFT))&CRC_CRC_LU_MASK)
Kojto 93:e188a91d3eaa 737 #define CRC_CRC_HL_MASK 0xFF0000u
Kojto 93:e188a91d3eaa 738 #define CRC_CRC_HL_SHIFT 16
Kojto 93:e188a91d3eaa 739 #define CRC_CRC_HL(x) (((uint32_t)(((uint32_t)(x))<<CRC_CRC_HL_SHIFT))&CRC_CRC_HL_MASK)
Kojto 93:e188a91d3eaa 740 #define CRC_CRC_HU_MASK 0xFF000000u
Kojto 93:e188a91d3eaa 741 #define CRC_CRC_HU_SHIFT 24
Kojto 93:e188a91d3eaa 742 #define CRC_CRC_HU(x) (((uint32_t)(((uint32_t)(x))<<CRC_CRC_HU_SHIFT))&CRC_CRC_HU_MASK)
Kojto 93:e188a91d3eaa 743 /* CRCLL Bit Fields */
Kojto 93:e188a91d3eaa 744 #define CRC_CRCLL_CRCLL_MASK 0xFFu
Kojto 93:e188a91d3eaa 745 #define CRC_CRCLL_CRCLL_SHIFT 0
Kojto 93:e188a91d3eaa 746 #define CRC_CRCLL_CRCLL(x) (((uint8_t)(((uint8_t)(x))<<CRC_CRCLL_CRCLL_SHIFT))&CRC_CRCLL_CRCLL_MASK)
Kojto 93:e188a91d3eaa 747 /* CRCLU Bit Fields */
Kojto 93:e188a91d3eaa 748 #define CRC_CRCLU_CRCLU_MASK 0xFFu
Kojto 93:e188a91d3eaa 749 #define CRC_CRCLU_CRCLU_SHIFT 0
Kojto 93:e188a91d3eaa 750 #define CRC_CRCLU_CRCLU(x) (((uint8_t)(((uint8_t)(x))<<CRC_CRCLU_CRCLU_SHIFT))&CRC_CRCLU_CRCLU_MASK)
Kojto 93:e188a91d3eaa 751 /* CRCHL Bit Fields */
Kojto 93:e188a91d3eaa 752 #define CRC_CRCHL_CRCHL_MASK 0xFFu
Kojto 93:e188a91d3eaa 753 #define CRC_CRCHL_CRCHL_SHIFT 0
Kojto 93:e188a91d3eaa 754 #define CRC_CRCHL_CRCHL(x) (((uint8_t)(((uint8_t)(x))<<CRC_CRCHL_CRCHL_SHIFT))&CRC_CRCHL_CRCHL_MASK)
Kojto 93:e188a91d3eaa 755 /* CRCHU Bit Fields */
Kojto 93:e188a91d3eaa 756 #define CRC_CRCHU_CRCHU_MASK 0xFFu
Kojto 93:e188a91d3eaa 757 #define CRC_CRCHU_CRCHU_SHIFT 0
Kojto 93:e188a91d3eaa 758 #define CRC_CRCHU_CRCHU(x) (((uint8_t)(((uint8_t)(x))<<CRC_CRCHU_CRCHU_SHIFT))&CRC_CRCHU_CRCHU_MASK)
Kojto 93:e188a91d3eaa 759 /* GPOLYL Bit Fields */
Kojto 93:e188a91d3eaa 760 #define CRC_GPOLYL_GPOLYL_MASK 0xFFFFu
Kojto 93:e188a91d3eaa 761 #define CRC_GPOLYL_GPOLYL_SHIFT 0
Kojto 93:e188a91d3eaa 762 #define CRC_GPOLYL_GPOLYL(x) (((uint16_t)(((uint16_t)(x))<<CRC_GPOLYL_GPOLYL_SHIFT))&CRC_GPOLYL_GPOLYL_MASK)
Kojto 93:e188a91d3eaa 763 /* GPOLYH Bit Fields */
Kojto 93:e188a91d3eaa 764 #define CRC_GPOLYH_GPOLYH_MASK 0xFFFFu
Kojto 93:e188a91d3eaa 765 #define CRC_GPOLYH_GPOLYH_SHIFT 0
Kojto 93:e188a91d3eaa 766 #define CRC_GPOLYH_GPOLYH(x) (((uint16_t)(((uint16_t)(x))<<CRC_GPOLYH_GPOLYH_SHIFT))&CRC_GPOLYH_GPOLYH_MASK)
Kojto 93:e188a91d3eaa 767 /* GPOLY Bit Fields */
Kojto 93:e188a91d3eaa 768 #define CRC_GPOLY_LOW_MASK 0xFFFFu
Kojto 93:e188a91d3eaa 769 #define CRC_GPOLY_LOW_SHIFT 0
Kojto 93:e188a91d3eaa 770 #define CRC_GPOLY_LOW(x) (((uint32_t)(((uint32_t)(x))<<CRC_GPOLY_LOW_SHIFT))&CRC_GPOLY_LOW_MASK)
Kojto 93:e188a91d3eaa 771 #define CRC_GPOLY_HIGH_MASK 0xFFFF0000u
Kojto 93:e188a91d3eaa 772 #define CRC_GPOLY_HIGH_SHIFT 16
Kojto 93:e188a91d3eaa 773 #define CRC_GPOLY_HIGH(x) (((uint32_t)(((uint32_t)(x))<<CRC_GPOLY_HIGH_SHIFT))&CRC_GPOLY_HIGH_MASK)
Kojto 93:e188a91d3eaa 774 /* GPOLYLL Bit Fields */
Kojto 93:e188a91d3eaa 775 #define CRC_GPOLYLL_GPOLYLL_MASK 0xFFu
Kojto 93:e188a91d3eaa 776 #define CRC_GPOLYLL_GPOLYLL_SHIFT 0
Kojto 93:e188a91d3eaa 777 #define CRC_GPOLYLL_GPOLYLL(x) (((uint8_t)(((uint8_t)(x))<<CRC_GPOLYLL_GPOLYLL_SHIFT))&CRC_GPOLYLL_GPOLYLL_MASK)
Kojto 93:e188a91d3eaa 778 /* GPOLYLU Bit Fields */
Kojto 93:e188a91d3eaa 779 #define CRC_GPOLYLU_GPOLYLU_MASK 0xFFu
Kojto 93:e188a91d3eaa 780 #define CRC_GPOLYLU_GPOLYLU_SHIFT 0
Kojto 93:e188a91d3eaa 781 #define CRC_GPOLYLU_GPOLYLU(x) (((uint8_t)(((uint8_t)(x))<<CRC_GPOLYLU_GPOLYLU_SHIFT))&CRC_GPOLYLU_GPOLYLU_MASK)
Kojto 93:e188a91d3eaa 782 /* GPOLYHL Bit Fields */
Kojto 93:e188a91d3eaa 783 #define CRC_GPOLYHL_GPOLYHL_MASK 0xFFu
Kojto 93:e188a91d3eaa 784 #define CRC_GPOLYHL_GPOLYHL_SHIFT 0
Kojto 93:e188a91d3eaa 785 #define CRC_GPOLYHL_GPOLYHL(x) (((uint8_t)(((uint8_t)(x))<<CRC_GPOLYHL_GPOLYHL_SHIFT))&CRC_GPOLYHL_GPOLYHL_MASK)
Kojto 93:e188a91d3eaa 786 /* GPOLYHU Bit Fields */
Kojto 93:e188a91d3eaa 787 #define CRC_GPOLYHU_GPOLYHU_MASK 0xFFu
Kojto 93:e188a91d3eaa 788 #define CRC_GPOLYHU_GPOLYHU_SHIFT 0
Kojto 93:e188a91d3eaa 789 #define CRC_GPOLYHU_GPOLYHU(x) (((uint8_t)(((uint8_t)(x))<<CRC_GPOLYHU_GPOLYHU_SHIFT))&CRC_GPOLYHU_GPOLYHU_MASK)
Kojto 93:e188a91d3eaa 790 /* CTRL Bit Fields */
Kojto 93:e188a91d3eaa 791 #define CRC_CTRL_TCRC_MASK 0x1000000u
Kojto 93:e188a91d3eaa 792 #define CRC_CTRL_TCRC_SHIFT 24
Kojto 93:e188a91d3eaa 793 #define CRC_CTRL_WAS_MASK 0x2000000u
Kojto 93:e188a91d3eaa 794 #define CRC_CTRL_WAS_SHIFT 25
Kojto 93:e188a91d3eaa 795 #define CRC_CTRL_FXOR_MASK 0x4000000u
Kojto 93:e188a91d3eaa 796 #define CRC_CTRL_FXOR_SHIFT 26
Kojto 93:e188a91d3eaa 797 #define CRC_CTRL_TOTR_MASK 0x30000000u
Kojto 93:e188a91d3eaa 798 #define CRC_CTRL_TOTR_SHIFT 28
Kojto 93:e188a91d3eaa 799 #define CRC_CTRL_TOTR(x) (((uint32_t)(((uint32_t)(x))<<CRC_CTRL_TOTR_SHIFT))&CRC_CTRL_TOTR_MASK)
Kojto 93:e188a91d3eaa 800 #define CRC_CTRL_TOT_MASK 0xC0000000u
Kojto 93:e188a91d3eaa 801 #define CRC_CTRL_TOT_SHIFT 30
Kojto 93:e188a91d3eaa 802 #define CRC_CTRL_TOT(x) (((uint32_t)(((uint32_t)(x))<<CRC_CTRL_TOT_SHIFT))&CRC_CTRL_TOT_MASK)
Kojto 93:e188a91d3eaa 803 /* CTRLHU Bit Fields */
Kojto 93:e188a91d3eaa 804 #define CRC_CTRLHU_TCRC_MASK 0x1u
Kojto 93:e188a91d3eaa 805 #define CRC_CTRLHU_TCRC_SHIFT 0
Kojto 93:e188a91d3eaa 806 #define CRC_CTRLHU_WAS_MASK 0x2u
Kojto 93:e188a91d3eaa 807 #define CRC_CTRLHU_WAS_SHIFT 1
Kojto 93:e188a91d3eaa 808 #define CRC_CTRLHU_FXOR_MASK 0x4u
Kojto 93:e188a91d3eaa 809 #define CRC_CTRLHU_FXOR_SHIFT 2
Kojto 93:e188a91d3eaa 810 #define CRC_CTRLHU_TOTR_MASK 0x30u
Kojto 93:e188a91d3eaa 811 #define CRC_CTRLHU_TOTR_SHIFT 4
Kojto 93:e188a91d3eaa 812 #define CRC_CTRLHU_TOTR(x) (((uint8_t)(((uint8_t)(x))<<CRC_CTRLHU_TOTR_SHIFT))&CRC_CTRLHU_TOTR_MASK)
Kojto 93:e188a91d3eaa 813 #define CRC_CTRLHU_TOT_MASK 0xC0u
Kojto 93:e188a91d3eaa 814 #define CRC_CTRLHU_TOT_SHIFT 6
Kojto 93:e188a91d3eaa 815 #define CRC_CTRLHU_TOT(x) (((uint8_t)(((uint8_t)(x))<<CRC_CTRLHU_TOT_SHIFT))&CRC_CTRLHU_TOT_MASK)
Kojto 93:e188a91d3eaa 816
Kojto 93:e188a91d3eaa 817 /**
Kojto 93:e188a91d3eaa 818 * @}
Kojto 93:e188a91d3eaa 819 */ /* end of group CRC_Register_Masks */
Kojto 93:e188a91d3eaa 820
Kojto 93:e188a91d3eaa 821
Kojto 93:e188a91d3eaa 822 /* CRC - Peripheral instance base addresses */
Kojto 93:e188a91d3eaa 823 /** Peripheral CRC base address */
Kojto 93:e188a91d3eaa 824 #define CRC_BASE (0x40032000u)
Kojto 93:e188a91d3eaa 825 /** Peripheral CRC base pointer */
Kojto 93:e188a91d3eaa 826 #define CRC0 ((CRC_Type *)CRC_BASE)
Kojto 93:e188a91d3eaa 827
Kojto 93:e188a91d3eaa 828 /**
Kojto 93:e188a91d3eaa 829 * @}
Kojto 93:e188a91d3eaa 830 */ /* end of group CRC_Peripheral_Access_Layer */
Kojto 93:e188a91d3eaa 831
Kojto 93:e188a91d3eaa 832
Kojto 93:e188a91d3eaa 833 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 834 -- DAC Peripheral Access Layer
Kojto 93:e188a91d3eaa 835 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 836
Kojto 93:e188a91d3eaa 837 /**
Kojto 93:e188a91d3eaa 838 * @addtogroup DAC_Peripheral_Access_Layer DAC Peripheral Access Layer
Kojto 93:e188a91d3eaa 839 * @{
Kojto 93:e188a91d3eaa 840 */
Kojto 93:e188a91d3eaa 841
Kojto 93:e188a91d3eaa 842 /** DAC - Register Layout Typedef */
Kojto 93:e188a91d3eaa 843 typedef struct {
Kojto 93:e188a91d3eaa 844 struct { /* offset: 0x0, array step: 0x2 */
Kojto 93:e188a91d3eaa 845 __IO uint8_t DATL; /**< DAC Data Low Register, array offset: 0x0, array step: 0x2 */
Kojto 93:e188a91d3eaa 846 __IO uint8_t DATH; /**< DAC Data High Register, array offset: 0x1, array step: 0x2 */
Kojto 93:e188a91d3eaa 847 } DAT[16];
Kojto 93:e188a91d3eaa 848 __IO uint8_t SR; /**< DAC Status Register, offset: 0x20 */
Kojto 93:e188a91d3eaa 849 __IO uint8_t C0; /**< DAC Control Register, offset: 0x21 */
Kojto 93:e188a91d3eaa 850 __IO uint8_t C1; /**< DAC Control Register 1, offset: 0x22 */
Kojto 93:e188a91d3eaa 851 __IO uint8_t C2; /**< DAC Control Register 2, offset: 0x23 */
Kojto 93:e188a91d3eaa 852 } DAC_Type, *DAC_MemMapPtr;
Kojto 93:e188a91d3eaa 853
Kojto 93:e188a91d3eaa 854 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 855 -- DAC Register Masks
Kojto 93:e188a91d3eaa 856 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 857
Kojto 93:e188a91d3eaa 858 /**
Kojto 93:e188a91d3eaa 859 * @addtogroup DAC_Register_Masks DAC Register Masks
Kojto 93:e188a91d3eaa 860 * @{
Kojto 93:e188a91d3eaa 861 */
Kojto 93:e188a91d3eaa 862
Kojto 93:e188a91d3eaa 863 /* DATL Bit Fields */
Kojto 93:e188a91d3eaa 864 #define DAC_DATL_DATA0_MASK 0xFFu
Kojto 93:e188a91d3eaa 865 #define DAC_DATL_DATA0_SHIFT 0
Kojto 93:e188a91d3eaa 866 #define DAC_DATL_DATA0(x) (((uint8_t)(((uint8_t)(x))<<DAC_DATL_DATA0_SHIFT))&DAC_DATL_DATA0_MASK)
Kojto 93:e188a91d3eaa 867 /* DATH Bit Fields */
Kojto 93:e188a91d3eaa 868 #define DAC_DATH_DATA1_MASK 0xFu
Kojto 93:e188a91d3eaa 869 #define DAC_DATH_DATA1_SHIFT 0
Kojto 93:e188a91d3eaa 870 #define DAC_DATH_DATA1(x) (((uint8_t)(((uint8_t)(x))<<DAC_DATH_DATA1_SHIFT))&DAC_DATH_DATA1_MASK)
Kojto 93:e188a91d3eaa 871 /* SR Bit Fields */
Kojto 93:e188a91d3eaa 872 #define DAC_SR_DACBFRPBF_MASK 0x1u
Kojto 93:e188a91d3eaa 873 #define DAC_SR_DACBFRPBF_SHIFT 0
Kojto 93:e188a91d3eaa 874 #define DAC_SR_DACBFRPTF_MASK 0x2u
Kojto 93:e188a91d3eaa 875 #define DAC_SR_DACBFRPTF_SHIFT 1
Kojto 93:e188a91d3eaa 876 #define DAC_SR_DACBFWMF_MASK 0x4u
Kojto 93:e188a91d3eaa 877 #define DAC_SR_DACBFWMF_SHIFT 2
Kojto 93:e188a91d3eaa 878 /* C0 Bit Fields */
Kojto 93:e188a91d3eaa 879 #define DAC_C0_DACBBIEN_MASK 0x1u
Kojto 93:e188a91d3eaa 880 #define DAC_C0_DACBBIEN_SHIFT 0
Kojto 93:e188a91d3eaa 881 #define DAC_C0_DACBTIEN_MASK 0x2u
Kojto 93:e188a91d3eaa 882 #define DAC_C0_DACBTIEN_SHIFT 1
Kojto 93:e188a91d3eaa 883 #define DAC_C0_DACBWIEN_MASK 0x4u
Kojto 93:e188a91d3eaa 884 #define DAC_C0_DACBWIEN_SHIFT 2
Kojto 93:e188a91d3eaa 885 #define DAC_C0_LPEN_MASK 0x8u
Kojto 93:e188a91d3eaa 886 #define DAC_C0_LPEN_SHIFT 3
Kojto 93:e188a91d3eaa 887 #define DAC_C0_DACSWTRG_MASK 0x10u
Kojto 93:e188a91d3eaa 888 #define DAC_C0_DACSWTRG_SHIFT 4
Kojto 93:e188a91d3eaa 889 #define DAC_C0_DACTRGSEL_MASK 0x20u
Kojto 93:e188a91d3eaa 890 #define DAC_C0_DACTRGSEL_SHIFT 5
Kojto 93:e188a91d3eaa 891 #define DAC_C0_DACRFS_MASK 0x40u
Kojto 93:e188a91d3eaa 892 #define DAC_C0_DACRFS_SHIFT 6
Kojto 93:e188a91d3eaa 893 #define DAC_C0_DACEN_MASK 0x80u
Kojto 93:e188a91d3eaa 894 #define DAC_C0_DACEN_SHIFT 7
Kojto 93:e188a91d3eaa 895 /* C1 Bit Fields */
Kojto 93:e188a91d3eaa 896 #define DAC_C1_DACBFEN_MASK 0x1u
Kojto 93:e188a91d3eaa 897 #define DAC_C1_DACBFEN_SHIFT 0
Kojto 93:e188a91d3eaa 898 #define DAC_C1_DACBFMD_MASK 0x6u
Kojto 93:e188a91d3eaa 899 #define DAC_C1_DACBFMD_SHIFT 1
Kojto 93:e188a91d3eaa 900 #define DAC_C1_DACBFMD(x) (((uint8_t)(((uint8_t)(x))<<DAC_C1_DACBFMD_SHIFT))&DAC_C1_DACBFMD_MASK)
Kojto 93:e188a91d3eaa 901 #define DAC_C1_DACBFWM_MASK 0x18u
Kojto 93:e188a91d3eaa 902 #define DAC_C1_DACBFWM_SHIFT 3
Kojto 93:e188a91d3eaa 903 #define DAC_C1_DACBFWM(x) (((uint8_t)(((uint8_t)(x))<<DAC_C1_DACBFWM_SHIFT))&DAC_C1_DACBFWM_MASK)
Kojto 93:e188a91d3eaa 904 #define DAC_C1_DMAEN_MASK 0x80u
Kojto 93:e188a91d3eaa 905 #define DAC_C1_DMAEN_SHIFT 7
Kojto 93:e188a91d3eaa 906 /* C2 Bit Fields */
Kojto 93:e188a91d3eaa 907 #define DAC_C2_DACBFUP_MASK 0xFu
Kojto 93:e188a91d3eaa 908 #define DAC_C2_DACBFUP_SHIFT 0
Kojto 93:e188a91d3eaa 909 #define DAC_C2_DACBFUP(x) (((uint8_t)(((uint8_t)(x))<<DAC_C2_DACBFUP_SHIFT))&DAC_C2_DACBFUP_MASK)
Kojto 93:e188a91d3eaa 910 #define DAC_C2_DACBFRP_MASK 0xF0u
Kojto 93:e188a91d3eaa 911 #define DAC_C2_DACBFRP_SHIFT 4
Kojto 93:e188a91d3eaa 912 #define DAC_C2_DACBFRP(x) (((uint8_t)(((uint8_t)(x))<<DAC_C2_DACBFRP_SHIFT))&DAC_C2_DACBFRP_MASK)
Kojto 93:e188a91d3eaa 913
Kojto 93:e188a91d3eaa 914 /**
Kojto 93:e188a91d3eaa 915 * @}
Kojto 93:e188a91d3eaa 916 */ /* end of group DAC_Register_Masks */
Kojto 93:e188a91d3eaa 917
Kojto 93:e188a91d3eaa 918
Kojto 93:e188a91d3eaa 919 /* DAC - Peripheral instance base addresses */
Kojto 93:e188a91d3eaa 920 /** Peripheral DAC0 base address */
Kojto 93:e188a91d3eaa 921 #define DAC0_BASE (0x400CC000u)
Kojto 93:e188a91d3eaa 922 /** Peripheral DAC0 base pointer */
Kojto 93:e188a91d3eaa 923 #define DAC0 ((DAC_Type *)DAC0_BASE)
Kojto 93:e188a91d3eaa 924 /** Array initializer of DAC peripheral base pointers */
Kojto 93:e188a91d3eaa 925 #define DAC_BASES { DAC0 }
Kojto 93:e188a91d3eaa 926
Kojto 93:e188a91d3eaa 927 /**
Kojto 93:e188a91d3eaa 928 * @}
Kojto 93:e188a91d3eaa 929 */ /* end of group DAC_Peripheral_Access_Layer */
Kojto 93:e188a91d3eaa 930
Kojto 93:e188a91d3eaa 931
Kojto 93:e188a91d3eaa 932 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 933 -- DMA Peripheral Access Layer
Kojto 93:e188a91d3eaa 934 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 935
Kojto 93:e188a91d3eaa 936 /**
Kojto 93:e188a91d3eaa 937 * @addtogroup DMA_Peripheral_Access_Layer DMA Peripheral Access Layer
Kojto 93:e188a91d3eaa 938 * @{
Kojto 93:e188a91d3eaa 939 */
Kojto 93:e188a91d3eaa 940
Kojto 93:e188a91d3eaa 941 /** DMA - Register Layout Typedef */
Kojto 93:e188a91d3eaa 942 typedef struct {
Kojto 93:e188a91d3eaa 943 __IO uint32_t CR; /**< Control Register, offset: 0x0 */
Kojto 93:e188a91d3eaa 944 __I uint32_t ES; /**< Error Status Register, offset: 0x4 */
Kojto 93:e188a91d3eaa 945 uint8_t RESERVED_0[4];
Kojto 93:e188a91d3eaa 946 __IO uint32_t ERQ; /**< Enable Request Register, offset: 0xC */
Kojto 93:e188a91d3eaa 947 uint8_t RESERVED_1[4];
Kojto 93:e188a91d3eaa 948 __IO uint32_t EEI; /**< Enable Error Interrupt Register, offset: 0x14 */
Kojto 93:e188a91d3eaa 949 __O uint8_t CEEI; /**< Clear Enable Error Interrupt Register, offset: 0x18 */
Kojto 93:e188a91d3eaa 950 __O uint8_t SEEI; /**< Set Enable Error Interrupt Register, offset: 0x19 */
Kojto 93:e188a91d3eaa 951 __O uint8_t CERQ; /**< Clear Enable Request Register, offset: 0x1A */
Kojto 93:e188a91d3eaa 952 __O uint8_t SERQ; /**< Set Enable Request Register, offset: 0x1B */
Kojto 93:e188a91d3eaa 953 __O uint8_t CDNE; /**< Clear DONE Status Bit Register, offset: 0x1C */
Kojto 93:e188a91d3eaa 954 __O uint8_t SSRT; /**< Set START Bit Register, offset: 0x1D */
Kojto 93:e188a91d3eaa 955 __O uint8_t CERR; /**< Clear Error Register, offset: 0x1E */
Kojto 93:e188a91d3eaa 956 __O uint8_t CINT; /**< Clear Interrupt Request Register, offset: 0x1F */
Kojto 93:e188a91d3eaa 957 uint8_t RESERVED_2[4];
Kojto 93:e188a91d3eaa 958 __IO uint32_t INT; /**< Interrupt Request Register, offset: 0x24 */
Kojto 93:e188a91d3eaa 959 uint8_t RESERVED_3[4];
Kojto 93:e188a91d3eaa 960 __IO uint32_t ERR; /**< Error Register, offset: 0x2C */
Kojto 93:e188a91d3eaa 961 uint8_t RESERVED_4[4];
Kojto 93:e188a91d3eaa 962 __IO uint32_t HRS; /**< Hardware Request Status Register, offset: 0x34 */
Kojto 93:e188a91d3eaa 963 uint8_t RESERVED_5[200];
Kojto 93:e188a91d3eaa 964 __IO uint8_t DCHPRI3; /**< Channel n Priority Register, offset: 0x100 */
Kojto 93:e188a91d3eaa 965 __IO uint8_t DCHPRI2; /**< Channel n Priority Register, offset: 0x101 */
Kojto 93:e188a91d3eaa 966 __IO uint8_t DCHPRI1; /**< Channel n Priority Register, offset: 0x102 */
Kojto 93:e188a91d3eaa 967 __IO uint8_t DCHPRI0; /**< Channel n Priority Register, offset: 0x103 */
Kojto 93:e188a91d3eaa 968 uint8_t RESERVED_6[3836];
Kojto 93:e188a91d3eaa 969 struct { /* offset: 0x1000, array step: 0x20 */
Kojto 93:e188a91d3eaa 970 __IO uint32_t SADDR; /**< TCD Source Address, array offset: 0x1000, array step: 0x20 */
Kojto 93:e188a91d3eaa 971 __IO uint16_t SOFF; /**< TCD Signed Source Address Offset, array offset: 0x1004, array step: 0x20 */
Kojto 93:e188a91d3eaa 972 __IO uint16_t ATTR; /**< TCD Transfer Attributes, array offset: 0x1006, array step: 0x20 */
Kojto 93:e188a91d3eaa 973 union { /* offset: 0x1008, array step: 0x20 */
Kojto 93:e188a91d3eaa 974 __IO uint32_t NBYTES_MLNO; /**< TCD Minor Byte Count (Minor Loop Disabled), array offset: 0x1008, array step: 0x20 */
Kojto 93:e188a91d3eaa 975 __IO uint32_t NBYTES_MLOFFNO; /**< TCD Signed Minor Loop Offset (Minor Loop Enabled and Offset Disabled), array offset: 0x1008, array step: 0x20 */
Kojto 93:e188a91d3eaa 976 __IO uint32_t NBYTES_MLOFFYES; /**< TCD Signed Minor Loop Offset (Minor Loop and Offset Enabled), array offset: 0x1008, array step: 0x20 */
Kojto 93:e188a91d3eaa 977 };
Kojto 93:e188a91d3eaa 978 __IO uint32_t SLAST; /**< TCD Last Source Address Adjustment, array offset: 0x100C, array step: 0x20 */
Kojto 93:e188a91d3eaa 979 __IO uint32_t DADDR; /**< TCD Destination Address, array offset: 0x1010, array step: 0x20 */
Kojto 93:e188a91d3eaa 980 __IO uint16_t DOFF; /**< TCD Signed Destination Address Offset, array offset: 0x1014, array step: 0x20 */
Kojto 93:e188a91d3eaa 981 union { /* offset: 0x1016, array step: 0x20 */
Kojto 93:e188a91d3eaa 982 __IO uint16_t CITER_ELINKNO; /**< TCD Current Minor Loop Link, Major Loop Count (Channel Linking Disabled), array offset: 0x1016, array step: 0x20 */
Kojto 93:e188a91d3eaa 983 __IO uint16_t CITER_ELINKYES; /**< TCD Current Minor Loop Link, Major Loop Count (Channel Linking Enabled), array offset: 0x1016, array step: 0x20 */
Kojto 93:e188a91d3eaa 984 };
Kojto 93:e188a91d3eaa 985 __IO uint32_t DLAST_SGA; /**< TCD Last Destination Address Adjustment/Scatter Gather Address, array offset: 0x1018, array step: 0x20 */
Kojto 93:e188a91d3eaa 986 __IO uint16_t CSR; /**< TCD Control and Status, array offset: 0x101C, array step: 0x20 */
Kojto 93:e188a91d3eaa 987 union { /* offset: 0x101E, array step: 0x20 */
Kojto 93:e188a91d3eaa 988 __IO uint16_t BITER_ELINKNO; /**< TCD Beginning Minor Loop Link, Major Loop Count (Channel Linking Disabled), array offset: 0x101E, array step: 0x20 */
Kojto 93:e188a91d3eaa 989 __IO uint16_t BITER_ELINKYES; /**< TCD Beginning Minor Loop Link, Major Loop Count (Channel Linking Enabled), array offset: 0x101E, array step: 0x20 */
Kojto 93:e188a91d3eaa 990 };
Kojto 93:e188a91d3eaa 991 } TCD[4];
Kojto 93:e188a91d3eaa 992 } DMA_Type;
Kojto 93:e188a91d3eaa 993
Kojto 93:e188a91d3eaa 994 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 995 -- DMA Register Masks
Kojto 93:e188a91d3eaa 996 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 997
Kojto 93:e188a91d3eaa 998 /**
Kojto 93:e188a91d3eaa 999 * @addtogroup DMA_Register_Masks DMA Register Masks
Kojto 93:e188a91d3eaa 1000 * @{
Kojto 93:e188a91d3eaa 1001 */
Kojto 93:e188a91d3eaa 1002
Kojto 93:e188a91d3eaa 1003 /* CR Bit Fields */
Kojto 93:e188a91d3eaa 1004 #define DMA_CR_EDBG_MASK 0x2u
Kojto 93:e188a91d3eaa 1005 #define DMA_CR_EDBG_SHIFT 1
Kojto 93:e188a91d3eaa 1006 #define DMA_CR_ERCA_MASK 0x4u
Kojto 93:e188a91d3eaa 1007 #define DMA_CR_ERCA_SHIFT 2
Kojto 93:e188a91d3eaa 1008 #define DMA_CR_HOE_MASK 0x10u
Kojto 93:e188a91d3eaa 1009 #define DMA_CR_HOE_SHIFT 4
Kojto 93:e188a91d3eaa 1010 #define DMA_CR_HALT_MASK 0x20u
Kojto 93:e188a91d3eaa 1011 #define DMA_CR_HALT_SHIFT 5
Kojto 93:e188a91d3eaa 1012 #define DMA_CR_CLM_MASK 0x40u
Kojto 93:e188a91d3eaa 1013 #define DMA_CR_CLM_SHIFT 6
Kojto 93:e188a91d3eaa 1014 #define DMA_CR_EMLM_MASK 0x80u
Kojto 93:e188a91d3eaa 1015 #define DMA_CR_EMLM_SHIFT 7
Kojto 93:e188a91d3eaa 1016 #define DMA_CR_ECX_MASK 0x10000u
Kojto 93:e188a91d3eaa 1017 #define DMA_CR_ECX_SHIFT 16
Kojto 93:e188a91d3eaa 1018 #define DMA_CR_CX_MASK 0x20000u
Kojto 93:e188a91d3eaa 1019 #define DMA_CR_CX_SHIFT 17
Kojto 93:e188a91d3eaa 1020 /* ES Bit Fields */
Kojto 93:e188a91d3eaa 1021 #define DMA_ES_DBE_MASK 0x1u
Kojto 93:e188a91d3eaa 1022 #define DMA_ES_DBE_SHIFT 0
Kojto 93:e188a91d3eaa 1023 #define DMA_ES_SBE_MASK 0x2u
Kojto 93:e188a91d3eaa 1024 #define DMA_ES_SBE_SHIFT 1
Kojto 93:e188a91d3eaa 1025 #define DMA_ES_SGE_MASK 0x4u
Kojto 93:e188a91d3eaa 1026 #define DMA_ES_SGE_SHIFT 2
Kojto 93:e188a91d3eaa 1027 #define DMA_ES_NCE_MASK 0x8u
Kojto 93:e188a91d3eaa 1028 #define DMA_ES_NCE_SHIFT 3
Kojto 93:e188a91d3eaa 1029 #define DMA_ES_DOE_MASK 0x10u
Kojto 93:e188a91d3eaa 1030 #define DMA_ES_DOE_SHIFT 4
Kojto 93:e188a91d3eaa 1031 #define DMA_ES_DAE_MASK 0x20u
Kojto 93:e188a91d3eaa 1032 #define DMA_ES_DAE_SHIFT 5
Kojto 93:e188a91d3eaa 1033 #define DMA_ES_SOE_MASK 0x40u
Kojto 93:e188a91d3eaa 1034 #define DMA_ES_SOE_SHIFT 6
Kojto 93:e188a91d3eaa 1035 #define DMA_ES_SAE_MASK 0x80u
Kojto 93:e188a91d3eaa 1036 #define DMA_ES_SAE_SHIFT 7
Kojto 93:e188a91d3eaa 1037 #define DMA_ES_ERRCHN_MASK 0xF00u
Kojto 93:e188a91d3eaa 1038 #define DMA_ES_ERRCHN_SHIFT 8
Kojto 93:e188a91d3eaa 1039 #define DMA_ES_ERRCHN(x) (((uint32_t)(((uint32_t)(x))<<DMA_ES_ERRCHN_SHIFT))&DMA_ES_ERRCHN_MASK)
Kojto 93:e188a91d3eaa 1040 #define DMA_ES_CPE_MASK 0x4000u
Kojto 93:e188a91d3eaa 1041 #define DMA_ES_CPE_SHIFT 14
Kojto 93:e188a91d3eaa 1042 #define DMA_ES_ECX_MASK 0x10000u
Kojto 93:e188a91d3eaa 1043 #define DMA_ES_ECX_SHIFT 16
Kojto 93:e188a91d3eaa 1044 #define DMA_ES_VLD_MASK 0x80000000u
Kojto 93:e188a91d3eaa 1045 #define DMA_ES_VLD_SHIFT 31
Kojto 93:e188a91d3eaa 1046 /* ERQ Bit Fields */
Kojto 93:e188a91d3eaa 1047 #define DMA_ERQ_ERQ0_MASK 0x1u
Kojto 93:e188a91d3eaa 1048 #define DMA_ERQ_ERQ0_SHIFT 0
Kojto 93:e188a91d3eaa 1049 #define DMA_ERQ_ERQ1_MASK 0x2u
Kojto 93:e188a91d3eaa 1050 #define DMA_ERQ_ERQ1_SHIFT 1
Kojto 93:e188a91d3eaa 1051 #define DMA_ERQ_ERQ2_MASK 0x4u
Kojto 93:e188a91d3eaa 1052 #define DMA_ERQ_ERQ2_SHIFT 2
Kojto 93:e188a91d3eaa 1053 #define DMA_ERQ_ERQ3_MASK 0x8u
Kojto 93:e188a91d3eaa 1054 #define DMA_ERQ_ERQ3_SHIFT 3
Kojto 93:e188a91d3eaa 1055 /* EEI Bit Fields */
Kojto 93:e188a91d3eaa 1056 #define DMA_EEI_EEI0_MASK 0x1u
Kojto 93:e188a91d3eaa 1057 #define DMA_EEI_EEI0_SHIFT 0
Kojto 93:e188a91d3eaa 1058 #define DMA_EEI_EEI1_MASK 0x2u
Kojto 93:e188a91d3eaa 1059 #define DMA_EEI_EEI1_SHIFT 1
Kojto 93:e188a91d3eaa 1060 #define DMA_EEI_EEI2_MASK 0x4u
Kojto 93:e188a91d3eaa 1061 #define DMA_EEI_EEI2_SHIFT 2
Kojto 93:e188a91d3eaa 1062 #define DMA_EEI_EEI3_MASK 0x8u
Kojto 93:e188a91d3eaa 1063 #define DMA_EEI_EEI3_SHIFT 3
Kojto 93:e188a91d3eaa 1064 /* CEEI Bit Fields */
Kojto 93:e188a91d3eaa 1065 #define DMA_CEEI_CEEI_MASK 0xFu
Kojto 93:e188a91d3eaa 1066 #define DMA_CEEI_CEEI_SHIFT 0
Kojto 93:e188a91d3eaa 1067 #define DMA_CEEI_CEEI(x) (((uint8_t)(((uint8_t)(x))<<DMA_CEEI_CEEI_SHIFT))&DMA_CEEI_CEEI_MASK)
Kojto 93:e188a91d3eaa 1068 #define DMA_CEEI_CAEE_MASK 0x40u
Kojto 93:e188a91d3eaa 1069 #define DMA_CEEI_CAEE_SHIFT 6
Kojto 93:e188a91d3eaa 1070 #define DMA_CEEI_NOP_MASK 0x80u
Kojto 93:e188a91d3eaa 1071 #define DMA_CEEI_NOP_SHIFT 7
Kojto 93:e188a91d3eaa 1072 /* SEEI Bit Fields */
Kojto 93:e188a91d3eaa 1073 #define DMA_SEEI_SEEI_MASK 0xFu
Kojto 93:e188a91d3eaa 1074 #define DMA_SEEI_SEEI_SHIFT 0
Kojto 93:e188a91d3eaa 1075 #define DMA_SEEI_SEEI(x) (((uint8_t)(((uint8_t)(x))<<DMA_SEEI_SEEI_SHIFT))&DMA_SEEI_SEEI_MASK)
Kojto 93:e188a91d3eaa 1076 #define DMA_SEEI_SAEE_MASK 0x40u
Kojto 93:e188a91d3eaa 1077 #define DMA_SEEI_SAEE_SHIFT 6
Kojto 93:e188a91d3eaa 1078 #define DMA_SEEI_NOP_MASK 0x80u
Kojto 93:e188a91d3eaa 1079 #define DMA_SEEI_NOP_SHIFT 7
Kojto 93:e188a91d3eaa 1080 /* CERQ Bit Fields */
Kojto 93:e188a91d3eaa 1081 #define DMA_CERQ_CERQ_MASK 0xFu
Kojto 93:e188a91d3eaa 1082 #define DMA_CERQ_CERQ_SHIFT 0
Kojto 93:e188a91d3eaa 1083 #define DMA_CERQ_CERQ(x) (((uint8_t)(((uint8_t)(x))<<DMA_CERQ_CERQ_SHIFT))&DMA_CERQ_CERQ_MASK)
Kojto 93:e188a91d3eaa 1084 #define DMA_CERQ_CAER_MASK 0x40u
Kojto 93:e188a91d3eaa 1085 #define DMA_CERQ_CAER_SHIFT 6
Kojto 93:e188a91d3eaa 1086 #define DMA_CERQ_NOP_MASK 0x80u
Kojto 93:e188a91d3eaa 1087 #define DMA_CERQ_NOP_SHIFT 7
Kojto 93:e188a91d3eaa 1088 /* SERQ Bit Fields */
Kojto 93:e188a91d3eaa 1089 #define DMA_SERQ_SERQ_MASK 0xFu
Kojto 93:e188a91d3eaa 1090 #define DMA_SERQ_SERQ_SHIFT 0
Kojto 93:e188a91d3eaa 1091 #define DMA_SERQ_SERQ(x) (((uint8_t)(((uint8_t)(x))<<DMA_SERQ_SERQ_SHIFT))&DMA_SERQ_SERQ_MASK)
Kojto 93:e188a91d3eaa 1092 #define DMA_SERQ_SAER_MASK 0x40u
Kojto 93:e188a91d3eaa 1093 #define DMA_SERQ_SAER_SHIFT 6
Kojto 93:e188a91d3eaa 1094 #define DMA_SERQ_NOP_MASK 0x80u
Kojto 93:e188a91d3eaa 1095 #define DMA_SERQ_NOP_SHIFT 7
Kojto 93:e188a91d3eaa 1096 /* CDNE Bit Fields */
Kojto 93:e188a91d3eaa 1097 #define DMA_CDNE_CDNE_MASK 0xFu
Kojto 93:e188a91d3eaa 1098 #define DMA_CDNE_CDNE_SHIFT 0
Kojto 93:e188a91d3eaa 1099 #define DMA_CDNE_CDNE(x) (((uint8_t)(((uint8_t)(x))<<DMA_CDNE_CDNE_SHIFT))&DMA_CDNE_CDNE_MASK)
Kojto 93:e188a91d3eaa 1100 #define DMA_CDNE_CADN_MASK 0x40u
Kojto 93:e188a91d3eaa 1101 #define DMA_CDNE_CADN_SHIFT 6
Kojto 93:e188a91d3eaa 1102 #define DMA_CDNE_NOP_MASK 0x80u
Kojto 93:e188a91d3eaa 1103 #define DMA_CDNE_NOP_SHIFT 7
Kojto 93:e188a91d3eaa 1104 /* SSRT Bit Fields */
Kojto 93:e188a91d3eaa 1105 #define DMA_SSRT_SSRT_MASK 0xFu
Kojto 93:e188a91d3eaa 1106 #define DMA_SSRT_SSRT_SHIFT 0
Kojto 93:e188a91d3eaa 1107 #define DMA_SSRT_SSRT(x) (((uint8_t)(((uint8_t)(x))<<DMA_SSRT_SSRT_SHIFT))&DMA_SSRT_SSRT_MASK)
Kojto 93:e188a91d3eaa 1108 #define DMA_SSRT_SAST_MASK 0x40u
Kojto 93:e188a91d3eaa 1109 #define DMA_SSRT_SAST_SHIFT 6
Kojto 93:e188a91d3eaa 1110 #define DMA_SSRT_NOP_MASK 0x80u
Kojto 93:e188a91d3eaa 1111 #define DMA_SSRT_NOP_SHIFT 7
Kojto 93:e188a91d3eaa 1112 /* CERR Bit Fields */
Kojto 93:e188a91d3eaa 1113 #define DMA_CERR_CERR_MASK 0xFu
Kojto 93:e188a91d3eaa 1114 #define DMA_CERR_CERR_SHIFT 0
Kojto 93:e188a91d3eaa 1115 #define DMA_CERR_CERR(x) (((uint8_t)(((uint8_t)(x))<<DMA_CERR_CERR_SHIFT))&DMA_CERR_CERR_MASK)
Kojto 93:e188a91d3eaa 1116 #define DMA_CERR_CAEI_MASK 0x40u
Kojto 93:e188a91d3eaa 1117 #define DMA_CERR_CAEI_SHIFT 6
Kojto 93:e188a91d3eaa 1118 #define DMA_CERR_NOP_MASK 0x80u
Kojto 93:e188a91d3eaa 1119 #define DMA_CERR_NOP_SHIFT 7
Kojto 93:e188a91d3eaa 1120 /* CINT Bit Fields */
Kojto 93:e188a91d3eaa 1121 #define DMA_CINT_CINT_MASK 0xFu
Kojto 93:e188a91d3eaa 1122 #define DMA_CINT_CINT_SHIFT 0
Kojto 93:e188a91d3eaa 1123 #define DMA_CINT_CINT(x) (((uint8_t)(((uint8_t)(x))<<DMA_CINT_CINT_SHIFT))&DMA_CINT_CINT_MASK)
Kojto 93:e188a91d3eaa 1124 #define DMA_CINT_CAIR_MASK 0x40u
Kojto 93:e188a91d3eaa 1125 #define DMA_CINT_CAIR_SHIFT 6
Kojto 93:e188a91d3eaa 1126 #define DMA_CINT_NOP_MASK 0x80u
Kojto 93:e188a91d3eaa 1127 #define DMA_CINT_NOP_SHIFT 7
Kojto 93:e188a91d3eaa 1128 /* INT Bit Fields */
Kojto 93:e188a91d3eaa 1129 #define DMA_INT_INT0_MASK 0x1u
Kojto 93:e188a91d3eaa 1130 #define DMA_INT_INT0_SHIFT 0
Kojto 93:e188a91d3eaa 1131 #define DMA_INT_INT1_MASK 0x2u
Kojto 93:e188a91d3eaa 1132 #define DMA_INT_INT1_SHIFT 1
Kojto 93:e188a91d3eaa 1133 #define DMA_INT_INT2_MASK 0x4u
Kojto 93:e188a91d3eaa 1134 #define DMA_INT_INT2_SHIFT 2
Kojto 93:e188a91d3eaa 1135 #define DMA_INT_INT3_MASK 0x8u
Kojto 93:e188a91d3eaa 1136 #define DMA_INT_INT3_SHIFT 3
Kojto 93:e188a91d3eaa 1137 /* ERR Bit Fields */
Kojto 93:e188a91d3eaa 1138 #define DMA_ERR_ERR0_MASK 0x1u
Kojto 93:e188a91d3eaa 1139 #define DMA_ERR_ERR0_SHIFT 0
Kojto 93:e188a91d3eaa 1140 #define DMA_ERR_ERR1_MASK 0x2u
Kojto 93:e188a91d3eaa 1141 #define DMA_ERR_ERR1_SHIFT 1
Kojto 93:e188a91d3eaa 1142 #define DMA_ERR_ERR2_MASK 0x4u
Kojto 93:e188a91d3eaa 1143 #define DMA_ERR_ERR2_SHIFT 2
Kojto 93:e188a91d3eaa 1144 #define DMA_ERR_ERR3_MASK 0x8u
Kojto 93:e188a91d3eaa 1145 #define DMA_ERR_ERR3_SHIFT 3
Kojto 93:e188a91d3eaa 1146 /* HRS Bit Fields */
Kojto 93:e188a91d3eaa 1147 #define DMA_HRS_HRS0_MASK 0x1u
Kojto 93:e188a91d3eaa 1148 #define DMA_HRS_HRS0_SHIFT 0
Kojto 93:e188a91d3eaa 1149 #define DMA_HRS_HRS1_MASK 0x2u
Kojto 93:e188a91d3eaa 1150 #define DMA_HRS_HRS1_SHIFT 1
Kojto 93:e188a91d3eaa 1151 #define DMA_HRS_HRS2_MASK 0x4u
Kojto 93:e188a91d3eaa 1152 #define DMA_HRS_HRS2_SHIFT 2
Kojto 93:e188a91d3eaa 1153 #define DMA_HRS_HRS3_MASK 0x8u
Kojto 93:e188a91d3eaa 1154 #define DMA_HRS_HRS3_SHIFT 3
Kojto 93:e188a91d3eaa 1155 /* DCHPRI3 Bit Fields */
Kojto 93:e188a91d3eaa 1156 #define DMA_DCHPRI3_CHPRI_MASK 0xFu
Kojto 93:e188a91d3eaa 1157 #define DMA_DCHPRI3_CHPRI_SHIFT 0
Kojto 93:e188a91d3eaa 1158 #define DMA_DCHPRI3_CHPRI(x) (((uint8_t)(((uint8_t)(x))<<DMA_DCHPRI3_CHPRI_SHIFT))&DMA_DCHPRI3_CHPRI_MASK)
Kojto 93:e188a91d3eaa 1159 #define DMA_DCHPRI3_DPA_MASK 0x40u
Kojto 93:e188a91d3eaa 1160 #define DMA_DCHPRI3_DPA_SHIFT 6
Kojto 93:e188a91d3eaa 1161 #define DMA_DCHPRI3_ECP_MASK 0x80u
Kojto 93:e188a91d3eaa 1162 #define DMA_DCHPRI3_ECP_SHIFT 7
Kojto 93:e188a91d3eaa 1163 /* DCHPRI2 Bit Fields */
Kojto 93:e188a91d3eaa 1164 #define DMA_DCHPRI2_CHPRI_MASK 0xFu
Kojto 93:e188a91d3eaa 1165 #define DMA_DCHPRI2_CHPRI_SHIFT 0
Kojto 93:e188a91d3eaa 1166 #define DMA_DCHPRI2_CHPRI(x) (((uint8_t)(((uint8_t)(x))<<DMA_DCHPRI2_CHPRI_SHIFT))&DMA_DCHPRI2_CHPRI_MASK)
Kojto 93:e188a91d3eaa 1167 #define DMA_DCHPRI2_DPA_MASK 0x40u
Kojto 93:e188a91d3eaa 1168 #define DMA_DCHPRI2_DPA_SHIFT 6
Kojto 93:e188a91d3eaa 1169 #define DMA_DCHPRI2_ECP_MASK 0x80u
Kojto 93:e188a91d3eaa 1170 #define DMA_DCHPRI2_ECP_SHIFT 7
Kojto 93:e188a91d3eaa 1171 /* DCHPRI1 Bit Fields */
Kojto 93:e188a91d3eaa 1172 #define DMA_DCHPRI1_CHPRI_MASK 0xFu
Kojto 93:e188a91d3eaa 1173 #define DMA_DCHPRI1_CHPRI_SHIFT 0
Kojto 93:e188a91d3eaa 1174 #define DMA_DCHPRI1_CHPRI(x) (((uint8_t)(((uint8_t)(x))<<DMA_DCHPRI1_CHPRI_SHIFT))&DMA_DCHPRI1_CHPRI_MASK)
Kojto 93:e188a91d3eaa 1175 #define DMA_DCHPRI1_DPA_MASK 0x40u
Kojto 93:e188a91d3eaa 1176 #define DMA_DCHPRI1_DPA_SHIFT 6
Kojto 93:e188a91d3eaa 1177 #define DMA_DCHPRI1_ECP_MASK 0x80u
Kojto 93:e188a91d3eaa 1178 #define DMA_DCHPRI1_ECP_SHIFT 7
Kojto 93:e188a91d3eaa 1179 /* DCHPRI0 Bit Fields */
Kojto 93:e188a91d3eaa 1180 #define DMA_DCHPRI0_CHPRI_MASK 0xFu
Kojto 93:e188a91d3eaa 1181 #define DMA_DCHPRI0_CHPRI_SHIFT 0
Kojto 93:e188a91d3eaa 1182 #define DMA_DCHPRI0_CHPRI(x) (((uint8_t)(((uint8_t)(x))<<DMA_DCHPRI0_CHPRI_SHIFT))&DMA_DCHPRI0_CHPRI_MASK)
Kojto 93:e188a91d3eaa 1183 #define DMA_DCHPRI0_DPA_MASK 0x40u
Kojto 93:e188a91d3eaa 1184 #define DMA_DCHPRI0_DPA_SHIFT 6
Kojto 93:e188a91d3eaa 1185 #define DMA_DCHPRI0_ECP_MASK 0x80u
Kojto 93:e188a91d3eaa 1186 #define DMA_DCHPRI0_ECP_SHIFT 7
Kojto 93:e188a91d3eaa 1187 /* SADDR Bit Fields */
Kojto 93:e188a91d3eaa 1188 #define DMA_SADDR_SADDR_MASK 0xFFFFFFFFu
Kojto 93:e188a91d3eaa 1189 #define DMA_SADDR_SADDR_SHIFT 0
Kojto 93:e188a91d3eaa 1190 #define DMA_SADDR_SADDR(x) (((uint32_t)(((uint32_t)(x))<<DMA_SADDR_SADDR_SHIFT))&DMA_SADDR_SADDR_MASK)
Kojto 93:e188a91d3eaa 1191 /* SOFF Bit Fields */
Kojto 93:e188a91d3eaa 1192 #define DMA_SOFF_SOFF_MASK 0xFFFFu
Kojto 93:e188a91d3eaa 1193 #define DMA_SOFF_SOFF_SHIFT 0
Kojto 93:e188a91d3eaa 1194 #define DMA_SOFF_SOFF(x) (((uint16_t)(((uint16_t)(x))<<DMA_SOFF_SOFF_SHIFT))&DMA_SOFF_SOFF_MASK)
Kojto 93:e188a91d3eaa 1195 /* ATTR Bit Fields */
Kojto 93:e188a91d3eaa 1196 #define DMA_ATTR_DSIZE_MASK 0x7u
Kojto 93:e188a91d3eaa 1197 #define DMA_ATTR_DSIZE_SHIFT 0
Kojto 93:e188a91d3eaa 1198 #define DMA_ATTR_DSIZE(x) (((uint16_t)(((uint16_t)(x))<<DMA_ATTR_DSIZE_SHIFT))&DMA_ATTR_DSIZE_MASK)
Kojto 93:e188a91d3eaa 1199 #define DMA_ATTR_DMOD_MASK 0xF8u
Kojto 93:e188a91d3eaa 1200 #define DMA_ATTR_DMOD_SHIFT 3
Kojto 93:e188a91d3eaa 1201 #define DMA_ATTR_DMOD(x) (((uint16_t)(((uint16_t)(x))<<DMA_ATTR_DMOD_SHIFT))&DMA_ATTR_DMOD_MASK)
Kojto 93:e188a91d3eaa 1202 #define DMA_ATTR_SSIZE_MASK 0x700u
Kojto 93:e188a91d3eaa 1203 #define DMA_ATTR_SSIZE_SHIFT 8
Kojto 93:e188a91d3eaa 1204 #define DMA_ATTR_SSIZE(x) (((uint16_t)(((uint16_t)(x))<<DMA_ATTR_SSIZE_SHIFT))&DMA_ATTR_SSIZE_MASK)
Kojto 93:e188a91d3eaa 1205 #define DMA_ATTR_SMOD_MASK 0xF800u
Kojto 93:e188a91d3eaa 1206 #define DMA_ATTR_SMOD_SHIFT 11
Kojto 93:e188a91d3eaa 1207 #define DMA_ATTR_SMOD(x) (((uint16_t)(((uint16_t)(x))<<DMA_ATTR_SMOD_SHIFT))&DMA_ATTR_SMOD_MASK)
Kojto 93:e188a91d3eaa 1208 /* NBYTES_MLNO Bit Fields */
Kojto 93:e188a91d3eaa 1209 #define DMA_NBYTES_MLNO_NBYTES_MASK 0xFFFFFFFFu
Kojto 93:e188a91d3eaa 1210 #define DMA_NBYTES_MLNO_NBYTES_SHIFT 0
Kojto 93:e188a91d3eaa 1211 #define DMA_NBYTES_MLNO_NBYTES(x) (((uint32_t)(((uint32_t)(x))<<DMA_NBYTES_MLNO_NBYTES_SHIFT))&DMA_NBYTES_MLNO_NBYTES_MASK)
Kojto 93:e188a91d3eaa 1212 /* NBYTES_MLOFFNO Bit Fields */
Kojto 93:e188a91d3eaa 1213 #define DMA_NBYTES_MLOFFNO_NBYTES_MASK 0x3FFFFFFFu
Kojto 93:e188a91d3eaa 1214 #define DMA_NBYTES_MLOFFNO_NBYTES_SHIFT 0
Kojto 93:e188a91d3eaa 1215 #define DMA_NBYTES_MLOFFNO_NBYTES(x) (((uint32_t)(((uint32_t)(x))<<DMA_NBYTES_MLOFFNO_NBYTES_SHIFT))&DMA_NBYTES_MLOFFNO_NBYTES_MASK)
Kojto 93:e188a91d3eaa 1216 #define DMA_NBYTES_MLOFFNO_DMLOE_MASK 0x40000000u
Kojto 93:e188a91d3eaa 1217 #define DMA_NBYTES_MLOFFNO_DMLOE_SHIFT 30
Kojto 93:e188a91d3eaa 1218 #define DMA_NBYTES_MLOFFNO_SMLOE_MASK 0x80000000u
Kojto 93:e188a91d3eaa 1219 #define DMA_NBYTES_MLOFFNO_SMLOE_SHIFT 31
Kojto 93:e188a91d3eaa 1220 /* NBYTES_MLOFFYES Bit Fields */
Kojto 93:e188a91d3eaa 1221 #define DMA_NBYTES_MLOFFYES_NBYTES_MASK 0x3FFu
Kojto 93:e188a91d3eaa 1222 #define DMA_NBYTES_MLOFFYES_NBYTES_SHIFT 0
Kojto 93:e188a91d3eaa 1223 #define DMA_NBYTES_MLOFFYES_NBYTES(x) (((uint32_t)(((uint32_t)(x))<<DMA_NBYTES_MLOFFYES_NBYTES_SHIFT))&DMA_NBYTES_MLOFFYES_NBYTES_MASK)
Kojto 93:e188a91d3eaa 1224 #define DMA_NBYTES_MLOFFYES_MLOFF_MASK 0x3FFFFC00u
Kojto 93:e188a91d3eaa 1225 #define DMA_NBYTES_MLOFFYES_MLOFF_SHIFT 10
Kojto 93:e188a91d3eaa 1226 #define DMA_NBYTES_MLOFFYES_MLOFF(x) (((uint32_t)(((uint32_t)(x))<<DMA_NBYTES_MLOFFYES_MLOFF_SHIFT))&DMA_NBYTES_MLOFFYES_MLOFF_MASK)
Kojto 93:e188a91d3eaa 1227 #define DMA_NBYTES_MLOFFYES_DMLOE_MASK 0x40000000u
Kojto 93:e188a91d3eaa 1228 #define DMA_NBYTES_MLOFFYES_DMLOE_SHIFT 30
Kojto 93:e188a91d3eaa 1229 #define DMA_NBYTES_MLOFFYES_SMLOE_MASK 0x80000000u
Kojto 93:e188a91d3eaa 1230 #define DMA_NBYTES_MLOFFYES_SMLOE_SHIFT 31
Kojto 93:e188a91d3eaa 1231 /* SLAST Bit Fields */
Kojto 93:e188a91d3eaa 1232 #define DMA_SLAST_SLAST_MASK 0xFFFFFFFFu
Kojto 93:e188a91d3eaa 1233 #define DMA_SLAST_SLAST_SHIFT 0
Kojto 93:e188a91d3eaa 1234 #define DMA_SLAST_SLAST(x) (((uint32_t)(((uint32_t)(x))<<DMA_SLAST_SLAST_SHIFT))&DMA_SLAST_SLAST_MASK)
Kojto 93:e188a91d3eaa 1235 /* DADDR Bit Fields */
Kojto 93:e188a91d3eaa 1236 #define DMA_DADDR_DADDR_MASK 0xFFFFFFFFu
Kojto 93:e188a91d3eaa 1237 #define DMA_DADDR_DADDR_SHIFT 0
Kojto 93:e188a91d3eaa 1238 #define DMA_DADDR_DADDR(x) (((uint32_t)(((uint32_t)(x))<<DMA_DADDR_DADDR_SHIFT))&DMA_DADDR_DADDR_MASK)
Kojto 93:e188a91d3eaa 1239 /* DOFF Bit Fields */
Kojto 93:e188a91d3eaa 1240 #define DMA_DOFF_DOFF_MASK 0xFFFFu
Kojto 93:e188a91d3eaa 1241 #define DMA_DOFF_DOFF_SHIFT 0
Kojto 93:e188a91d3eaa 1242 #define DMA_DOFF_DOFF(x) (((uint16_t)(((uint16_t)(x))<<DMA_DOFF_DOFF_SHIFT))&DMA_DOFF_DOFF_MASK)
Kojto 93:e188a91d3eaa 1243 /* CITER_ELINKNO Bit Fields */
Kojto 93:e188a91d3eaa 1244 #define DMA_CITER_ELINKNO_CITER_MASK 0x7FFFu
Kojto 93:e188a91d3eaa 1245 #define DMA_CITER_ELINKNO_CITER_SHIFT 0
Kojto 93:e188a91d3eaa 1246 #define DMA_CITER_ELINKNO_CITER(x) (((uint16_t)(((uint16_t)(x))<<DMA_CITER_ELINKNO_CITER_SHIFT))&DMA_CITER_ELINKNO_CITER_MASK)
Kojto 93:e188a91d3eaa 1247 #define DMA_CITER_ELINKNO_ELINK_MASK 0x8000u
Kojto 93:e188a91d3eaa 1248 #define DMA_CITER_ELINKNO_ELINK_SHIFT 15
Kojto 93:e188a91d3eaa 1249 /* CITER_ELINKYES Bit Fields */
Kojto 93:e188a91d3eaa 1250 #define DMA_CITER_ELINKYES_CITER_MASK 0x1FFu
Kojto 93:e188a91d3eaa 1251 #define DMA_CITER_ELINKYES_CITER_SHIFT 0
Kojto 93:e188a91d3eaa 1252 #define DMA_CITER_ELINKYES_CITER(x) (((uint16_t)(((uint16_t)(x))<<DMA_CITER_ELINKYES_CITER_SHIFT))&DMA_CITER_ELINKYES_CITER_MASK)
Kojto 93:e188a91d3eaa 1253 #define DMA_CITER_ELINKYES_LINKCH_MASK 0x1E00u
Kojto 93:e188a91d3eaa 1254 #define DMA_CITER_ELINKYES_LINKCH_SHIFT 9
Kojto 93:e188a91d3eaa 1255 #define DMA_CITER_ELINKYES_LINKCH(x) (((uint16_t)(((uint16_t)(x))<<DMA_CITER_ELINKYES_LINKCH_SHIFT))&DMA_CITER_ELINKYES_LINKCH_MASK)
Kojto 93:e188a91d3eaa 1256 #define DMA_CITER_ELINKYES_ELINK_MASK 0x8000u
Kojto 93:e188a91d3eaa 1257 #define DMA_CITER_ELINKYES_ELINK_SHIFT 15
Kojto 93:e188a91d3eaa 1258 /* DLAST_SGA Bit Fields */
Kojto 93:e188a91d3eaa 1259 #define DMA_DLAST_SGA_DLASTSGA_MASK 0xFFFFFFFFu
Kojto 93:e188a91d3eaa 1260 #define DMA_DLAST_SGA_DLASTSGA_SHIFT 0
Kojto 93:e188a91d3eaa 1261 #define DMA_DLAST_SGA_DLASTSGA(x) (((uint32_t)(((uint32_t)(x))<<DMA_DLAST_SGA_DLASTSGA_SHIFT))&DMA_DLAST_SGA_DLASTSGA_MASK)
Kojto 93:e188a91d3eaa 1262 /* CSR Bit Fields */
Kojto 93:e188a91d3eaa 1263 #define DMA_CSR_START_MASK 0x1u
Kojto 93:e188a91d3eaa 1264 #define DMA_CSR_START_SHIFT 0
Kojto 93:e188a91d3eaa 1265 #define DMA_CSR_INTMAJOR_MASK 0x2u
Kojto 93:e188a91d3eaa 1266 #define DMA_CSR_INTMAJOR_SHIFT 1
Kojto 93:e188a91d3eaa 1267 #define DMA_CSR_INTHALF_MASK 0x4u
Kojto 93:e188a91d3eaa 1268 #define DMA_CSR_INTHALF_SHIFT 2
Kojto 93:e188a91d3eaa 1269 #define DMA_CSR_DREQ_MASK 0x8u
Kojto 93:e188a91d3eaa 1270 #define DMA_CSR_DREQ_SHIFT 3
Kojto 93:e188a91d3eaa 1271 #define DMA_CSR_ESG_MASK 0x10u
Kojto 93:e188a91d3eaa 1272 #define DMA_CSR_ESG_SHIFT 4
Kojto 93:e188a91d3eaa 1273 #define DMA_CSR_MAJORELINK_MASK 0x20u
Kojto 93:e188a91d3eaa 1274 #define DMA_CSR_MAJORELINK_SHIFT 5
Kojto 93:e188a91d3eaa 1275 #define DMA_CSR_ACTIVE_MASK 0x40u
Kojto 93:e188a91d3eaa 1276 #define DMA_CSR_ACTIVE_SHIFT 6
Kojto 93:e188a91d3eaa 1277 #define DMA_CSR_DONE_MASK 0x80u
Kojto 93:e188a91d3eaa 1278 #define DMA_CSR_DONE_SHIFT 7
Kojto 93:e188a91d3eaa 1279 #define DMA_CSR_MAJORLINKCH_MASK 0xF00u
Kojto 93:e188a91d3eaa 1280 #define DMA_CSR_MAJORLINKCH_SHIFT 8
Kojto 93:e188a91d3eaa 1281 #define DMA_CSR_MAJORLINKCH(x) (((uint16_t)(((uint16_t)(x))<<DMA_CSR_MAJORLINKCH_SHIFT))&DMA_CSR_MAJORLINKCH_MASK)
Kojto 93:e188a91d3eaa 1282 #define DMA_CSR_BWC_MASK 0xC000u
Kojto 93:e188a91d3eaa 1283 #define DMA_CSR_BWC_SHIFT 14
Kojto 93:e188a91d3eaa 1284 #define DMA_CSR_BWC(x) (((uint16_t)(((uint16_t)(x))<<DMA_CSR_BWC_SHIFT))&DMA_CSR_BWC_MASK)
Kojto 93:e188a91d3eaa 1285 /* BITER_ELINKNO Bit Fields */
Kojto 93:e188a91d3eaa 1286 #define DMA_BITER_ELINKNO_BITER_MASK 0x7FFFu
Kojto 93:e188a91d3eaa 1287 #define DMA_BITER_ELINKNO_BITER_SHIFT 0
Kojto 93:e188a91d3eaa 1288 #define DMA_BITER_ELINKNO_BITER(x) (((uint16_t)(((uint16_t)(x))<<DMA_BITER_ELINKNO_BITER_SHIFT))&DMA_BITER_ELINKNO_BITER_MASK)
Kojto 93:e188a91d3eaa 1289 #define DMA_BITER_ELINKNO_ELINK_MASK 0x8000u
Kojto 93:e188a91d3eaa 1290 #define DMA_BITER_ELINKNO_ELINK_SHIFT 15
Kojto 93:e188a91d3eaa 1291 /* BITER_ELINKYES Bit Fields */
Kojto 93:e188a91d3eaa 1292 #define DMA_BITER_ELINKYES_BITER_MASK 0x1FFu
Kojto 93:e188a91d3eaa 1293 #define DMA_BITER_ELINKYES_BITER_SHIFT 0
Kojto 93:e188a91d3eaa 1294 #define DMA_BITER_ELINKYES_BITER(x) (((uint16_t)(((uint16_t)(x))<<DMA_BITER_ELINKYES_BITER_SHIFT))&DMA_BITER_ELINKYES_BITER_MASK)
Kojto 93:e188a91d3eaa 1295 #define DMA_BITER_ELINKYES_LINKCH_MASK 0x1E00u
Kojto 93:e188a91d3eaa 1296 #define DMA_BITER_ELINKYES_LINKCH_SHIFT 9
Kojto 93:e188a91d3eaa 1297 #define DMA_BITER_ELINKYES_LINKCH(x) (((uint16_t)(((uint16_t)(x))<<DMA_BITER_ELINKYES_LINKCH_SHIFT))&DMA_BITER_ELINKYES_LINKCH_MASK)
Kojto 93:e188a91d3eaa 1298 #define DMA_BITER_ELINKYES_ELINK_MASK 0x8000u
Kojto 93:e188a91d3eaa 1299 #define DMA_BITER_ELINKYES_ELINK_SHIFT 15
Kojto 93:e188a91d3eaa 1300
Kojto 93:e188a91d3eaa 1301 /**
Kojto 93:e188a91d3eaa 1302 * @}
Kojto 93:e188a91d3eaa 1303 */ /* end of group DMA_Register_Masks */
Kojto 93:e188a91d3eaa 1304
Kojto 93:e188a91d3eaa 1305
Kojto 93:e188a91d3eaa 1306 /* DMA - Peripheral instance base addresses */
Kojto 93:e188a91d3eaa 1307 /** Peripheral DMA base address */
Kojto 93:e188a91d3eaa 1308 #define DMA_BASE (0x40008000u)
Kojto 93:e188a91d3eaa 1309 /** Peripheral DMA base pointer */
Kojto 93:e188a91d3eaa 1310 #define DMA0 ((DMA_Type *)DMA_BASE)
Kojto 93:e188a91d3eaa 1311
Kojto 93:e188a91d3eaa 1312 /**
Kojto 93:e188a91d3eaa 1313 * @}
Kojto 93:e188a91d3eaa 1314 */ /* end of group DMA_Peripheral_Access_Layer */
Kojto 93:e188a91d3eaa 1315
Kojto 93:e188a91d3eaa 1316
Kojto 93:e188a91d3eaa 1317 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 1318 -- DMAMUX Peripheral Access Layer
Kojto 93:e188a91d3eaa 1319 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 1320
Kojto 93:e188a91d3eaa 1321 /**
Kojto 93:e188a91d3eaa 1322 * @addtogroup DMAMUX_Peripheral_Access_Layer DMAMUX Peripheral Access Layer
Kojto 93:e188a91d3eaa 1323 * @{
Kojto 93:e188a91d3eaa 1324 */
Kojto 93:e188a91d3eaa 1325
Kojto 93:e188a91d3eaa 1326 /** DMAMUX - Register Layout Typedef */
Kojto 93:e188a91d3eaa 1327 typedef struct {
Kojto 93:e188a91d3eaa 1328 __IO uint8_t CHCFG[16]; /**< Channel Configuration Register, array offset: 0x0, array step: 0x1 */
Kojto 93:e188a91d3eaa 1329 } DMAMUX_Type;
Kojto 93:e188a91d3eaa 1330
Kojto 93:e188a91d3eaa 1331 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 1332 -- DMAMUX Register Masks
Kojto 93:e188a91d3eaa 1333 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 1334
Kojto 93:e188a91d3eaa 1335 /**
Kojto 93:e188a91d3eaa 1336 * @addtogroup DMAMUX_Register_Masks DMAMUX Register Masks
Kojto 93:e188a91d3eaa 1337 * @{
Kojto 93:e188a91d3eaa 1338 */
Kojto 93:e188a91d3eaa 1339
Kojto 93:e188a91d3eaa 1340 /* CHCFG Bit Fields */
Kojto 93:e188a91d3eaa 1341 #define DMAMUX_CHCFG_SOURCE_MASK 0x3Fu
Kojto 93:e188a91d3eaa 1342 #define DMAMUX_CHCFG_SOURCE_SHIFT 0
Kojto 93:e188a91d3eaa 1343 #define DMAMUX_CHCFG_SOURCE(x) (((uint8_t)(((uint8_t)(x))<<DMAMUX_CHCFG_SOURCE_SHIFT))&DMAMUX_CHCFG_SOURCE_MASK)
Kojto 93:e188a91d3eaa 1344 #define DMAMUX_CHCFG_TRIG_MASK 0x40u
Kojto 93:e188a91d3eaa 1345 #define DMAMUX_CHCFG_TRIG_SHIFT 6
Kojto 93:e188a91d3eaa 1346 #define DMAMUX_CHCFG_ENBL_MASK 0x80u
Kojto 93:e188a91d3eaa 1347 #define DMAMUX_CHCFG_ENBL_SHIFT 7
Kojto 93:e188a91d3eaa 1348
Kojto 93:e188a91d3eaa 1349 /**
Kojto 93:e188a91d3eaa 1350 * @}
Kojto 93:e188a91d3eaa 1351 */ /* end of group DMAMUX_Register_Masks */
Kojto 93:e188a91d3eaa 1352
Kojto 93:e188a91d3eaa 1353
Kojto 93:e188a91d3eaa 1354 /* DMAMUX - Peripheral instance base addresses */
Kojto 93:e188a91d3eaa 1355 /** Peripheral DMAMUX base address */
Kojto 93:e188a91d3eaa 1356 #define DMAMUX_BASE (0x40021000u)
Kojto 93:e188a91d3eaa 1357 /** Peripheral DMAMUX base pointer */
Kojto 93:e188a91d3eaa 1358 #define DMAMUX ((DMAMUX_Type *)DMAMUX_BASE)
Kojto 93:e188a91d3eaa 1359
Kojto 93:e188a91d3eaa 1360 /**
Kojto 93:e188a91d3eaa 1361 * @}
Kojto 93:e188a91d3eaa 1362 */ /* end of group DMAMUX_Peripheral_Access_Layer */
Kojto 93:e188a91d3eaa 1363
Kojto 93:e188a91d3eaa 1364
Kojto 93:e188a91d3eaa 1365 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 1366 -- EWM Peripheral Access Layer
Kojto 93:e188a91d3eaa 1367 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 1368
Kojto 93:e188a91d3eaa 1369 /**
Kojto 93:e188a91d3eaa 1370 * @addtogroup EWM_Peripheral_Access_Layer EWM Peripheral Access Layer
Kojto 93:e188a91d3eaa 1371 * @{
Kojto 93:e188a91d3eaa 1372 */
Kojto 93:e188a91d3eaa 1373
Kojto 93:e188a91d3eaa 1374 /** EWM - Register Layout Typedef */
Kojto 93:e188a91d3eaa 1375 typedef struct {
Kojto 93:e188a91d3eaa 1376 __IO uint8_t CTRL; /**< Control Register, offset: 0x0 */
Kojto 93:e188a91d3eaa 1377 __O uint8_t SERV; /**< Service Register, offset: 0x1 */
Kojto 93:e188a91d3eaa 1378 __IO uint8_t CMPL; /**< Compare Low Register, offset: 0x2 */
Kojto 93:e188a91d3eaa 1379 __IO uint8_t CMPH; /**< Compare High Register, offset: 0x3 */
Kojto 93:e188a91d3eaa 1380 } EWM_Type;
Kojto 93:e188a91d3eaa 1381
Kojto 93:e188a91d3eaa 1382 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 1383 -- EWM Register Masks
Kojto 93:e188a91d3eaa 1384 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 1385
Kojto 93:e188a91d3eaa 1386 /**
Kojto 93:e188a91d3eaa 1387 * @addtogroup EWM_Register_Masks EWM Register Masks
Kojto 93:e188a91d3eaa 1388 * @{
Kojto 93:e188a91d3eaa 1389 */
Kojto 93:e188a91d3eaa 1390
Kojto 93:e188a91d3eaa 1391 /* CTRL Bit Fields */
Kojto 93:e188a91d3eaa 1392 #define EWM_CTRL_EWMEN_MASK 0x1u
Kojto 93:e188a91d3eaa 1393 #define EWM_CTRL_EWMEN_SHIFT 0
Kojto 93:e188a91d3eaa 1394 #define EWM_CTRL_ASSIN_MASK 0x2u
Kojto 93:e188a91d3eaa 1395 #define EWM_CTRL_ASSIN_SHIFT 1
Kojto 93:e188a91d3eaa 1396 #define EWM_CTRL_INEN_MASK 0x4u
Kojto 93:e188a91d3eaa 1397 #define EWM_CTRL_INEN_SHIFT 2
Kojto 93:e188a91d3eaa 1398 #define EWM_CTRL_INTEN_MASK 0x8u
Kojto 93:e188a91d3eaa 1399 #define EWM_CTRL_INTEN_SHIFT 3
Kojto 93:e188a91d3eaa 1400 /* SERV Bit Fields */
Kojto 93:e188a91d3eaa 1401 #define EWM_SERV_SERVICE_MASK 0xFFu
Kojto 93:e188a91d3eaa 1402 #define EWM_SERV_SERVICE_SHIFT 0
Kojto 93:e188a91d3eaa 1403 #define EWM_SERV_SERVICE(x) (((uint8_t)(((uint8_t)(x))<<EWM_SERV_SERVICE_SHIFT))&EWM_SERV_SERVICE_MASK)
Kojto 93:e188a91d3eaa 1404 /* CMPL Bit Fields */
Kojto 93:e188a91d3eaa 1405 #define EWM_CMPL_COMPAREL_MASK 0xFFu
Kojto 93:e188a91d3eaa 1406 #define EWM_CMPL_COMPAREL_SHIFT 0
Kojto 93:e188a91d3eaa 1407 #define EWM_CMPL_COMPAREL(x) (((uint8_t)(((uint8_t)(x))<<EWM_CMPL_COMPAREL_SHIFT))&EWM_CMPL_COMPAREL_MASK)
Kojto 93:e188a91d3eaa 1408 /* CMPH Bit Fields */
Kojto 93:e188a91d3eaa 1409 #define EWM_CMPH_COMPAREH_MASK 0xFFu
Kojto 93:e188a91d3eaa 1410 #define EWM_CMPH_COMPAREH_SHIFT 0
Kojto 93:e188a91d3eaa 1411 #define EWM_CMPH_COMPAREH(x) (((uint8_t)(((uint8_t)(x))<<EWM_CMPH_COMPAREH_SHIFT))&EWM_CMPH_COMPAREH_MASK)
Kojto 93:e188a91d3eaa 1412
Kojto 93:e188a91d3eaa 1413 /**
Kojto 93:e188a91d3eaa 1414 * @}
Kojto 93:e188a91d3eaa 1415 */ /* end of group EWM_Register_Masks */
Kojto 93:e188a91d3eaa 1416
Kojto 93:e188a91d3eaa 1417
Kojto 93:e188a91d3eaa 1418 /* EWM - Peripheral instance base addresses */
Kojto 93:e188a91d3eaa 1419 /** Peripheral EWM base address */
Kojto 93:e188a91d3eaa 1420 #define EWM_BASE (0x40061000u)
Kojto 93:e188a91d3eaa 1421 /** Peripheral EWM base pointer */
Kojto 93:e188a91d3eaa 1422 #define EWM ((EWM_Type *)EWM_BASE)
Kojto 93:e188a91d3eaa 1423
Kojto 93:e188a91d3eaa 1424 /**
Kojto 93:e188a91d3eaa 1425 * @}
Kojto 93:e188a91d3eaa 1426 */ /* end of group EWM_Peripheral_Access_Layer */
Kojto 93:e188a91d3eaa 1427
Kojto 93:e188a91d3eaa 1428
Kojto 93:e188a91d3eaa 1429 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 1430 -- FMC Peripheral Access Layer
Kojto 93:e188a91d3eaa 1431 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 1432
Kojto 93:e188a91d3eaa 1433 /**
Kojto 93:e188a91d3eaa 1434 * @addtogroup FMC_Peripheral_Access_Layer FMC Peripheral Access Layer
Kojto 93:e188a91d3eaa 1435 * @{
Kojto 93:e188a91d3eaa 1436 */
Kojto 93:e188a91d3eaa 1437
Kojto 93:e188a91d3eaa 1438 /** FMC - Register Layout Typedef */
Kojto 93:e188a91d3eaa 1439 typedef struct {
Kojto 93:e188a91d3eaa 1440 __IO uint32_t PFAPR; /**< Flash Access Protection Register, offset: 0x0 */
Kojto 93:e188a91d3eaa 1441 __IO uint32_t PFB0CR; /**< Flash Control Register, offset: 0x4 */
Kojto 93:e188a91d3eaa 1442 uint8_t RESERVED_0[248];
Kojto 93:e188a91d3eaa 1443 struct { /* offset: 0x100, array step: 0x20 */
Kojto 93:e188a91d3eaa 1444 __IO uint32_t TAGVD[2]; /**< Cache Tag Storage, array offset: 0x100, array step: index*0x20, index2*0x4 */
Kojto 93:e188a91d3eaa 1445 uint8_t RESERVED_0[24];
Kojto 93:e188a91d3eaa 1446 } TAG_WAY[4];
Kojto 93:e188a91d3eaa 1447 uint8_t RESERVED_1[132];
Kojto 93:e188a91d3eaa 1448 struct { /* offset: 0x204, array step: 0x8 */
Kojto 93:e188a91d3eaa 1449 __IO uint32_t DATAW0S; /**< Cache Data Storage, array offset: 0x204, array step: 0x8 */
Kojto 93:e188a91d3eaa 1450 uint8_t RESERVED_0[4];
Kojto 93:e188a91d3eaa 1451 } DATAW0S[2];
Kojto 93:e188a91d3eaa 1452 uint8_t RESERVED_2[48];
Kojto 93:e188a91d3eaa 1453 struct { /* offset: 0x244, array step: 0x8 */
Kojto 93:e188a91d3eaa 1454 __IO uint32_t DATAW1S; /**< Cache Data Storage, array offset: 0x244, array step: 0x8 */
Kojto 93:e188a91d3eaa 1455 uint8_t RESERVED_0[4];
Kojto 93:e188a91d3eaa 1456 } DATAW1S[2];
Kojto 93:e188a91d3eaa 1457 uint8_t RESERVED_3[48];
Kojto 93:e188a91d3eaa 1458 struct { /* offset: 0x284, array step: 0x8 */
Kojto 93:e188a91d3eaa 1459 __IO uint32_t DATAW2S; /**< Cache Data Storage, array offset: 0x284, array step: 0x8 */
Kojto 93:e188a91d3eaa 1460 uint8_t RESERVED_0[4];
Kojto 93:e188a91d3eaa 1461 } DATAW2S[2];
Kojto 93:e188a91d3eaa 1462 uint8_t RESERVED_4[48];
Kojto 93:e188a91d3eaa 1463 struct { /* offset: 0x2C4, array step: 0x8 */
Kojto 93:e188a91d3eaa 1464 __IO uint32_t DATAW3S; /**< Cache Data Storage, array offset: 0x2C4, array step: 0x8 */
Kojto 93:e188a91d3eaa 1465 uint8_t RESERVED_0[4];
Kojto 93:e188a91d3eaa 1466 } DATAW3S[2];
Kojto 93:e188a91d3eaa 1467 } FMC_Type;
Kojto 93:e188a91d3eaa 1468
Kojto 93:e188a91d3eaa 1469 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 1470 -- FMC Register Masks
Kojto 93:e188a91d3eaa 1471 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 1472
Kojto 93:e188a91d3eaa 1473 /**
Kojto 93:e188a91d3eaa 1474 * @addtogroup FMC_Register_Masks FMC Register Masks
Kojto 93:e188a91d3eaa 1475 * @{
Kojto 93:e188a91d3eaa 1476 */
Kojto 93:e188a91d3eaa 1477
Kojto 93:e188a91d3eaa 1478 /* PFAPR Bit Fields */
Kojto 93:e188a91d3eaa 1479 #define FMC_PFAPR_M0AP_MASK 0x3u
Kojto 93:e188a91d3eaa 1480 #define FMC_PFAPR_M0AP_SHIFT 0
Kojto 93:e188a91d3eaa 1481 #define FMC_PFAPR_M0AP(x) (((uint32_t)(((uint32_t)(x))<<FMC_PFAPR_M0AP_SHIFT))&FMC_PFAPR_M0AP_MASK)
Kojto 93:e188a91d3eaa 1482 #define FMC_PFAPR_M1AP_MASK 0xCu
Kojto 93:e188a91d3eaa 1483 #define FMC_PFAPR_M1AP_SHIFT 2
Kojto 93:e188a91d3eaa 1484 #define FMC_PFAPR_M1AP(x) (((uint32_t)(((uint32_t)(x))<<FMC_PFAPR_M1AP_SHIFT))&FMC_PFAPR_M1AP_MASK)
Kojto 93:e188a91d3eaa 1485 #define FMC_PFAPR_M2AP_MASK 0x30u
Kojto 93:e188a91d3eaa 1486 #define FMC_PFAPR_M2AP_SHIFT 4
Kojto 93:e188a91d3eaa 1487 #define FMC_PFAPR_M2AP(x) (((uint32_t)(((uint32_t)(x))<<FMC_PFAPR_M2AP_SHIFT))&FMC_PFAPR_M2AP_MASK)
Kojto 93:e188a91d3eaa 1488 #define FMC_PFAPR_M3AP_MASK 0xC0u
Kojto 93:e188a91d3eaa 1489 #define FMC_PFAPR_M3AP_SHIFT 6
Kojto 93:e188a91d3eaa 1490 #define FMC_PFAPR_M3AP(x) (((uint32_t)(((uint32_t)(x))<<FMC_PFAPR_M3AP_SHIFT))&FMC_PFAPR_M3AP_MASK)
Kojto 93:e188a91d3eaa 1491 #define FMC_PFAPR_M0PFD_MASK 0x10000u
Kojto 93:e188a91d3eaa 1492 #define FMC_PFAPR_M0PFD_SHIFT 16
Kojto 93:e188a91d3eaa 1493 #define FMC_PFAPR_M1PFD_MASK 0x20000u
Kojto 93:e188a91d3eaa 1494 #define FMC_PFAPR_M1PFD_SHIFT 17
Kojto 93:e188a91d3eaa 1495 #define FMC_PFAPR_M2PFD_MASK 0x40000u
Kojto 93:e188a91d3eaa 1496 #define FMC_PFAPR_M2PFD_SHIFT 18
Kojto 93:e188a91d3eaa 1497 #define FMC_PFAPR_M3PFD_MASK 0x80000u
Kojto 93:e188a91d3eaa 1498 #define FMC_PFAPR_M3PFD_SHIFT 19
Kojto 93:e188a91d3eaa 1499 /* PFB0CR Bit Fields */
Kojto 93:e188a91d3eaa 1500 #define FMC_PFB0CR_B0SEBE_MASK 0x1u
Kojto 93:e188a91d3eaa 1501 #define FMC_PFB0CR_B0SEBE_SHIFT 0
Kojto 93:e188a91d3eaa 1502 #define FMC_PFB0CR_B0IPE_MASK 0x2u
Kojto 93:e188a91d3eaa 1503 #define FMC_PFB0CR_B0IPE_SHIFT 1
Kojto 93:e188a91d3eaa 1504 #define FMC_PFB0CR_B0DPE_MASK 0x4u
Kojto 93:e188a91d3eaa 1505 #define FMC_PFB0CR_B0DPE_SHIFT 2
Kojto 93:e188a91d3eaa 1506 #define FMC_PFB0CR_B0ICE_MASK 0x8u
Kojto 93:e188a91d3eaa 1507 #define FMC_PFB0CR_B0ICE_SHIFT 3
Kojto 93:e188a91d3eaa 1508 #define FMC_PFB0CR_B0DCE_MASK 0x10u
Kojto 93:e188a91d3eaa 1509 #define FMC_PFB0CR_B0DCE_SHIFT 4
Kojto 93:e188a91d3eaa 1510 #define FMC_PFB0CR_CRC_MASK 0xE0u
Kojto 93:e188a91d3eaa 1511 #define FMC_PFB0CR_CRC_SHIFT 5
Kojto 93:e188a91d3eaa 1512 #define FMC_PFB0CR_CRC(x) (((uint32_t)(((uint32_t)(x))<<FMC_PFB0CR_CRC_SHIFT))&FMC_PFB0CR_CRC_MASK)
Kojto 93:e188a91d3eaa 1513 #define FMC_PFB0CR_B0MW_MASK 0x60000u
Kojto 93:e188a91d3eaa 1514 #define FMC_PFB0CR_B0MW_SHIFT 17
Kojto 93:e188a91d3eaa 1515 #define FMC_PFB0CR_B0MW(x) (((uint32_t)(((uint32_t)(x))<<FMC_PFB0CR_B0MW_SHIFT))&FMC_PFB0CR_B0MW_MASK)
Kojto 93:e188a91d3eaa 1516 #define FMC_PFB0CR_S_B_INV_MASK 0x80000u
Kojto 93:e188a91d3eaa 1517 #define FMC_PFB0CR_S_B_INV_SHIFT 19
Kojto 93:e188a91d3eaa 1518 #define FMC_PFB0CR_CINV_WAY_MASK 0xF00000u
Kojto 93:e188a91d3eaa 1519 #define FMC_PFB0CR_CINV_WAY_SHIFT 20
Kojto 93:e188a91d3eaa 1520 #define FMC_PFB0CR_CINV_WAY(x) (((uint32_t)(((uint32_t)(x))<<FMC_PFB0CR_CINV_WAY_SHIFT))&FMC_PFB0CR_CINV_WAY_MASK)
Kojto 93:e188a91d3eaa 1521 #define FMC_PFB0CR_CLCK_WAY_MASK 0xF000000u
Kojto 93:e188a91d3eaa 1522 #define FMC_PFB0CR_CLCK_WAY_SHIFT 24
Kojto 93:e188a91d3eaa 1523 #define FMC_PFB0CR_CLCK_WAY(x) (((uint32_t)(((uint32_t)(x))<<FMC_PFB0CR_CLCK_WAY_SHIFT))&FMC_PFB0CR_CLCK_WAY_MASK)
Kojto 93:e188a91d3eaa 1524 #define FMC_PFB0CR_B0RWSC_MASK 0xF0000000u
Kojto 93:e188a91d3eaa 1525 #define FMC_PFB0CR_B0RWSC_SHIFT 28
Kojto 93:e188a91d3eaa 1526 #define FMC_PFB0CR_B0RWSC(x) (((uint32_t)(((uint32_t)(x))<<FMC_PFB0CR_B0RWSC_SHIFT))&FMC_PFB0CR_B0RWSC_MASK)
Kojto 93:e188a91d3eaa 1527 /* TAGVD Bit Fields */
Kojto 93:e188a91d3eaa 1528 #define FMC_TAGVD_valid_MASK 0x1u
Kojto 93:e188a91d3eaa 1529 #define FMC_TAGVD_valid_SHIFT 0
Kojto 93:e188a91d3eaa 1530 #define FMC_TAGVD_tag_MASK 0x7FFC0u
Kojto 93:e188a91d3eaa 1531 #define FMC_TAGVD_tag_SHIFT 6
Kojto 93:e188a91d3eaa 1532 #define FMC_TAGVD_tag(x) (((uint32_t)(((uint32_t)(x))<<FMC_TAGVD_tag_SHIFT))&FMC_TAGVD_tag_MASK)
Kojto 93:e188a91d3eaa 1533 /* DATAW0S Bit Fields */
Kojto 93:e188a91d3eaa 1534 #define FMC_DATAW0S_data_MASK 0xFFFFFFFFu
Kojto 93:e188a91d3eaa 1535 #define FMC_DATAW0S_data_SHIFT 0
Kojto 93:e188a91d3eaa 1536 #define FMC_DATAW0S_data(x) (((uint32_t)(((uint32_t)(x))<<FMC_DATAW0S_data_SHIFT))&FMC_DATAW0S_data_MASK)
Kojto 93:e188a91d3eaa 1537 /* DATAW1S Bit Fields */
Kojto 93:e188a91d3eaa 1538 #define FMC_DATAW1S_data_MASK 0xFFFFFFFFu
Kojto 93:e188a91d3eaa 1539 #define FMC_DATAW1S_data_SHIFT 0
Kojto 93:e188a91d3eaa 1540 #define FMC_DATAW1S_data(x) (((uint32_t)(((uint32_t)(x))<<FMC_DATAW1S_data_SHIFT))&FMC_DATAW1S_data_MASK)
Kojto 93:e188a91d3eaa 1541 /* DATAW2S Bit Fields */
Kojto 93:e188a91d3eaa 1542 #define FMC_DATAW2S_data_MASK 0xFFFFFFFFu
Kojto 93:e188a91d3eaa 1543 #define FMC_DATAW2S_data_SHIFT 0
Kojto 93:e188a91d3eaa 1544 #define FMC_DATAW2S_data(x) (((uint32_t)(((uint32_t)(x))<<FMC_DATAW2S_data_SHIFT))&FMC_DATAW2S_data_MASK)
Kojto 93:e188a91d3eaa 1545 /* DATAW3S Bit Fields */
Kojto 93:e188a91d3eaa 1546 #define FMC_DATAW3S_data_MASK 0xFFFFFFFFu
Kojto 93:e188a91d3eaa 1547 #define FMC_DATAW3S_data_SHIFT 0
Kojto 93:e188a91d3eaa 1548 #define FMC_DATAW3S_data(x) (((uint32_t)(((uint32_t)(x))<<FMC_DATAW3S_data_SHIFT))&FMC_DATAW3S_data_MASK)
Kojto 93:e188a91d3eaa 1549
Kojto 93:e188a91d3eaa 1550 /**
Kojto 93:e188a91d3eaa 1551 * @}
Kojto 93:e188a91d3eaa 1552 */ /* end of group FMC_Register_Masks */
Kojto 93:e188a91d3eaa 1553
Kojto 93:e188a91d3eaa 1554
Kojto 93:e188a91d3eaa 1555 /* FMC - Peripheral instance base addresses */
Kojto 93:e188a91d3eaa 1556 /** Peripheral FMC base address */
Kojto 93:e188a91d3eaa 1557 #define FMC_BASE (0x4001F000u)
Kojto 93:e188a91d3eaa 1558 /** Peripheral FMC base pointer */
Kojto 93:e188a91d3eaa 1559 #define FMC ((FMC_Type *)FMC_BASE)
Kojto 93:e188a91d3eaa 1560
Kojto 93:e188a91d3eaa 1561 /**
Kojto 93:e188a91d3eaa 1562 * @}
Kojto 93:e188a91d3eaa 1563 */ /* end of group FMC_Peripheral_Access_Layer */
Kojto 93:e188a91d3eaa 1564
Kojto 93:e188a91d3eaa 1565
Kojto 93:e188a91d3eaa 1566 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 1567 -- FTFL Peripheral Access Layer
Kojto 93:e188a91d3eaa 1568 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 1569
Kojto 93:e188a91d3eaa 1570 /**
Kojto 93:e188a91d3eaa 1571 * @addtogroup FTFL_Peripheral_Access_Layer FTFL Peripheral Access Layer
Kojto 93:e188a91d3eaa 1572 * @{
Kojto 93:e188a91d3eaa 1573 */
Kojto 93:e188a91d3eaa 1574
Kojto 93:e188a91d3eaa 1575 /** FTFL - Register Layout Typedef */
Kojto 93:e188a91d3eaa 1576 typedef struct {
Kojto 93:e188a91d3eaa 1577 __IO uint8_t FSTAT; /**< Flash Status Register, offset: 0x0 */
Kojto 93:e188a91d3eaa 1578 __IO uint8_t FCNFG; /**< Flash Configuration Register, offset: 0x1 */
Kojto 93:e188a91d3eaa 1579 __I uint8_t FSEC; /**< Flash Security Register, offset: 0x2 */
Kojto 93:e188a91d3eaa 1580 __I uint8_t FOPT; /**< Flash Option Register, offset: 0x3 */
Kojto 93:e188a91d3eaa 1581 __IO uint8_t FCCOB3; /**< Flash Common Command Object Registers, offset: 0x4 */
Kojto 93:e188a91d3eaa 1582 __IO uint8_t FCCOB2; /**< Flash Common Command Object Registers, offset: 0x5 */
Kojto 93:e188a91d3eaa 1583 __IO uint8_t FCCOB1; /**< Flash Common Command Object Registers, offset: 0x6 */
Kojto 93:e188a91d3eaa 1584 __IO uint8_t FCCOB0; /**< Flash Common Command Object Registers, offset: 0x7 */
Kojto 93:e188a91d3eaa 1585 __IO uint8_t FCCOB7; /**< Flash Common Command Object Registers, offset: 0x8 */
Kojto 93:e188a91d3eaa 1586 __IO uint8_t FCCOB6; /**< Flash Common Command Object Registers, offset: 0x9 */
Kojto 93:e188a91d3eaa 1587 __IO uint8_t FCCOB5; /**< Flash Common Command Object Registers, offset: 0xA */
Kojto 93:e188a91d3eaa 1588 __IO uint8_t FCCOB4; /**< Flash Common Command Object Registers, offset: 0xB */
Kojto 93:e188a91d3eaa 1589 __IO uint8_t FCCOBB; /**< Flash Common Command Object Registers, offset: 0xC */
Kojto 93:e188a91d3eaa 1590 __IO uint8_t FCCOBA; /**< Flash Common Command Object Registers, offset: 0xD */
Kojto 93:e188a91d3eaa 1591 __IO uint8_t FCCOB9; /**< Flash Common Command Object Registers, offset: 0xE */
Kojto 93:e188a91d3eaa 1592 __IO uint8_t FCCOB8; /**< Flash Common Command Object Registers, offset: 0xF */
Kojto 93:e188a91d3eaa 1593 __IO uint8_t FPROT3; /**< Program Flash Protection Registers, offset: 0x10 */
Kojto 93:e188a91d3eaa 1594 __IO uint8_t FPROT2; /**< Program Flash Protection Registers, offset: 0x11 */
Kojto 93:e188a91d3eaa 1595 __IO uint8_t FPROT1; /**< Program Flash Protection Registers, offset: 0x12 */
Kojto 93:e188a91d3eaa 1596 __IO uint8_t FPROT0; /**< Program Flash Protection Registers, offset: 0x13 */
Kojto 93:e188a91d3eaa 1597 uint8_t RESERVED_0[2];
Kojto 93:e188a91d3eaa 1598 __IO uint8_t FEPROT; /**< EEPROM Protection Register, offset: 0x16 */
Kojto 93:e188a91d3eaa 1599 __IO uint8_t FDPROT; /**< Data Flash Protection Register, offset: 0x17 */
Kojto 93:e188a91d3eaa 1600 } FTFL_Type;
Kojto 93:e188a91d3eaa 1601
Kojto 93:e188a91d3eaa 1602 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 1603 -- FTFL Register Masks
Kojto 93:e188a91d3eaa 1604 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 1605
Kojto 93:e188a91d3eaa 1606 /**
Kojto 93:e188a91d3eaa 1607 * @addtogroup FTFL_Register_Masks FTFL Register Masks
Kojto 93:e188a91d3eaa 1608 * @{
Kojto 93:e188a91d3eaa 1609 */
Kojto 93:e188a91d3eaa 1610
Kojto 93:e188a91d3eaa 1611 /* FSTAT Bit Fields */
Kojto 93:e188a91d3eaa 1612 #define FTFL_FSTAT_MGSTAT0_MASK 0x1u
Kojto 93:e188a91d3eaa 1613 #define FTFL_FSTAT_MGSTAT0_SHIFT 0
Kojto 93:e188a91d3eaa 1614 #define FTFL_FSTAT_FPVIOL_MASK 0x10u
Kojto 93:e188a91d3eaa 1615 #define FTFL_FSTAT_FPVIOL_SHIFT 4
Kojto 93:e188a91d3eaa 1616 #define FTFL_FSTAT_ACCERR_MASK 0x20u
Kojto 93:e188a91d3eaa 1617 #define FTFL_FSTAT_ACCERR_SHIFT 5
Kojto 93:e188a91d3eaa 1618 #define FTFL_FSTAT_RDCOLERR_MASK 0x40u
Kojto 93:e188a91d3eaa 1619 #define FTFL_FSTAT_RDCOLERR_SHIFT 6
Kojto 93:e188a91d3eaa 1620 #define FTFL_FSTAT_CCIF_MASK 0x80u
Kojto 93:e188a91d3eaa 1621 #define FTFL_FSTAT_CCIF_SHIFT 7
Kojto 93:e188a91d3eaa 1622 /* FCNFG Bit Fields */
Kojto 93:e188a91d3eaa 1623 #define FTFL_FCNFG_EEERDY_MASK 0x1u
Kojto 93:e188a91d3eaa 1624 #define FTFL_FCNFG_EEERDY_SHIFT 0
Kojto 93:e188a91d3eaa 1625 #define FTFL_FCNFG_RAMRDY_MASK 0x2u
Kojto 93:e188a91d3eaa 1626 #define FTFL_FCNFG_RAMRDY_SHIFT 1
Kojto 93:e188a91d3eaa 1627 #define FTFL_FCNFG_PFLSH_MASK 0x4u
Kojto 93:e188a91d3eaa 1628 #define FTFL_FCNFG_PFLSH_SHIFT 2
Kojto 93:e188a91d3eaa 1629 #define FTFL_FCNFG_ERSSUSP_MASK 0x10u
Kojto 93:e188a91d3eaa 1630 #define FTFL_FCNFG_ERSSUSP_SHIFT 4
Kojto 93:e188a91d3eaa 1631 #define FTFL_FCNFG_ERSAREQ_MASK 0x20u
Kojto 93:e188a91d3eaa 1632 #define FTFL_FCNFG_ERSAREQ_SHIFT 5
Kojto 93:e188a91d3eaa 1633 #define FTFL_FCNFG_RDCOLLIE_MASK 0x40u
Kojto 93:e188a91d3eaa 1634 #define FTFL_FCNFG_RDCOLLIE_SHIFT 6
Kojto 93:e188a91d3eaa 1635 #define FTFL_FCNFG_CCIE_MASK 0x80u
Kojto 93:e188a91d3eaa 1636 #define FTFL_FCNFG_CCIE_SHIFT 7
Kojto 93:e188a91d3eaa 1637 /* FSEC Bit Fields */
Kojto 93:e188a91d3eaa 1638 #define FTFL_FSEC_SEC_MASK 0x3u
Kojto 93:e188a91d3eaa 1639 #define FTFL_FSEC_SEC_SHIFT 0
Kojto 93:e188a91d3eaa 1640 #define FTFL_FSEC_SEC(x) (((uint8_t)(((uint8_t)(x))<<FTFL_FSEC_SEC_SHIFT))&FTFL_FSEC_SEC_MASK)
Kojto 93:e188a91d3eaa 1641 #define FTFL_FSEC_FSLACC_MASK 0xCu
Kojto 93:e188a91d3eaa 1642 #define FTFL_FSEC_FSLACC_SHIFT 2
Kojto 93:e188a91d3eaa 1643 #define FTFL_FSEC_FSLACC(x) (((uint8_t)(((uint8_t)(x))<<FTFL_FSEC_FSLACC_SHIFT))&FTFL_FSEC_FSLACC_MASK)
Kojto 93:e188a91d3eaa 1644 #define FTFL_FSEC_MEEN_MASK 0x30u
Kojto 93:e188a91d3eaa 1645 #define FTFL_FSEC_MEEN_SHIFT 4
Kojto 93:e188a91d3eaa 1646 #define FTFL_FSEC_MEEN(x) (((uint8_t)(((uint8_t)(x))<<FTFL_FSEC_MEEN_SHIFT))&FTFL_FSEC_MEEN_MASK)
Kojto 93:e188a91d3eaa 1647 #define FTFL_FSEC_KEYEN_MASK 0xC0u
Kojto 93:e188a91d3eaa 1648 #define FTFL_FSEC_KEYEN_SHIFT 6
Kojto 93:e188a91d3eaa 1649 #define FTFL_FSEC_KEYEN(x) (((uint8_t)(((uint8_t)(x))<<FTFL_FSEC_KEYEN_SHIFT))&FTFL_FSEC_KEYEN_MASK)
Kojto 93:e188a91d3eaa 1650 /* FOPT Bit Fields */
Kojto 93:e188a91d3eaa 1651 #define FTFL_FOPT_OPT_MASK 0xFFu
Kojto 93:e188a91d3eaa 1652 #define FTFL_FOPT_OPT_SHIFT 0
Kojto 93:e188a91d3eaa 1653 #define FTFL_FOPT_OPT(x) (((uint8_t)(((uint8_t)(x))<<FTFL_FOPT_OPT_SHIFT))&FTFL_FOPT_OPT_MASK)
Kojto 93:e188a91d3eaa 1654 /* FCCOB3 Bit Fields */
Kojto 93:e188a91d3eaa 1655 #define FTFL_FCCOB3_CCOBn_MASK 0xFFu
Kojto 93:e188a91d3eaa 1656 #define FTFL_FCCOB3_CCOBn_SHIFT 0
Kojto 93:e188a91d3eaa 1657 #define FTFL_FCCOB3_CCOBn(x) (((uint8_t)(((uint8_t)(x))<<FTFL_FCCOB3_CCOBn_SHIFT))&FTFL_FCCOB3_CCOBn_MASK)
Kojto 93:e188a91d3eaa 1658 /* FCCOB2 Bit Fields */
Kojto 93:e188a91d3eaa 1659 #define FTFL_FCCOB2_CCOBn_MASK 0xFFu
Kojto 93:e188a91d3eaa 1660 #define FTFL_FCCOB2_CCOBn_SHIFT 0
Kojto 93:e188a91d3eaa 1661 #define FTFL_FCCOB2_CCOBn(x) (((uint8_t)(((uint8_t)(x))<<FTFL_FCCOB2_CCOBn_SHIFT))&FTFL_FCCOB2_CCOBn_MASK)
Kojto 93:e188a91d3eaa 1662 /* FCCOB1 Bit Fields */
Kojto 93:e188a91d3eaa 1663 #define FTFL_FCCOB1_CCOBn_MASK 0xFFu
Kojto 93:e188a91d3eaa 1664 #define FTFL_FCCOB1_CCOBn_SHIFT 0
Kojto 93:e188a91d3eaa 1665 #define FTFL_FCCOB1_CCOBn(x) (((uint8_t)(((uint8_t)(x))<<FTFL_FCCOB1_CCOBn_SHIFT))&FTFL_FCCOB1_CCOBn_MASK)
Kojto 93:e188a91d3eaa 1666 /* FCCOB0 Bit Fields */
Kojto 93:e188a91d3eaa 1667 #define FTFL_FCCOB0_CCOBn_MASK 0xFFu
Kojto 93:e188a91d3eaa 1668 #define FTFL_FCCOB0_CCOBn_SHIFT 0
Kojto 93:e188a91d3eaa 1669 #define FTFL_FCCOB0_CCOBn(x) (((uint8_t)(((uint8_t)(x))<<FTFL_FCCOB0_CCOBn_SHIFT))&FTFL_FCCOB0_CCOBn_MASK)
Kojto 93:e188a91d3eaa 1670 /* FCCOB7 Bit Fields */
Kojto 93:e188a91d3eaa 1671 #define FTFL_FCCOB7_CCOBn_MASK 0xFFu
Kojto 93:e188a91d3eaa 1672 #define FTFL_FCCOB7_CCOBn_SHIFT 0
Kojto 93:e188a91d3eaa 1673 #define FTFL_FCCOB7_CCOBn(x) (((uint8_t)(((uint8_t)(x))<<FTFL_FCCOB7_CCOBn_SHIFT))&FTFL_FCCOB7_CCOBn_MASK)
Kojto 93:e188a91d3eaa 1674 /* FCCOB6 Bit Fields */
Kojto 93:e188a91d3eaa 1675 #define FTFL_FCCOB6_CCOBn_MASK 0xFFu
Kojto 93:e188a91d3eaa 1676 #define FTFL_FCCOB6_CCOBn_SHIFT 0
Kojto 93:e188a91d3eaa 1677 #define FTFL_FCCOB6_CCOBn(x) (((uint8_t)(((uint8_t)(x))<<FTFL_FCCOB6_CCOBn_SHIFT))&FTFL_FCCOB6_CCOBn_MASK)
Kojto 93:e188a91d3eaa 1678 /* FCCOB5 Bit Fields */
Kojto 93:e188a91d3eaa 1679 #define FTFL_FCCOB5_CCOBn_MASK 0xFFu
Kojto 93:e188a91d3eaa 1680 #define FTFL_FCCOB5_CCOBn_SHIFT 0
Kojto 93:e188a91d3eaa 1681 #define FTFL_FCCOB5_CCOBn(x) (((uint8_t)(((uint8_t)(x))<<FTFL_FCCOB5_CCOBn_SHIFT))&FTFL_FCCOB5_CCOBn_MASK)
Kojto 93:e188a91d3eaa 1682 /* FCCOB4 Bit Fields */
Kojto 93:e188a91d3eaa 1683 #define FTFL_FCCOB4_CCOBn_MASK 0xFFu
Kojto 93:e188a91d3eaa 1684 #define FTFL_FCCOB4_CCOBn_SHIFT 0
Kojto 93:e188a91d3eaa 1685 #define FTFL_FCCOB4_CCOBn(x) (((uint8_t)(((uint8_t)(x))<<FTFL_FCCOB4_CCOBn_SHIFT))&FTFL_FCCOB4_CCOBn_MASK)
Kojto 93:e188a91d3eaa 1686 /* FCCOBB Bit Fields */
Kojto 93:e188a91d3eaa 1687 #define FTFL_FCCOBB_CCOBn_MASK 0xFFu
Kojto 93:e188a91d3eaa 1688 #define FTFL_FCCOBB_CCOBn_SHIFT 0
Kojto 93:e188a91d3eaa 1689 #define FTFL_FCCOBB_CCOBn(x) (((uint8_t)(((uint8_t)(x))<<FTFL_FCCOBB_CCOBn_SHIFT))&FTFL_FCCOBB_CCOBn_MASK)
Kojto 93:e188a91d3eaa 1690 /* FCCOBA Bit Fields */
Kojto 93:e188a91d3eaa 1691 #define FTFL_FCCOBA_CCOBn_MASK 0xFFu
Kojto 93:e188a91d3eaa 1692 #define FTFL_FCCOBA_CCOBn_SHIFT 0
Kojto 93:e188a91d3eaa 1693 #define FTFL_FCCOBA_CCOBn(x) (((uint8_t)(((uint8_t)(x))<<FTFL_FCCOBA_CCOBn_SHIFT))&FTFL_FCCOBA_CCOBn_MASK)
Kojto 93:e188a91d3eaa 1694 /* FCCOB9 Bit Fields */
Kojto 93:e188a91d3eaa 1695 #define FTFL_FCCOB9_CCOBn_MASK 0xFFu
Kojto 93:e188a91d3eaa 1696 #define FTFL_FCCOB9_CCOBn_SHIFT 0
Kojto 93:e188a91d3eaa 1697 #define FTFL_FCCOB9_CCOBn(x) (((uint8_t)(((uint8_t)(x))<<FTFL_FCCOB9_CCOBn_SHIFT))&FTFL_FCCOB9_CCOBn_MASK)
Kojto 93:e188a91d3eaa 1698 /* FCCOB8 Bit Fields */
Kojto 93:e188a91d3eaa 1699 #define FTFL_FCCOB8_CCOBn_MASK 0xFFu
Kojto 93:e188a91d3eaa 1700 #define FTFL_FCCOB8_CCOBn_SHIFT 0
Kojto 93:e188a91d3eaa 1701 #define FTFL_FCCOB8_CCOBn(x) (((uint8_t)(((uint8_t)(x))<<FTFL_FCCOB8_CCOBn_SHIFT))&FTFL_FCCOB8_CCOBn_MASK)
Kojto 93:e188a91d3eaa 1702 /* FPROT3 Bit Fields */
Kojto 93:e188a91d3eaa 1703 #define FTFL_FPROT3_PROT_MASK 0xFFu
Kojto 93:e188a91d3eaa 1704 #define FTFL_FPROT3_PROT_SHIFT 0
Kojto 93:e188a91d3eaa 1705 #define FTFL_FPROT3_PROT(x) (((uint8_t)(((uint8_t)(x))<<FTFL_FPROT3_PROT_SHIFT))&FTFL_FPROT3_PROT_MASK)
Kojto 93:e188a91d3eaa 1706 /* FPROT2 Bit Fields */
Kojto 93:e188a91d3eaa 1707 #define FTFL_FPROT2_PROT_MASK 0xFFu
Kojto 93:e188a91d3eaa 1708 #define FTFL_FPROT2_PROT_SHIFT 0
Kojto 93:e188a91d3eaa 1709 #define FTFL_FPROT2_PROT(x) (((uint8_t)(((uint8_t)(x))<<FTFL_FPROT2_PROT_SHIFT))&FTFL_FPROT2_PROT_MASK)
Kojto 93:e188a91d3eaa 1710 /* FPROT1 Bit Fields */
Kojto 93:e188a91d3eaa 1711 #define FTFL_FPROT1_PROT_MASK 0xFFu
Kojto 93:e188a91d3eaa 1712 #define FTFL_FPROT1_PROT_SHIFT 0
Kojto 93:e188a91d3eaa 1713 #define FTFL_FPROT1_PROT(x) (((uint8_t)(((uint8_t)(x))<<FTFL_FPROT1_PROT_SHIFT))&FTFL_FPROT1_PROT_MASK)
Kojto 93:e188a91d3eaa 1714 /* FPROT0 Bit Fields */
Kojto 93:e188a91d3eaa 1715 #define FTFL_FPROT0_PROT_MASK 0xFFu
Kojto 93:e188a91d3eaa 1716 #define FTFL_FPROT0_PROT_SHIFT 0
Kojto 93:e188a91d3eaa 1717 #define FTFL_FPROT0_PROT(x) (((uint8_t)(((uint8_t)(x))<<FTFL_FPROT0_PROT_SHIFT))&FTFL_FPROT0_PROT_MASK)
Kojto 93:e188a91d3eaa 1718 /* FEPROT Bit Fields */
Kojto 93:e188a91d3eaa 1719 #define FTFL_FEPROT_EPROT_MASK 0xFFu
Kojto 93:e188a91d3eaa 1720 #define FTFL_FEPROT_EPROT_SHIFT 0
Kojto 93:e188a91d3eaa 1721 #define FTFL_FEPROT_EPROT(x) (((uint8_t)(((uint8_t)(x))<<FTFL_FEPROT_EPROT_SHIFT))&FTFL_FEPROT_EPROT_MASK)
Kojto 93:e188a91d3eaa 1722 /* FDPROT Bit Fields */
Kojto 93:e188a91d3eaa 1723 #define FTFL_FDPROT_DPROT_MASK 0xFFu
Kojto 93:e188a91d3eaa 1724 #define FTFL_FDPROT_DPROT_SHIFT 0
Kojto 93:e188a91d3eaa 1725 #define FTFL_FDPROT_DPROT(x) (((uint8_t)(((uint8_t)(x))<<FTFL_FDPROT_DPROT_SHIFT))&FTFL_FDPROT_DPROT_MASK)
Kojto 93:e188a91d3eaa 1726
Kojto 93:e188a91d3eaa 1727 /**
Kojto 93:e188a91d3eaa 1728 * @}
Kojto 93:e188a91d3eaa 1729 */ /* end of group FTFL_Register_Masks */
Kojto 93:e188a91d3eaa 1730
Kojto 93:e188a91d3eaa 1731
Kojto 93:e188a91d3eaa 1732 /* FTFL - Peripheral instance base addresses */
Kojto 93:e188a91d3eaa 1733 /** Peripheral FTFL base address */
Kojto 93:e188a91d3eaa 1734 #define FTFL_BASE (0x40020000u)
Kojto 93:e188a91d3eaa 1735 /** Peripheral FTFL base pointer */
Kojto 93:e188a91d3eaa 1736 #define FTFL ((FTFL_Type *)FTFL_BASE)
Kojto 93:e188a91d3eaa 1737
Kojto 93:e188a91d3eaa 1738 /**
Kojto 93:e188a91d3eaa 1739 * @}
Kojto 93:e188a91d3eaa 1740 */ /* end of group FTFL_Peripheral_Access_Layer */
Kojto 93:e188a91d3eaa 1741
Kojto 93:e188a91d3eaa 1742
Kojto 93:e188a91d3eaa 1743 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 1744 -- FTM Peripheral Access Layer
Kojto 93:e188a91d3eaa 1745 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 1746
Kojto 93:e188a91d3eaa 1747 /**
Kojto 93:e188a91d3eaa 1748 * @addtogroup FTM_Peripheral_Access_Layer FTM Peripheral Access Layer
Kojto 93:e188a91d3eaa 1749 * @{
Kojto 93:e188a91d3eaa 1750 */
Kojto 93:e188a91d3eaa 1751
Kojto 93:e188a91d3eaa 1752 /** FTM - Register Layout Typedef */
Kojto 93:e188a91d3eaa 1753 typedef struct {
Kojto 93:e188a91d3eaa 1754 __IO uint32_t SC; /**< Status and Control, offset: 0x0 */
Kojto 93:e188a91d3eaa 1755 __IO uint32_t CNT; /**< Counter, offset: 0x4 */
Kojto 93:e188a91d3eaa 1756 __IO uint32_t MOD; /**< Modulo, offset: 0x8 */
Kojto 93:e188a91d3eaa 1757 struct { /* offset: 0xC, array step: 0x8 */
Kojto 93:e188a91d3eaa 1758 __IO uint32_t CnSC; /**< Channel (n) Status and Control, array offset: 0xC, array step: 0x8 */
Kojto 93:e188a91d3eaa 1759 __IO uint32_t CnV; /**< Channel (n) Value, array offset: 0x10, array step: 0x8 */
Kojto 93:e188a91d3eaa 1760 } CONTROLS[8];
Kojto 93:e188a91d3eaa 1761 __IO uint32_t CNTIN; /**< Counter Initial Value, offset: 0x4C */
Kojto 93:e188a91d3eaa 1762 __I uint32_t STATUS; /**< Capture and Compare Status, offset: 0x50 */
Kojto 93:e188a91d3eaa 1763 __IO uint32_t MODE; /**< Features Mode Selection, offset: 0x54 */
Kojto 93:e188a91d3eaa 1764 __IO uint32_t SYNC; /**< Synchronization, offset: 0x58 */
Kojto 93:e188a91d3eaa 1765 __IO uint32_t OUTINIT; /**< Initial State for Channels Output, offset: 0x5C */
Kojto 93:e188a91d3eaa 1766 __IO uint32_t OUTMASK; /**< Output Mask, offset: 0x60 */
Kojto 93:e188a91d3eaa 1767 __IO uint32_t COMBINE; /**< Function for Linked Channels, offset: 0x64 */
Kojto 93:e188a91d3eaa 1768 __IO uint32_t DEADTIME; /**< Deadtime Insertion Control, offset: 0x68 */
Kojto 93:e188a91d3eaa 1769 __IO uint32_t EXTTRIG; /**< FTM External Trigger, offset: 0x6C */
Kojto 93:e188a91d3eaa 1770 __IO uint32_t POL; /**< Channels Polarity, offset: 0x70 */
Kojto 93:e188a91d3eaa 1771 __IO uint32_t FMS; /**< Fault Mode Status, offset: 0x74 */
Kojto 93:e188a91d3eaa 1772 __IO uint32_t FILTER; /**< Input Capture Filter Control, offset: 0x78 */
Kojto 93:e188a91d3eaa 1773 __IO uint32_t FLTCTRL; /**< Fault Control, offset: 0x7C */
Kojto 93:e188a91d3eaa 1774 __IO uint32_t QDCTRL; /**< Quadrature Decoder Control and Status, offset: 0x80 */
Kojto 93:e188a91d3eaa 1775 __IO uint32_t CONF; /**< Configuration, offset: 0x84 */
Kojto 93:e188a91d3eaa 1776 __IO uint32_t FLTPOL; /**< FTM Fault Input Polarity, offset: 0x88 */
Kojto 93:e188a91d3eaa 1777 __IO uint32_t SYNCONF; /**< Synchronization Configuration, offset: 0x8C */
Kojto 93:e188a91d3eaa 1778 __IO uint32_t INVCTRL; /**< FTM Inverting Control, offset: 0x90 */
Kojto 93:e188a91d3eaa 1779 __IO uint32_t SWOCTRL; /**< FTM Software Output Control, offset: 0x94 */
Kojto 93:e188a91d3eaa 1780 __IO uint32_t PWMLOAD; /**< FTM PWM Load, offset: 0x98 */
Kojto 93:e188a91d3eaa 1781 } FTM_Type;
Kojto 93:e188a91d3eaa 1782
Kojto 93:e188a91d3eaa 1783 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 1784 -- FTM Register Masks
Kojto 93:e188a91d3eaa 1785 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 1786
Kojto 93:e188a91d3eaa 1787 /**
Kojto 93:e188a91d3eaa 1788 * @addtogroup FTM_Register_Masks FTM Register Masks
Kojto 93:e188a91d3eaa 1789 * @{
Kojto 93:e188a91d3eaa 1790 */
Kojto 93:e188a91d3eaa 1791
Kojto 93:e188a91d3eaa 1792 /* SC Bit Fields */
Kojto 93:e188a91d3eaa 1793 #define FTM_SC_PS_MASK 0x7u
Kojto 93:e188a91d3eaa 1794 #define FTM_SC_PS_SHIFT 0
Kojto 93:e188a91d3eaa 1795 #define FTM_SC_PS(x) (((uint32_t)(((uint32_t)(x))<<FTM_SC_PS_SHIFT))&FTM_SC_PS_MASK)
Kojto 93:e188a91d3eaa 1796 #define FTM_SC_CLKS_MASK 0x18u
Kojto 93:e188a91d3eaa 1797 #define FTM_SC_CLKS_SHIFT 3
Kojto 93:e188a91d3eaa 1798 #define FTM_SC_CLKS(x) (((uint32_t)(((uint32_t)(x))<<FTM_SC_CLKS_SHIFT))&FTM_SC_CLKS_MASK)
Kojto 93:e188a91d3eaa 1799 #define FTM_SC_CPWMS_MASK 0x20u
Kojto 93:e188a91d3eaa 1800 #define FTM_SC_CPWMS_SHIFT 5
Kojto 93:e188a91d3eaa 1801 #define FTM_SC_TOIE_MASK 0x40u
Kojto 93:e188a91d3eaa 1802 #define FTM_SC_TOIE_SHIFT 6
Kojto 93:e188a91d3eaa 1803 #define FTM_SC_TOF_MASK 0x80u
Kojto 93:e188a91d3eaa 1804 #define FTM_SC_TOF_SHIFT 7
Kojto 93:e188a91d3eaa 1805 /* CNT Bit Fields */
Kojto 93:e188a91d3eaa 1806 #define FTM_CNT_COUNT_MASK 0xFFFFu
Kojto 93:e188a91d3eaa 1807 #define FTM_CNT_COUNT_SHIFT 0
Kojto 93:e188a91d3eaa 1808 #define FTM_CNT_COUNT(x) (((uint32_t)(((uint32_t)(x))<<FTM_CNT_COUNT_SHIFT))&FTM_CNT_COUNT_MASK)
Kojto 93:e188a91d3eaa 1809 /* MOD Bit Fields */
Kojto 93:e188a91d3eaa 1810 #define FTM_MOD_MOD_MASK 0xFFFFu
Kojto 93:e188a91d3eaa 1811 #define FTM_MOD_MOD_SHIFT 0
Kojto 93:e188a91d3eaa 1812 #define FTM_MOD_MOD(x) (((uint32_t)(((uint32_t)(x))<<FTM_MOD_MOD_SHIFT))&FTM_MOD_MOD_MASK)
Kojto 93:e188a91d3eaa 1813 /* CnSC Bit Fields */
Kojto 93:e188a91d3eaa 1814 #define FTM_CnSC_DMA_MASK 0x1u
Kojto 93:e188a91d3eaa 1815 #define FTM_CnSC_DMA_SHIFT 0
Kojto 93:e188a91d3eaa 1816 #define FTM_CnSC_ELSA_MASK 0x4u
Kojto 93:e188a91d3eaa 1817 #define FTM_CnSC_ELSA_SHIFT 2
Kojto 93:e188a91d3eaa 1818 #define FTM_CnSC_ELSB_MASK 0x8u
Kojto 93:e188a91d3eaa 1819 #define FTM_CnSC_ELSB_SHIFT 3
Kojto 93:e188a91d3eaa 1820 #define FTM_CnSC_MSA_MASK 0x10u
Kojto 93:e188a91d3eaa 1821 #define FTM_CnSC_MSA_SHIFT 4
Kojto 93:e188a91d3eaa 1822 #define FTM_CnSC_MSB_MASK 0x20u
Kojto 93:e188a91d3eaa 1823 #define FTM_CnSC_MSB_SHIFT 5
Kojto 93:e188a91d3eaa 1824 #define FTM_CnSC_CHIE_MASK 0x40u
Kojto 93:e188a91d3eaa 1825 #define FTM_CnSC_CHIE_SHIFT 6
Kojto 93:e188a91d3eaa 1826 #define FTM_CnSC_CHF_MASK 0x80u
Kojto 93:e188a91d3eaa 1827 #define FTM_CnSC_CHF_SHIFT 7
Kojto 93:e188a91d3eaa 1828 /* CnV Bit Fields */
Kojto 93:e188a91d3eaa 1829 #define FTM_CnV_VAL_MASK 0xFFFFu
Kojto 93:e188a91d3eaa 1830 #define FTM_CnV_VAL_SHIFT 0
Kojto 93:e188a91d3eaa 1831 #define FTM_CnV_VAL(x) (((uint32_t)(((uint32_t)(x))<<FTM_CnV_VAL_SHIFT))&FTM_CnV_VAL_MASK)
Kojto 93:e188a91d3eaa 1832 /* CNTIN Bit Fields */
Kojto 93:e188a91d3eaa 1833 #define FTM_CNTIN_INIT_MASK 0xFFFFu
Kojto 93:e188a91d3eaa 1834 #define FTM_CNTIN_INIT_SHIFT 0
Kojto 93:e188a91d3eaa 1835 #define FTM_CNTIN_INIT(x) (((uint32_t)(((uint32_t)(x))<<FTM_CNTIN_INIT_SHIFT))&FTM_CNTIN_INIT_MASK)
Kojto 93:e188a91d3eaa 1836 /* STATUS Bit Fields */
Kojto 93:e188a91d3eaa 1837 #define FTM_STATUS_CH0F_MASK 0x1u
Kojto 93:e188a91d3eaa 1838 #define FTM_STATUS_CH0F_SHIFT 0
Kojto 93:e188a91d3eaa 1839 #define FTM_STATUS_CH1F_MASK 0x2u
Kojto 93:e188a91d3eaa 1840 #define FTM_STATUS_CH1F_SHIFT 1
Kojto 93:e188a91d3eaa 1841 #define FTM_STATUS_CH2F_MASK 0x4u
Kojto 93:e188a91d3eaa 1842 #define FTM_STATUS_CH2F_SHIFT 2
Kojto 93:e188a91d3eaa 1843 #define FTM_STATUS_CH3F_MASK 0x8u
Kojto 93:e188a91d3eaa 1844 #define FTM_STATUS_CH3F_SHIFT 3
Kojto 93:e188a91d3eaa 1845 #define FTM_STATUS_CH4F_MASK 0x10u
Kojto 93:e188a91d3eaa 1846 #define FTM_STATUS_CH4F_SHIFT 4
Kojto 93:e188a91d3eaa 1847 #define FTM_STATUS_CH5F_MASK 0x20u
Kojto 93:e188a91d3eaa 1848 #define FTM_STATUS_CH5F_SHIFT 5
Kojto 93:e188a91d3eaa 1849 #define FTM_STATUS_CH6F_MASK 0x40u
Kojto 93:e188a91d3eaa 1850 #define FTM_STATUS_CH6F_SHIFT 6
Kojto 93:e188a91d3eaa 1851 #define FTM_STATUS_CH7F_MASK 0x80u
Kojto 93:e188a91d3eaa 1852 #define FTM_STATUS_CH7F_SHIFT 7
Kojto 93:e188a91d3eaa 1853 /* MODE Bit Fields */
Kojto 93:e188a91d3eaa 1854 #define FTM_MODE_FTMEN_MASK 0x1u
Kojto 93:e188a91d3eaa 1855 #define FTM_MODE_FTMEN_SHIFT 0
Kojto 93:e188a91d3eaa 1856 #define FTM_MODE_INIT_MASK 0x2u
Kojto 93:e188a91d3eaa 1857 #define FTM_MODE_INIT_SHIFT 1
Kojto 93:e188a91d3eaa 1858 #define FTM_MODE_WPDIS_MASK 0x4u
Kojto 93:e188a91d3eaa 1859 #define FTM_MODE_WPDIS_SHIFT 2
Kojto 93:e188a91d3eaa 1860 #define FTM_MODE_PWMSYNC_MASK 0x8u
Kojto 93:e188a91d3eaa 1861 #define FTM_MODE_PWMSYNC_SHIFT 3
Kojto 93:e188a91d3eaa 1862 #define FTM_MODE_CAPTEST_MASK 0x10u
Kojto 93:e188a91d3eaa 1863 #define FTM_MODE_CAPTEST_SHIFT 4
Kojto 93:e188a91d3eaa 1864 #define FTM_MODE_FAULTM_MASK 0x60u
Kojto 93:e188a91d3eaa 1865 #define FTM_MODE_FAULTM_SHIFT 5
Kojto 93:e188a91d3eaa 1866 #define FTM_MODE_FAULTM(x) (((uint32_t)(((uint32_t)(x))<<FTM_MODE_FAULTM_SHIFT))&FTM_MODE_FAULTM_MASK)
Kojto 93:e188a91d3eaa 1867 #define FTM_MODE_FAULTIE_MASK 0x80u
Kojto 93:e188a91d3eaa 1868 #define FTM_MODE_FAULTIE_SHIFT 7
Kojto 93:e188a91d3eaa 1869 /* SYNC Bit Fields */
Kojto 93:e188a91d3eaa 1870 #define FTM_SYNC_CNTMIN_MASK 0x1u
Kojto 93:e188a91d3eaa 1871 #define FTM_SYNC_CNTMIN_SHIFT 0
Kojto 93:e188a91d3eaa 1872 #define FTM_SYNC_CNTMAX_MASK 0x2u
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Kojto 93:e188a91d3eaa 1903 /* OUTMASK Bit Fields */
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Kojto 93:e188a91d3eaa 1915 #define FTM_OUTMASK_CH5OM_SHIFT 5
Kojto 93:e188a91d3eaa 1916 #define FTM_OUTMASK_CH6OM_MASK 0x40u
Kojto 93:e188a91d3eaa 1917 #define FTM_OUTMASK_CH6OM_SHIFT 6
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Kojto 93:e188a91d3eaa 1920 /* COMBINE Bit Fields */
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Kojto 93:e188a91d3eaa 1923 #define FTM_COMBINE_COMP0_MASK 0x2u
Kojto 93:e188a91d3eaa 1924 #define FTM_COMBINE_COMP0_SHIFT 1
Kojto 93:e188a91d3eaa 1925 #define FTM_COMBINE_DECAPEN0_MASK 0x4u
Kojto 93:e188a91d3eaa 1926 #define FTM_COMBINE_DECAPEN0_SHIFT 2
Kojto 93:e188a91d3eaa 1927 #define FTM_COMBINE_DECAP0_MASK 0x8u
Kojto 93:e188a91d3eaa 1928 #define FTM_COMBINE_DECAP0_SHIFT 3
Kojto 93:e188a91d3eaa 1929 #define FTM_COMBINE_DTEN0_MASK 0x10u
Kojto 93:e188a91d3eaa 1930 #define FTM_COMBINE_DTEN0_SHIFT 4
Kojto 93:e188a91d3eaa 1931 #define FTM_COMBINE_SYNCEN0_MASK 0x20u
Kojto 93:e188a91d3eaa 1932 #define FTM_COMBINE_SYNCEN0_SHIFT 5
Kojto 93:e188a91d3eaa 1933 #define FTM_COMBINE_FAULTEN0_MASK 0x40u
Kojto 93:e188a91d3eaa 1934 #define FTM_COMBINE_FAULTEN0_SHIFT 6
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Kojto 93:e188a91d3eaa 1937 #define FTM_COMBINE_COMP1_MASK 0x200u
Kojto 93:e188a91d3eaa 1938 #define FTM_COMBINE_COMP1_SHIFT 9
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Kojto 93:e188a91d3eaa 1942 #define FTM_COMBINE_DECAP1_SHIFT 11
Kojto 93:e188a91d3eaa 1943 #define FTM_COMBINE_DTEN1_MASK 0x1000u
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Kojto 93:e188a91d3eaa 1945 #define FTM_COMBINE_SYNCEN1_MASK 0x2000u
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Kojto 93:e188a91d3eaa 1949 #define FTM_COMBINE_COMBINE2_MASK 0x10000u
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Kojto 93:e188a91d3eaa 1972 #define FTM_COMBINE_DTEN3_SHIFT 28
Kojto 93:e188a91d3eaa 1973 #define FTM_COMBINE_SYNCEN3_MASK 0x20000000u
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Kojto 93:e188a91d3eaa 1975 #define FTM_COMBINE_FAULTEN3_MASK 0x40000000u
Kojto 93:e188a91d3eaa 1976 #define FTM_COMBINE_FAULTEN3_SHIFT 30
Kojto 93:e188a91d3eaa 1977 /* DEADTIME Bit Fields */
Kojto 93:e188a91d3eaa 1978 #define FTM_DEADTIME_DTVAL_MASK 0x3Fu
Kojto 93:e188a91d3eaa 1979 #define FTM_DEADTIME_DTVAL_SHIFT 0
Kojto 93:e188a91d3eaa 1980 #define FTM_DEADTIME_DTVAL(x) (((uint32_t)(((uint32_t)(x))<<FTM_DEADTIME_DTVAL_SHIFT))&FTM_DEADTIME_DTVAL_MASK)
Kojto 93:e188a91d3eaa 1981 #define FTM_DEADTIME_DTPS_MASK 0xC0u
Kojto 93:e188a91d3eaa 1982 #define FTM_DEADTIME_DTPS_SHIFT 6
Kojto 93:e188a91d3eaa 1983 #define FTM_DEADTIME_DTPS(x) (((uint32_t)(((uint32_t)(x))<<FTM_DEADTIME_DTPS_SHIFT))&FTM_DEADTIME_DTPS_MASK)
Kojto 93:e188a91d3eaa 1984 /* EXTTRIG Bit Fields */
Kojto 93:e188a91d3eaa 1985 #define FTM_EXTTRIG_CH2TRIG_MASK 0x1u
Kojto 93:e188a91d3eaa 1986 #define FTM_EXTTRIG_CH2TRIG_SHIFT 0
Kojto 93:e188a91d3eaa 1987 #define FTM_EXTTRIG_CH3TRIG_MASK 0x2u
Kojto 93:e188a91d3eaa 1988 #define FTM_EXTTRIG_CH3TRIG_SHIFT 1
Kojto 93:e188a91d3eaa 1989 #define FTM_EXTTRIG_CH4TRIG_MASK 0x4u
Kojto 93:e188a91d3eaa 1990 #define FTM_EXTTRIG_CH4TRIG_SHIFT 2
Kojto 93:e188a91d3eaa 1991 #define FTM_EXTTRIG_CH5TRIG_MASK 0x8u
Kojto 93:e188a91d3eaa 1992 #define FTM_EXTTRIG_CH5TRIG_SHIFT 3
Kojto 93:e188a91d3eaa 1993 #define FTM_EXTTRIG_CH0TRIG_MASK 0x10u
Kojto 93:e188a91d3eaa 1994 #define FTM_EXTTRIG_CH0TRIG_SHIFT 4
Kojto 93:e188a91d3eaa 1995 #define FTM_EXTTRIG_CH1TRIG_MASK 0x20u
Kojto 93:e188a91d3eaa 1996 #define FTM_EXTTRIG_CH1TRIG_SHIFT 5
Kojto 93:e188a91d3eaa 1997 #define FTM_EXTTRIG_INITTRIGEN_MASK 0x40u
Kojto 93:e188a91d3eaa 1998 #define FTM_EXTTRIG_INITTRIGEN_SHIFT 6
Kojto 93:e188a91d3eaa 1999 #define FTM_EXTTRIG_TRIGF_MASK 0x80u
Kojto 93:e188a91d3eaa 2000 #define FTM_EXTTRIG_TRIGF_SHIFT 7
Kojto 93:e188a91d3eaa 2001 /* POL Bit Fields */
Kojto 93:e188a91d3eaa 2002 #define FTM_POL_POL0_MASK 0x1u
Kojto 93:e188a91d3eaa 2003 #define FTM_POL_POL0_SHIFT 0
Kojto 93:e188a91d3eaa 2004 #define FTM_POL_POL1_MASK 0x2u
Kojto 93:e188a91d3eaa 2005 #define FTM_POL_POL1_SHIFT 1
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Kojto 93:e188a91d3eaa 2007 #define FTM_POL_POL2_SHIFT 2
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Kojto 93:e188a91d3eaa 2009 #define FTM_POL_POL3_SHIFT 3
Kojto 93:e188a91d3eaa 2010 #define FTM_POL_POL4_MASK 0x10u
Kojto 93:e188a91d3eaa 2011 #define FTM_POL_POL4_SHIFT 4
Kojto 93:e188a91d3eaa 2012 #define FTM_POL_POL5_MASK 0x20u
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Kojto 93:e188a91d3eaa 2014 #define FTM_POL_POL6_MASK 0x40u
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Kojto 93:e188a91d3eaa 2017 #define FTM_POL_POL7_SHIFT 7
Kojto 93:e188a91d3eaa 2018 /* FMS Bit Fields */
Kojto 93:e188a91d3eaa 2019 #define FTM_FMS_FAULTF0_MASK 0x1u
Kojto 93:e188a91d3eaa 2020 #define FTM_FMS_FAULTF0_SHIFT 0
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Kojto 93:e188a91d3eaa 2022 #define FTM_FMS_FAULTF1_SHIFT 1
Kojto 93:e188a91d3eaa 2023 #define FTM_FMS_FAULTF2_MASK 0x4u
Kojto 93:e188a91d3eaa 2024 #define FTM_FMS_FAULTF2_SHIFT 2
Kojto 93:e188a91d3eaa 2025 #define FTM_FMS_FAULTF3_MASK 0x8u
Kojto 93:e188a91d3eaa 2026 #define FTM_FMS_FAULTF3_SHIFT 3
Kojto 93:e188a91d3eaa 2027 #define FTM_FMS_FAULTIN_MASK 0x20u
Kojto 93:e188a91d3eaa 2028 #define FTM_FMS_FAULTIN_SHIFT 5
Kojto 93:e188a91d3eaa 2029 #define FTM_FMS_WPEN_MASK 0x40u
Kojto 93:e188a91d3eaa 2030 #define FTM_FMS_WPEN_SHIFT 6
Kojto 93:e188a91d3eaa 2031 #define FTM_FMS_FAULTF_MASK 0x80u
Kojto 93:e188a91d3eaa 2032 #define FTM_FMS_FAULTF_SHIFT 7
Kojto 93:e188a91d3eaa 2033 /* FILTER Bit Fields */
Kojto 93:e188a91d3eaa 2034 #define FTM_FILTER_CH0FVAL_MASK 0xFu
Kojto 93:e188a91d3eaa 2035 #define FTM_FILTER_CH0FVAL_SHIFT 0
Kojto 93:e188a91d3eaa 2036 #define FTM_FILTER_CH0FVAL(x) (((uint32_t)(((uint32_t)(x))<<FTM_FILTER_CH0FVAL_SHIFT))&FTM_FILTER_CH0FVAL_MASK)
Kojto 93:e188a91d3eaa 2037 #define FTM_FILTER_CH1FVAL_MASK 0xF0u
Kojto 93:e188a91d3eaa 2038 #define FTM_FILTER_CH1FVAL_SHIFT 4
Kojto 93:e188a91d3eaa 2039 #define FTM_FILTER_CH1FVAL(x) (((uint32_t)(((uint32_t)(x))<<FTM_FILTER_CH1FVAL_SHIFT))&FTM_FILTER_CH1FVAL_MASK)
Kojto 93:e188a91d3eaa 2040 #define FTM_FILTER_CH2FVAL_MASK 0xF00u
Kojto 93:e188a91d3eaa 2041 #define FTM_FILTER_CH2FVAL_SHIFT 8
Kojto 93:e188a91d3eaa 2042 #define FTM_FILTER_CH2FVAL(x) (((uint32_t)(((uint32_t)(x))<<FTM_FILTER_CH2FVAL_SHIFT))&FTM_FILTER_CH2FVAL_MASK)
Kojto 93:e188a91d3eaa 2043 #define FTM_FILTER_CH3FVAL_MASK 0xF000u
Kojto 93:e188a91d3eaa 2044 #define FTM_FILTER_CH3FVAL_SHIFT 12
Kojto 93:e188a91d3eaa 2045 #define FTM_FILTER_CH3FVAL(x) (((uint32_t)(((uint32_t)(x))<<FTM_FILTER_CH3FVAL_SHIFT))&FTM_FILTER_CH3FVAL_MASK)
Kojto 93:e188a91d3eaa 2046 /* FLTCTRL Bit Fields */
Kojto 93:e188a91d3eaa 2047 #define FTM_FLTCTRL_FAULT0EN_MASK 0x1u
Kojto 93:e188a91d3eaa 2048 #define FTM_FLTCTRL_FAULT0EN_SHIFT 0
Kojto 93:e188a91d3eaa 2049 #define FTM_FLTCTRL_FAULT1EN_MASK 0x2u
Kojto 93:e188a91d3eaa 2050 #define FTM_FLTCTRL_FAULT1EN_SHIFT 1
Kojto 93:e188a91d3eaa 2051 #define FTM_FLTCTRL_FAULT2EN_MASK 0x4u
Kojto 93:e188a91d3eaa 2052 #define FTM_FLTCTRL_FAULT2EN_SHIFT 2
Kojto 93:e188a91d3eaa 2053 #define FTM_FLTCTRL_FAULT3EN_MASK 0x8u
Kojto 93:e188a91d3eaa 2054 #define FTM_FLTCTRL_FAULT3EN_SHIFT 3
Kojto 93:e188a91d3eaa 2055 #define FTM_FLTCTRL_FFLTR0EN_MASK 0x10u
Kojto 93:e188a91d3eaa 2056 #define FTM_FLTCTRL_FFLTR0EN_SHIFT 4
Kojto 93:e188a91d3eaa 2057 #define FTM_FLTCTRL_FFLTR1EN_MASK 0x20u
Kojto 93:e188a91d3eaa 2058 #define FTM_FLTCTRL_FFLTR1EN_SHIFT 5
Kojto 93:e188a91d3eaa 2059 #define FTM_FLTCTRL_FFLTR2EN_MASK 0x40u
Kojto 93:e188a91d3eaa 2060 #define FTM_FLTCTRL_FFLTR2EN_SHIFT 6
Kojto 93:e188a91d3eaa 2061 #define FTM_FLTCTRL_FFLTR3EN_MASK 0x80u
Kojto 93:e188a91d3eaa 2062 #define FTM_FLTCTRL_FFLTR3EN_SHIFT 7
Kojto 93:e188a91d3eaa 2063 #define FTM_FLTCTRL_FFVAL_MASK 0xF00u
Kojto 93:e188a91d3eaa 2064 #define FTM_FLTCTRL_FFVAL_SHIFT 8
Kojto 93:e188a91d3eaa 2065 #define FTM_FLTCTRL_FFVAL(x) (((uint32_t)(((uint32_t)(x))<<FTM_FLTCTRL_FFVAL_SHIFT))&FTM_FLTCTRL_FFVAL_MASK)
Kojto 93:e188a91d3eaa 2066 /* QDCTRL Bit Fields */
Kojto 93:e188a91d3eaa 2067 #define FTM_QDCTRL_QUADEN_MASK 0x1u
Kojto 93:e188a91d3eaa 2068 #define FTM_QDCTRL_QUADEN_SHIFT 0
Kojto 93:e188a91d3eaa 2069 #define FTM_QDCTRL_TOFDIR_MASK 0x2u
Kojto 93:e188a91d3eaa 2070 #define FTM_QDCTRL_TOFDIR_SHIFT 1
Kojto 93:e188a91d3eaa 2071 #define FTM_QDCTRL_QUADIR_MASK 0x4u
Kojto 93:e188a91d3eaa 2072 #define FTM_QDCTRL_QUADIR_SHIFT 2
Kojto 93:e188a91d3eaa 2073 #define FTM_QDCTRL_QUADMODE_MASK 0x8u
Kojto 93:e188a91d3eaa 2074 #define FTM_QDCTRL_QUADMODE_SHIFT 3
Kojto 93:e188a91d3eaa 2075 #define FTM_QDCTRL_PHBPOL_MASK 0x10u
Kojto 93:e188a91d3eaa 2076 #define FTM_QDCTRL_PHBPOL_SHIFT 4
Kojto 93:e188a91d3eaa 2077 #define FTM_QDCTRL_PHAPOL_MASK 0x20u
Kojto 93:e188a91d3eaa 2078 #define FTM_QDCTRL_PHAPOL_SHIFT 5
Kojto 93:e188a91d3eaa 2079 #define FTM_QDCTRL_PHBFLTREN_MASK 0x40u
Kojto 93:e188a91d3eaa 2080 #define FTM_QDCTRL_PHBFLTREN_SHIFT 6
Kojto 93:e188a91d3eaa 2081 #define FTM_QDCTRL_PHAFLTREN_MASK 0x80u
Kojto 93:e188a91d3eaa 2082 #define FTM_QDCTRL_PHAFLTREN_SHIFT 7
Kojto 93:e188a91d3eaa 2083 /* CONF Bit Fields */
Kojto 93:e188a91d3eaa 2084 #define FTM_CONF_NUMTOF_MASK 0x1Fu
Kojto 93:e188a91d3eaa 2085 #define FTM_CONF_NUMTOF_SHIFT 0
Kojto 93:e188a91d3eaa 2086 #define FTM_CONF_NUMTOF(x) (((uint32_t)(((uint32_t)(x))<<FTM_CONF_NUMTOF_SHIFT))&FTM_CONF_NUMTOF_MASK)
Kojto 93:e188a91d3eaa 2087 #define FTM_CONF_BDMMODE_MASK 0xC0u
Kojto 93:e188a91d3eaa 2088 #define FTM_CONF_BDMMODE_SHIFT 6
Kojto 93:e188a91d3eaa 2089 #define FTM_CONF_BDMMODE(x) (((uint32_t)(((uint32_t)(x))<<FTM_CONF_BDMMODE_SHIFT))&FTM_CONF_BDMMODE_MASK)
Kojto 93:e188a91d3eaa 2090 #define FTM_CONF_GTBEEN_MASK 0x200u
Kojto 93:e188a91d3eaa 2091 #define FTM_CONF_GTBEEN_SHIFT 9
Kojto 93:e188a91d3eaa 2092 #define FTM_CONF_GTBEOUT_MASK 0x400u
Kojto 93:e188a91d3eaa 2093 #define FTM_CONF_GTBEOUT_SHIFT 10
Kojto 93:e188a91d3eaa 2094 /* FLTPOL Bit Fields */
Kojto 93:e188a91d3eaa 2095 #define FTM_FLTPOL_FLT0POL_MASK 0x1u
Kojto 93:e188a91d3eaa 2096 #define FTM_FLTPOL_FLT0POL_SHIFT 0
Kojto 93:e188a91d3eaa 2097 #define FTM_FLTPOL_FLT1POL_MASK 0x2u
Kojto 93:e188a91d3eaa 2098 #define FTM_FLTPOL_FLT1POL_SHIFT 1
Kojto 93:e188a91d3eaa 2099 #define FTM_FLTPOL_FLT2POL_MASK 0x4u
Kojto 93:e188a91d3eaa 2100 #define FTM_FLTPOL_FLT2POL_SHIFT 2
Kojto 93:e188a91d3eaa 2101 #define FTM_FLTPOL_FLT3POL_MASK 0x8u
Kojto 93:e188a91d3eaa 2102 #define FTM_FLTPOL_FLT3POL_SHIFT 3
Kojto 93:e188a91d3eaa 2103 /* SYNCONF Bit Fields */
Kojto 93:e188a91d3eaa 2104 #define FTM_SYNCONF_HWTRIGMODE_MASK 0x1u
Kojto 93:e188a91d3eaa 2105 #define FTM_SYNCONF_HWTRIGMODE_SHIFT 0
Kojto 93:e188a91d3eaa 2106 #define FTM_SYNCONF_CNTINC_MASK 0x4u
Kojto 93:e188a91d3eaa 2107 #define FTM_SYNCONF_CNTINC_SHIFT 2
Kojto 93:e188a91d3eaa 2108 #define FTM_SYNCONF_INVC_MASK 0x10u
Kojto 93:e188a91d3eaa 2109 #define FTM_SYNCONF_INVC_SHIFT 4
Kojto 93:e188a91d3eaa 2110 #define FTM_SYNCONF_SWOC_MASK 0x20u
Kojto 93:e188a91d3eaa 2111 #define FTM_SYNCONF_SWOC_SHIFT 5
Kojto 93:e188a91d3eaa 2112 #define FTM_SYNCONF_SYNCMODE_MASK 0x80u
Kojto 93:e188a91d3eaa 2113 #define FTM_SYNCONF_SYNCMODE_SHIFT 7
Kojto 93:e188a91d3eaa 2114 #define FTM_SYNCONF_SWRSTCNT_MASK 0x100u
Kojto 93:e188a91d3eaa 2115 #define FTM_SYNCONF_SWRSTCNT_SHIFT 8
Kojto 93:e188a91d3eaa 2116 #define FTM_SYNCONF_SWWRBUF_MASK 0x200u
Kojto 93:e188a91d3eaa 2117 #define FTM_SYNCONF_SWWRBUF_SHIFT 9
Kojto 93:e188a91d3eaa 2118 #define FTM_SYNCONF_SWOM_MASK 0x400u
Kojto 93:e188a91d3eaa 2119 #define FTM_SYNCONF_SWOM_SHIFT 10
Kojto 93:e188a91d3eaa 2120 #define FTM_SYNCONF_SWINVC_MASK 0x800u
Kojto 93:e188a91d3eaa 2121 #define FTM_SYNCONF_SWINVC_SHIFT 11
Kojto 93:e188a91d3eaa 2122 #define FTM_SYNCONF_SWSOC_MASK 0x1000u
Kojto 93:e188a91d3eaa 2123 #define FTM_SYNCONF_SWSOC_SHIFT 12
Kojto 93:e188a91d3eaa 2124 #define FTM_SYNCONF_HWRSTCNT_MASK 0x10000u
Kojto 93:e188a91d3eaa 2125 #define FTM_SYNCONF_HWRSTCNT_SHIFT 16
Kojto 93:e188a91d3eaa 2126 #define FTM_SYNCONF_HWWRBUF_MASK 0x20000u
Kojto 93:e188a91d3eaa 2127 #define FTM_SYNCONF_HWWRBUF_SHIFT 17
Kojto 93:e188a91d3eaa 2128 #define FTM_SYNCONF_HWOM_MASK 0x40000u
Kojto 93:e188a91d3eaa 2129 #define FTM_SYNCONF_HWOM_SHIFT 18
Kojto 93:e188a91d3eaa 2130 #define FTM_SYNCONF_HWINVC_MASK 0x80000u
Kojto 93:e188a91d3eaa 2131 #define FTM_SYNCONF_HWINVC_SHIFT 19
Kojto 93:e188a91d3eaa 2132 #define FTM_SYNCONF_HWSOC_MASK 0x100000u
Kojto 93:e188a91d3eaa 2133 #define FTM_SYNCONF_HWSOC_SHIFT 20
Kojto 93:e188a91d3eaa 2134 /* INVCTRL Bit Fields */
Kojto 93:e188a91d3eaa 2135 #define FTM_INVCTRL_INV0EN_MASK 0x1u
Kojto 93:e188a91d3eaa 2136 #define FTM_INVCTRL_INV0EN_SHIFT 0
Kojto 93:e188a91d3eaa 2137 #define FTM_INVCTRL_INV1EN_MASK 0x2u
Kojto 93:e188a91d3eaa 2138 #define FTM_INVCTRL_INV1EN_SHIFT 1
Kojto 93:e188a91d3eaa 2139 #define FTM_INVCTRL_INV2EN_MASK 0x4u
Kojto 93:e188a91d3eaa 2140 #define FTM_INVCTRL_INV2EN_SHIFT 2
Kojto 93:e188a91d3eaa 2141 #define FTM_INVCTRL_INV3EN_MASK 0x8u
Kojto 93:e188a91d3eaa 2142 #define FTM_INVCTRL_INV3EN_SHIFT 3
Kojto 93:e188a91d3eaa 2143 /* SWOCTRL Bit Fields */
Kojto 93:e188a91d3eaa 2144 #define FTM_SWOCTRL_CH0OC_MASK 0x1u
Kojto 93:e188a91d3eaa 2145 #define FTM_SWOCTRL_CH0OC_SHIFT 0
Kojto 93:e188a91d3eaa 2146 #define FTM_SWOCTRL_CH1OC_MASK 0x2u
Kojto 93:e188a91d3eaa 2147 #define FTM_SWOCTRL_CH1OC_SHIFT 1
Kojto 93:e188a91d3eaa 2148 #define FTM_SWOCTRL_CH2OC_MASK 0x4u
Kojto 93:e188a91d3eaa 2149 #define FTM_SWOCTRL_CH2OC_SHIFT 2
Kojto 93:e188a91d3eaa 2150 #define FTM_SWOCTRL_CH3OC_MASK 0x8u
Kojto 93:e188a91d3eaa 2151 #define FTM_SWOCTRL_CH3OC_SHIFT 3
Kojto 93:e188a91d3eaa 2152 #define FTM_SWOCTRL_CH4OC_MASK 0x10u
Kojto 93:e188a91d3eaa 2153 #define FTM_SWOCTRL_CH4OC_SHIFT 4
Kojto 93:e188a91d3eaa 2154 #define FTM_SWOCTRL_CH5OC_MASK 0x20u
Kojto 93:e188a91d3eaa 2155 #define FTM_SWOCTRL_CH5OC_SHIFT 5
Kojto 93:e188a91d3eaa 2156 #define FTM_SWOCTRL_CH6OC_MASK 0x40u
Kojto 93:e188a91d3eaa 2157 #define FTM_SWOCTRL_CH6OC_SHIFT 6
Kojto 93:e188a91d3eaa 2158 #define FTM_SWOCTRL_CH7OC_MASK 0x80u
Kojto 93:e188a91d3eaa 2159 #define FTM_SWOCTRL_CH7OC_SHIFT 7
Kojto 93:e188a91d3eaa 2160 #define FTM_SWOCTRL_CH0OCV_MASK 0x100u
Kojto 93:e188a91d3eaa 2161 #define FTM_SWOCTRL_CH0OCV_SHIFT 8
Kojto 93:e188a91d3eaa 2162 #define FTM_SWOCTRL_CH1OCV_MASK 0x200u
Kojto 93:e188a91d3eaa 2163 #define FTM_SWOCTRL_CH1OCV_SHIFT 9
Kojto 93:e188a91d3eaa 2164 #define FTM_SWOCTRL_CH2OCV_MASK 0x400u
Kojto 93:e188a91d3eaa 2165 #define FTM_SWOCTRL_CH2OCV_SHIFT 10
Kojto 93:e188a91d3eaa 2166 #define FTM_SWOCTRL_CH3OCV_MASK 0x800u
Kojto 93:e188a91d3eaa 2167 #define FTM_SWOCTRL_CH3OCV_SHIFT 11
Kojto 93:e188a91d3eaa 2168 #define FTM_SWOCTRL_CH4OCV_MASK 0x1000u
Kojto 93:e188a91d3eaa 2169 #define FTM_SWOCTRL_CH4OCV_SHIFT 12
Kojto 93:e188a91d3eaa 2170 #define FTM_SWOCTRL_CH5OCV_MASK 0x2000u
Kojto 93:e188a91d3eaa 2171 #define FTM_SWOCTRL_CH5OCV_SHIFT 13
Kojto 93:e188a91d3eaa 2172 #define FTM_SWOCTRL_CH6OCV_MASK 0x4000u
Kojto 93:e188a91d3eaa 2173 #define FTM_SWOCTRL_CH6OCV_SHIFT 14
Kojto 93:e188a91d3eaa 2174 #define FTM_SWOCTRL_CH7OCV_MASK 0x8000u
Kojto 93:e188a91d3eaa 2175 #define FTM_SWOCTRL_CH7OCV_SHIFT 15
Kojto 93:e188a91d3eaa 2176 /* PWMLOAD Bit Fields */
Kojto 93:e188a91d3eaa 2177 #define FTM_PWMLOAD_CH0SEL_MASK 0x1u
Kojto 93:e188a91d3eaa 2178 #define FTM_PWMLOAD_CH0SEL_SHIFT 0
Kojto 93:e188a91d3eaa 2179 #define FTM_PWMLOAD_CH1SEL_MASK 0x2u
Kojto 93:e188a91d3eaa 2180 #define FTM_PWMLOAD_CH1SEL_SHIFT 1
Kojto 93:e188a91d3eaa 2181 #define FTM_PWMLOAD_CH2SEL_MASK 0x4u
Kojto 93:e188a91d3eaa 2182 #define FTM_PWMLOAD_CH2SEL_SHIFT 2
Kojto 93:e188a91d3eaa 2183 #define FTM_PWMLOAD_CH3SEL_MASK 0x8u
Kojto 93:e188a91d3eaa 2184 #define FTM_PWMLOAD_CH3SEL_SHIFT 3
Kojto 93:e188a91d3eaa 2185 #define FTM_PWMLOAD_CH4SEL_MASK 0x10u
Kojto 93:e188a91d3eaa 2186 #define FTM_PWMLOAD_CH4SEL_SHIFT 4
Kojto 93:e188a91d3eaa 2187 #define FTM_PWMLOAD_CH5SEL_MASK 0x20u
Kojto 93:e188a91d3eaa 2188 #define FTM_PWMLOAD_CH5SEL_SHIFT 5
Kojto 93:e188a91d3eaa 2189 #define FTM_PWMLOAD_CH6SEL_MASK 0x40u
Kojto 93:e188a91d3eaa 2190 #define FTM_PWMLOAD_CH6SEL_SHIFT 6
Kojto 93:e188a91d3eaa 2191 #define FTM_PWMLOAD_CH7SEL_MASK 0x80u
Kojto 93:e188a91d3eaa 2192 #define FTM_PWMLOAD_CH7SEL_SHIFT 7
Kojto 93:e188a91d3eaa 2193 #define FTM_PWMLOAD_LDOK_MASK 0x200u
Kojto 93:e188a91d3eaa 2194 #define FTM_PWMLOAD_LDOK_SHIFT 9
Kojto 93:e188a91d3eaa 2195
Kojto 93:e188a91d3eaa 2196 /**
Kojto 93:e188a91d3eaa 2197 * @}
Kojto 93:e188a91d3eaa 2198 */ /* end of group FTM_Register_Masks */
Kojto 93:e188a91d3eaa 2199
Kojto 93:e188a91d3eaa 2200
Kojto 93:e188a91d3eaa 2201 /* FTM - Peripheral instance base addresses */
Kojto 93:e188a91d3eaa 2202 /** Peripheral FTM0 base address */
Kojto 93:e188a91d3eaa 2203 #define FTM0_BASE (0x40038000u)
Kojto 93:e188a91d3eaa 2204 /** Peripheral FTM0 base pointer */
Kojto 93:e188a91d3eaa 2205 #define FTM0 ((FTM_Type *)FTM0_BASE)
Kojto 93:e188a91d3eaa 2206 /** Peripheral FTM1 base address */
Kojto 93:e188a91d3eaa 2207 #define FTM1_BASE (0x40039000u)
Kojto 93:e188a91d3eaa 2208 /** Peripheral FTM1 base pointer */
Kojto 93:e188a91d3eaa 2209 #define FTM1 ((FTM_Type *)FTM1_BASE)
Kojto 93:e188a91d3eaa 2210
Kojto 93:e188a91d3eaa 2211 /**
Kojto 93:e188a91d3eaa 2212 * @}
Kojto 93:e188a91d3eaa 2213 */ /* end of group FTM_Peripheral_Access_Layer */
Kojto 93:e188a91d3eaa 2214
Kojto 93:e188a91d3eaa 2215
Kojto 93:e188a91d3eaa 2216 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 2217 -- GPIO Peripheral Access Layer
Kojto 93:e188a91d3eaa 2218 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 2219
Kojto 93:e188a91d3eaa 2220 /**
Kojto 93:e188a91d3eaa 2221 * @addtogroup GPIO_Peripheral_Access_Layer GPIO Peripheral Access Layer
Kojto 93:e188a91d3eaa 2222 * @{
Kojto 93:e188a91d3eaa 2223 */
Kojto 93:e188a91d3eaa 2224
Kojto 93:e188a91d3eaa 2225 /** GPIO - Register Layout Typedef */
Kojto 93:e188a91d3eaa 2226 typedef struct {
Kojto 93:e188a91d3eaa 2227 __IO uint32_t PDOR; /**< Port Data Output Register, offset: 0x0 */
Kojto 93:e188a91d3eaa 2228 __O uint32_t PSOR; /**< Port Set Output Register, offset: 0x4 */
Kojto 93:e188a91d3eaa 2229 __O uint32_t PCOR; /**< Port Clear Output Register, offset: 0x8 */
Kojto 93:e188a91d3eaa 2230 __O uint32_t PTOR; /**< Port Toggle Output Register, offset: 0xC */
Kojto 93:e188a91d3eaa 2231 __I uint32_t PDIR; /**< Port Data Input Register, offset: 0x10 */
Kojto 93:e188a91d3eaa 2232 __IO uint32_t PDDR; /**< Port Data Direction Register, offset: 0x14 */
Kojto 93:e188a91d3eaa 2233 } GPIO_Type;
Kojto 93:e188a91d3eaa 2234
Kojto 93:e188a91d3eaa 2235 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 2236 -- GPIO Register Masks
Kojto 93:e188a91d3eaa 2237 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 2238
Kojto 93:e188a91d3eaa 2239 /**
Kojto 93:e188a91d3eaa 2240 * @addtogroup GPIO_Register_Masks GPIO Register Masks
Kojto 93:e188a91d3eaa 2241 * @{
Kojto 93:e188a91d3eaa 2242 */
Kojto 93:e188a91d3eaa 2243
Kojto 93:e188a91d3eaa 2244 /* PDOR Bit Fields */
Kojto 93:e188a91d3eaa 2245 #define GPIO_PDOR_PDO_MASK 0xFFFFFFFFu
Kojto 93:e188a91d3eaa 2246 #define GPIO_PDOR_PDO_SHIFT 0
Kojto 93:e188a91d3eaa 2247 #define GPIO_PDOR_PDO(x) (((uint32_t)(((uint32_t)(x))<<GPIO_PDOR_PDO_SHIFT))&GPIO_PDOR_PDO_MASK)
Kojto 93:e188a91d3eaa 2248 /* PSOR Bit Fields */
Kojto 93:e188a91d3eaa 2249 #define GPIO_PSOR_PTSO_MASK 0xFFFFFFFFu
Kojto 93:e188a91d3eaa 2250 #define GPIO_PSOR_PTSO_SHIFT 0
Kojto 93:e188a91d3eaa 2251 #define GPIO_PSOR_PTSO(x) (((uint32_t)(((uint32_t)(x))<<GPIO_PSOR_PTSO_SHIFT))&GPIO_PSOR_PTSO_MASK)
Kojto 93:e188a91d3eaa 2252 /* PCOR Bit Fields */
Kojto 93:e188a91d3eaa 2253 #define GPIO_PCOR_PTCO_MASK 0xFFFFFFFFu
Kojto 93:e188a91d3eaa 2254 #define GPIO_PCOR_PTCO_SHIFT 0
Kojto 93:e188a91d3eaa 2255 #define GPIO_PCOR_PTCO(x) (((uint32_t)(((uint32_t)(x))<<GPIO_PCOR_PTCO_SHIFT))&GPIO_PCOR_PTCO_MASK)
Kojto 93:e188a91d3eaa 2256 /* PTOR Bit Fields */
Kojto 93:e188a91d3eaa 2257 #define GPIO_PTOR_PTTO_MASK 0xFFFFFFFFu
Kojto 93:e188a91d3eaa 2258 #define GPIO_PTOR_PTTO_SHIFT 0
Kojto 93:e188a91d3eaa 2259 #define GPIO_PTOR_PTTO(x) (((uint32_t)(((uint32_t)(x))<<GPIO_PTOR_PTTO_SHIFT))&GPIO_PTOR_PTTO_MASK)
Kojto 93:e188a91d3eaa 2260 /* PDIR Bit Fields */
Kojto 93:e188a91d3eaa 2261 #define GPIO_PDIR_PDI_MASK 0xFFFFFFFFu
Kojto 93:e188a91d3eaa 2262 #define GPIO_PDIR_PDI_SHIFT 0
Kojto 93:e188a91d3eaa 2263 #define GPIO_PDIR_PDI(x) (((uint32_t)(((uint32_t)(x))<<GPIO_PDIR_PDI_SHIFT))&GPIO_PDIR_PDI_MASK)
Kojto 93:e188a91d3eaa 2264 /* PDDR Bit Fields */
Kojto 93:e188a91d3eaa 2265 #define GPIO_PDDR_PDD_MASK 0xFFFFFFFFu
Kojto 93:e188a91d3eaa 2266 #define GPIO_PDDR_PDD_SHIFT 0
Kojto 93:e188a91d3eaa 2267 #define GPIO_PDDR_PDD(x) (((uint32_t)(((uint32_t)(x))<<GPIO_PDDR_PDD_SHIFT))&GPIO_PDDR_PDD_MASK)
Kojto 93:e188a91d3eaa 2268
Kojto 93:e188a91d3eaa 2269 /**
Kojto 93:e188a91d3eaa 2270 * @}
Kojto 93:e188a91d3eaa 2271 */ /* end of group GPIO_Register_Masks */
Kojto 93:e188a91d3eaa 2272
Kojto 93:e188a91d3eaa 2273
Kojto 93:e188a91d3eaa 2274 /* GPIO - Peripheral instance base addresses */
Kojto 93:e188a91d3eaa 2275 /** Peripheral PTA base address */
Kojto 93:e188a91d3eaa 2276 #define PTA_BASE (0x400FF000u)
Kojto 93:e188a91d3eaa 2277 /** Peripheral PTA base pointer */
Kojto 93:e188a91d3eaa 2278 #define PTA ((GPIO_Type *)PTA_BASE)
Kojto 93:e188a91d3eaa 2279 /** Peripheral PTB base address */
Kojto 93:e188a91d3eaa 2280 #define PTB_BASE (0x400FF040u)
Kojto 93:e188a91d3eaa 2281 /** Peripheral PTB base pointer */
Kojto 93:e188a91d3eaa 2282 #define PTB ((GPIO_Type *)PTB_BASE)
Kojto 93:e188a91d3eaa 2283 /** Peripheral PTC base address */
Kojto 93:e188a91d3eaa 2284 #define PTC_BASE (0x400FF080u)
Kojto 93:e188a91d3eaa 2285 /** Peripheral PTC base pointer */
Kojto 93:e188a91d3eaa 2286 #define PTC ((GPIO_Type *)PTC_BASE)
Kojto 93:e188a91d3eaa 2287 /** Peripheral PTD base address */
Kojto 93:e188a91d3eaa 2288 #define PTD_BASE (0x400FF0C0u)
Kojto 93:e188a91d3eaa 2289 /** Peripheral PTD base pointer */
Kojto 93:e188a91d3eaa 2290 #define PTD ((GPIO_Type *)PTD_BASE)
Kojto 93:e188a91d3eaa 2291 /** Peripheral PTE base address */
Kojto 93:e188a91d3eaa 2292 #define PTE_BASE (0x400FF100u)
Kojto 93:e188a91d3eaa 2293 /** Peripheral PTE base pointer */
Kojto 93:e188a91d3eaa 2294 #define PTE ((GPIO_Type *)PTE_BASE)
Kojto 93:e188a91d3eaa 2295
Kojto 93:e188a91d3eaa 2296 /**
Kojto 93:e188a91d3eaa 2297 * @}
Kojto 93:e188a91d3eaa 2298 */ /* end of group GPIO_Peripheral_Access_Layer */
Kojto 93:e188a91d3eaa 2299
Kojto 93:e188a91d3eaa 2300
Kojto 93:e188a91d3eaa 2301 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 2302 -- I2C Peripheral Access Layer
Kojto 93:e188a91d3eaa 2303 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 2304
Kojto 93:e188a91d3eaa 2305 /**
Kojto 93:e188a91d3eaa 2306 * @addtogroup I2C_Peripheral_Access_Layer I2C Peripheral Access Layer
Kojto 93:e188a91d3eaa 2307 * @{
Kojto 93:e188a91d3eaa 2308 */
Kojto 93:e188a91d3eaa 2309
Kojto 93:e188a91d3eaa 2310 /** I2C - Register Layout Typedef */
Kojto 93:e188a91d3eaa 2311 typedef struct {
Kojto 93:e188a91d3eaa 2312 __IO uint8_t A1; /**< I2C Address Register 1, offset: 0x0 */
Kojto 93:e188a91d3eaa 2313 __IO uint8_t F; /**< I2C Frequency Divider register, offset: 0x1 */
Kojto 93:e188a91d3eaa 2314 __IO uint8_t C1; /**< I2C Control Register 1, offset: 0x2 */
Kojto 93:e188a91d3eaa 2315 __IO uint8_t S; /**< I2C Status Register, offset: 0x3 */
Kojto 93:e188a91d3eaa 2316 __IO uint8_t D; /**< I2C Data I/O register, offset: 0x4 */
Kojto 93:e188a91d3eaa 2317 __IO uint8_t C2; /**< I2C Control Register 2, offset: 0x5 */
Kojto 93:e188a91d3eaa 2318 __IO uint8_t FLT; /**< I2C Programmable Input Glitch Filter register, offset: 0x6 */
Kojto 93:e188a91d3eaa 2319 __IO uint8_t RA; /**< I2C Range Address register, offset: 0x7 */
Kojto 93:e188a91d3eaa 2320 __IO uint8_t SMB; /**< I2C SMBus Control and Status register, offset: 0x8 */
Kojto 93:e188a91d3eaa 2321 __IO uint8_t A2; /**< I2C Address Register 2, offset: 0x9 */
Kojto 93:e188a91d3eaa 2322 __IO uint8_t SLTH; /**< I2C SCL Low Timeout Register High, offset: 0xA */
Kojto 93:e188a91d3eaa 2323 __IO uint8_t SLTL; /**< I2C SCL Low Timeout Register Low, offset: 0xB */
Kojto 93:e188a91d3eaa 2324 } I2C_Type;
Kojto 93:e188a91d3eaa 2325
Kojto 93:e188a91d3eaa 2326 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 2327 -- I2C Register Masks
Kojto 93:e188a91d3eaa 2328 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 2329
Kojto 93:e188a91d3eaa 2330 /**
Kojto 93:e188a91d3eaa 2331 * @addtogroup I2C_Register_Masks I2C Register Masks
Kojto 93:e188a91d3eaa 2332 * @{
Kojto 93:e188a91d3eaa 2333 */
Kojto 93:e188a91d3eaa 2334
Kojto 93:e188a91d3eaa 2335 /* A1 Bit Fields */
Kojto 93:e188a91d3eaa 2336 #define I2C_A1_AD_MASK 0xFEu
Kojto 93:e188a91d3eaa 2337 #define I2C_A1_AD_SHIFT 1
Kojto 93:e188a91d3eaa 2338 #define I2C_A1_AD(x) (((uint8_t)(((uint8_t)(x))<<I2C_A1_AD_SHIFT))&I2C_A1_AD_MASK)
Kojto 93:e188a91d3eaa 2339 /* F Bit Fields */
Kojto 93:e188a91d3eaa 2340 #define I2C_F_ICR_MASK 0x3Fu
Kojto 93:e188a91d3eaa 2341 #define I2C_F_ICR_SHIFT 0
Kojto 93:e188a91d3eaa 2342 #define I2C_F_ICR(x) (((uint8_t)(((uint8_t)(x))<<I2C_F_ICR_SHIFT))&I2C_F_ICR_MASK)
Kojto 93:e188a91d3eaa 2343 #define I2C_F_MULT_MASK 0xC0u
Kojto 93:e188a91d3eaa 2344 #define I2C_F_MULT_SHIFT 6
Kojto 93:e188a91d3eaa 2345 #define I2C_F_MULT(x) (((uint8_t)(((uint8_t)(x))<<I2C_F_MULT_SHIFT))&I2C_F_MULT_MASK)
Kojto 93:e188a91d3eaa 2346 /* C1 Bit Fields */
Kojto 93:e188a91d3eaa 2347 #define I2C_C1_DMAEN_MASK 0x1u
Kojto 93:e188a91d3eaa 2348 #define I2C_C1_DMAEN_SHIFT 0
Kojto 93:e188a91d3eaa 2349 #define I2C_C1_WUEN_MASK 0x2u
Kojto 93:e188a91d3eaa 2350 #define I2C_C1_WUEN_SHIFT 1
Kojto 93:e188a91d3eaa 2351 #define I2C_C1_RSTA_MASK 0x4u
Kojto 93:e188a91d3eaa 2352 #define I2C_C1_RSTA_SHIFT 2
Kojto 93:e188a91d3eaa 2353 #define I2C_C1_TXAK_MASK 0x8u
Kojto 93:e188a91d3eaa 2354 #define I2C_C1_TXAK_SHIFT 3
Kojto 93:e188a91d3eaa 2355 #define I2C_C1_TX_MASK 0x10u
Kojto 93:e188a91d3eaa 2356 #define I2C_C1_TX_SHIFT 4
Kojto 93:e188a91d3eaa 2357 #define I2C_C1_MST_MASK 0x20u
Kojto 93:e188a91d3eaa 2358 #define I2C_C1_MST_SHIFT 5
Kojto 93:e188a91d3eaa 2359 #define I2C_C1_IICIE_MASK 0x40u
Kojto 93:e188a91d3eaa 2360 #define I2C_C1_IICIE_SHIFT 6
Kojto 93:e188a91d3eaa 2361 #define I2C_C1_IICEN_MASK 0x80u
Kojto 93:e188a91d3eaa 2362 #define I2C_C1_IICEN_SHIFT 7
Kojto 93:e188a91d3eaa 2363 /* S Bit Fields */
Kojto 93:e188a91d3eaa 2364 #define I2C_S_RXAK_MASK 0x1u
Kojto 93:e188a91d3eaa 2365 #define I2C_S_RXAK_SHIFT 0
Kojto 93:e188a91d3eaa 2366 #define I2C_S_IICIF_MASK 0x2u
Kojto 93:e188a91d3eaa 2367 #define I2C_S_IICIF_SHIFT 1
Kojto 93:e188a91d3eaa 2368 #define I2C_S_SRW_MASK 0x4u
Kojto 93:e188a91d3eaa 2369 #define I2C_S_SRW_SHIFT 2
Kojto 93:e188a91d3eaa 2370 #define I2C_S_RAM_MASK 0x8u
Kojto 93:e188a91d3eaa 2371 #define I2C_S_RAM_SHIFT 3
Kojto 93:e188a91d3eaa 2372 #define I2C_S_ARBL_MASK 0x10u
Kojto 93:e188a91d3eaa 2373 #define I2C_S_ARBL_SHIFT 4
Kojto 93:e188a91d3eaa 2374 #define I2C_S_BUSY_MASK 0x20u
Kojto 93:e188a91d3eaa 2375 #define I2C_S_BUSY_SHIFT 5
Kojto 93:e188a91d3eaa 2376 #define I2C_S_IAAS_MASK 0x40u
Kojto 93:e188a91d3eaa 2377 #define I2C_S_IAAS_SHIFT 6
Kojto 93:e188a91d3eaa 2378 #define I2C_S_TCF_MASK 0x80u
Kojto 93:e188a91d3eaa 2379 #define I2C_S_TCF_SHIFT 7
Kojto 93:e188a91d3eaa 2380 /* D Bit Fields */
Kojto 93:e188a91d3eaa 2381 #define I2C_D_DATA_MASK 0xFFu
Kojto 93:e188a91d3eaa 2382 #define I2C_D_DATA_SHIFT 0
Kojto 93:e188a91d3eaa 2383 #define I2C_D_DATA(x) (((uint8_t)(((uint8_t)(x))<<I2C_D_DATA_SHIFT))&I2C_D_DATA_MASK)
Kojto 93:e188a91d3eaa 2384 /* C2 Bit Fields */
Kojto 93:e188a91d3eaa 2385 #define I2C_C2_AD_MASK 0x7u
Kojto 93:e188a91d3eaa 2386 #define I2C_C2_AD_SHIFT 0
Kojto 93:e188a91d3eaa 2387 #define I2C_C2_AD(x) (((uint8_t)(((uint8_t)(x))<<I2C_C2_AD_SHIFT))&I2C_C2_AD_MASK)
Kojto 93:e188a91d3eaa 2388 #define I2C_C2_RMEN_MASK 0x8u
Kojto 93:e188a91d3eaa 2389 #define I2C_C2_RMEN_SHIFT 3
Kojto 93:e188a91d3eaa 2390 #define I2C_C2_SBRC_MASK 0x10u
Kojto 93:e188a91d3eaa 2391 #define I2C_C2_SBRC_SHIFT 4
Kojto 93:e188a91d3eaa 2392 #define I2C_C2_HDRS_MASK 0x20u
Kojto 93:e188a91d3eaa 2393 #define I2C_C2_HDRS_SHIFT 5
Kojto 93:e188a91d3eaa 2394 #define I2C_C2_ADEXT_MASK 0x40u
Kojto 93:e188a91d3eaa 2395 #define I2C_C2_ADEXT_SHIFT 6
Kojto 93:e188a91d3eaa 2396 #define I2C_C2_GCAEN_MASK 0x80u
Kojto 93:e188a91d3eaa 2397 #define I2C_C2_GCAEN_SHIFT 7
Kojto 93:e188a91d3eaa 2398 /* FLT Bit Fields */
Kojto 93:e188a91d3eaa 2399 #define I2C_FLT_FLT_MASK 0x1Fu
Kojto 93:e188a91d3eaa 2400 #define I2C_FLT_FLT_SHIFT 0
Kojto 93:e188a91d3eaa 2401 #define I2C_FLT_FLT(x) (((uint8_t)(((uint8_t)(x))<<I2C_FLT_FLT_SHIFT))&I2C_FLT_FLT_MASK)
Kojto 93:e188a91d3eaa 2402 /* RA Bit Fields */
Kojto 93:e188a91d3eaa 2403 #define I2C_RA_RAD_MASK 0xFEu
Kojto 93:e188a91d3eaa 2404 #define I2C_RA_RAD_SHIFT 1
Kojto 93:e188a91d3eaa 2405 #define I2C_RA_RAD(x) (((uint8_t)(((uint8_t)(x))<<I2C_RA_RAD_SHIFT))&I2C_RA_RAD_MASK)
Kojto 93:e188a91d3eaa 2406 /* SMB Bit Fields */
Kojto 93:e188a91d3eaa 2407 #define I2C_SMB_SHTF2IE_MASK 0x1u
Kojto 93:e188a91d3eaa 2408 #define I2C_SMB_SHTF2IE_SHIFT 0
Kojto 93:e188a91d3eaa 2409 #define I2C_SMB_SHTF2_MASK 0x2u
Kojto 93:e188a91d3eaa 2410 #define I2C_SMB_SHTF2_SHIFT 1
Kojto 93:e188a91d3eaa 2411 #define I2C_SMB_SHTF1_MASK 0x4u
Kojto 93:e188a91d3eaa 2412 #define I2C_SMB_SHTF1_SHIFT 2
Kojto 93:e188a91d3eaa 2413 #define I2C_SMB_SLTF_MASK 0x8u
Kojto 93:e188a91d3eaa 2414 #define I2C_SMB_SLTF_SHIFT 3
Kojto 93:e188a91d3eaa 2415 #define I2C_SMB_TCKSEL_MASK 0x10u
Kojto 93:e188a91d3eaa 2416 #define I2C_SMB_TCKSEL_SHIFT 4
Kojto 93:e188a91d3eaa 2417 #define I2C_SMB_SIICAEN_MASK 0x20u
Kojto 93:e188a91d3eaa 2418 #define I2C_SMB_SIICAEN_SHIFT 5
Kojto 93:e188a91d3eaa 2419 #define I2C_SMB_ALERTEN_MASK 0x40u
Kojto 93:e188a91d3eaa 2420 #define I2C_SMB_ALERTEN_SHIFT 6
Kojto 93:e188a91d3eaa 2421 #define I2C_SMB_FACK_MASK 0x80u
Kojto 93:e188a91d3eaa 2422 #define I2C_SMB_FACK_SHIFT 7
Kojto 93:e188a91d3eaa 2423 /* A2 Bit Fields */
Kojto 93:e188a91d3eaa 2424 #define I2C_A2_SAD_MASK 0xFEu
Kojto 93:e188a91d3eaa 2425 #define I2C_A2_SAD_SHIFT 1
Kojto 93:e188a91d3eaa 2426 #define I2C_A2_SAD(x) (((uint8_t)(((uint8_t)(x))<<I2C_A2_SAD_SHIFT))&I2C_A2_SAD_MASK)
Kojto 93:e188a91d3eaa 2427 /* SLTH Bit Fields */
Kojto 93:e188a91d3eaa 2428 #define I2C_SLTH_SSLT_MASK 0xFFu
Kojto 93:e188a91d3eaa 2429 #define I2C_SLTH_SSLT_SHIFT 0
Kojto 93:e188a91d3eaa 2430 #define I2C_SLTH_SSLT(x) (((uint8_t)(((uint8_t)(x))<<I2C_SLTH_SSLT_SHIFT))&I2C_SLTH_SSLT_MASK)
Kojto 93:e188a91d3eaa 2431 /* SLTL Bit Fields */
Kojto 93:e188a91d3eaa 2432 #define I2C_SLTL_SSLT_MASK 0xFFu
Kojto 93:e188a91d3eaa 2433 #define I2C_SLTL_SSLT_SHIFT 0
Kojto 93:e188a91d3eaa 2434 #define I2C_SLTL_SSLT(x) (((uint8_t)(((uint8_t)(x))<<I2C_SLTL_SSLT_SHIFT))&I2C_SLTL_SSLT_MASK)
Kojto 93:e188a91d3eaa 2435
Kojto 93:e188a91d3eaa 2436 /**
Kojto 93:e188a91d3eaa 2437 * @}
Kojto 93:e188a91d3eaa 2438 */ /* end of group I2C_Register_Masks */
Kojto 93:e188a91d3eaa 2439
Kojto 93:e188a91d3eaa 2440
Kojto 93:e188a91d3eaa 2441 /* I2C - Peripheral instance base addresses */
Kojto 93:e188a91d3eaa 2442 /** Peripheral I2C0 base address */
Kojto 93:e188a91d3eaa 2443 #define I2C0_BASE (0x40066000u)
Kojto 93:e188a91d3eaa 2444 #define I2C1_BASE (0x40067000u)
Kojto 93:e188a91d3eaa 2445 /** Peripheral I2C0 base pointer */
Kojto 93:e188a91d3eaa 2446 #define I2C0 ((I2C_Type *)I2C0_BASE)
Kojto 93:e188a91d3eaa 2447 #define I2C1 ((I2C_Type *)I2C1_BASE)
Kojto 93:e188a91d3eaa 2448 /**
Kojto 93:e188a91d3eaa 2449 * @}
Kojto 93:e188a91d3eaa 2450 */ /* end of group I2C_Peripheral_Access_Layer */
Kojto 93:e188a91d3eaa 2451
Kojto 93:e188a91d3eaa 2452
Kojto 93:e188a91d3eaa 2453 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 2454 -- I2S Peripheral Access Layer
Kojto 93:e188a91d3eaa 2455 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 2456
Kojto 93:e188a91d3eaa 2457 /**
Kojto 93:e188a91d3eaa 2458 * @addtogroup I2S_Peripheral_Access_Layer I2S Peripheral Access Layer
Kojto 93:e188a91d3eaa 2459 * @{
Kojto 93:e188a91d3eaa 2460 */
Kojto 93:e188a91d3eaa 2461
Kojto 93:e188a91d3eaa 2462 /** I2S - Register Layout Typedef */
Kojto 93:e188a91d3eaa 2463 typedef struct {
Kojto 93:e188a91d3eaa 2464 __IO uint32_t TCSR; /**< SAI Transmit Control Register, offset: 0x0 */
Kojto 93:e188a91d3eaa 2465 __IO uint32_t TCR1; /**< SAI Transmit Configuration 1 Register, offset: 0x4 */
Kojto 93:e188a91d3eaa 2466 __IO uint32_t TCR2; /**< SAI Transmit Configuration 2 Register, offset: 0x8 */
Kojto 93:e188a91d3eaa 2467 __IO uint32_t TCR3; /**< SAI Transmit Configuration 3 Register, offset: 0xC */
Kojto 93:e188a91d3eaa 2468 __IO uint32_t TCR4; /**< SAI Transmit Configuration 4 Register, offset: 0x10 */
Kojto 93:e188a91d3eaa 2469 __IO uint32_t TCR5; /**< SAI Transmit Configuration 5 Register, offset: 0x14 */
Kojto 93:e188a91d3eaa 2470 uint8_t RESERVED_0[8];
Kojto 93:e188a91d3eaa 2471 __O uint32_t TDR[2]; /**< SAI Transmit Data Register, array offset: 0x20, array step: 0x4 */
Kojto 93:e188a91d3eaa 2472 uint8_t RESERVED_1[24];
Kojto 93:e188a91d3eaa 2473 __I uint32_t TFR[2]; /**< SAI Transmit FIFO Register, array offset: 0x40, array step: 0x4 */
Kojto 93:e188a91d3eaa 2474 uint8_t RESERVED_2[24];
Kojto 93:e188a91d3eaa 2475 __IO uint32_t TMR; /**< SAI Transmit Mask Register, offset: 0x60 */
Kojto 93:e188a91d3eaa 2476 uint8_t RESERVED_3[28];
Kojto 93:e188a91d3eaa 2477 __IO uint32_t RCSR; /**< SAI Receive Control Register, offset: 0x80 */
Kojto 93:e188a91d3eaa 2478 __IO uint32_t RCR1; /**< SAI Receive Configuration 1 Register, offset: 0x84 */
Kojto 93:e188a91d3eaa 2479 __IO uint32_t RCR2; /**< SAI Receive Configuration 2 Register, offset: 0x88 */
Kojto 93:e188a91d3eaa 2480 __IO uint32_t RCR3; /**< SAI Receive Configuration 3 Register, offset: 0x8C */
Kojto 93:e188a91d3eaa 2481 __IO uint32_t RCR4; /**< SAI Receive Configuration 4 Register, offset: 0x90 */
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Kojto 93:e188a91d3eaa 2543 #define I2S_TCR1_TFW(x) (((uint32_t)(((uint32_t)(x))<<I2S_TCR1_TFW_SHIFT))&I2S_TCR1_TFW_MASK)
Kojto 93:e188a91d3eaa 2544 /* TCR2 Bit Fields */
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Kojto 93:e188a91d3eaa 2547 #define I2S_TCR2_DIV(x) (((uint32_t)(((uint32_t)(x))<<I2S_TCR2_DIV_SHIFT))&I2S_TCR2_DIV_MASK)
Kojto 93:e188a91d3eaa 2548 #define I2S_TCR2_BCD_MASK 0x1000000u
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Kojto 93:e188a91d3eaa 2550 #define I2S_TCR2_BCP_MASK 0x2000000u
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Kojto 93:e188a91d3eaa 2553 #define I2S_TCR2_MSEL_SHIFT 26
Kojto 93:e188a91d3eaa 2554 #define I2S_TCR2_MSEL(x) (((uint32_t)(((uint32_t)(x))<<I2S_TCR2_MSEL_SHIFT))&I2S_TCR2_MSEL_MASK)
Kojto 93:e188a91d3eaa 2555 #define I2S_TCR2_BCI_MASK 0x10000000u
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Kojto 93:e188a91d3eaa 2560 #define I2S_TCR2_SYNC_SHIFT 30
Kojto 93:e188a91d3eaa 2561 #define I2S_TCR2_SYNC(x) (((uint32_t)(((uint32_t)(x))<<I2S_TCR2_SYNC_SHIFT))&I2S_TCR2_SYNC_MASK)
Kojto 93:e188a91d3eaa 2562 /* TCR3 Bit Fields */
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Kojto 93:e188a91d3eaa 2564 #define I2S_TCR3_WDFL_SHIFT 0
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Kojto 93:e188a91d3eaa 2566 #define I2S_TCR3_TCE_MASK 0x30000u
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Kojto 93:e188a91d3eaa 2569 /* TCR4 Bit Fields */
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Kojto 93:e188a91d3eaa 2575 #define I2S_TCR4_FSE_SHIFT 3
Kojto 93:e188a91d3eaa 2576 #define I2S_TCR4_MF_MASK 0x10u
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Kojto 93:e188a91d3eaa 2580 #define I2S_TCR4_SYWD(x) (((uint32_t)(((uint32_t)(x))<<I2S_TCR4_SYWD_SHIFT))&I2S_TCR4_SYWD_MASK)
Kojto 93:e188a91d3eaa 2581 #define I2S_TCR4_FRSZ_MASK 0x1F0000u
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Kojto 93:e188a91d3eaa 2584 /* TCR5 Bit Fields */
Kojto 93:e188a91d3eaa 2585 #define I2S_TCR5_FBT_MASK 0x1F00u
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Kojto 93:e188a91d3eaa 2587 #define I2S_TCR5_FBT(x) (((uint32_t)(((uint32_t)(x))<<I2S_TCR5_FBT_SHIFT))&I2S_TCR5_FBT_MASK)
Kojto 93:e188a91d3eaa 2588 #define I2S_TCR5_W0W_MASK 0x1F0000u
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Kojto 93:e188a91d3eaa 2591 #define I2S_TCR5_WNW_MASK 0x1F000000u
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Kojto 93:e188a91d3eaa 2594 /* TDR Bit Fields */
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Kojto 93:e188a91d3eaa 2598 /* TFR Bit Fields */
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Kojto 93:e188a91d3eaa 2601 #define I2S_TFR_RFP(x) (((uint32_t)(((uint32_t)(x))<<I2S_TFR_RFP_SHIFT))&I2S_TFR_RFP_MASK)
Kojto 93:e188a91d3eaa 2602 #define I2S_TFR_WFP_MASK 0xF0000u
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Kojto 93:e188a91d3eaa 2605 /* TMR Bit Fields */
Kojto 93:e188a91d3eaa 2606 #define I2S_TMR_TWM_MASK 0xFFFFFFFFu
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Kojto 93:e188a91d3eaa 2609 /* RCSR Bit Fields */
Kojto 93:e188a91d3eaa 2610 #define I2S_RCSR_FRDE_MASK 0x1u
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Kojto 93:e188a91d3eaa 2644 #define I2S_RCSR_RE_MASK 0x80000000u
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Kojto 93:e188a91d3eaa 2646 /* RCR1 Bit Fields */
Kojto 93:e188a91d3eaa 2647 #define I2S_RCR1_RFW_MASK 0x7u
Kojto 93:e188a91d3eaa 2648 #define I2S_RCR1_RFW_SHIFT 0
Kojto 93:e188a91d3eaa 2649 #define I2S_RCR1_RFW(x) (((uint32_t)(((uint32_t)(x))<<I2S_RCR1_RFW_SHIFT))&I2S_RCR1_RFW_MASK)
Kojto 93:e188a91d3eaa 2650 /* RCR2 Bit Fields */
Kojto 93:e188a91d3eaa 2651 #define I2S_RCR2_DIV_MASK 0xFFu
Kojto 93:e188a91d3eaa 2652 #define I2S_RCR2_DIV_SHIFT 0
Kojto 93:e188a91d3eaa 2653 #define I2S_RCR2_DIV(x) (((uint32_t)(((uint32_t)(x))<<I2S_RCR2_DIV_SHIFT))&I2S_RCR2_DIV_MASK)
Kojto 93:e188a91d3eaa 2654 #define I2S_RCR2_BCD_MASK 0x1000000u
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Kojto 93:e188a91d3eaa 2656 #define I2S_RCR2_BCP_MASK 0x2000000u
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Kojto 93:e188a91d3eaa 2659 #define I2S_RCR2_MSEL_SHIFT 26
Kojto 93:e188a91d3eaa 2660 #define I2S_RCR2_MSEL(x) (((uint32_t)(((uint32_t)(x))<<I2S_RCR2_MSEL_SHIFT))&I2S_RCR2_MSEL_MASK)
Kojto 93:e188a91d3eaa 2661 #define I2S_RCR2_BCI_MASK 0x10000000u
Kojto 93:e188a91d3eaa 2662 #define I2S_RCR2_BCI_SHIFT 28
Kojto 93:e188a91d3eaa 2663 #define I2S_RCR2_BCS_MASK 0x20000000u
Kojto 93:e188a91d3eaa 2664 #define I2S_RCR2_BCS_SHIFT 29
Kojto 93:e188a91d3eaa 2665 #define I2S_RCR2_SYNC_MASK 0xC0000000u
Kojto 93:e188a91d3eaa 2666 #define I2S_RCR2_SYNC_SHIFT 30
Kojto 93:e188a91d3eaa 2667 #define I2S_RCR2_SYNC(x) (((uint32_t)(((uint32_t)(x))<<I2S_RCR2_SYNC_SHIFT))&I2S_RCR2_SYNC_MASK)
Kojto 93:e188a91d3eaa 2668 /* RCR3 Bit Fields */
Kojto 93:e188a91d3eaa 2669 #define I2S_RCR3_WDFL_MASK 0x1Fu
Kojto 93:e188a91d3eaa 2670 #define I2S_RCR3_WDFL_SHIFT 0
Kojto 93:e188a91d3eaa 2671 #define I2S_RCR3_WDFL(x) (((uint32_t)(((uint32_t)(x))<<I2S_RCR3_WDFL_SHIFT))&I2S_RCR3_WDFL_MASK)
Kojto 93:e188a91d3eaa 2672 #define I2S_RCR3_RCE_MASK 0x30000u
Kojto 93:e188a91d3eaa 2673 #define I2S_RCR3_RCE_SHIFT 16
Kojto 93:e188a91d3eaa 2674 #define I2S_RCR3_RCE(x) (((uint32_t)(((uint32_t)(x))<<I2S_RCR3_RCE_SHIFT))&I2S_RCR3_RCE_MASK)
Kojto 93:e188a91d3eaa 2675 /* RCR4 Bit Fields */
Kojto 93:e188a91d3eaa 2676 #define I2S_RCR4_FSD_MASK 0x1u
Kojto 93:e188a91d3eaa 2677 #define I2S_RCR4_FSD_SHIFT 0
Kojto 93:e188a91d3eaa 2678 #define I2S_RCR4_FSP_MASK 0x2u
Kojto 93:e188a91d3eaa 2679 #define I2S_RCR4_FSP_SHIFT 1
Kojto 93:e188a91d3eaa 2680 #define I2S_RCR4_FSE_MASK 0x8u
Kojto 93:e188a91d3eaa 2681 #define I2S_RCR4_FSE_SHIFT 3
Kojto 93:e188a91d3eaa 2682 #define I2S_RCR4_MF_MASK 0x10u
Kojto 93:e188a91d3eaa 2683 #define I2S_RCR4_MF_SHIFT 4
Kojto 93:e188a91d3eaa 2684 #define I2S_RCR4_SYWD_MASK 0x1F00u
Kojto 93:e188a91d3eaa 2685 #define I2S_RCR4_SYWD_SHIFT 8
Kojto 93:e188a91d3eaa 2686 #define I2S_RCR4_SYWD(x) (((uint32_t)(((uint32_t)(x))<<I2S_RCR4_SYWD_SHIFT))&I2S_RCR4_SYWD_MASK)
Kojto 93:e188a91d3eaa 2687 #define I2S_RCR4_FRSZ_MASK 0x1F0000u
Kojto 93:e188a91d3eaa 2688 #define I2S_RCR4_FRSZ_SHIFT 16
Kojto 93:e188a91d3eaa 2689 #define I2S_RCR4_FRSZ(x) (((uint32_t)(((uint32_t)(x))<<I2S_RCR4_FRSZ_SHIFT))&I2S_RCR4_FRSZ_MASK)
Kojto 93:e188a91d3eaa 2690 /* RCR5 Bit Fields */
Kojto 93:e188a91d3eaa 2691 #define I2S_RCR5_FBT_MASK 0x1F00u
Kojto 93:e188a91d3eaa 2692 #define I2S_RCR5_FBT_SHIFT 8
Kojto 93:e188a91d3eaa 2693 #define I2S_RCR5_FBT(x) (((uint32_t)(((uint32_t)(x))<<I2S_RCR5_FBT_SHIFT))&I2S_RCR5_FBT_MASK)
Kojto 93:e188a91d3eaa 2694 #define I2S_RCR5_W0W_MASK 0x1F0000u
Kojto 93:e188a91d3eaa 2695 #define I2S_RCR5_W0W_SHIFT 16
Kojto 93:e188a91d3eaa 2696 #define I2S_RCR5_W0W(x) (((uint32_t)(((uint32_t)(x))<<I2S_RCR5_W0W_SHIFT))&I2S_RCR5_W0W_MASK)
Kojto 93:e188a91d3eaa 2697 #define I2S_RCR5_WNW_MASK 0x1F000000u
Kojto 93:e188a91d3eaa 2698 #define I2S_RCR5_WNW_SHIFT 24
Kojto 93:e188a91d3eaa 2699 #define I2S_RCR5_WNW(x) (((uint32_t)(((uint32_t)(x))<<I2S_RCR5_WNW_SHIFT))&I2S_RCR5_WNW_MASK)
Kojto 93:e188a91d3eaa 2700 /* RDR Bit Fields */
Kojto 93:e188a91d3eaa 2701 #define I2S_RDR_RDR_MASK 0xFFFFFFFFu
Kojto 93:e188a91d3eaa 2702 #define I2S_RDR_RDR_SHIFT 0
Kojto 93:e188a91d3eaa 2703 #define I2S_RDR_RDR(x) (((uint32_t)(((uint32_t)(x))<<I2S_RDR_RDR_SHIFT))&I2S_RDR_RDR_MASK)
Kojto 93:e188a91d3eaa 2704 /* RFR Bit Fields */
Kojto 93:e188a91d3eaa 2705 #define I2S_RFR_RFP_MASK 0xFu
Kojto 93:e188a91d3eaa 2706 #define I2S_RFR_RFP_SHIFT 0
Kojto 93:e188a91d3eaa 2707 #define I2S_RFR_RFP(x) (((uint32_t)(((uint32_t)(x))<<I2S_RFR_RFP_SHIFT))&I2S_RFR_RFP_MASK)
Kojto 93:e188a91d3eaa 2708 #define I2S_RFR_WFP_MASK 0xF0000u
Kojto 93:e188a91d3eaa 2709 #define I2S_RFR_WFP_SHIFT 16
Kojto 93:e188a91d3eaa 2710 #define I2S_RFR_WFP(x) (((uint32_t)(((uint32_t)(x))<<I2S_RFR_WFP_SHIFT))&I2S_RFR_WFP_MASK)
Kojto 93:e188a91d3eaa 2711 /* RMR Bit Fields */
Kojto 93:e188a91d3eaa 2712 #define I2S_RMR_RWM_MASK 0xFFFFFFFFu
Kojto 93:e188a91d3eaa 2713 #define I2S_RMR_RWM_SHIFT 0
Kojto 93:e188a91d3eaa 2714 #define I2S_RMR_RWM(x) (((uint32_t)(((uint32_t)(x))<<I2S_RMR_RWM_SHIFT))&I2S_RMR_RWM_MASK)
Kojto 93:e188a91d3eaa 2715 /* MCR Bit Fields */
Kojto 93:e188a91d3eaa 2716 #define I2S_MCR_MICS_MASK 0x3000000u
Kojto 93:e188a91d3eaa 2717 #define I2S_MCR_MICS_SHIFT 24
Kojto 93:e188a91d3eaa 2718 #define I2S_MCR_MICS(x) (((uint32_t)(((uint32_t)(x))<<I2S_MCR_MICS_SHIFT))&I2S_MCR_MICS_MASK)
Kojto 93:e188a91d3eaa 2719 #define I2S_MCR_MOE_MASK 0x40000000u
Kojto 93:e188a91d3eaa 2720 #define I2S_MCR_MOE_SHIFT 30
Kojto 93:e188a91d3eaa 2721 #define I2S_MCR_DUF_MASK 0x80000000u
Kojto 93:e188a91d3eaa 2722 #define I2S_MCR_DUF_SHIFT 31
Kojto 93:e188a91d3eaa 2723 /* MDR Bit Fields */
Kojto 93:e188a91d3eaa 2724 #define I2S_MDR_DIVIDE_MASK 0xFFFu
Kojto 93:e188a91d3eaa 2725 #define I2S_MDR_DIVIDE_SHIFT 0
Kojto 93:e188a91d3eaa 2726 #define I2S_MDR_DIVIDE(x) (((uint32_t)(((uint32_t)(x))<<I2S_MDR_DIVIDE_SHIFT))&I2S_MDR_DIVIDE_MASK)
Kojto 93:e188a91d3eaa 2727 #define I2S_MDR_FRACT_MASK 0xFF000u
Kojto 93:e188a91d3eaa 2728 #define I2S_MDR_FRACT_SHIFT 12
Kojto 93:e188a91d3eaa 2729 #define I2S_MDR_FRACT(x) (((uint32_t)(((uint32_t)(x))<<I2S_MDR_FRACT_SHIFT))&I2S_MDR_FRACT_MASK)
Kojto 93:e188a91d3eaa 2730
Kojto 93:e188a91d3eaa 2731 /**
Kojto 93:e188a91d3eaa 2732 * @}
Kojto 93:e188a91d3eaa 2733 */ /* end of group I2S_Register_Masks */
Kojto 93:e188a91d3eaa 2734
Kojto 93:e188a91d3eaa 2735
Kojto 93:e188a91d3eaa 2736 /* I2S - Peripheral instance base addresses */
Kojto 93:e188a91d3eaa 2737 /** Peripheral I2S0 base address */
Kojto 93:e188a91d3eaa 2738 #define I2S0_BASE (0x4002F000u)
Kojto 93:e188a91d3eaa 2739 /** Peripheral I2S0 base pointer */
Kojto 93:e188a91d3eaa 2740 #define I2S0 ((I2S_Type *)I2S0_BASE)
Kojto 93:e188a91d3eaa 2741
Kojto 93:e188a91d3eaa 2742 /**
Kojto 93:e188a91d3eaa 2743 * @}
Kojto 93:e188a91d3eaa 2744 */ /* end of group I2S_Peripheral_Access_Layer */
Kojto 93:e188a91d3eaa 2745
Kojto 93:e188a91d3eaa 2746
Kojto 93:e188a91d3eaa 2747 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 2748 -- LLWU Peripheral Access Layer
Kojto 93:e188a91d3eaa 2749 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 2750
Kojto 93:e188a91d3eaa 2751 /**
Kojto 93:e188a91d3eaa 2752 * @addtogroup LLWU_Peripheral_Access_Layer LLWU Peripheral Access Layer
Kojto 93:e188a91d3eaa 2753 * @{
Kojto 93:e188a91d3eaa 2754 */
Kojto 93:e188a91d3eaa 2755
Kojto 93:e188a91d3eaa 2756 /** LLWU - Register Layout Typedef */
Kojto 93:e188a91d3eaa 2757 typedef struct {
Kojto 93:e188a91d3eaa 2758 __IO uint8_t PE1; /**< LLWU Pin Enable 1 Register, offset: 0x0 */
Kojto 93:e188a91d3eaa 2759 __IO uint8_t PE2; /**< LLWU Pin Enable 2 Register, offset: 0x1 */
Kojto 93:e188a91d3eaa 2760 __IO uint8_t PE3; /**< LLWU Pin Enable 3 Register, offset: 0x2 */
Kojto 93:e188a91d3eaa 2761 __IO uint8_t PE4; /**< LLWU Pin Enable 4 Register, offset: 0x3 */
Kojto 93:e188a91d3eaa 2762 __IO uint8_t ME; /**< LLWU Module Enable Register, offset: 0x4 */
Kojto 93:e188a91d3eaa 2763 __IO uint8_t F1; /**< LLWU Flag 1 Register, offset: 0x5 */
Kojto 93:e188a91d3eaa 2764 __IO uint8_t F2; /**< LLWU Flag 2 Register, offset: 0x6 */
Kojto 93:e188a91d3eaa 2765 __I uint8_t F3; /**< LLWU Flag 3 Register, offset: 0x7 */
Kojto 93:e188a91d3eaa 2766 __IO uint8_t FILT1; /**< LLWU Pin Filter 1 Register, offset: 0x8 */
Kojto 93:e188a91d3eaa 2767 __IO uint8_t FILT2; /**< LLWU Pin Filter 2 Register, offset: 0x9 */
Kojto 93:e188a91d3eaa 2768 __IO uint8_t RST; /**< LLWU Reset Enable Register, offset: 0xA */
Kojto 93:e188a91d3eaa 2769 } LLWU_Type;
Kojto 93:e188a91d3eaa 2770
Kojto 93:e188a91d3eaa 2771 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 2772 -- LLWU Register Masks
Kojto 93:e188a91d3eaa 2773 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 2774
Kojto 93:e188a91d3eaa 2775 /**
Kojto 93:e188a91d3eaa 2776 * @addtogroup LLWU_Register_Masks LLWU Register Masks
Kojto 93:e188a91d3eaa 2777 * @{
Kojto 93:e188a91d3eaa 2778 */
Kojto 93:e188a91d3eaa 2779
Kojto 93:e188a91d3eaa 2780 /* PE1 Bit Fields */
Kojto 93:e188a91d3eaa 2781 #define LLWU_PE1_WUPE0_MASK 0x3u
Kojto 93:e188a91d3eaa 2782 #define LLWU_PE1_WUPE0_SHIFT 0
Kojto 93:e188a91d3eaa 2783 #define LLWU_PE1_WUPE0(x) (((uint8_t)(((uint8_t)(x))<<LLWU_PE1_WUPE0_SHIFT))&LLWU_PE1_WUPE0_MASK)
Kojto 93:e188a91d3eaa 2784 #define LLWU_PE1_WUPE1_MASK 0xCu
Kojto 93:e188a91d3eaa 2785 #define LLWU_PE1_WUPE1_SHIFT 2
Kojto 93:e188a91d3eaa 2786 #define LLWU_PE1_WUPE1(x) (((uint8_t)(((uint8_t)(x))<<LLWU_PE1_WUPE1_SHIFT))&LLWU_PE1_WUPE1_MASK)
Kojto 93:e188a91d3eaa 2787 #define LLWU_PE1_WUPE2_MASK 0x30u
Kojto 93:e188a91d3eaa 2788 #define LLWU_PE1_WUPE2_SHIFT 4
Kojto 93:e188a91d3eaa 2789 #define LLWU_PE1_WUPE2(x) (((uint8_t)(((uint8_t)(x))<<LLWU_PE1_WUPE2_SHIFT))&LLWU_PE1_WUPE2_MASK)
Kojto 93:e188a91d3eaa 2790 #define LLWU_PE1_WUPE3_MASK 0xC0u
Kojto 93:e188a91d3eaa 2791 #define LLWU_PE1_WUPE3_SHIFT 6
Kojto 93:e188a91d3eaa 2792 #define LLWU_PE1_WUPE3(x) (((uint8_t)(((uint8_t)(x))<<LLWU_PE1_WUPE3_SHIFT))&LLWU_PE1_WUPE3_MASK)
Kojto 93:e188a91d3eaa 2793 /* PE2 Bit Fields */
Kojto 93:e188a91d3eaa 2794 #define LLWU_PE2_WUPE4_MASK 0x3u
Kojto 93:e188a91d3eaa 2795 #define LLWU_PE2_WUPE4_SHIFT 0
Kojto 93:e188a91d3eaa 2796 #define LLWU_PE2_WUPE4(x) (((uint8_t)(((uint8_t)(x))<<LLWU_PE2_WUPE4_SHIFT))&LLWU_PE2_WUPE4_MASK)
Kojto 93:e188a91d3eaa 2797 #define LLWU_PE2_WUPE5_MASK 0xCu
Kojto 93:e188a91d3eaa 2798 #define LLWU_PE2_WUPE5_SHIFT 2
Kojto 93:e188a91d3eaa 2799 #define LLWU_PE2_WUPE5(x) (((uint8_t)(((uint8_t)(x))<<LLWU_PE2_WUPE5_SHIFT))&LLWU_PE2_WUPE5_MASK)
Kojto 93:e188a91d3eaa 2800 #define LLWU_PE2_WUPE6_MASK 0x30u
Kojto 93:e188a91d3eaa 2801 #define LLWU_PE2_WUPE6_SHIFT 4
Kojto 93:e188a91d3eaa 2802 #define LLWU_PE2_WUPE6(x) (((uint8_t)(((uint8_t)(x))<<LLWU_PE2_WUPE6_SHIFT))&LLWU_PE2_WUPE6_MASK)
Kojto 93:e188a91d3eaa 2803 #define LLWU_PE2_WUPE7_MASK 0xC0u
Kojto 93:e188a91d3eaa 2804 #define LLWU_PE2_WUPE7_SHIFT 6
Kojto 93:e188a91d3eaa 2805 #define LLWU_PE2_WUPE7(x) (((uint8_t)(((uint8_t)(x))<<LLWU_PE2_WUPE7_SHIFT))&LLWU_PE2_WUPE7_MASK)
Kojto 93:e188a91d3eaa 2806 /* PE3 Bit Fields */
Kojto 93:e188a91d3eaa 2807 #define LLWU_PE3_WUPE8_MASK 0x3u
Kojto 93:e188a91d3eaa 2808 #define LLWU_PE3_WUPE8_SHIFT 0
Kojto 93:e188a91d3eaa 2809 #define LLWU_PE3_WUPE8(x) (((uint8_t)(((uint8_t)(x))<<LLWU_PE3_WUPE8_SHIFT))&LLWU_PE3_WUPE8_MASK)
Kojto 93:e188a91d3eaa 2810 #define LLWU_PE3_WUPE9_MASK 0xCu
Kojto 93:e188a91d3eaa 2811 #define LLWU_PE3_WUPE9_SHIFT 2
Kojto 93:e188a91d3eaa 2812 #define LLWU_PE3_WUPE9(x) (((uint8_t)(((uint8_t)(x))<<LLWU_PE3_WUPE9_SHIFT))&LLWU_PE3_WUPE9_MASK)
Kojto 93:e188a91d3eaa 2813 #define LLWU_PE3_WUPE10_MASK 0x30u
Kojto 93:e188a91d3eaa 2814 #define LLWU_PE3_WUPE10_SHIFT 4
Kojto 93:e188a91d3eaa 2815 #define LLWU_PE3_WUPE10(x) (((uint8_t)(((uint8_t)(x))<<LLWU_PE3_WUPE10_SHIFT))&LLWU_PE3_WUPE10_MASK)
Kojto 93:e188a91d3eaa 2816 #define LLWU_PE3_WUPE11_MASK 0xC0u
Kojto 93:e188a91d3eaa 2817 #define LLWU_PE3_WUPE11_SHIFT 6
Kojto 93:e188a91d3eaa 2818 #define LLWU_PE3_WUPE11(x) (((uint8_t)(((uint8_t)(x))<<LLWU_PE3_WUPE11_SHIFT))&LLWU_PE3_WUPE11_MASK)
Kojto 93:e188a91d3eaa 2819 /* PE4 Bit Fields */
Kojto 93:e188a91d3eaa 2820 #define LLWU_PE4_WUPE12_MASK 0x3u
Kojto 93:e188a91d3eaa 2821 #define LLWU_PE4_WUPE12_SHIFT 0
Kojto 93:e188a91d3eaa 2822 #define LLWU_PE4_WUPE12(x) (((uint8_t)(((uint8_t)(x))<<LLWU_PE4_WUPE12_SHIFT))&LLWU_PE4_WUPE12_MASK)
Kojto 93:e188a91d3eaa 2823 #define LLWU_PE4_WUPE13_MASK 0xCu
Kojto 93:e188a91d3eaa 2824 #define LLWU_PE4_WUPE13_SHIFT 2
Kojto 93:e188a91d3eaa 2825 #define LLWU_PE4_WUPE13(x) (((uint8_t)(((uint8_t)(x))<<LLWU_PE4_WUPE13_SHIFT))&LLWU_PE4_WUPE13_MASK)
Kojto 93:e188a91d3eaa 2826 #define LLWU_PE4_WUPE14_MASK 0x30u
Kojto 93:e188a91d3eaa 2827 #define LLWU_PE4_WUPE14_SHIFT 4
Kojto 93:e188a91d3eaa 2828 #define LLWU_PE4_WUPE14(x) (((uint8_t)(((uint8_t)(x))<<LLWU_PE4_WUPE14_SHIFT))&LLWU_PE4_WUPE14_MASK)
Kojto 93:e188a91d3eaa 2829 #define LLWU_PE4_WUPE15_MASK 0xC0u
Kojto 93:e188a91d3eaa 2830 #define LLWU_PE4_WUPE15_SHIFT 6
Kojto 93:e188a91d3eaa 2831 #define LLWU_PE4_WUPE15(x) (((uint8_t)(((uint8_t)(x))<<LLWU_PE4_WUPE15_SHIFT))&LLWU_PE4_WUPE15_MASK)
Kojto 93:e188a91d3eaa 2832 /* ME Bit Fields */
Kojto 93:e188a91d3eaa 2833 #define LLWU_ME_WUME0_MASK 0x1u
Kojto 93:e188a91d3eaa 2834 #define LLWU_ME_WUME0_SHIFT 0
Kojto 93:e188a91d3eaa 2835 #define LLWU_ME_WUME1_MASK 0x2u
Kojto 93:e188a91d3eaa 2836 #define LLWU_ME_WUME1_SHIFT 1
Kojto 93:e188a91d3eaa 2837 #define LLWU_ME_WUME2_MASK 0x4u
Kojto 93:e188a91d3eaa 2838 #define LLWU_ME_WUME2_SHIFT 2
Kojto 93:e188a91d3eaa 2839 #define LLWU_ME_WUME3_MASK 0x8u
Kojto 93:e188a91d3eaa 2840 #define LLWU_ME_WUME3_SHIFT 3
Kojto 93:e188a91d3eaa 2841 #define LLWU_ME_WUME4_MASK 0x10u
Kojto 93:e188a91d3eaa 2842 #define LLWU_ME_WUME4_SHIFT 4
Kojto 93:e188a91d3eaa 2843 #define LLWU_ME_WUME5_MASK 0x20u
Kojto 93:e188a91d3eaa 2844 #define LLWU_ME_WUME5_SHIFT 5
Kojto 93:e188a91d3eaa 2845 #define LLWU_ME_WUME6_MASK 0x40u
Kojto 93:e188a91d3eaa 2846 #define LLWU_ME_WUME6_SHIFT 6
Kojto 93:e188a91d3eaa 2847 #define LLWU_ME_WUME7_MASK 0x80u
Kojto 93:e188a91d3eaa 2848 #define LLWU_ME_WUME7_SHIFT 7
Kojto 93:e188a91d3eaa 2849 /* F1 Bit Fields */
Kojto 93:e188a91d3eaa 2850 #define LLWU_F1_WUF0_MASK 0x1u
Kojto 93:e188a91d3eaa 2851 #define LLWU_F1_WUF0_SHIFT 0
Kojto 93:e188a91d3eaa 2852 #define LLWU_F1_WUF1_MASK 0x2u
Kojto 93:e188a91d3eaa 2853 #define LLWU_F1_WUF1_SHIFT 1
Kojto 93:e188a91d3eaa 2854 #define LLWU_F1_WUF2_MASK 0x4u
Kojto 93:e188a91d3eaa 2855 #define LLWU_F1_WUF2_SHIFT 2
Kojto 93:e188a91d3eaa 2856 #define LLWU_F1_WUF3_MASK 0x8u
Kojto 93:e188a91d3eaa 2857 #define LLWU_F1_WUF3_SHIFT 3
Kojto 93:e188a91d3eaa 2858 #define LLWU_F1_WUF4_MASK 0x10u
Kojto 93:e188a91d3eaa 2859 #define LLWU_F1_WUF4_SHIFT 4
Kojto 93:e188a91d3eaa 2860 #define LLWU_F1_WUF5_MASK 0x20u
Kojto 93:e188a91d3eaa 2861 #define LLWU_F1_WUF5_SHIFT 5
Kojto 93:e188a91d3eaa 2862 #define LLWU_F1_WUF6_MASK 0x40u
Kojto 93:e188a91d3eaa 2863 #define LLWU_F1_WUF6_SHIFT 6
Kojto 93:e188a91d3eaa 2864 #define LLWU_F1_WUF7_MASK 0x80u
Kojto 93:e188a91d3eaa 2865 #define LLWU_F1_WUF7_SHIFT 7
Kojto 93:e188a91d3eaa 2866 /* F2 Bit Fields */
Kojto 93:e188a91d3eaa 2867 #define LLWU_F2_WUF8_MASK 0x1u
Kojto 93:e188a91d3eaa 2868 #define LLWU_F2_WUF8_SHIFT 0
Kojto 93:e188a91d3eaa 2869 #define LLWU_F2_WUF9_MASK 0x2u
Kojto 93:e188a91d3eaa 2870 #define LLWU_F2_WUF9_SHIFT 1
Kojto 93:e188a91d3eaa 2871 #define LLWU_F2_WUF10_MASK 0x4u
Kojto 93:e188a91d3eaa 2872 #define LLWU_F2_WUF10_SHIFT 2
Kojto 93:e188a91d3eaa 2873 #define LLWU_F2_WUF11_MASK 0x8u
Kojto 93:e188a91d3eaa 2874 #define LLWU_F2_WUF11_SHIFT 3
Kojto 93:e188a91d3eaa 2875 #define LLWU_F2_WUF12_MASK 0x10u
Kojto 93:e188a91d3eaa 2876 #define LLWU_F2_WUF12_SHIFT 4
Kojto 93:e188a91d3eaa 2877 #define LLWU_F2_WUF13_MASK 0x20u
Kojto 93:e188a91d3eaa 2878 #define LLWU_F2_WUF13_SHIFT 5
Kojto 93:e188a91d3eaa 2879 #define LLWU_F2_WUF14_MASK 0x40u
Kojto 93:e188a91d3eaa 2880 #define LLWU_F2_WUF14_SHIFT 6
Kojto 93:e188a91d3eaa 2881 #define LLWU_F2_WUF15_MASK 0x80u
Kojto 93:e188a91d3eaa 2882 #define LLWU_F2_WUF15_SHIFT 7
Kojto 93:e188a91d3eaa 2883 /* F3 Bit Fields */
Kojto 93:e188a91d3eaa 2884 #define LLWU_F3_MWUF0_MASK 0x1u
Kojto 93:e188a91d3eaa 2885 #define LLWU_F3_MWUF0_SHIFT 0
Kojto 93:e188a91d3eaa 2886 #define LLWU_F3_MWUF1_MASK 0x2u
Kojto 93:e188a91d3eaa 2887 #define LLWU_F3_MWUF1_SHIFT 1
Kojto 93:e188a91d3eaa 2888 #define LLWU_F3_MWUF2_MASK 0x4u
Kojto 93:e188a91d3eaa 2889 #define LLWU_F3_MWUF2_SHIFT 2
Kojto 93:e188a91d3eaa 2890 #define LLWU_F3_MWUF3_MASK 0x8u
Kojto 93:e188a91d3eaa 2891 #define LLWU_F3_MWUF3_SHIFT 3
Kojto 93:e188a91d3eaa 2892 #define LLWU_F3_MWUF4_MASK 0x10u
Kojto 93:e188a91d3eaa 2893 #define LLWU_F3_MWUF4_SHIFT 4
Kojto 93:e188a91d3eaa 2894 #define LLWU_F3_MWUF5_MASK 0x20u
Kojto 93:e188a91d3eaa 2895 #define LLWU_F3_MWUF5_SHIFT 5
Kojto 93:e188a91d3eaa 2896 #define LLWU_F3_MWUF6_MASK 0x40u
Kojto 93:e188a91d3eaa 2897 #define LLWU_F3_MWUF6_SHIFT 6
Kojto 93:e188a91d3eaa 2898 #define LLWU_F3_MWUF7_MASK 0x80u
Kojto 93:e188a91d3eaa 2899 #define LLWU_F3_MWUF7_SHIFT 7
Kojto 93:e188a91d3eaa 2900 /* FILT1 Bit Fields */
Kojto 93:e188a91d3eaa 2901 #define LLWU_FILT1_FILTSEL_MASK 0xFu
Kojto 93:e188a91d3eaa 2902 #define LLWU_FILT1_FILTSEL_SHIFT 0
Kojto 93:e188a91d3eaa 2903 #define LLWU_FILT1_FILTSEL(x) (((uint8_t)(((uint8_t)(x))<<LLWU_FILT1_FILTSEL_SHIFT))&LLWU_FILT1_FILTSEL_MASK)
Kojto 93:e188a91d3eaa 2904 #define LLWU_FILT1_FILTE_MASK 0x60u
Kojto 93:e188a91d3eaa 2905 #define LLWU_FILT1_FILTE_SHIFT 5
Kojto 93:e188a91d3eaa 2906 #define LLWU_FILT1_FILTE(x) (((uint8_t)(((uint8_t)(x))<<LLWU_FILT1_FILTE_SHIFT))&LLWU_FILT1_FILTE_MASK)
Kojto 93:e188a91d3eaa 2907 #define LLWU_FILT1_FILTF_MASK 0x80u
Kojto 93:e188a91d3eaa 2908 #define LLWU_FILT1_FILTF_SHIFT 7
Kojto 93:e188a91d3eaa 2909 /* FILT2 Bit Fields */
Kojto 93:e188a91d3eaa 2910 #define LLWU_FILT2_FILTSEL_MASK 0xFu
Kojto 93:e188a91d3eaa 2911 #define LLWU_FILT2_FILTSEL_SHIFT 0
Kojto 93:e188a91d3eaa 2912 #define LLWU_FILT2_FILTSEL(x) (((uint8_t)(((uint8_t)(x))<<LLWU_FILT2_FILTSEL_SHIFT))&LLWU_FILT2_FILTSEL_MASK)
Kojto 93:e188a91d3eaa 2913 #define LLWU_FILT2_FILTE_MASK 0x60u
Kojto 93:e188a91d3eaa 2914 #define LLWU_FILT2_FILTE_SHIFT 5
Kojto 93:e188a91d3eaa 2915 #define LLWU_FILT2_FILTE(x) (((uint8_t)(((uint8_t)(x))<<LLWU_FILT2_FILTE_SHIFT))&LLWU_FILT2_FILTE_MASK)
Kojto 93:e188a91d3eaa 2916 #define LLWU_FILT2_FILTF_MASK 0x80u
Kojto 93:e188a91d3eaa 2917 #define LLWU_FILT2_FILTF_SHIFT 7
Kojto 93:e188a91d3eaa 2918 /* RST Bit Fields */
Kojto 93:e188a91d3eaa 2919 #define LLWU_RST_RSTFILT_MASK 0x1u
Kojto 93:e188a91d3eaa 2920 #define LLWU_RST_RSTFILT_SHIFT 0
Kojto 93:e188a91d3eaa 2921 #define LLWU_RST_LLRSTE_MASK 0x2u
Kojto 93:e188a91d3eaa 2922 #define LLWU_RST_LLRSTE_SHIFT 1
Kojto 93:e188a91d3eaa 2923
Kojto 93:e188a91d3eaa 2924 /**
Kojto 93:e188a91d3eaa 2925 * @}
Kojto 93:e188a91d3eaa 2926 */ /* end of group LLWU_Register_Masks */
Kojto 93:e188a91d3eaa 2927
Kojto 93:e188a91d3eaa 2928
Kojto 93:e188a91d3eaa 2929 /* LLWU - Peripheral instance base addresses */
Kojto 93:e188a91d3eaa 2930 /** Peripheral LLWU base address */
Kojto 93:e188a91d3eaa 2931 #define LLWU_BASE (0x4007C000u)
Kojto 93:e188a91d3eaa 2932 /** Peripheral LLWU base pointer */
Kojto 93:e188a91d3eaa 2933 #define LLWU ((LLWU_Type *)LLWU_BASE)
Kojto 93:e188a91d3eaa 2934
Kojto 93:e188a91d3eaa 2935 /**
Kojto 93:e188a91d3eaa 2936 * @}
Kojto 93:e188a91d3eaa 2937 */ /* end of group LLWU_Peripheral_Access_Layer */
Kojto 93:e188a91d3eaa 2938
Kojto 93:e188a91d3eaa 2939
Kojto 93:e188a91d3eaa 2940 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 2941 -- LPTMR Peripheral Access Layer
Kojto 93:e188a91d3eaa 2942 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 2943
Kojto 93:e188a91d3eaa 2944 /**
Kojto 93:e188a91d3eaa 2945 * @addtogroup LPTMR_Peripheral_Access_Layer LPTMR Peripheral Access Layer
Kojto 93:e188a91d3eaa 2946 * @{
Kojto 93:e188a91d3eaa 2947 */
Kojto 93:e188a91d3eaa 2948
Kojto 93:e188a91d3eaa 2949 /** LPTMR - Register Layout Typedef */
Kojto 93:e188a91d3eaa 2950 typedef struct {
Kojto 93:e188a91d3eaa 2951 __IO uint32_t CSR; /**< Low Power Timer Control Status Register, offset: 0x0 */
Kojto 93:e188a91d3eaa 2952 __IO uint32_t PSR; /**< Low Power Timer Prescale Register, offset: 0x4 */
Kojto 93:e188a91d3eaa 2953 __IO uint32_t CMR; /**< Low Power Timer Compare Register, offset: 0x8 */
Kojto 93:e188a91d3eaa 2954 __I uint32_t CNR; /**< Low Power Timer Counter Register, offset: 0xC */
Kojto 93:e188a91d3eaa 2955 } LPTMR_Type;
Kojto 93:e188a91d3eaa 2956
Kojto 93:e188a91d3eaa 2957 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 2958 -- LPTMR Register Masks
Kojto 93:e188a91d3eaa 2959 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 2960
Kojto 93:e188a91d3eaa 2961 /**
Kojto 93:e188a91d3eaa 2962 * @addtogroup LPTMR_Register_Masks LPTMR Register Masks
Kojto 93:e188a91d3eaa 2963 * @{
Kojto 93:e188a91d3eaa 2964 */
Kojto 93:e188a91d3eaa 2965
Kojto 93:e188a91d3eaa 2966 /* CSR Bit Fields */
Kojto 93:e188a91d3eaa 2967 #define LPTMR_CSR_TEN_MASK 0x1u
Kojto 93:e188a91d3eaa 2968 #define LPTMR_CSR_TEN_SHIFT 0
Kojto 93:e188a91d3eaa 2969 #define LPTMR_CSR_TMS_MASK 0x2u
Kojto 93:e188a91d3eaa 2970 #define LPTMR_CSR_TMS_SHIFT 1
Kojto 93:e188a91d3eaa 2971 #define LPTMR_CSR_TFC_MASK 0x4u
Kojto 93:e188a91d3eaa 2972 #define LPTMR_CSR_TFC_SHIFT 2
Kojto 93:e188a91d3eaa 2973 #define LPTMR_CSR_TPP_MASK 0x8u
Kojto 93:e188a91d3eaa 2974 #define LPTMR_CSR_TPP_SHIFT 3
Kojto 93:e188a91d3eaa 2975 #define LPTMR_CSR_TPS_MASK 0x30u
Kojto 93:e188a91d3eaa 2976 #define LPTMR_CSR_TPS_SHIFT 4
Kojto 93:e188a91d3eaa 2977 #define LPTMR_CSR_TPS(x) (((uint32_t)(((uint32_t)(x))<<LPTMR_CSR_TPS_SHIFT))&LPTMR_CSR_TPS_MASK)
Kojto 93:e188a91d3eaa 2978 #define LPTMR_CSR_TIE_MASK 0x40u
Kojto 93:e188a91d3eaa 2979 #define LPTMR_CSR_TIE_SHIFT 6
Kojto 93:e188a91d3eaa 2980 #define LPTMR_CSR_TCF_MASK 0x80u
Kojto 93:e188a91d3eaa 2981 #define LPTMR_CSR_TCF_SHIFT 7
Kojto 93:e188a91d3eaa 2982 /* PSR Bit Fields */
Kojto 93:e188a91d3eaa 2983 #define LPTMR_PSR_PCS_MASK 0x3u
Kojto 93:e188a91d3eaa 2984 #define LPTMR_PSR_PCS_SHIFT 0
Kojto 93:e188a91d3eaa 2985 #define LPTMR_PSR_PCS(x) (((uint32_t)(((uint32_t)(x))<<LPTMR_PSR_PCS_SHIFT))&LPTMR_PSR_PCS_MASK)
Kojto 93:e188a91d3eaa 2986 #define LPTMR_PSR_PBYP_MASK 0x4u
Kojto 93:e188a91d3eaa 2987 #define LPTMR_PSR_PBYP_SHIFT 2
Kojto 93:e188a91d3eaa 2988 #define LPTMR_PSR_PRESCALE_MASK 0x78u
Kojto 93:e188a91d3eaa 2989 #define LPTMR_PSR_PRESCALE_SHIFT 3
Kojto 93:e188a91d3eaa 2990 #define LPTMR_PSR_PRESCALE(x) (((uint32_t)(((uint32_t)(x))<<LPTMR_PSR_PRESCALE_SHIFT))&LPTMR_PSR_PRESCALE_MASK)
Kojto 93:e188a91d3eaa 2991 /* CMR Bit Fields */
Kojto 93:e188a91d3eaa 2992 #define LPTMR_CMR_COMPARE_MASK 0xFFFFu
Kojto 93:e188a91d3eaa 2993 #define LPTMR_CMR_COMPARE_SHIFT 0
Kojto 93:e188a91d3eaa 2994 #define LPTMR_CMR_COMPARE(x) (((uint32_t)(((uint32_t)(x))<<LPTMR_CMR_COMPARE_SHIFT))&LPTMR_CMR_COMPARE_MASK)
Kojto 93:e188a91d3eaa 2995 /* CNR Bit Fields */
Kojto 93:e188a91d3eaa 2996 #define LPTMR_CNR_COUNTER_MASK 0xFFFFu
Kojto 93:e188a91d3eaa 2997 #define LPTMR_CNR_COUNTER_SHIFT 0
Kojto 93:e188a91d3eaa 2998 #define LPTMR_CNR_COUNTER(x) (((uint32_t)(((uint32_t)(x))<<LPTMR_CNR_COUNTER_SHIFT))&LPTMR_CNR_COUNTER_MASK)
Kojto 93:e188a91d3eaa 2999
Kojto 93:e188a91d3eaa 3000 /**
Kojto 93:e188a91d3eaa 3001 * @}
Kojto 93:e188a91d3eaa 3002 */ /* end of group LPTMR_Register_Masks */
Kojto 93:e188a91d3eaa 3003
Kojto 93:e188a91d3eaa 3004
Kojto 93:e188a91d3eaa 3005 /* LPTMR - Peripheral instance base addresses */
Kojto 93:e188a91d3eaa 3006 /** Peripheral LPTMR0 base address */
Kojto 93:e188a91d3eaa 3007 #define LPTMR0_BASE (0x40040000u)
Kojto 93:e188a91d3eaa 3008 /** Peripheral LPTMR0 base pointer */
Kojto 93:e188a91d3eaa 3009 #define LPTMR0 ((LPTMR_Type *)LPTMR0_BASE)
Kojto 93:e188a91d3eaa 3010
Kojto 93:e188a91d3eaa 3011 /**
Kojto 93:e188a91d3eaa 3012 * @}
Kojto 93:e188a91d3eaa 3013 */ /* end of group LPTMR_Peripheral_Access_Layer */
Kojto 93:e188a91d3eaa 3014
Kojto 93:e188a91d3eaa 3015
Kojto 93:e188a91d3eaa 3016 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 3017 -- MCG Peripheral Access Layer
Kojto 93:e188a91d3eaa 3018 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 3019
Kojto 93:e188a91d3eaa 3020 /**
Kojto 93:e188a91d3eaa 3021 * @addtogroup MCG_Peripheral_Access_Layer MCG Peripheral Access Layer
Kojto 93:e188a91d3eaa 3022 * @{
Kojto 93:e188a91d3eaa 3023 */
Kojto 93:e188a91d3eaa 3024
Kojto 93:e188a91d3eaa 3025 /** MCG - Register Layout Typedef */
Kojto 93:e188a91d3eaa 3026 typedef struct {
Kojto 93:e188a91d3eaa 3027 __IO uint8_t C1; /**< MCG Control 1 Register, offset: 0x0 */
Kojto 93:e188a91d3eaa 3028 __IO uint8_t C2; /**< MCG Control 2 Register, offset: 0x1 */
Kojto 93:e188a91d3eaa 3029 __IO uint8_t C3; /**< MCG Control 3 Register, offset: 0x2 */
Kojto 93:e188a91d3eaa 3030 __IO uint8_t C4; /**< MCG Control 4 Register, offset: 0x3 */
Kojto 93:e188a91d3eaa 3031 __IO uint8_t C5; /**< MCG Control 5 Register, offset: 0x4 */
Kojto 93:e188a91d3eaa 3032 __IO uint8_t C6; /**< MCG Control 6 Register, offset: 0x5 */
Kojto 93:e188a91d3eaa 3033 __I uint8_t S; /**< MCG Status Register, offset: 0x6 */
Kojto 93:e188a91d3eaa 3034 uint8_t RESERVED_0[1];
Kojto 93:e188a91d3eaa 3035 __IO uint8_t SC; /**< MCG Status and Control Register, offset: 0x8 */
Kojto 93:e188a91d3eaa 3036 uint8_t RESERVED_1[1];
Kojto 93:e188a91d3eaa 3037 __IO uint8_t ATCVH; /**< MCG Auto Trim Compare Value High Register, offset: 0xA */
Kojto 93:e188a91d3eaa 3038 __IO uint8_t ATCVL; /**< MCG Auto Trim Compare Value Low Register, offset: 0xB */
Kojto 93:e188a91d3eaa 3039 __IO uint8_t C7; /**< MCG Control 7 Register, offset: 0xC */
Kojto 93:e188a91d3eaa 3040 __IO uint8_t C8; /**< MCG Control 8 Register, offset: 0xD */
Kojto 93:e188a91d3eaa 3041 } MCG_Type;
Kojto 93:e188a91d3eaa 3042
Kojto 93:e188a91d3eaa 3043 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 3044 -- MCG Register Masks
Kojto 93:e188a91d3eaa 3045 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 3046
Kojto 93:e188a91d3eaa 3047 /**
Kojto 93:e188a91d3eaa 3048 * @addtogroup MCG_Register_Masks MCG Register Masks
Kojto 93:e188a91d3eaa 3049 * @{
Kojto 93:e188a91d3eaa 3050 */
Kojto 93:e188a91d3eaa 3051
Kojto 93:e188a91d3eaa 3052 /* C1 Bit Fields */
Kojto 93:e188a91d3eaa 3053 #define MCG_C1_IREFSTEN_MASK 0x1u
Kojto 93:e188a91d3eaa 3054 #define MCG_C1_IREFSTEN_SHIFT 0
Kojto 93:e188a91d3eaa 3055 #define MCG_C1_IRCLKEN_MASK 0x2u
Kojto 93:e188a91d3eaa 3056 #define MCG_C1_IRCLKEN_SHIFT 1
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Kojto 93:e188a91d3eaa 3059 #define MCG_C1_FRDIV_MASK 0x38u
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Kojto 93:e188a91d3eaa 3061 #define MCG_C1_FRDIV(x) (((uint8_t)(((uint8_t)(x))<<MCG_C1_FRDIV_SHIFT))&MCG_C1_FRDIV_MASK)
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Kojto 93:e188a91d3eaa 3064 #define MCG_C1_CLKS(x) (((uint8_t)(((uint8_t)(x))<<MCG_C1_CLKS_SHIFT))&MCG_C1_CLKS_MASK)
Kojto 93:e188a91d3eaa 3065 /* C2 Bit Fields */
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Kojto 93:e188a91d3eaa 3077 #define MCG_C2_LOCRE0_MASK 0x80u
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Kojto 93:e188a91d3eaa 3083 /* C4 Bit Fields */
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Kojto 93:e188a91d3eaa 3089 #define MCG_C4_DRST_DRS_MASK 0x60u
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Kojto 93:e188a91d3eaa 3097 #define MCG_C5_PRDIV0(x) (((uint8_t)(((uint8_t)(x))<<MCG_C5_PRDIV0_SHIFT))&MCG_C5_PRDIV0_MASK)
Kojto 93:e188a91d3eaa 3098 #define MCG_C5_PLLSTEN0_MASK 0x20u
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Kojto 93:e188a91d3eaa 3102 /* C6 Bit Fields */
Kojto 93:e188a91d3eaa 3103 #define MCG_C6_VDIV0_MASK 0x1Fu
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Kojto 93:e188a91d3eaa 3105 #define MCG_C6_VDIV0(x) (((uint8_t)(((uint8_t)(x))<<MCG_C6_VDIV0_SHIFT))&MCG_C6_VDIV0_MASK)
Kojto 93:e188a91d3eaa 3106 #define MCG_C6_CME0_MASK 0x20u
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Kojto 93:e188a91d3eaa 3110 #define MCG_C6_LOLIE0_MASK 0x80u
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Kojto 93:e188a91d3eaa 3112 /* S Bit Fields */
Kojto 93:e188a91d3eaa 3113 #define MCG_S_IRCST_MASK 0x1u
Kojto 93:e188a91d3eaa 3114 #define MCG_S_IRCST_SHIFT 0
Kojto 93:e188a91d3eaa 3115 #define MCG_S_OSCINIT0_MASK 0x2u
Kojto 93:e188a91d3eaa 3116 #define MCG_S_OSCINIT0_SHIFT 1
Kojto 93:e188a91d3eaa 3117 #define MCG_S_CLKST_MASK 0xCu
Kojto 93:e188a91d3eaa 3118 #define MCG_S_CLKST_SHIFT 2
Kojto 93:e188a91d3eaa 3119 #define MCG_S_CLKST(x) (((uint8_t)(((uint8_t)(x))<<MCG_S_CLKST_SHIFT))&MCG_S_CLKST_MASK)
Kojto 93:e188a91d3eaa 3120 #define MCG_S_IREFST_MASK 0x10u
Kojto 93:e188a91d3eaa 3121 #define MCG_S_IREFST_SHIFT 4
Kojto 93:e188a91d3eaa 3122 #define MCG_S_PLLST_MASK 0x20u
Kojto 93:e188a91d3eaa 3123 #define MCG_S_PLLST_SHIFT 5
Kojto 93:e188a91d3eaa 3124 #define MCG_S_LOCK0_MASK 0x40u
Kojto 93:e188a91d3eaa 3125 #define MCG_S_LOCK0_SHIFT 6
Kojto 93:e188a91d3eaa 3126 #define MCG_S_LOLS0_MASK 0x80u
Kojto 93:e188a91d3eaa 3127 #define MCG_S_LOLS0_SHIFT 7
Kojto 93:e188a91d3eaa 3128 /* SC Bit Fields */
Kojto 93:e188a91d3eaa 3129 #define MCG_SC_LOCS0_MASK 0x1u
Kojto 93:e188a91d3eaa 3130 #define MCG_SC_LOCS0_SHIFT 0
Kojto 93:e188a91d3eaa 3131 #define MCG_SC_FCRDIV_MASK 0xEu
Kojto 93:e188a91d3eaa 3132 #define MCG_SC_FCRDIV_SHIFT 1
Kojto 93:e188a91d3eaa 3133 #define MCG_SC_FCRDIV(x) (((uint8_t)(((uint8_t)(x))<<MCG_SC_FCRDIV_SHIFT))&MCG_SC_FCRDIV_MASK)
Kojto 93:e188a91d3eaa 3134 #define MCG_SC_FLTPRSRV_MASK 0x10u
Kojto 93:e188a91d3eaa 3135 #define MCG_SC_FLTPRSRV_SHIFT 4
Kojto 93:e188a91d3eaa 3136 #define MCG_SC_ATMF_MASK 0x20u
Kojto 93:e188a91d3eaa 3137 #define MCG_SC_ATMF_SHIFT 5
Kojto 93:e188a91d3eaa 3138 #define MCG_SC_ATMS_MASK 0x40u
Kojto 93:e188a91d3eaa 3139 #define MCG_SC_ATMS_SHIFT 6
Kojto 93:e188a91d3eaa 3140 #define MCG_SC_ATME_MASK 0x80u
Kojto 93:e188a91d3eaa 3141 #define MCG_SC_ATME_SHIFT 7
Kojto 93:e188a91d3eaa 3142 /* ATCVH Bit Fields */
Kojto 93:e188a91d3eaa 3143 #define MCG_ATCVH_ATCVH_MASK 0xFFu
Kojto 93:e188a91d3eaa 3144 #define MCG_ATCVH_ATCVH_SHIFT 0
Kojto 93:e188a91d3eaa 3145 #define MCG_ATCVH_ATCVH(x) (((uint8_t)(((uint8_t)(x))<<MCG_ATCVH_ATCVH_SHIFT))&MCG_ATCVH_ATCVH_MASK)
Kojto 93:e188a91d3eaa 3146 /* ATCVL Bit Fields */
Kojto 93:e188a91d3eaa 3147 #define MCG_ATCVL_ATCVL_MASK 0xFFu
Kojto 93:e188a91d3eaa 3148 #define MCG_ATCVL_ATCVL_SHIFT 0
Kojto 93:e188a91d3eaa 3149 #define MCG_ATCVL_ATCVL(x) (((uint8_t)(((uint8_t)(x))<<MCG_ATCVL_ATCVL_SHIFT))&MCG_ATCVL_ATCVL_MASK)
Kojto 93:e188a91d3eaa 3150 /* C7 Bit Fields */
Kojto 93:e188a91d3eaa 3151 #define MCG_C7_OSCSEL_MASK 0x1u
Kojto 93:e188a91d3eaa 3152 #define MCG_C7_OSCSEL_SHIFT 0
Kojto 93:e188a91d3eaa 3153 /* C8 Bit Fields */
Kojto 93:e188a91d3eaa 3154 #define MCG_C8_LOCS1_MASK 0x1u
Kojto 93:e188a91d3eaa 3155 #define MCG_C8_LOCS1_SHIFT 0
Kojto 93:e188a91d3eaa 3156 #define MCG_C8_CME1_MASK 0x20u
Kojto 93:e188a91d3eaa 3157 #define MCG_C8_CME1_SHIFT 5
Kojto 93:e188a91d3eaa 3158 #define MCG_C8_LOLRE_MASK 0x40u
Kojto 93:e188a91d3eaa 3159 #define MCG_C8_LOLRE_SHIFT 6
Kojto 93:e188a91d3eaa 3160 #define MCG_C8_LOCRE1_MASK 0x80u
Kojto 93:e188a91d3eaa 3161 #define MCG_C8_LOCRE1_SHIFT 7
Kojto 93:e188a91d3eaa 3162
Kojto 93:e188a91d3eaa 3163 /**
Kojto 93:e188a91d3eaa 3164 * @}
Kojto 93:e188a91d3eaa 3165 */ /* end of group MCG_Register_Masks */
Kojto 93:e188a91d3eaa 3166
Kojto 93:e188a91d3eaa 3167
Kojto 93:e188a91d3eaa 3168 /* MCG - Peripheral instance base addresses */
Kojto 93:e188a91d3eaa 3169 /** Peripheral MCG base address */
Kojto 93:e188a91d3eaa 3170 #define MCG_BASE (0x40064000u)
Kojto 93:e188a91d3eaa 3171 /** Peripheral MCG base pointer */
Kojto 93:e188a91d3eaa 3172 #define MCG ((MCG_Type *)MCG_BASE)
Kojto 93:e188a91d3eaa 3173
Kojto 93:e188a91d3eaa 3174 /**
Kojto 93:e188a91d3eaa 3175 * @}
Kojto 93:e188a91d3eaa 3176 */ /* end of group MCG_Peripheral_Access_Layer */
Kojto 93:e188a91d3eaa 3177
Kojto 93:e188a91d3eaa 3178
Kojto 93:e188a91d3eaa 3179 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 3180 -- NV Peripheral Access Layer
Kojto 93:e188a91d3eaa 3181 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 3182
Kojto 93:e188a91d3eaa 3183 /**
Kojto 93:e188a91d3eaa 3184 * @addtogroup NV_Peripheral_Access_Layer NV Peripheral Access Layer
Kojto 93:e188a91d3eaa 3185 * @{
Kojto 93:e188a91d3eaa 3186 */
Kojto 93:e188a91d3eaa 3187
Kojto 93:e188a91d3eaa 3188 /** NV - Register Layout Typedef */
Kojto 93:e188a91d3eaa 3189 typedef struct {
Kojto 93:e188a91d3eaa 3190 __I uint8_t BACKKEY3; /**< Backdoor Comparison Key 3., offset: 0x0 */
Kojto 93:e188a91d3eaa 3191 __I uint8_t BACKKEY2; /**< Backdoor Comparison Key 2., offset: 0x1 */
Kojto 93:e188a91d3eaa 3192 __I uint8_t BACKKEY1; /**< Backdoor Comparison Key 1., offset: 0x2 */
Kojto 93:e188a91d3eaa 3193 __I uint8_t BACKKEY0; /**< Backdoor Comparison Key 0., offset: 0x3 */
Kojto 93:e188a91d3eaa 3194 __I uint8_t BACKKEY7; /**< Backdoor Comparison Key 7., offset: 0x4 */
Kojto 93:e188a91d3eaa 3195 __I uint8_t BACKKEY6; /**< Backdoor Comparison Key 6., offset: 0x5 */
Kojto 93:e188a91d3eaa 3196 __I uint8_t BACKKEY5; /**< Backdoor Comparison Key 5., offset: 0x6 */
Kojto 93:e188a91d3eaa 3197 __I uint8_t BACKKEY4; /**< Backdoor Comparison Key 4., offset: 0x7 */
Kojto 93:e188a91d3eaa 3198 __I uint8_t FPROT3; /**< Non-volatile P-Flash Protection 1 - Low Register, offset: 0x8 */
Kojto 93:e188a91d3eaa 3199 __I uint8_t FPROT2; /**< Non-volatile P-Flash Protection 1 - High Register, offset: 0x9 */
Kojto 93:e188a91d3eaa 3200 __I uint8_t FPROT1; /**< Non-volatile P-Flash Protection 0 - Low Register, offset: 0xA */
Kojto 93:e188a91d3eaa 3201 __I uint8_t FPROT0; /**< Non-volatile P-Flash Protection 0 - High Register, offset: 0xB */
Kojto 93:e188a91d3eaa 3202 __I uint8_t FSEC; /**< Non-volatile Flash Security Register, offset: 0xC */
Kojto 93:e188a91d3eaa 3203 __I uint8_t FOPT; /**< Non-volatile Flash Option Register, offset: 0xD */
Kojto 93:e188a91d3eaa 3204 __I uint8_t FEPROT; /**< Non-volatile EERAM Protection Register, offset: 0xE */
Kojto 93:e188a91d3eaa 3205 __I uint8_t FDPROT; /**< Non-volatile D-Flash Protection Register, offset: 0xF */
Kojto 93:e188a91d3eaa 3206 } NV_Type;
Kojto 93:e188a91d3eaa 3207
Kojto 93:e188a91d3eaa 3208 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 3209 -- NV Register Masks
Kojto 93:e188a91d3eaa 3210 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 3211
Kojto 93:e188a91d3eaa 3212 /**
Kojto 93:e188a91d3eaa 3213 * @addtogroup NV_Register_Masks NV Register Masks
Kojto 93:e188a91d3eaa 3214 * @{
Kojto 93:e188a91d3eaa 3215 */
Kojto 93:e188a91d3eaa 3216
Kojto 93:e188a91d3eaa 3217 /* BACKKEY3 Bit Fields */
Kojto 93:e188a91d3eaa 3218 #define NV_BACKKEY3_KEY_MASK 0xFFu
Kojto 93:e188a91d3eaa 3219 #define NV_BACKKEY3_KEY_SHIFT 0
Kojto 93:e188a91d3eaa 3220 #define NV_BACKKEY3_KEY(x) (((uint8_t)(((uint8_t)(x))<<NV_BACKKEY3_KEY_SHIFT))&NV_BACKKEY3_KEY_MASK)
Kojto 93:e188a91d3eaa 3221 /* BACKKEY2 Bit Fields */
Kojto 93:e188a91d3eaa 3222 #define NV_BACKKEY2_KEY_MASK 0xFFu
Kojto 93:e188a91d3eaa 3223 #define NV_BACKKEY2_KEY_SHIFT 0
Kojto 93:e188a91d3eaa 3224 #define NV_BACKKEY2_KEY(x) (((uint8_t)(((uint8_t)(x))<<NV_BACKKEY2_KEY_SHIFT))&NV_BACKKEY2_KEY_MASK)
Kojto 93:e188a91d3eaa 3225 /* BACKKEY1 Bit Fields */
Kojto 93:e188a91d3eaa 3226 #define NV_BACKKEY1_KEY_MASK 0xFFu
Kojto 93:e188a91d3eaa 3227 #define NV_BACKKEY1_KEY_SHIFT 0
Kojto 93:e188a91d3eaa 3228 #define NV_BACKKEY1_KEY(x) (((uint8_t)(((uint8_t)(x))<<NV_BACKKEY1_KEY_SHIFT))&NV_BACKKEY1_KEY_MASK)
Kojto 93:e188a91d3eaa 3229 /* BACKKEY0 Bit Fields */
Kojto 93:e188a91d3eaa 3230 #define NV_BACKKEY0_KEY_MASK 0xFFu
Kojto 93:e188a91d3eaa 3231 #define NV_BACKKEY0_KEY_SHIFT 0
Kojto 93:e188a91d3eaa 3232 #define NV_BACKKEY0_KEY(x) (((uint8_t)(((uint8_t)(x))<<NV_BACKKEY0_KEY_SHIFT))&NV_BACKKEY0_KEY_MASK)
Kojto 93:e188a91d3eaa 3233 /* BACKKEY7 Bit Fields */
Kojto 93:e188a91d3eaa 3234 #define NV_BACKKEY7_KEY_MASK 0xFFu
Kojto 93:e188a91d3eaa 3235 #define NV_BACKKEY7_KEY_SHIFT 0
Kojto 93:e188a91d3eaa 3236 #define NV_BACKKEY7_KEY(x) (((uint8_t)(((uint8_t)(x))<<NV_BACKKEY7_KEY_SHIFT))&NV_BACKKEY7_KEY_MASK)
Kojto 93:e188a91d3eaa 3237 /* BACKKEY6 Bit Fields */
Kojto 93:e188a91d3eaa 3238 #define NV_BACKKEY6_KEY_MASK 0xFFu
Kojto 93:e188a91d3eaa 3239 #define NV_BACKKEY6_KEY_SHIFT 0
Kojto 93:e188a91d3eaa 3240 #define NV_BACKKEY6_KEY(x) (((uint8_t)(((uint8_t)(x))<<NV_BACKKEY6_KEY_SHIFT))&NV_BACKKEY6_KEY_MASK)
Kojto 93:e188a91d3eaa 3241 /* BACKKEY5 Bit Fields */
Kojto 93:e188a91d3eaa 3242 #define NV_BACKKEY5_KEY_MASK 0xFFu
Kojto 93:e188a91d3eaa 3243 #define NV_BACKKEY5_KEY_SHIFT 0
Kojto 93:e188a91d3eaa 3244 #define NV_BACKKEY5_KEY(x) (((uint8_t)(((uint8_t)(x))<<NV_BACKKEY5_KEY_SHIFT))&NV_BACKKEY5_KEY_MASK)
Kojto 93:e188a91d3eaa 3245 /* BACKKEY4 Bit Fields */
Kojto 93:e188a91d3eaa 3246 #define NV_BACKKEY4_KEY_MASK 0xFFu
Kojto 93:e188a91d3eaa 3247 #define NV_BACKKEY4_KEY_SHIFT 0
Kojto 93:e188a91d3eaa 3248 #define NV_BACKKEY4_KEY(x) (((uint8_t)(((uint8_t)(x))<<NV_BACKKEY4_KEY_SHIFT))&NV_BACKKEY4_KEY_MASK)
Kojto 93:e188a91d3eaa 3249 /* FPROT3 Bit Fields */
Kojto 93:e188a91d3eaa 3250 #define NV_FPROT3_PROT_MASK 0xFFu
Kojto 93:e188a91d3eaa 3251 #define NV_FPROT3_PROT_SHIFT 0
Kojto 93:e188a91d3eaa 3252 #define NV_FPROT3_PROT(x) (((uint8_t)(((uint8_t)(x))<<NV_FPROT3_PROT_SHIFT))&NV_FPROT3_PROT_MASK)
Kojto 93:e188a91d3eaa 3253 /* FPROT2 Bit Fields */
Kojto 93:e188a91d3eaa 3254 #define NV_FPROT2_PROT_MASK 0xFFu
Kojto 93:e188a91d3eaa 3255 #define NV_FPROT2_PROT_SHIFT 0
Kojto 93:e188a91d3eaa 3256 #define NV_FPROT2_PROT(x) (((uint8_t)(((uint8_t)(x))<<NV_FPROT2_PROT_SHIFT))&NV_FPROT2_PROT_MASK)
Kojto 93:e188a91d3eaa 3257 /* FPROT1 Bit Fields */
Kojto 93:e188a91d3eaa 3258 #define NV_FPROT1_PROT_MASK 0xFFu
Kojto 93:e188a91d3eaa 3259 #define NV_FPROT1_PROT_SHIFT 0
Kojto 93:e188a91d3eaa 3260 #define NV_FPROT1_PROT(x) (((uint8_t)(((uint8_t)(x))<<NV_FPROT1_PROT_SHIFT))&NV_FPROT1_PROT_MASK)
Kojto 93:e188a91d3eaa 3261 /* FPROT0 Bit Fields */
Kojto 93:e188a91d3eaa 3262 #define NV_FPROT0_PROT_MASK 0xFFu
Kojto 93:e188a91d3eaa 3263 #define NV_FPROT0_PROT_SHIFT 0
Kojto 93:e188a91d3eaa 3264 #define NV_FPROT0_PROT(x) (((uint8_t)(((uint8_t)(x))<<NV_FPROT0_PROT_SHIFT))&NV_FPROT0_PROT_MASK)
Kojto 93:e188a91d3eaa 3265 /* FSEC Bit Fields */
Kojto 93:e188a91d3eaa 3266 #define NV_FSEC_SEC_MASK 0x3u
Kojto 93:e188a91d3eaa 3267 #define NV_FSEC_SEC_SHIFT 0
Kojto 93:e188a91d3eaa 3268 #define NV_FSEC_SEC(x) (((uint8_t)(((uint8_t)(x))<<NV_FSEC_SEC_SHIFT))&NV_FSEC_SEC_MASK)
Kojto 93:e188a91d3eaa 3269 #define NV_FSEC_FSLACC_MASK 0xCu
Kojto 93:e188a91d3eaa 3270 #define NV_FSEC_FSLACC_SHIFT 2
Kojto 93:e188a91d3eaa 3271 #define NV_FSEC_FSLACC(x) (((uint8_t)(((uint8_t)(x))<<NV_FSEC_FSLACC_SHIFT))&NV_FSEC_FSLACC_MASK)
Kojto 93:e188a91d3eaa 3272 #define NV_FSEC_MEEN_MASK 0x30u
Kojto 93:e188a91d3eaa 3273 #define NV_FSEC_MEEN_SHIFT 4
Kojto 93:e188a91d3eaa 3274 #define NV_FSEC_MEEN(x) (((uint8_t)(((uint8_t)(x))<<NV_FSEC_MEEN_SHIFT))&NV_FSEC_MEEN_MASK)
Kojto 93:e188a91d3eaa 3275 #define NV_FSEC_KEYEN_MASK 0xC0u
Kojto 93:e188a91d3eaa 3276 #define NV_FSEC_KEYEN_SHIFT 6
Kojto 93:e188a91d3eaa 3277 #define NV_FSEC_KEYEN(x) (((uint8_t)(((uint8_t)(x))<<NV_FSEC_KEYEN_SHIFT))&NV_FSEC_KEYEN_MASK)
Kojto 93:e188a91d3eaa 3278 /* FOPT Bit Fields */
Kojto 93:e188a91d3eaa 3279 #define NV_FOPT_LPBOOT_MASK 0x1u
Kojto 93:e188a91d3eaa 3280 #define NV_FOPT_LPBOOT_SHIFT 0
Kojto 93:e188a91d3eaa 3281 #define NV_FOPT_EZPORT_DIS_MASK 0x2u
Kojto 93:e188a91d3eaa 3282 #define NV_FOPT_EZPORT_DIS_SHIFT 1
Kojto 93:e188a91d3eaa 3283 /* FEPROT Bit Fields */
Kojto 93:e188a91d3eaa 3284 #define NV_FEPROT_EPROT_MASK 0xFFu
Kojto 93:e188a91d3eaa 3285 #define NV_FEPROT_EPROT_SHIFT 0
Kojto 93:e188a91d3eaa 3286 #define NV_FEPROT_EPROT(x) (((uint8_t)(((uint8_t)(x))<<NV_FEPROT_EPROT_SHIFT))&NV_FEPROT_EPROT_MASK)
Kojto 93:e188a91d3eaa 3287 /* FDPROT Bit Fields */
Kojto 93:e188a91d3eaa 3288 #define NV_FDPROT_DPROT_MASK 0xFFu
Kojto 93:e188a91d3eaa 3289 #define NV_FDPROT_DPROT_SHIFT 0
Kojto 93:e188a91d3eaa 3290 #define NV_FDPROT_DPROT(x) (((uint8_t)(((uint8_t)(x))<<NV_FDPROT_DPROT_SHIFT))&NV_FDPROT_DPROT_MASK)
Kojto 93:e188a91d3eaa 3291
Kojto 93:e188a91d3eaa 3292 /**
Kojto 93:e188a91d3eaa 3293 * @}
Kojto 93:e188a91d3eaa 3294 */ /* end of group NV_Register_Masks */
Kojto 93:e188a91d3eaa 3295
Kojto 93:e188a91d3eaa 3296
Kojto 93:e188a91d3eaa 3297 /* NV - Peripheral instance base addresses */
Kojto 93:e188a91d3eaa 3298 /** Peripheral FTFL_FlashConfig base address */
Kojto 93:e188a91d3eaa 3299 #define FTFL_FlashConfig_BASE (0x400u)
Kojto 93:e188a91d3eaa 3300 /** Peripheral FTFL_FlashConfig base pointer */
Kojto 93:e188a91d3eaa 3301 #define FTFL_FlashConfig ((NV_Type *)FTFL_FlashConfig_BASE)
Kojto 93:e188a91d3eaa 3302
Kojto 93:e188a91d3eaa 3303 /**
Kojto 93:e188a91d3eaa 3304 * @}
Kojto 93:e188a91d3eaa 3305 */ /* end of group NV_Peripheral_Access_Layer */
Kojto 93:e188a91d3eaa 3306
Kojto 93:e188a91d3eaa 3307
Kojto 93:e188a91d3eaa 3308 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 3309 -- OSC Peripheral Access Layer
Kojto 93:e188a91d3eaa 3310 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 3311
Kojto 93:e188a91d3eaa 3312 /**
Kojto 93:e188a91d3eaa 3313 * @addtogroup OSC_Peripheral_Access_Layer OSC Peripheral Access Layer
Kojto 93:e188a91d3eaa 3314 * @{
Kojto 93:e188a91d3eaa 3315 */
Kojto 93:e188a91d3eaa 3316
Kojto 93:e188a91d3eaa 3317 /** OSC - Register Layout Typedef */
Kojto 93:e188a91d3eaa 3318 typedef struct {
Kojto 93:e188a91d3eaa 3319 __IO uint8_t CR; /**< OSC Control Register, offset: 0x0 */
Kojto 93:e188a91d3eaa 3320 } OSC_Type;
Kojto 93:e188a91d3eaa 3321
Kojto 93:e188a91d3eaa 3322 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 3323 -- OSC Register Masks
Kojto 93:e188a91d3eaa 3324 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 3325
Kojto 93:e188a91d3eaa 3326 /**
Kojto 93:e188a91d3eaa 3327 * @addtogroup OSC_Register_Masks OSC Register Masks
Kojto 93:e188a91d3eaa 3328 * @{
Kojto 93:e188a91d3eaa 3329 */
Kojto 93:e188a91d3eaa 3330
Kojto 93:e188a91d3eaa 3331 /* CR Bit Fields */
Kojto 93:e188a91d3eaa 3332 #define OSC_CR_SC16P_MASK 0x1u
Kojto 93:e188a91d3eaa 3333 #define OSC_CR_SC16P_SHIFT 0
Kojto 93:e188a91d3eaa 3334 #define OSC_CR_SC8P_MASK 0x2u
Kojto 93:e188a91d3eaa 3335 #define OSC_CR_SC8P_SHIFT 1
Kojto 93:e188a91d3eaa 3336 #define OSC_CR_SC4P_MASK 0x4u
Kojto 93:e188a91d3eaa 3337 #define OSC_CR_SC4P_SHIFT 2
Kojto 93:e188a91d3eaa 3338 #define OSC_CR_SC2P_MASK 0x8u
Kojto 93:e188a91d3eaa 3339 #define OSC_CR_SC2P_SHIFT 3
Kojto 93:e188a91d3eaa 3340 #define OSC_CR_EREFSTEN_MASK 0x20u
Kojto 93:e188a91d3eaa 3341 #define OSC_CR_EREFSTEN_SHIFT 5
Kojto 93:e188a91d3eaa 3342 #define OSC_CR_ERCLKEN_MASK 0x80u
Kojto 93:e188a91d3eaa 3343 #define OSC_CR_ERCLKEN_SHIFT 7
Kojto 93:e188a91d3eaa 3344
Kojto 93:e188a91d3eaa 3345 /**
Kojto 93:e188a91d3eaa 3346 * @}
Kojto 93:e188a91d3eaa 3347 */ /* end of group OSC_Register_Masks */
Kojto 93:e188a91d3eaa 3348
Kojto 93:e188a91d3eaa 3349
Kojto 93:e188a91d3eaa 3350 /* OSC - Peripheral instance base addresses */
Kojto 93:e188a91d3eaa 3351 /** Peripheral OSC0 base address */
Kojto 93:e188a91d3eaa 3352 #define OSC0_BASE (0x40065000u)
Kojto 93:e188a91d3eaa 3353 /** Peripheral OSC0 base pointer */
Kojto 93:e188a91d3eaa 3354 #define OSC0 ((OSC_Type *)OSC0_BASE)
Kojto 93:e188a91d3eaa 3355
Kojto 93:e188a91d3eaa 3356 /**
Kojto 93:e188a91d3eaa 3357 * @}
Kojto 93:e188a91d3eaa 3358 */ /* end of group OSC_Peripheral_Access_Layer */
Kojto 93:e188a91d3eaa 3359
Kojto 93:e188a91d3eaa 3360
Kojto 93:e188a91d3eaa 3361 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 3362 -- PDB Peripheral Access Layer
Kojto 93:e188a91d3eaa 3363 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 3364
Kojto 93:e188a91d3eaa 3365 /**
Kojto 93:e188a91d3eaa 3366 * @addtogroup PDB_Peripheral_Access_Layer PDB Peripheral Access Layer
Kojto 93:e188a91d3eaa 3367 * @{
Kojto 93:e188a91d3eaa 3368 */
Kojto 93:e188a91d3eaa 3369
Kojto 93:e188a91d3eaa 3370 /** PDB - Register Layout Typedef */
Kojto 93:e188a91d3eaa 3371 typedef struct {
Kojto 93:e188a91d3eaa 3372 __IO uint32_t SC; /**< Status and Control Register, offset: 0x0 */
Kojto 93:e188a91d3eaa 3373 __IO uint32_t MOD; /**< Modulus Register, offset: 0x4 */
Kojto 93:e188a91d3eaa 3374 __I uint32_t CNT; /**< Counter Register, offset: 0x8 */
Kojto 93:e188a91d3eaa 3375 __IO uint32_t IDLY; /**< Interrupt Delay Register, offset: 0xC */
Kojto 93:e188a91d3eaa 3376 struct { /* offset: 0x10, array step: 0x10 */
Kojto 93:e188a91d3eaa 3377 __IO uint32_t C1; /**< Channel n Control Register 1, array offset: 0x10, array step: 0x10 */
Kojto 93:e188a91d3eaa 3378 __IO uint32_t S; /**< Channel n Status Register, array offset: 0x14, array step: 0x10 */
Kojto 93:e188a91d3eaa 3379 __IO uint32_t DLY[2]; /**< Channel n Delay 0 Register..Channel n Delay 1 Register, array offset: 0x18, array step: index*0x10, index2*0x4 */
Kojto 93:e188a91d3eaa 3380 } CH[1];
Kojto 93:e188a91d3eaa 3381 uint8_t RESERVED_0[368];
Kojto 93:e188a91d3eaa 3382 __IO uint32_t POEN; /**< Pulse-Out n Enable Register, offset: 0x190 */
Kojto 93:e188a91d3eaa 3383 __IO uint32_t PODLY[2]; /**< Pulse-Out n Delay Register, array offset: 0x194, array step: 0x4 */
Kojto 93:e188a91d3eaa 3384 } PDB_Type;
Kojto 93:e188a91d3eaa 3385
Kojto 93:e188a91d3eaa 3386 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 3387 -- PDB Register Masks
Kojto 93:e188a91d3eaa 3388 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 3389
Kojto 93:e188a91d3eaa 3390 /**
Kojto 93:e188a91d3eaa 3391 * @addtogroup PDB_Register_Masks PDB Register Masks
Kojto 93:e188a91d3eaa 3392 * @{
Kojto 93:e188a91d3eaa 3393 */
Kojto 93:e188a91d3eaa 3394
Kojto 93:e188a91d3eaa 3395 /* SC Bit Fields */
Kojto 93:e188a91d3eaa 3396 #define PDB_SC_LDOK_MASK 0x1u
Kojto 93:e188a91d3eaa 3397 #define PDB_SC_LDOK_SHIFT 0
Kojto 93:e188a91d3eaa 3398 #define PDB_SC_CONT_MASK 0x2u
Kojto 93:e188a91d3eaa 3399 #define PDB_SC_CONT_SHIFT 1
Kojto 93:e188a91d3eaa 3400 #define PDB_SC_MULT_MASK 0xCu
Kojto 93:e188a91d3eaa 3401 #define PDB_SC_MULT_SHIFT 2
Kojto 93:e188a91d3eaa 3402 #define PDB_SC_MULT(x) (((uint32_t)(((uint32_t)(x))<<PDB_SC_MULT_SHIFT))&PDB_SC_MULT_MASK)
Kojto 93:e188a91d3eaa 3403 #define PDB_SC_PDBIE_MASK 0x20u
Kojto 93:e188a91d3eaa 3404 #define PDB_SC_PDBIE_SHIFT 5
Kojto 93:e188a91d3eaa 3405 #define PDB_SC_PDBIF_MASK 0x40u
Kojto 93:e188a91d3eaa 3406 #define PDB_SC_PDBIF_SHIFT 6
Kojto 93:e188a91d3eaa 3407 #define PDB_SC_PDBEN_MASK 0x80u
Kojto 93:e188a91d3eaa 3408 #define PDB_SC_PDBEN_SHIFT 7
Kojto 93:e188a91d3eaa 3409 #define PDB_SC_TRGSEL_MASK 0xF00u
Kojto 93:e188a91d3eaa 3410 #define PDB_SC_TRGSEL_SHIFT 8
Kojto 93:e188a91d3eaa 3411 #define PDB_SC_TRGSEL(x) (((uint32_t)(((uint32_t)(x))<<PDB_SC_TRGSEL_SHIFT))&PDB_SC_TRGSEL_MASK)
Kojto 93:e188a91d3eaa 3412 #define PDB_SC_PRESCALER_MASK 0x7000u
Kojto 93:e188a91d3eaa 3413 #define PDB_SC_PRESCALER_SHIFT 12
Kojto 93:e188a91d3eaa 3414 #define PDB_SC_PRESCALER(x) (((uint32_t)(((uint32_t)(x))<<PDB_SC_PRESCALER_SHIFT))&PDB_SC_PRESCALER_MASK)
Kojto 93:e188a91d3eaa 3415 #define PDB_SC_DMAEN_MASK 0x8000u
Kojto 93:e188a91d3eaa 3416 #define PDB_SC_DMAEN_SHIFT 15
Kojto 93:e188a91d3eaa 3417 #define PDB_SC_SWTRIG_MASK 0x10000u
Kojto 93:e188a91d3eaa 3418 #define PDB_SC_SWTRIG_SHIFT 16
Kojto 93:e188a91d3eaa 3419 #define PDB_SC_PDBEIE_MASK 0x20000u
Kojto 93:e188a91d3eaa 3420 #define PDB_SC_PDBEIE_SHIFT 17
Kojto 93:e188a91d3eaa 3421 #define PDB_SC_LDMOD_MASK 0xC0000u
Kojto 93:e188a91d3eaa 3422 #define PDB_SC_LDMOD_SHIFT 18
Kojto 93:e188a91d3eaa 3423 #define PDB_SC_LDMOD(x) (((uint32_t)(((uint32_t)(x))<<PDB_SC_LDMOD_SHIFT))&PDB_SC_LDMOD_MASK)
Kojto 93:e188a91d3eaa 3424 /* MOD Bit Fields */
Kojto 93:e188a91d3eaa 3425 #define PDB_MOD_MOD_MASK 0xFFFFu
Kojto 93:e188a91d3eaa 3426 #define PDB_MOD_MOD_SHIFT 0
Kojto 93:e188a91d3eaa 3427 #define PDB_MOD_MOD(x) (((uint32_t)(((uint32_t)(x))<<PDB_MOD_MOD_SHIFT))&PDB_MOD_MOD_MASK)
Kojto 93:e188a91d3eaa 3428 /* CNT Bit Fields */
Kojto 93:e188a91d3eaa 3429 #define PDB_CNT_CNT_MASK 0xFFFFu
Kojto 93:e188a91d3eaa 3430 #define PDB_CNT_CNT_SHIFT 0
Kojto 93:e188a91d3eaa 3431 #define PDB_CNT_CNT(x) (((uint32_t)(((uint32_t)(x))<<PDB_CNT_CNT_SHIFT))&PDB_CNT_CNT_MASK)
Kojto 93:e188a91d3eaa 3432 /* IDLY Bit Fields */
Kojto 93:e188a91d3eaa 3433 #define PDB_IDLY_IDLY_MASK 0xFFFFu
Kojto 93:e188a91d3eaa 3434 #define PDB_IDLY_IDLY_SHIFT 0
Kojto 93:e188a91d3eaa 3435 #define PDB_IDLY_IDLY(x) (((uint32_t)(((uint32_t)(x))<<PDB_IDLY_IDLY_SHIFT))&PDB_IDLY_IDLY_MASK)
Kojto 93:e188a91d3eaa 3436 /* C1 Bit Fields */
Kojto 93:e188a91d3eaa 3437 #define PDB_C1_EN_MASK 0xFFu
Kojto 93:e188a91d3eaa 3438 #define PDB_C1_EN_SHIFT 0
Kojto 93:e188a91d3eaa 3439 #define PDB_C1_EN(x) (((uint32_t)(((uint32_t)(x))<<PDB_C1_EN_SHIFT))&PDB_C1_EN_MASK)
Kojto 93:e188a91d3eaa 3440 #define PDB_C1_TOS_MASK 0xFF00u
Kojto 93:e188a91d3eaa 3441 #define PDB_C1_TOS_SHIFT 8
Kojto 93:e188a91d3eaa 3442 #define PDB_C1_TOS(x) (((uint32_t)(((uint32_t)(x))<<PDB_C1_TOS_SHIFT))&PDB_C1_TOS_MASK)
Kojto 93:e188a91d3eaa 3443 #define PDB_C1_BB_MASK 0xFF0000u
Kojto 93:e188a91d3eaa 3444 #define PDB_C1_BB_SHIFT 16
Kojto 93:e188a91d3eaa 3445 #define PDB_C1_BB(x) (((uint32_t)(((uint32_t)(x))<<PDB_C1_BB_SHIFT))&PDB_C1_BB_MASK)
Kojto 93:e188a91d3eaa 3446 /* S Bit Fields */
Kojto 93:e188a91d3eaa 3447 #define PDB_S_ERR_MASK 0xFFu
Kojto 93:e188a91d3eaa 3448 #define PDB_S_ERR_SHIFT 0
Kojto 93:e188a91d3eaa 3449 #define PDB_S_ERR(x) (((uint32_t)(((uint32_t)(x))<<PDB_S_ERR_SHIFT))&PDB_S_ERR_MASK)
Kojto 93:e188a91d3eaa 3450 #define PDB_S_CF_MASK 0xFF0000u
Kojto 93:e188a91d3eaa 3451 #define PDB_S_CF_SHIFT 16
Kojto 93:e188a91d3eaa 3452 #define PDB_S_CF(x) (((uint32_t)(((uint32_t)(x))<<PDB_S_CF_SHIFT))&PDB_S_CF_MASK)
Kojto 93:e188a91d3eaa 3453 /* DLY Bit Fields */
Kojto 93:e188a91d3eaa 3454 #define PDB_DLY_DLY_MASK 0xFFFFu
Kojto 93:e188a91d3eaa 3455 #define PDB_DLY_DLY_SHIFT 0
Kojto 93:e188a91d3eaa 3456 #define PDB_DLY_DLY(x) (((uint32_t)(((uint32_t)(x))<<PDB_DLY_DLY_SHIFT))&PDB_DLY_DLY_MASK)
Kojto 93:e188a91d3eaa 3457 /* POEN Bit Fields */
Kojto 93:e188a91d3eaa 3458 #define PDB_POEN_POEN_MASK 0xFFu
Kojto 93:e188a91d3eaa 3459 #define PDB_POEN_POEN_SHIFT 0
Kojto 93:e188a91d3eaa 3460 #define PDB_POEN_POEN(x) (((uint32_t)(((uint32_t)(x))<<PDB_POEN_POEN_SHIFT))&PDB_POEN_POEN_MASK)
Kojto 93:e188a91d3eaa 3461 /* PODLY Bit Fields */
Kojto 93:e188a91d3eaa 3462 #define PDB_PODLY_DLY2_MASK 0xFFFFu
Kojto 93:e188a91d3eaa 3463 #define PDB_PODLY_DLY2_SHIFT 0
Kojto 93:e188a91d3eaa 3464 #define PDB_PODLY_DLY2(x) (((uint32_t)(((uint32_t)(x))<<PDB_PODLY_DLY2_SHIFT))&PDB_PODLY_DLY2_MASK)
Kojto 93:e188a91d3eaa 3465 #define PDB_PODLY_DLY1_MASK 0xFFFF0000u
Kojto 93:e188a91d3eaa 3466 #define PDB_PODLY_DLY1_SHIFT 16
Kojto 93:e188a91d3eaa 3467 #define PDB_PODLY_DLY1(x) (((uint32_t)(((uint32_t)(x))<<PDB_PODLY_DLY1_SHIFT))&PDB_PODLY_DLY1_MASK)
Kojto 93:e188a91d3eaa 3468
Kojto 93:e188a91d3eaa 3469 /**
Kojto 93:e188a91d3eaa 3470 * @}
Kojto 93:e188a91d3eaa 3471 */ /* end of group PDB_Register_Masks */
Kojto 93:e188a91d3eaa 3472
Kojto 93:e188a91d3eaa 3473
Kojto 93:e188a91d3eaa 3474 /* PDB - Peripheral instance base addresses */
Kojto 93:e188a91d3eaa 3475 /** Peripheral PDB0 base address */
Kojto 93:e188a91d3eaa 3476 #define PDB0_BASE (0x40036000u)
Kojto 93:e188a91d3eaa 3477 /** Peripheral PDB0 base pointer */
Kojto 93:e188a91d3eaa 3478 #define PDB0 ((PDB_Type *)PDB0_BASE)
Kojto 93:e188a91d3eaa 3479
Kojto 93:e188a91d3eaa 3480 /**
Kojto 93:e188a91d3eaa 3481 * @}
Kojto 93:e188a91d3eaa 3482 */ /* end of group PDB_Peripheral_Access_Layer */
Kojto 93:e188a91d3eaa 3483
Kojto 93:e188a91d3eaa 3484
Kojto 93:e188a91d3eaa 3485 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 3486 -- PIT Peripheral Access Layer
Kojto 93:e188a91d3eaa 3487 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 3488
Kojto 93:e188a91d3eaa 3489 /**
Kojto 93:e188a91d3eaa 3490 * @addtogroup PIT_Peripheral_Access_Layer PIT Peripheral Access Layer
Kojto 93:e188a91d3eaa 3491 * @{
Kojto 93:e188a91d3eaa 3492 */
Kojto 93:e188a91d3eaa 3493
Kojto 93:e188a91d3eaa 3494 /** PIT - Register Layout Typedef */
Kojto 93:e188a91d3eaa 3495 typedef struct {
Kojto 93:e188a91d3eaa 3496 __IO uint32_t MCR; /**< PIT Module Control Register, offset: 0x0 */
Kojto 93:e188a91d3eaa 3497 uint8_t RESERVED_0[252];
Kojto 93:e188a91d3eaa 3498 struct { /* offset: 0x100, array step: 0x10 */
Kojto 93:e188a91d3eaa 3499 __IO uint32_t LDVAL; /**< Timer Load Value Register, array offset: 0x100, array step: 0x10 */
Kojto 93:e188a91d3eaa 3500 __I uint32_t CVAL; /**< Current Timer Value Register, array offset: 0x104, array step: 0x10 */
Kojto 93:e188a91d3eaa 3501 __IO uint32_t TCTRL; /**< Timer Control Register, array offset: 0x108, array step: 0x10 */
Kojto 93:e188a91d3eaa 3502 __IO uint32_t TFLG; /**< Timer Flag Register, array offset: 0x10C, array step: 0x10 */
Kojto 93:e188a91d3eaa 3503 } CHANNEL[4];
Kojto 93:e188a91d3eaa 3504 } PIT_Type;
Kojto 93:e188a91d3eaa 3505
Kojto 93:e188a91d3eaa 3506 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 3507 -- PIT Register Masks
Kojto 93:e188a91d3eaa 3508 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 3509
Kojto 93:e188a91d3eaa 3510 /**
Kojto 93:e188a91d3eaa 3511 * @addtogroup PIT_Register_Masks PIT Register Masks
Kojto 93:e188a91d3eaa 3512 * @{
Kojto 93:e188a91d3eaa 3513 */
Kojto 93:e188a91d3eaa 3514
Kojto 93:e188a91d3eaa 3515 /* MCR Bit Fields */
Kojto 93:e188a91d3eaa 3516 #define PIT_MCR_FRZ_MASK 0x1u
Kojto 93:e188a91d3eaa 3517 #define PIT_MCR_FRZ_SHIFT 0
Kojto 93:e188a91d3eaa 3518 #define PIT_MCR_MDIS_MASK 0x2u
Kojto 93:e188a91d3eaa 3519 #define PIT_MCR_MDIS_SHIFT 1
Kojto 93:e188a91d3eaa 3520 /* LDVAL Bit Fields */
Kojto 93:e188a91d3eaa 3521 #define PIT_LDVAL_TSV_MASK 0xFFFFFFFFu
Kojto 93:e188a91d3eaa 3522 #define PIT_LDVAL_TSV_SHIFT 0
Kojto 93:e188a91d3eaa 3523 #define PIT_LDVAL_TSV(x) (((uint32_t)(((uint32_t)(x))<<PIT_LDVAL_TSV_SHIFT))&PIT_LDVAL_TSV_MASK)
Kojto 93:e188a91d3eaa 3524 /* CVAL Bit Fields */
Kojto 93:e188a91d3eaa 3525 #define PIT_CVAL_TVL_MASK 0xFFFFFFFFu
Kojto 93:e188a91d3eaa 3526 #define PIT_CVAL_TVL_SHIFT 0
Kojto 93:e188a91d3eaa 3527 #define PIT_CVAL_TVL(x) (((uint32_t)(((uint32_t)(x))<<PIT_CVAL_TVL_SHIFT))&PIT_CVAL_TVL_MASK)
Kojto 93:e188a91d3eaa 3528 /* TCTRL Bit Fields */
Kojto 93:e188a91d3eaa 3529 #define PIT_TCTRL_TEN_MASK 0x1u
Kojto 93:e188a91d3eaa 3530 #define PIT_TCTRL_TEN_SHIFT 0
Kojto 93:e188a91d3eaa 3531 #define PIT_TCTRL_TIE_MASK 0x2u
Kojto 93:e188a91d3eaa 3532 #define PIT_TCTRL_TIE_SHIFT 1
Kojto 93:e188a91d3eaa 3533 /* TFLG Bit Fields */
Kojto 93:e188a91d3eaa 3534 #define PIT_TFLG_TIF_MASK 0x1u
Kojto 93:e188a91d3eaa 3535 #define PIT_TFLG_TIF_SHIFT 0
Kojto 93:e188a91d3eaa 3536
Kojto 93:e188a91d3eaa 3537 /**
Kojto 93:e188a91d3eaa 3538 * @}
Kojto 93:e188a91d3eaa 3539 */ /* end of group PIT_Register_Masks */
Kojto 93:e188a91d3eaa 3540
Kojto 93:e188a91d3eaa 3541
Kojto 93:e188a91d3eaa 3542 /* PIT - Peripheral instance base addresses */
Kojto 93:e188a91d3eaa 3543 /** Peripheral PIT base address */
Kojto 93:e188a91d3eaa 3544 #define PIT_BASE (0x40037000u)
Kojto 93:e188a91d3eaa 3545 /** Peripheral PIT base pointer */
Kojto 93:e188a91d3eaa 3546 #define PIT ((PIT_Type *)PIT_BASE)
Kojto 93:e188a91d3eaa 3547
Kojto 93:e188a91d3eaa 3548 /**
Kojto 93:e188a91d3eaa 3549 * @}
Kojto 93:e188a91d3eaa 3550 */ /* end of group PIT_Peripheral_Access_Layer */
Kojto 93:e188a91d3eaa 3551
Kojto 93:e188a91d3eaa 3552
Kojto 93:e188a91d3eaa 3553 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 3554 -- PMC Peripheral Access Layer
Kojto 93:e188a91d3eaa 3555 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 3556
Kojto 93:e188a91d3eaa 3557 /**
Kojto 93:e188a91d3eaa 3558 * @addtogroup PMC_Peripheral_Access_Layer PMC Peripheral Access Layer
Kojto 93:e188a91d3eaa 3559 * @{
Kojto 93:e188a91d3eaa 3560 */
Kojto 93:e188a91d3eaa 3561
Kojto 93:e188a91d3eaa 3562 /** PMC - Register Layout Typedef */
Kojto 93:e188a91d3eaa 3563 typedef struct {
Kojto 93:e188a91d3eaa 3564 __IO uint8_t LVDSC1; /**< Low Voltage Detect Status and Control 1 Register, offset: 0x0 */
Kojto 93:e188a91d3eaa 3565 __IO uint8_t LVDSC2; /**< Low Voltage Detect Status and Control 2 Register, offset: 0x1 */
Kojto 93:e188a91d3eaa 3566 __IO uint8_t REGSC; /**< Regulator Status and Control Register, offset: 0x2 */
Kojto 93:e188a91d3eaa 3567 } PMC_Type;
Kojto 93:e188a91d3eaa 3568
Kojto 93:e188a91d3eaa 3569 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 3570 -- PMC Register Masks
Kojto 93:e188a91d3eaa 3571 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 3572
Kojto 93:e188a91d3eaa 3573 /**
Kojto 93:e188a91d3eaa 3574 * @addtogroup PMC_Register_Masks PMC Register Masks
Kojto 93:e188a91d3eaa 3575 * @{
Kojto 93:e188a91d3eaa 3576 */
Kojto 93:e188a91d3eaa 3577
Kojto 93:e188a91d3eaa 3578 /* LVDSC1 Bit Fields */
Kojto 93:e188a91d3eaa 3579 #define PMC_LVDSC1_LVDV_MASK 0x3u
Kojto 93:e188a91d3eaa 3580 #define PMC_LVDSC1_LVDV_SHIFT 0
Kojto 93:e188a91d3eaa 3581 #define PMC_LVDSC1_LVDV(x) (((uint8_t)(((uint8_t)(x))<<PMC_LVDSC1_LVDV_SHIFT))&PMC_LVDSC1_LVDV_MASK)
Kojto 93:e188a91d3eaa 3582 #define PMC_LVDSC1_LVDRE_MASK 0x10u
Kojto 93:e188a91d3eaa 3583 #define PMC_LVDSC1_LVDRE_SHIFT 4
Kojto 93:e188a91d3eaa 3584 #define PMC_LVDSC1_LVDIE_MASK 0x20u
Kojto 93:e188a91d3eaa 3585 #define PMC_LVDSC1_LVDIE_SHIFT 5
Kojto 93:e188a91d3eaa 3586 #define PMC_LVDSC1_LVDACK_MASK 0x40u
Kojto 93:e188a91d3eaa 3587 #define PMC_LVDSC1_LVDACK_SHIFT 6
Kojto 93:e188a91d3eaa 3588 #define PMC_LVDSC1_LVDF_MASK 0x80u
Kojto 93:e188a91d3eaa 3589 #define PMC_LVDSC1_LVDF_SHIFT 7
Kojto 93:e188a91d3eaa 3590 /* LVDSC2 Bit Fields */
Kojto 93:e188a91d3eaa 3591 #define PMC_LVDSC2_LVWV_MASK 0x3u
Kojto 93:e188a91d3eaa 3592 #define PMC_LVDSC2_LVWV_SHIFT 0
Kojto 93:e188a91d3eaa 3593 #define PMC_LVDSC2_LVWV(x) (((uint8_t)(((uint8_t)(x))<<PMC_LVDSC2_LVWV_SHIFT))&PMC_LVDSC2_LVWV_MASK)
Kojto 93:e188a91d3eaa 3594 #define PMC_LVDSC2_LVWIE_MASK 0x20u
Kojto 93:e188a91d3eaa 3595 #define PMC_LVDSC2_LVWIE_SHIFT 5
Kojto 93:e188a91d3eaa 3596 #define PMC_LVDSC2_LVWACK_MASK 0x40u
Kojto 93:e188a91d3eaa 3597 #define PMC_LVDSC2_LVWACK_SHIFT 6
Kojto 93:e188a91d3eaa 3598 #define PMC_LVDSC2_LVWF_MASK 0x80u
Kojto 93:e188a91d3eaa 3599 #define PMC_LVDSC2_LVWF_SHIFT 7
Kojto 93:e188a91d3eaa 3600 /* REGSC Bit Fields */
Kojto 93:e188a91d3eaa 3601 #define PMC_REGSC_BGBE_MASK 0x1u
Kojto 93:e188a91d3eaa 3602 #define PMC_REGSC_BGBE_SHIFT 0
Kojto 93:e188a91d3eaa 3603 #define PMC_REGSC_REGONS_MASK 0x4u
Kojto 93:e188a91d3eaa 3604 #define PMC_REGSC_REGONS_SHIFT 2
Kojto 93:e188a91d3eaa 3605 #define PMC_REGSC_ACKISO_MASK 0x8u
Kojto 93:e188a91d3eaa 3606 #define PMC_REGSC_ACKISO_SHIFT 3
Kojto 93:e188a91d3eaa 3607
Kojto 93:e188a91d3eaa 3608 /**
Kojto 93:e188a91d3eaa 3609 * @}
Kojto 93:e188a91d3eaa 3610 */ /* end of group PMC_Register_Masks */
Kojto 93:e188a91d3eaa 3611
Kojto 93:e188a91d3eaa 3612
Kojto 93:e188a91d3eaa 3613 /* PMC - Peripheral instance base addresses */
Kojto 93:e188a91d3eaa 3614 /** Peripheral PMC base address */
Kojto 93:e188a91d3eaa 3615 #define PMC_BASE (0x4007D000u)
Kojto 93:e188a91d3eaa 3616 /** Peripheral PMC base pointer */
Kojto 93:e188a91d3eaa 3617 #define PMC ((PMC_Type *)PMC_BASE)
Kojto 93:e188a91d3eaa 3618
Kojto 93:e188a91d3eaa 3619 /**
Kojto 93:e188a91d3eaa 3620 * @}
Kojto 93:e188a91d3eaa 3621 */ /* end of group PMC_Peripheral_Access_Layer */
Kojto 93:e188a91d3eaa 3622
Kojto 93:e188a91d3eaa 3623
Kojto 93:e188a91d3eaa 3624 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 3625 -- PORT Peripheral Access Layer
Kojto 93:e188a91d3eaa 3626 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 3627
Kojto 93:e188a91d3eaa 3628 /**
Kojto 93:e188a91d3eaa 3629 * @addtogroup PORT_Peripheral_Access_Layer PORT Peripheral Access Layer
Kojto 93:e188a91d3eaa 3630 * @{
Kojto 93:e188a91d3eaa 3631 */
Kojto 93:e188a91d3eaa 3632
Kojto 93:e188a91d3eaa 3633 /** PORT - Register Layout Typedef */
Kojto 93:e188a91d3eaa 3634 typedef struct {
Kojto 93:e188a91d3eaa 3635 __IO uint32_t PCR[32]; /**< Pin Control Register n, array offset: 0x0, array step: 0x4 */
Kojto 93:e188a91d3eaa 3636 __O uint32_t GPCLR; /**< Global Pin Control Low Register, offset: 0x80 */
Kojto 93:e188a91d3eaa 3637 __O uint32_t GPCHR; /**< Global Pin Control High Register, offset: 0x84 */
Kojto 93:e188a91d3eaa 3638 uint8_t RESERVED_0[24];
Kojto 93:e188a91d3eaa 3639 __IO uint32_t ISFR; /**< Interrupt Status Flag Register, offset: 0xA0 */
Kojto 93:e188a91d3eaa 3640 uint8_t RESERVED_1[28];
Kojto 93:e188a91d3eaa 3641 __IO uint32_t DFER; /**< Digital Filter Enable Register, offset: 0xC0 */
Kojto 93:e188a91d3eaa 3642 __IO uint32_t DFCR; /**< Digital Filter Clock Register, offset: 0xC4 */
Kojto 93:e188a91d3eaa 3643 __IO uint32_t DFWR; /**< Digital Filter Width Register, offset: 0xC8 */
Kojto 93:e188a91d3eaa 3644 } PORT_Type;
Kojto 93:e188a91d3eaa 3645
Kojto 93:e188a91d3eaa 3646 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 3647 -- PORT Register Masks
Kojto 93:e188a91d3eaa 3648 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 3649
Kojto 93:e188a91d3eaa 3650 /**
Kojto 93:e188a91d3eaa 3651 * @addtogroup PORT_Register_Masks PORT Register Masks
Kojto 93:e188a91d3eaa 3652 * @{
Kojto 93:e188a91d3eaa 3653 */
Kojto 93:e188a91d3eaa 3654
Kojto 93:e188a91d3eaa 3655 /* PCR Bit Fields */
Kojto 93:e188a91d3eaa 3656 #define PORT_PCR_PS_MASK 0x1u
Kojto 93:e188a91d3eaa 3657 #define PORT_PCR_PS_SHIFT 0
Kojto 93:e188a91d3eaa 3658 #define PORT_PCR_PE_MASK 0x2u
Kojto 93:e188a91d3eaa 3659 #define PORT_PCR_PE_SHIFT 1
Kojto 93:e188a91d3eaa 3660 #define PORT_PCR_SRE_MASK 0x4u
Kojto 93:e188a91d3eaa 3661 #define PORT_PCR_SRE_SHIFT 2
Kojto 93:e188a91d3eaa 3662 #define PORT_PCR_PFE_MASK 0x10u
Kojto 93:e188a91d3eaa 3663 #define PORT_PCR_PFE_SHIFT 4
Kojto 93:e188a91d3eaa 3664 #define PORT_PCR_ODE_MASK 0x20u
Kojto 93:e188a91d3eaa 3665 #define PORT_PCR_ODE_SHIFT 5
Kojto 93:e188a91d3eaa 3666 #define PORT_PCR_DSE_MASK 0x40u
Kojto 93:e188a91d3eaa 3667 #define PORT_PCR_DSE_SHIFT 6
Kojto 93:e188a91d3eaa 3668 #define PORT_PCR_MUX_MASK 0x700u
Kojto 93:e188a91d3eaa 3669 #define PORT_PCR_MUX_SHIFT 8
Kojto 93:e188a91d3eaa 3670 #define PORT_PCR_MUX(x) (((uint32_t)(((uint32_t)(x))<<PORT_PCR_MUX_SHIFT))&PORT_PCR_MUX_MASK)
Kojto 93:e188a91d3eaa 3671 #define PORT_PCR_LK_MASK 0x8000u
Kojto 93:e188a91d3eaa 3672 #define PORT_PCR_LK_SHIFT 15
Kojto 93:e188a91d3eaa 3673 #define PORT_PCR_IRQC_MASK 0xF0000u
Kojto 93:e188a91d3eaa 3674 #define PORT_PCR_IRQC_SHIFT 16
Kojto 93:e188a91d3eaa 3675 #define PORT_PCR_IRQC(x) (((uint32_t)(((uint32_t)(x))<<PORT_PCR_IRQC_SHIFT))&PORT_PCR_IRQC_MASK)
Kojto 93:e188a91d3eaa 3676 #define PORT_PCR_ISF_MASK 0x1000000u
Kojto 93:e188a91d3eaa 3677 #define PORT_PCR_ISF_SHIFT 24
Kojto 93:e188a91d3eaa 3678 /* GPCLR Bit Fields */
Kojto 93:e188a91d3eaa 3679 #define PORT_GPCLR_GPWD_MASK 0xFFFFu
Kojto 93:e188a91d3eaa 3680 #define PORT_GPCLR_GPWD_SHIFT 0
Kojto 93:e188a91d3eaa 3681 #define PORT_GPCLR_GPWD(x) (((uint32_t)(((uint32_t)(x))<<PORT_GPCLR_GPWD_SHIFT))&PORT_GPCLR_GPWD_MASK)
Kojto 93:e188a91d3eaa 3682 #define PORT_GPCLR_GPWE_MASK 0xFFFF0000u
Kojto 93:e188a91d3eaa 3683 #define PORT_GPCLR_GPWE_SHIFT 16
Kojto 93:e188a91d3eaa 3684 #define PORT_GPCLR_GPWE(x) (((uint32_t)(((uint32_t)(x))<<PORT_GPCLR_GPWE_SHIFT))&PORT_GPCLR_GPWE_MASK)
Kojto 93:e188a91d3eaa 3685 /* GPCHR Bit Fields */
Kojto 93:e188a91d3eaa 3686 #define PORT_GPCHR_GPWD_MASK 0xFFFFu
Kojto 93:e188a91d3eaa 3687 #define PORT_GPCHR_GPWD_SHIFT 0
Kojto 93:e188a91d3eaa 3688 #define PORT_GPCHR_GPWD(x) (((uint32_t)(((uint32_t)(x))<<PORT_GPCHR_GPWD_SHIFT))&PORT_GPCHR_GPWD_MASK)
Kojto 93:e188a91d3eaa 3689 #define PORT_GPCHR_GPWE_MASK 0xFFFF0000u
Kojto 93:e188a91d3eaa 3690 #define PORT_GPCHR_GPWE_SHIFT 16
Kojto 93:e188a91d3eaa 3691 #define PORT_GPCHR_GPWE(x) (((uint32_t)(((uint32_t)(x))<<PORT_GPCHR_GPWE_SHIFT))&PORT_GPCHR_GPWE_MASK)
Kojto 93:e188a91d3eaa 3692 /* ISFR Bit Fields */
Kojto 93:e188a91d3eaa 3693 #define PORT_ISFR_ISF_MASK 0xFFFFFFFFu
Kojto 93:e188a91d3eaa 3694 #define PORT_ISFR_ISF_SHIFT 0
Kojto 93:e188a91d3eaa 3695 #define PORT_ISFR_ISF(x) (((uint32_t)(((uint32_t)(x))<<PORT_ISFR_ISF_SHIFT))&PORT_ISFR_ISF_MASK)
Kojto 93:e188a91d3eaa 3696 /* DFER Bit Fields */
Kojto 93:e188a91d3eaa 3697 #define PORT_DFER_DFE_MASK 0xFFFFFFFFu
Kojto 93:e188a91d3eaa 3698 #define PORT_DFER_DFE_SHIFT 0
Kojto 93:e188a91d3eaa 3699 #define PORT_DFER_DFE(x) (((uint32_t)(((uint32_t)(x))<<PORT_DFER_DFE_SHIFT))&PORT_DFER_DFE_MASK)
Kojto 93:e188a91d3eaa 3700 /* DFCR Bit Fields */
Kojto 93:e188a91d3eaa 3701 #define PORT_DFCR_CS_MASK 0x1u
Kojto 93:e188a91d3eaa 3702 #define PORT_DFCR_CS_SHIFT 0
Kojto 93:e188a91d3eaa 3703 /* DFWR Bit Fields */
Kojto 93:e188a91d3eaa 3704 #define PORT_DFWR_FILT_MASK 0x1Fu
Kojto 93:e188a91d3eaa 3705 #define PORT_DFWR_FILT_SHIFT 0
Kojto 93:e188a91d3eaa 3706 #define PORT_DFWR_FILT(x) (((uint32_t)(((uint32_t)(x))<<PORT_DFWR_FILT_SHIFT))&PORT_DFWR_FILT_MASK)
Kojto 93:e188a91d3eaa 3707
Kojto 93:e188a91d3eaa 3708 /**
Kojto 93:e188a91d3eaa 3709 * @}
Kojto 93:e188a91d3eaa 3710 */ /* end of group PORT_Register_Masks */
Kojto 93:e188a91d3eaa 3711
Kojto 93:e188a91d3eaa 3712
Kojto 93:e188a91d3eaa 3713 /* PORT - Peripheral instance base addresses */
Kojto 93:e188a91d3eaa 3714 /** Peripheral PORTA base address */
Kojto 93:e188a91d3eaa 3715 #define PORTA_BASE (0x40049000u)
Kojto 93:e188a91d3eaa 3716 /** Peripheral PORTA base pointer */
Kojto 93:e188a91d3eaa 3717 #define PORTA ((PORT_Type *)PORTA_BASE)
Kojto 93:e188a91d3eaa 3718 /** Peripheral PORTB base address */
Kojto 93:e188a91d3eaa 3719 #define PORTB_BASE (0x4004A000u)
Kojto 93:e188a91d3eaa 3720 /** Peripheral PORTB base pointer */
Kojto 93:e188a91d3eaa 3721 #define PORTB ((PORT_Type *)PORTB_BASE)
Kojto 93:e188a91d3eaa 3722 /** Peripheral PORTC base address */
Kojto 93:e188a91d3eaa 3723 #define PORTC_BASE (0x4004B000u)
Kojto 93:e188a91d3eaa 3724 /** Peripheral PORTC base pointer */
Kojto 93:e188a91d3eaa 3725 #define PORTC ((PORT_Type *)PORTC_BASE)
Kojto 93:e188a91d3eaa 3726 /** Peripheral PORTD base address */
Kojto 93:e188a91d3eaa 3727 #define PORTD_BASE (0x4004C000u)
Kojto 93:e188a91d3eaa 3728 /** Peripheral PORTD base pointer */
Kojto 93:e188a91d3eaa 3729 #define PORTD ((PORT_Type *)PORTD_BASE)
Kojto 93:e188a91d3eaa 3730 /** Peripheral PORTE base address */
Kojto 93:e188a91d3eaa 3731 #define PORTE_BASE (0x4004D000u)
Kojto 93:e188a91d3eaa 3732 /** Peripheral PORTE base pointer */
Kojto 93:e188a91d3eaa 3733 #define PORTE ((PORT_Type *)PORTE_BASE)
Kojto 93:e188a91d3eaa 3734
Kojto 93:e188a91d3eaa 3735 /**
Kojto 93:e188a91d3eaa 3736 * @}
Kojto 93:e188a91d3eaa 3737 */ /* end of group PORT_Peripheral_Access_Layer */
Kojto 93:e188a91d3eaa 3738
Kojto 93:e188a91d3eaa 3739
Kojto 93:e188a91d3eaa 3740 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 3741 -- RCM Peripheral Access Layer
Kojto 93:e188a91d3eaa 3742 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 3743
Kojto 93:e188a91d3eaa 3744 /**
Kojto 93:e188a91d3eaa 3745 * @addtogroup RCM_Peripheral_Access_Layer RCM Peripheral Access Layer
Kojto 93:e188a91d3eaa 3746 * @{
Kojto 93:e188a91d3eaa 3747 */
Kojto 93:e188a91d3eaa 3748
Kojto 93:e188a91d3eaa 3749 /** RCM - Register Layout Typedef */
Kojto 93:e188a91d3eaa 3750 typedef struct {
Kojto 93:e188a91d3eaa 3751 __I uint8_t SRS0; /**< System Reset Status Register 0, offset: 0x0 */
Kojto 93:e188a91d3eaa 3752 __I uint8_t SRS1; /**< System Reset Status Register 1, offset: 0x1 */
Kojto 93:e188a91d3eaa 3753 uint8_t RESERVED_0[2];
Kojto 93:e188a91d3eaa 3754 __IO uint8_t RPFC; /**< Reset Pin Filter Control Register, offset: 0x4 */
Kojto 93:e188a91d3eaa 3755 __IO uint8_t RPFW; /**< Reset Pin Filter Width Register, offset: 0x5 */
Kojto 93:e188a91d3eaa 3756 uint8_t RESERVED_1[1];
Kojto 93:e188a91d3eaa 3757 __I uint8_t MR; /**< Mode Register, offset: 0x7 */
Kojto 93:e188a91d3eaa 3758 } RCM_Type;
Kojto 93:e188a91d3eaa 3759
Kojto 93:e188a91d3eaa 3760 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 3761 -- RCM Register Masks
Kojto 93:e188a91d3eaa 3762 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 3763
Kojto 93:e188a91d3eaa 3764 /**
Kojto 93:e188a91d3eaa 3765 * @addtogroup RCM_Register_Masks RCM Register Masks
Kojto 93:e188a91d3eaa 3766 * @{
Kojto 93:e188a91d3eaa 3767 */
Kojto 93:e188a91d3eaa 3768
Kojto 93:e188a91d3eaa 3769 /* SRS0 Bit Fields */
Kojto 93:e188a91d3eaa 3770 #define RCM_SRS0_WAKEUP_MASK 0x1u
Kojto 93:e188a91d3eaa 3771 #define RCM_SRS0_WAKEUP_SHIFT 0
Kojto 93:e188a91d3eaa 3772 #define RCM_SRS0_LVD_MASK 0x2u
Kojto 93:e188a91d3eaa 3773 #define RCM_SRS0_LVD_SHIFT 1
Kojto 93:e188a91d3eaa 3774 #define RCM_SRS0_LOC_MASK 0x4u
Kojto 93:e188a91d3eaa 3775 #define RCM_SRS0_LOC_SHIFT 2
Kojto 93:e188a91d3eaa 3776 #define RCM_SRS0_LOL_MASK 0x8u
Kojto 93:e188a91d3eaa 3777 #define RCM_SRS0_LOL_SHIFT 3
Kojto 93:e188a91d3eaa 3778 #define RCM_SRS0_WDOG_MASK 0x20u
Kojto 93:e188a91d3eaa 3779 #define RCM_SRS0_WDOG_SHIFT 5
Kojto 93:e188a91d3eaa 3780 #define RCM_SRS0_PIN_MASK 0x40u
Kojto 93:e188a91d3eaa 3781 #define RCM_SRS0_PIN_SHIFT 6
Kojto 93:e188a91d3eaa 3782 #define RCM_SRS0_POR_MASK 0x80u
Kojto 93:e188a91d3eaa 3783 #define RCM_SRS0_POR_SHIFT 7
Kojto 93:e188a91d3eaa 3784 /* SRS1 Bit Fields */
Kojto 93:e188a91d3eaa 3785 #define RCM_SRS1_JTAG_MASK 0x1u
Kojto 93:e188a91d3eaa 3786 #define RCM_SRS1_JTAG_SHIFT 0
Kojto 93:e188a91d3eaa 3787 #define RCM_SRS1_LOCKUP_MASK 0x2u
Kojto 93:e188a91d3eaa 3788 #define RCM_SRS1_LOCKUP_SHIFT 1
Kojto 93:e188a91d3eaa 3789 #define RCM_SRS1_SW_MASK 0x4u
Kojto 93:e188a91d3eaa 3790 #define RCM_SRS1_SW_SHIFT 2
Kojto 93:e188a91d3eaa 3791 #define RCM_SRS1_MDM_AP_MASK 0x8u
Kojto 93:e188a91d3eaa 3792 #define RCM_SRS1_MDM_AP_SHIFT 3
Kojto 93:e188a91d3eaa 3793 #define RCM_SRS1_EZPT_MASK 0x10u
Kojto 93:e188a91d3eaa 3794 #define RCM_SRS1_EZPT_SHIFT 4
Kojto 93:e188a91d3eaa 3795 #define RCM_SRS1_SACKERR_MASK 0x20u
Kojto 93:e188a91d3eaa 3796 #define RCM_SRS1_SACKERR_SHIFT 5
Kojto 93:e188a91d3eaa 3797 /* RPFC Bit Fields */
Kojto 93:e188a91d3eaa 3798 #define RCM_RPFC_RSTFLTSRW_MASK 0x3u
Kojto 93:e188a91d3eaa 3799 #define RCM_RPFC_RSTFLTSRW_SHIFT 0
Kojto 93:e188a91d3eaa 3800 #define RCM_RPFC_RSTFLTSRW(x) (((uint8_t)(((uint8_t)(x))<<RCM_RPFC_RSTFLTSRW_SHIFT))&RCM_RPFC_RSTFLTSRW_MASK)
Kojto 93:e188a91d3eaa 3801 #define RCM_RPFC_RSTFLTSS_MASK 0x4u
Kojto 93:e188a91d3eaa 3802 #define RCM_RPFC_RSTFLTSS_SHIFT 2
Kojto 93:e188a91d3eaa 3803 /* RPFW Bit Fields */
Kojto 93:e188a91d3eaa 3804 #define RCM_RPFW_RSTFLTSEL_MASK 0x1Fu
Kojto 93:e188a91d3eaa 3805 #define RCM_RPFW_RSTFLTSEL_SHIFT 0
Kojto 93:e188a91d3eaa 3806 #define RCM_RPFW_RSTFLTSEL(x) (((uint8_t)(((uint8_t)(x))<<RCM_RPFW_RSTFLTSEL_SHIFT))&RCM_RPFW_RSTFLTSEL_MASK)
Kojto 93:e188a91d3eaa 3807 /* MR Bit Fields */
Kojto 93:e188a91d3eaa 3808 #define RCM_MR_EZP_MS_MASK 0x2u
Kojto 93:e188a91d3eaa 3809 #define RCM_MR_EZP_MS_SHIFT 1
Kojto 93:e188a91d3eaa 3810
Kojto 93:e188a91d3eaa 3811 /**
Kojto 93:e188a91d3eaa 3812 * @}
Kojto 93:e188a91d3eaa 3813 */ /* end of group RCM_Register_Masks */
Kojto 93:e188a91d3eaa 3814
Kojto 93:e188a91d3eaa 3815
Kojto 93:e188a91d3eaa 3816 /* RCM - Peripheral instance base addresses */
Kojto 93:e188a91d3eaa 3817 /** Peripheral RCM base address */
Kojto 93:e188a91d3eaa 3818 #define RCM_BASE (0x4007F000u)
Kojto 93:e188a91d3eaa 3819 /** Peripheral RCM base pointer */
Kojto 93:e188a91d3eaa 3820 #define RCM ((RCM_Type *)RCM_BASE)
Kojto 93:e188a91d3eaa 3821
Kojto 93:e188a91d3eaa 3822 /**
Kojto 93:e188a91d3eaa 3823 * @}
Kojto 93:e188a91d3eaa 3824 */ /* end of group RCM_Peripheral_Access_Layer */
Kojto 93:e188a91d3eaa 3825
Kojto 93:e188a91d3eaa 3826
Kojto 93:e188a91d3eaa 3827 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 3828 -- RFSYS Peripheral Access Layer
Kojto 93:e188a91d3eaa 3829 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 3830
Kojto 93:e188a91d3eaa 3831 /**
Kojto 93:e188a91d3eaa 3832 * @addtogroup RFSYS_Peripheral_Access_Layer RFSYS Peripheral Access Layer
Kojto 93:e188a91d3eaa 3833 * @{
Kojto 93:e188a91d3eaa 3834 */
Kojto 93:e188a91d3eaa 3835
Kojto 93:e188a91d3eaa 3836 /** RFSYS - Register Layout Typedef */
Kojto 93:e188a91d3eaa 3837 typedef struct {
Kojto 93:e188a91d3eaa 3838 __IO uint32_t REG[8]; /**< Register file register, array offset: 0x0, array step: 0x4 */
Kojto 93:e188a91d3eaa 3839 } RFSYS_Type;
Kojto 93:e188a91d3eaa 3840
Kojto 93:e188a91d3eaa 3841 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 3842 -- RFSYS Register Masks
Kojto 93:e188a91d3eaa 3843 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 3844
Kojto 93:e188a91d3eaa 3845 /**
Kojto 93:e188a91d3eaa 3846 * @addtogroup RFSYS_Register_Masks RFSYS Register Masks
Kojto 93:e188a91d3eaa 3847 * @{
Kojto 93:e188a91d3eaa 3848 */
Kojto 93:e188a91d3eaa 3849
Kojto 93:e188a91d3eaa 3850 /* REG Bit Fields */
Kojto 93:e188a91d3eaa 3851 #define RFSYS_REG_LL_MASK 0xFFu
Kojto 93:e188a91d3eaa 3852 #define RFSYS_REG_LL_SHIFT 0
Kojto 93:e188a91d3eaa 3853 #define RFSYS_REG_LL(x) (((uint32_t)(((uint32_t)(x))<<RFSYS_REG_LL_SHIFT))&RFSYS_REG_LL_MASK)
Kojto 93:e188a91d3eaa 3854 #define RFSYS_REG_LH_MASK 0xFF00u
Kojto 93:e188a91d3eaa 3855 #define RFSYS_REG_LH_SHIFT 8
Kojto 93:e188a91d3eaa 3856 #define RFSYS_REG_LH(x) (((uint32_t)(((uint32_t)(x))<<RFSYS_REG_LH_SHIFT))&RFSYS_REG_LH_MASK)
Kojto 93:e188a91d3eaa 3857 #define RFSYS_REG_HL_MASK 0xFF0000u
Kojto 93:e188a91d3eaa 3858 #define RFSYS_REG_HL_SHIFT 16
Kojto 93:e188a91d3eaa 3859 #define RFSYS_REG_HL(x) (((uint32_t)(((uint32_t)(x))<<RFSYS_REG_HL_SHIFT))&RFSYS_REG_HL_MASK)
Kojto 93:e188a91d3eaa 3860 #define RFSYS_REG_HH_MASK 0xFF000000u
Kojto 93:e188a91d3eaa 3861 #define RFSYS_REG_HH_SHIFT 24
Kojto 93:e188a91d3eaa 3862 #define RFSYS_REG_HH(x) (((uint32_t)(((uint32_t)(x))<<RFSYS_REG_HH_SHIFT))&RFSYS_REG_HH_MASK)
Kojto 93:e188a91d3eaa 3863
Kojto 93:e188a91d3eaa 3864 /**
Kojto 93:e188a91d3eaa 3865 * @}
Kojto 93:e188a91d3eaa 3866 */ /* end of group RFSYS_Register_Masks */
Kojto 93:e188a91d3eaa 3867
Kojto 93:e188a91d3eaa 3868
Kojto 93:e188a91d3eaa 3869 /* RFSYS - Peripheral instance base addresses */
Kojto 93:e188a91d3eaa 3870 /** Peripheral RFSYS base address */
Kojto 93:e188a91d3eaa 3871 #define RFSYS_BASE (0x40041000u)
Kojto 93:e188a91d3eaa 3872 /** Peripheral RFSYS base pointer */
Kojto 93:e188a91d3eaa 3873 #define RFSYS ((RFSYS_Type *)RFSYS_BASE)
Kojto 93:e188a91d3eaa 3874
Kojto 93:e188a91d3eaa 3875 /**
Kojto 93:e188a91d3eaa 3876 * @}
Kojto 93:e188a91d3eaa 3877 */ /* end of group RFSYS_Peripheral_Access_Layer */
Kojto 93:e188a91d3eaa 3878
Kojto 93:e188a91d3eaa 3879
Kojto 93:e188a91d3eaa 3880 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 3881 -- RFVBAT Peripheral Access Layer
Kojto 93:e188a91d3eaa 3882 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 3883
Kojto 93:e188a91d3eaa 3884 /**
Kojto 93:e188a91d3eaa 3885 * @addtogroup RFVBAT_Peripheral_Access_Layer RFVBAT Peripheral Access Layer
Kojto 93:e188a91d3eaa 3886 * @{
Kojto 93:e188a91d3eaa 3887 */
Kojto 93:e188a91d3eaa 3888
Kojto 93:e188a91d3eaa 3889 /** RFVBAT - Register Layout Typedef */
Kojto 93:e188a91d3eaa 3890 typedef struct {
Kojto 93:e188a91d3eaa 3891 __IO uint32_t REG[8]; /**< VBAT register file register, array offset: 0x0, array step: 0x4 */
Kojto 93:e188a91d3eaa 3892 } RFVBAT_Type;
Kojto 93:e188a91d3eaa 3893
Kojto 93:e188a91d3eaa 3894 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 3895 -- RFVBAT Register Masks
Kojto 93:e188a91d3eaa 3896 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 3897
Kojto 93:e188a91d3eaa 3898 /**
Kojto 93:e188a91d3eaa 3899 * @addtogroup RFVBAT_Register_Masks RFVBAT Register Masks
Kojto 93:e188a91d3eaa 3900 * @{
Kojto 93:e188a91d3eaa 3901 */
Kojto 93:e188a91d3eaa 3902
Kojto 93:e188a91d3eaa 3903 /* REG Bit Fields */
Kojto 93:e188a91d3eaa 3904 #define RFVBAT_REG_LL_MASK 0xFFu
Kojto 93:e188a91d3eaa 3905 #define RFVBAT_REG_LL_SHIFT 0
Kojto 93:e188a91d3eaa 3906 #define RFVBAT_REG_LL(x) (((uint32_t)(((uint32_t)(x))<<RFVBAT_REG_LL_SHIFT))&RFVBAT_REG_LL_MASK)
Kojto 93:e188a91d3eaa 3907 #define RFVBAT_REG_LH_MASK 0xFF00u
Kojto 93:e188a91d3eaa 3908 #define RFVBAT_REG_LH_SHIFT 8
Kojto 93:e188a91d3eaa 3909 #define RFVBAT_REG_LH(x) (((uint32_t)(((uint32_t)(x))<<RFVBAT_REG_LH_SHIFT))&RFVBAT_REG_LH_MASK)
Kojto 93:e188a91d3eaa 3910 #define RFVBAT_REG_HL_MASK 0xFF0000u
Kojto 93:e188a91d3eaa 3911 #define RFVBAT_REG_HL_SHIFT 16
Kojto 93:e188a91d3eaa 3912 #define RFVBAT_REG_HL(x) (((uint32_t)(((uint32_t)(x))<<RFVBAT_REG_HL_SHIFT))&RFVBAT_REG_HL_MASK)
Kojto 93:e188a91d3eaa 3913 #define RFVBAT_REG_HH_MASK 0xFF000000u
Kojto 93:e188a91d3eaa 3914 #define RFVBAT_REG_HH_SHIFT 24
Kojto 93:e188a91d3eaa 3915 #define RFVBAT_REG_HH(x) (((uint32_t)(((uint32_t)(x))<<RFVBAT_REG_HH_SHIFT))&RFVBAT_REG_HH_MASK)
Kojto 93:e188a91d3eaa 3916
Kojto 93:e188a91d3eaa 3917 /**
Kojto 93:e188a91d3eaa 3918 * @}
Kojto 93:e188a91d3eaa 3919 */ /* end of group RFVBAT_Register_Masks */
Kojto 93:e188a91d3eaa 3920
Kojto 93:e188a91d3eaa 3921
Kojto 93:e188a91d3eaa 3922 /* RFVBAT - Peripheral instance base addresses */
Kojto 93:e188a91d3eaa 3923 /** Peripheral RFVBAT base address */
Kojto 93:e188a91d3eaa 3924 #define RFVBAT_BASE (0x4003E000u)
Kojto 93:e188a91d3eaa 3925 /** Peripheral RFVBAT base pointer */
Kojto 93:e188a91d3eaa 3926 #define RFVBAT ((RFVBAT_Type *)RFVBAT_BASE)
Kojto 93:e188a91d3eaa 3927
Kojto 93:e188a91d3eaa 3928 /**
Kojto 93:e188a91d3eaa 3929 * @}
Kojto 93:e188a91d3eaa 3930 */ /* end of group RFVBAT_Peripheral_Access_Layer */
Kojto 93:e188a91d3eaa 3931
Kojto 93:e188a91d3eaa 3932
Kojto 93:e188a91d3eaa 3933 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 3934 -- RTC Peripheral Access Layer
Kojto 93:e188a91d3eaa 3935 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 3936
Kojto 93:e188a91d3eaa 3937 /**
Kojto 93:e188a91d3eaa 3938 * @addtogroup RTC_Peripheral_Access_Layer RTC Peripheral Access Layer
Kojto 93:e188a91d3eaa 3939 * @{
Kojto 93:e188a91d3eaa 3940 */
Kojto 93:e188a91d3eaa 3941
Kojto 93:e188a91d3eaa 3942 /** RTC - Register Layout Typedef */
Kojto 93:e188a91d3eaa 3943 typedef struct {
Kojto 93:e188a91d3eaa 3944 __IO uint32_t TSR; /**< RTC Time Seconds Register, offset: 0x0 */
Kojto 93:e188a91d3eaa 3945 __IO uint32_t TPR; /**< RTC Time Prescaler Register, offset: 0x4 */
Kojto 93:e188a91d3eaa 3946 __IO uint32_t TAR; /**< RTC Time Alarm Register, offset: 0x8 */
Kojto 93:e188a91d3eaa 3947 __IO uint32_t TCR; /**< RTC Time Compensation Register, offset: 0xC */
Kojto 93:e188a91d3eaa 3948 __IO uint32_t CR; /**< RTC Control Register, offset: 0x10 */
Kojto 93:e188a91d3eaa 3949 __IO uint32_t SR; /**< RTC Status Register, offset: 0x14 */
Kojto 93:e188a91d3eaa 3950 __IO uint32_t LR; /**< RTC Lock Register, offset: 0x18 */
Kojto 93:e188a91d3eaa 3951 __IO uint32_t IER; /**< RTC Interrupt Enable Register, offset: 0x1C */
Kojto 93:e188a91d3eaa 3952 uint8_t RESERVED_0[2016];
Kojto 93:e188a91d3eaa 3953 __IO uint32_t WAR; /**< RTC Write Access Register, offset: 0x800 */
Kojto 93:e188a91d3eaa 3954 __IO uint32_t RAR; /**< RTC Read Access Register, offset: 0x804 */
Kojto 93:e188a91d3eaa 3955 } RTC_Type;
Kojto 93:e188a91d3eaa 3956
Kojto 93:e188a91d3eaa 3957 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 3958 -- RTC Register Masks
Kojto 93:e188a91d3eaa 3959 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 3960
Kojto 93:e188a91d3eaa 3961 /**
Kojto 93:e188a91d3eaa 3962 * @addtogroup RTC_Register_Masks RTC Register Masks
Kojto 93:e188a91d3eaa 3963 * @{
Kojto 93:e188a91d3eaa 3964 */
Kojto 93:e188a91d3eaa 3965
Kojto 93:e188a91d3eaa 3966 /* TSR Bit Fields */
Kojto 93:e188a91d3eaa 3967 #define RTC_TSR_TSR_MASK 0xFFFFFFFFu
Kojto 93:e188a91d3eaa 3968 #define RTC_TSR_TSR_SHIFT 0
Kojto 93:e188a91d3eaa 3969 #define RTC_TSR_TSR(x) (((uint32_t)(((uint32_t)(x))<<RTC_TSR_TSR_SHIFT))&RTC_TSR_TSR_MASK)
Kojto 93:e188a91d3eaa 3970 /* TPR Bit Fields */
Kojto 93:e188a91d3eaa 3971 #define RTC_TPR_TPR_MASK 0xFFFFu
Kojto 93:e188a91d3eaa 3972 #define RTC_TPR_TPR_SHIFT 0
Kojto 93:e188a91d3eaa 3973 #define RTC_TPR_TPR(x) (((uint32_t)(((uint32_t)(x))<<RTC_TPR_TPR_SHIFT))&RTC_TPR_TPR_MASK)
Kojto 93:e188a91d3eaa 3974 /* TAR Bit Fields */
Kojto 93:e188a91d3eaa 3975 #define RTC_TAR_TAR_MASK 0xFFFFFFFFu
Kojto 93:e188a91d3eaa 3976 #define RTC_TAR_TAR_SHIFT 0
Kojto 93:e188a91d3eaa 3977 #define RTC_TAR_TAR(x) (((uint32_t)(((uint32_t)(x))<<RTC_TAR_TAR_SHIFT))&RTC_TAR_TAR_MASK)
Kojto 93:e188a91d3eaa 3978 /* TCR Bit Fields */
Kojto 93:e188a91d3eaa 3979 #define RTC_TCR_TCR_MASK 0xFFu
Kojto 93:e188a91d3eaa 3980 #define RTC_TCR_TCR_SHIFT 0
Kojto 93:e188a91d3eaa 3981 #define RTC_TCR_TCR(x) (((uint32_t)(((uint32_t)(x))<<RTC_TCR_TCR_SHIFT))&RTC_TCR_TCR_MASK)
Kojto 93:e188a91d3eaa 3982 #define RTC_TCR_CIR_MASK 0xFF00u
Kojto 93:e188a91d3eaa 3983 #define RTC_TCR_CIR_SHIFT 8
Kojto 93:e188a91d3eaa 3984 #define RTC_TCR_CIR(x) (((uint32_t)(((uint32_t)(x))<<RTC_TCR_CIR_SHIFT))&RTC_TCR_CIR_MASK)
Kojto 93:e188a91d3eaa 3985 #define RTC_TCR_TCV_MASK 0xFF0000u
Kojto 93:e188a91d3eaa 3986 #define RTC_TCR_TCV_SHIFT 16
Kojto 93:e188a91d3eaa 3987 #define RTC_TCR_TCV(x) (((uint32_t)(((uint32_t)(x))<<RTC_TCR_TCV_SHIFT))&RTC_TCR_TCV_MASK)
Kojto 93:e188a91d3eaa 3988 #define RTC_TCR_CIC_MASK 0xFF000000u
Kojto 93:e188a91d3eaa 3989 #define RTC_TCR_CIC_SHIFT 24
Kojto 93:e188a91d3eaa 3990 #define RTC_TCR_CIC(x) (((uint32_t)(((uint32_t)(x))<<RTC_TCR_CIC_SHIFT))&RTC_TCR_CIC_MASK)
Kojto 93:e188a91d3eaa 3991 /* CR Bit Fields */
Kojto 93:e188a91d3eaa 3992 #define RTC_CR_SWR_MASK 0x1u
Kojto 93:e188a91d3eaa 3993 #define RTC_CR_SWR_SHIFT 0
Kojto 93:e188a91d3eaa 3994 #define RTC_CR_WPE_MASK 0x2u
Kojto 93:e188a91d3eaa 3995 #define RTC_CR_WPE_SHIFT 1
Kojto 93:e188a91d3eaa 3996 #define RTC_CR_SUP_MASK 0x4u
Kojto 93:e188a91d3eaa 3997 #define RTC_CR_SUP_SHIFT 2
Kojto 93:e188a91d3eaa 3998 #define RTC_CR_UM_MASK 0x8u
Kojto 93:e188a91d3eaa 3999 #define RTC_CR_UM_SHIFT 3
Kojto 93:e188a91d3eaa 4000 #define RTC_CR_OSCE_MASK 0x100u
Kojto 93:e188a91d3eaa 4001 #define RTC_CR_OSCE_SHIFT 8
Kojto 93:e188a91d3eaa 4002 #define RTC_CR_CLKO_MASK 0x200u
Kojto 93:e188a91d3eaa 4003 #define RTC_CR_CLKO_SHIFT 9
Kojto 93:e188a91d3eaa 4004 #define RTC_CR_SC16P_MASK 0x400u
Kojto 93:e188a91d3eaa 4005 #define RTC_CR_SC16P_SHIFT 10
Kojto 93:e188a91d3eaa 4006 #define RTC_CR_SC8P_MASK 0x800u
Kojto 93:e188a91d3eaa 4007 #define RTC_CR_SC8P_SHIFT 11
Kojto 93:e188a91d3eaa 4008 #define RTC_CR_SC4P_MASK 0x1000u
Kojto 93:e188a91d3eaa 4009 #define RTC_CR_SC4P_SHIFT 12
Kojto 93:e188a91d3eaa 4010 #define RTC_CR_SC2P_MASK 0x2000u
Kojto 93:e188a91d3eaa 4011 #define RTC_CR_SC2P_SHIFT 13
Kojto 93:e188a91d3eaa 4012 /* SR Bit Fields */
Kojto 93:e188a91d3eaa 4013 #define RTC_SR_TIF_MASK 0x1u
Kojto 93:e188a91d3eaa 4014 #define RTC_SR_TIF_SHIFT 0
Kojto 93:e188a91d3eaa 4015 #define RTC_SR_TOF_MASK 0x2u
Kojto 93:e188a91d3eaa 4016 #define RTC_SR_TOF_SHIFT 1
Kojto 93:e188a91d3eaa 4017 #define RTC_SR_TAF_MASK 0x4u
Kojto 93:e188a91d3eaa 4018 #define RTC_SR_TAF_SHIFT 2
Kojto 93:e188a91d3eaa 4019 #define RTC_SR_TCE_MASK 0x10u
Kojto 93:e188a91d3eaa 4020 #define RTC_SR_TCE_SHIFT 4
Kojto 93:e188a91d3eaa 4021 /* LR Bit Fields */
Kojto 93:e188a91d3eaa 4022 #define RTC_LR_TCL_MASK 0x8u
Kojto 93:e188a91d3eaa 4023 #define RTC_LR_TCL_SHIFT 3
Kojto 93:e188a91d3eaa 4024 #define RTC_LR_CRL_MASK 0x10u
Kojto 93:e188a91d3eaa 4025 #define RTC_LR_CRL_SHIFT 4
Kojto 93:e188a91d3eaa 4026 #define RTC_LR_SRL_MASK 0x20u
Kojto 93:e188a91d3eaa 4027 #define RTC_LR_SRL_SHIFT 5
Kojto 93:e188a91d3eaa 4028 #define RTC_LR_LRL_MASK 0x40u
Kojto 93:e188a91d3eaa 4029 #define RTC_LR_LRL_SHIFT 6
Kojto 93:e188a91d3eaa 4030 /* IER Bit Fields */
Kojto 93:e188a91d3eaa 4031 #define RTC_IER_TIIE_MASK 0x1u
Kojto 93:e188a91d3eaa 4032 #define RTC_IER_TIIE_SHIFT 0
Kojto 93:e188a91d3eaa 4033 #define RTC_IER_TOIE_MASK 0x2u
Kojto 93:e188a91d3eaa 4034 #define RTC_IER_TOIE_SHIFT 1
Kojto 93:e188a91d3eaa 4035 #define RTC_IER_TAIE_MASK 0x4u
Kojto 93:e188a91d3eaa 4036 #define RTC_IER_TAIE_SHIFT 2
Kojto 93:e188a91d3eaa 4037 #define RTC_IER_TSIE_MASK 0x10u
Kojto 93:e188a91d3eaa 4038 #define RTC_IER_TSIE_SHIFT 4
Kojto 93:e188a91d3eaa 4039 /* WAR Bit Fields */
Kojto 93:e188a91d3eaa 4040 #define RTC_WAR_TSRW_MASK 0x1u
Kojto 93:e188a91d3eaa 4041 #define RTC_WAR_TSRW_SHIFT 0
Kojto 93:e188a91d3eaa 4042 #define RTC_WAR_TPRW_MASK 0x2u
Kojto 93:e188a91d3eaa 4043 #define RTC_WAR_TPRW_SHIFT 1
Kojto 93:e188a91d3eaa 4044 #define RTC_WAR_TARW_MASK 0x4u
Kojto 93:e188a91d3eaa 4045 #define RTC_WAR_TARW_SHIFT 2
Kojto 93:e188a91d3eaa 4046 #define RTC_WAR_TCRW_MASK 0x8u
Kojto 93:e188a91d3eaa 4047 #define RTC_WAR_TCRW_SHIFT 3
Kojto 93:e188a91d3eaa 4048 #define RTC_WAR_CRW_MASK 0x10u
Kojto 93:e188a91d3eaa 4049 #define RTC_WAR_CRW_SHIFT 4
Kojto 93:e188a91d3eaa 4050 #define RTC_WAR_SRW_MASK 0x20u
Kojto 93:e188a91d3eaa 4051 #define RTC_WAR_SRW_SHIFT 5
Kojto 93:e188a91d3eaa 4052 #define RTC_WAR_LRW_MASK 0x40u
Kojto 93:e188a91d3eaa 4053 #define RTC_WAR_LRW_SHIFT 6
Kojto 93:e188a91d3eaa 4054 #define RTC_WAR_IERW_MASK 0x80u
Kojto 93:e188a91d3eaa 4055 #define RTC_WAR_IERW_SHIFT 7
Kojto 93:e188a91d3eaa 4056 /* RAR Bit Fields */
Kojto 93:e188a91d3eaa 4057 #define RTC_RAR_TSRR_MASK 0x1u
Kojto 93:e188a91d3eaa 4058 #define RTC_RAR_TSRR_SHIFT 0
Kojto 93:e188a91d3eaa 4059 #define RTC_RAR_TPRR_MASK 0x2u
Kojto 93:e188a91d3eaa 4060 #define RTC_RAR_TPRR_SHIFT 1
Kojto 93:e188a91d3eaa 4061 #define RTC_RAR_TARR_MASK 0x4u
Kojto 93:e188a91d3eaa 4062 #define RTC_RAR_TARR_SHIFT 2
Kojto 93:e188a91d3eaa 4063 #define RTC_RAR_TCRR_MASK 0x8u
Kojto 93:e188a91d3eaa 4064 #define RTC_RAR_TCRR_SHIFT 3
Kojto 93:e188a91d3eaa 4065 #define RTC_RAR_CRR_MASK 0x10u
Kojto 93:e188a91d3eaa 4066 #define RTC_RAR_CRR_SHIFT 4
Kojto 93:e188a91d3eaa 4067 #define RTC_RAR_SRR_MASK 0x20u
Kojto 93:e188a91d3eaa 4068 #define RTC_RAR_SRR_SHIFT 5
Kojto 93:e188a91d3eaa 4069 #define RTC_RAR_LRR_MASK 0x40u
Kojto 93:e188a91d3eaa 4070 #define RTC_RAR_LRR_SHIFT 6
Kojto 93:e188a91d3eaa 4071 #define RTC_RAR_IERR_MASK 0x80u
Kojto 93:e188a91d3eaa 4072 #define RTC_RAR_IERR_SHIFT 7
Kojto 93:e188a91d3eaa 4073
Kojto 93:e188a91d3eaa 4074 /**
Kojto 93:e188a91d3eaa 4075 * @}
Kojto 93:e188a91d3eaa 4076 */ /* end of group RTC_Register_Masks */
Kojto 93:e188a91d3eaa 4077
Kojto 93:e188a91d3eaa 4078
Kojto 93:e188a91d3eaa 4079 /* RTC - Peripheral instance base addresses */
Kojto 93:e188a91d3eaa 4080 /** Peripheral RTC base address */
Kojto 93:e188a91d3eaa 4081 #define RTC_BASE (0x4003D000u)
Kojto 93:e188a91d3eaa 4082 /** Peripheral RTC base pointer */
Kojto 93:e188a91d3eaa 4083 #define RTC ((RTC_Type *)RTC_BASE)
Kojto 93:e188a91d3eaa 4084
Kojto 93:e188a91d3eaa 4085 /**
Kojto 93:e188a91d3eaa 4086 * @}
Kojto 93:e188a91d3eaa 4087 */ /* end of group RTC_Peripheral_Access_Layer */
Kojto 93:e188a91d3eaa 4088
Kojto 93:e188a91d3eaa 4089
Kojto 93:e188a91d3eaa 4090 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 4091 -- SIM Peripheral Access Layer
Kojto 93:e188a91d3eaa 4092 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 4093
Kojto 93:e188a91d3eaa 4094 /**
Kojto 93:e188a91d3eaa 4095 * @addtogroup SIM_Peripheral_Access_Layer SIM Peripheral Access Layer
Kojto 93:e188a91d3eaa 4096 * @{
Kojto 93:e188a91d3eaa 4097 */
Kojto 93:e188a91d3eaa 4098
Kojto 93:e188a91d3eaa 4099 /** SIM - Register Layout Typedef */
Kojto 93:e188a91d3eaa 4100 typedef struct {
Kojto 93:e188a91d3eaa 4101 __IO uint32_t SOPT1; /**< System Options Register 1, offset: 0x0 */
Kojto 93:e188a91d3eaa 4102 __IO uint32_t SOPT1CFG; /**< SOPT1 Configuration Register, offset: 0x4 */
Kojto 93:e188a91d3eaa 4103 uint8_t RESERVED_0[4092];
Kojto 93:e188a91d3eaa 4104 __IO uint32_t SOPT2; /**< System Options Register 2, offset: 0x1004 */
Kojto 93:e188a91d3eaa 4105 uint8_t RESERVED_1[4];
Kojto 93:e188a91d3eaa 4106 __IO uint32_t SOPT4; /**< System Options Register 4, offset: 0x100C */
Kojto 93:e188a91d3eaa 4107 __IO uint32_t SOPT5; /**< System Options Register 5, offset: 0x1010 */
Kojto 93:e188a91d3eaa 4108 uint8_t RESERVED_2[4];
Kojto 93:e188a91d3eaa 4109 __IO uint32_t SOPT7; /**< System Options Register 7, offset: 0x1018 */
Kojto 93:e188a91d3eaa 4110 uint8_t RESERVED_3[8];
Kojto 93:e188a91d3eaa 4111 __I uint32_t SDID; /**< System Device Identification Register, offset: 0x1024 */
Kojto 93:e188a91d3eaa 4112 __IO uint32_t SCGC1; /**< System Clock Gating Control Register 1, offset: 0x1028 */
Kojto 93:e188a91d3eaa 4113 __IO uint32_t SCGC2; /**< System Clock Gating Control Register 2, offset: 0x102C */
Kojto 93:e188a91d3eaa 4114 __IO uint32_t SCGC3; /**< System Clock Gating Control Register 3, offset: 0x1030 */
Kojto 93:e188a91d3eaa 4115 __IO uint32_t SCGC4; /**< System Clock Gating Control Register 4, offset: 0x1034 */
Kojto 93:e188a91d3eaa 4116 __IO uint32_t SCGC5; /**< System Clock Gating Control Register 5, offset: 0x1038 */
Kojto 93:e188a91d3eaa 4117 __IO uint32_t SCGC6; /**< System Clock Gating Control Register 6, offset: 0x103C */
Kojto 93:e188a91d3eaa 4118 __IO uint32_t SCGC7; /**< System Clock Gating Control Register 7, offset: 0x1040 */
Kojto 93:e188a91d3eaa 4119 __IO uint32_t CLKDIV1; /**< System Clock Divider Register 1, offset: 0x1044 */
Kojto 93:e188a91d3eaa 4120 __IO uint32_t CLKDIV2; /**< System Clock Divider Register 2, offset: 0x1048 */
Kojto 93:e188a91d3eaa 4121 __IO uint32_t FCFG1; /**< Flash Configuration Register 1, offset: 0x104C */
Kojto 93:e188a91d3eaa 4122 __I uint32_t FCFG2; /**< Flash Configuration Register 2, offset: 0x1050 */
Kojto 93:e188a91d3eaa 4123 __I uint32_t UIDH; /**< Unique Identification Register High, offset: 0x1054 */
Kojto 93:e188a91d3eaa 4124 __I uint32_t UIDMH; /**< Unique Identification Register Mid-High, offset: 0x1058 */
Kojto 93:e188a91d3eaa 4125 __I uint32_t UIDML; /**< Unique Identification Register Mid Low, offset: 0x105C */
Kojto 93:e188a91d3eaa 4126 __I uint32_t UIDL; /**< Unique Identification Register Low, offset: 0x1060 */
Kojto 93:e188a91d3eaa 4127 } SIM_Type;
Kojto 93:e188a91d3eaa 4128
Kojto 93:e188a91d3eaa 4129 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 4130 -- SIM Register Masks
Kojto 93:e188a91d3eaa 4131 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 4132
Kojto 93:e188a91d3eaa 4133 /**
Kojto 93:e188a91d3eaa 4134 * @addtogroup SIM_Register_Masks SIM Register Masks
Kojto 93:e188a91d3eaa 4135 * @{
Kojto 93:e188a91d3eaa 4136 */
Kojto 93:e188a91d3eaa 4137
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Kojto 93:e188a91d3eaa 4318 #define SIM_CLKDIV1_OUTDIV1_MASK 0xF0000000u
Kojto 93:e188a91d3eaa 4319 #define SIM_CLKDIV1_OUTDIV1_SHIFT 28
Kojto 93:e188a91d3eaa 4320 #define SIM_CLKDIV1_OUTDIV1(x) (((uint32_t)(((uint32_t)(x))<<SIM_CLKDIV1_OUTDIV1_SHIFT))&SIM_CLKDIV1_OUTDIV1_MASK)
Kojto 93:e188a91d3eaa 4321 /* CLKDIV2 Bit Fields */
Kojto 93:e188a91d3eaa 4322 #define SIM_CLKDIV2_USBFRAC_MASK 0x1u
Kojto 93:e188a91d3eaa 4323 #define SIM_CLKDIV2_USBFRAC_SHIFT 0
Kojto 93:e188a91d3eaa 4324 #define SIM_CLKDIV2_USBDIV_MASK 0xEu
Kojto 93:e188a91d3eaa 4325 #define SIM_CLKDIV2_USBDIV_SHIFT 1
Kojto 93:e188a91d3eaa 4326 #define SIM_CLKDIV2_USBDIV(x) (((uint32_t)(((uint32_t)(x))<<SIM_CLKDIV2_USBDIV_SHIFT))&SIM_CLKDIV2_USBDIV_MASK)
Kojto 93:e188a91d3eaa 4327 /* FCFG1 Bit Fields */
Kojto 93:e188a91d3eaa 4328 #define SIM_FCFG1_FLASHDIS_MASK 0x1u
Kojto 93:e188a91d3eaa 4329 #define SIM_FCFG1_FLASHDIS_SHIFT 0
Kojto 93:e188a91d3eaa 4330 #define SIM_FCFG1_FLASHDOZE_MASK 0x2u
Kojto 93:e188a91d3eaa 4331 #define SIM_FCFG1_FLASHDOZE_SHIFT 1
Kojto 93:e188a91d3eaa 4332 #define SIM_FCFG1_DEPART_MASK 0xF00u
Kojto 93:e188a91d3eaa 4333 #define SIM_FCFG1_DEPART_SHIFT 8
Kojto 93:e188a91d3eaa 4334 #define SIM_FCFG1_DEPART(x) (((uint32_t)(((uint32_t)(x))<<SIM_FCFG1_DEPART_SHIFT))&SIM_FCFG1_DEPART_MASK)
Kojto 93:e188a91d3eaa 4335 #define SIM_FCFG1_EESIZE_MASK 0xF0000u
Kojto 93:e188a91d3eaa 4336 #define SIM_FCFG1_EESIZE_SHIFT 16
Kojto 93:e188a91d3eaa 4337 #define SIM_FCFG1_EESIZE(x) (((uint32_t)(((uint32_t)(x))<<SIM_FCFG1_EESIZE_SHIFT))&SIM_FCFG1_EESIZE_MASK)
Kojto 93:e188a91d3eaa 4338 #define SIM_FCFG1_PFSIZE_MASK 0xF000000u
Kojto 93:e188a91d3eaa 4339 #define SIM_FCFG1_PFSIZE_SHIFT 24
Kojto 93:e188a91d3eaa 4340 #define SIM_FCFG1_PFSIZE(x) (((uint32_t)(((uint32_t)(x))<<SIM_FCFG1_PFSIZE_SHIFT))&SIM_FCFG1_PFSIZE_MASK)
Kojto 93:e188a91d3eaa 4341 #define SIM_FCFG1_NVMSIZE_MASK 0xF0000000u
Kojto 93:e188a91d3eaa 4342 #define SIM_FCFG1_NVMSIZE_SHIFT 28
Kojto 93:e188a91d3eaa 4343 #define SIM_FCFG1_NVMSIZE(x) (((uint32_t)(((uint32_t)(x))<<SIM_FCFG1_NVMSIZE_SHIFT))&SIM_FCFG1_NVMSIZE_MASK)
Kojto 93:e188a91d3eaa 4344 /* FCFG2 Bit Fields */
Kojto 93:e188a91d3eaa 4345 #define SIM_FCFG2_MAXADDR1_MASK 0x7F0000u
Kojto 93:e188a91d3eaa 4346 #define SIM_FCFG2_MAXADDR1_SHIFT 16
Kojto 93:e188a91d3eaa 4347 #define SIM_FCFG2_MAXADDR1(x) (((uint32_t)(((uint32_t)(x))<<SIM_FCFG2_MAXADDR1_SHIFT))&SIM_FCFG2_MAXADDR1_MASK)
Kojto 93:e188a91d3eaa 4348 #define SIM_FCFG2_PFLSH_MASK 0x800000u
Kojto 93:e188a91d3eaa 4349 #define SIM_FCFG2_PFLSH_SHIFT 23
Kojto 93:e188a91d3eaa 4350 #define SIM_FCFG2_MAXADDR0_MASK 0x7F000000u
Kojto 93:e188a91d3eaa 4351 #define SIM_FCFG2_MAXADDR0_SHIFT 24
Kojto 93:e188a91d3eaa 4352 #define SIM_FCFG2_MAXADDR0(x) (((uint32_t)(((uint32_t)(x))<<SIM_FCFG2_MAXADDR0_SHIFT))&SIM_FCFG2_MAXADDR0_MASK)
Kojto 93:e188a91d3eaa 4353 /* UIDH Bit Fields */
Kojto 93:e188a91d3eaa 4354 #define SIM_UIDH_UID_MASK 0xFFFFFFFFu
Kojto 93:e188a91d3eaa 4355 #define SIM_UIDH_UID_SHIFT 0
Kojto 93:e188a91d3eaa 4356 #define SIM_UIDH_UID(x) (((uint32_t)(((uint32_t)(x))<<SIM_UIDH_UID_SHIFT))&SIM_UIDH_UID_MASK)
Kojto 93:e188a91d3eaa 4357 /* UIDMH Bit Fields */
Kojto 93:e188a91d3eaa 4358 #define SIM_UIDMH_UID_MASK 0xFFFFFFFFu
Kojto 93:e188a91d3eaa 4359 #define SIM_UIDMH_UID_SHIFT 0
Kojto 93:e188a91d3eaa 4360 #define SIM_UIDMH_UID(x) (((uint32_t)(((uint32_t)(x))<<SIM_UIDMH_UID_SHIFT))&SIM_UIDMH_UID_MASK)
Kojto 93:e188a91d3eaa 4361 /* UIDML Bit Fields */
Kojto 93:e188a91d3eaa 4362 #define SIM_UIDML_UID_MASK 0xFFFFFFFFu
Kojto 93:e188a91d3eaa 4363 #define SIM_UIDML_UID_SHIFT 0
Kojto 93:e188a91d3eaa 4364 #define SIM_UIDML_UID(x) (((uint32_t)(((uint32_t)(x))<<SIM_UIDML_UID_SHIFT))&SIM_UIDML_UID_MASK)
Kojto 93:e188a91d3eaa 4365 /* UIDL Bit Fields */
Kojto 93:e188a91d3eaa 4366 #define SIM_UIDL_UID_MASK 0xFFFFFFFFu
Kojto 93:e188a91d3eaa 4367 #define SIM_UIDL_UID_SHIFT 0
Kojto 93:e188a91d3eaa 4368 #define SIM_UIDL_UID(x) (((uint32_t)(((uint32_t)(x))<<SIM_UIDL_UID_SHIFT))&SIM_UIDL_UID_MASK)
Kojto 93:e188a91d3eaa 4369
Kojto 93:e188a91d3eaa 4370 /**
Kojto 93:e188a91d3eaa 4371 * @}
Kojto 93:e188a91d3eaa 4372 */ /* end of group SIM_Register_Masks */
Kojto 93:e188a91d3eaa 4373
Kojto 93:e188a91d3eaa 4374
Kojto 93:e188a91d3eaa 4375 /* SIM - Peripheral instance base addresses */
Kojto 93:e188a91d3eaa 4376 /** Peripheral SIM base address */
Kojto 93:e188a91d3eaa 4377 #define SIM_BASE (0x40047000u)
Kojto 93:e188a91d3eaa 4378 /** Peripheral SIM base pointer */
Kojto 93:e188a91d3eaa 4379 #define SIM ((SIM_Type *)SIM_BASE)
Kojto 93:e188a91d3eaa 4380
Kojto 93:e188a91d3eaa 4381 /**
Kojto 93:e188a91d3eaa 4382 * @}
Kojto 93:e188a91d3eaa 4383 */ /* end of group SIM_Peripheral_Access_Layer */
Kojto 93:e188a91d3eaa 4384
Kojto 93:e188a91d3eaa 4385
Kojto 93:e188a91d3eaa 4386 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 4387 -- SMC Peripheral Access Layer
Kojto 93:e188a91d3eaa 4388 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 4389
Kojto 93:e188a91d3eaa 4390 /**
Kojto 93:e188a91d3eaa 4391 * @addtogroup SMC_Peripheral_Access_Layer SMC Peripheral Access Layer
Kojto 93:e188a91d3eaa 4392 * @{
Kojto 93:e188a91d3eaa 4393 */
Kojto 93:e188a91d3eaa 4394
Kojto 93:e188a91d3eaa 4395 /** SMC - Register Layout Typedef */
Kojto 93:e188a91d3eaa 4396 typedef struct {
Kojto 93:e188a91d3eaa 4397 __IO uint8_t PMPROT; /**< Power Mode Protection Register, offset: 0x0 */
Kojto 93:e188a91d3eaa 4398 __IO uint8_t PMCTRL; /**< Power Mode Control Register, offset: 0x1 */
Kojto 93:e188a91d3eaa 4399 __IO uint8_t VLLSCTRL; /**< VLLS Control Register, offset: 0x2 */
Kojto 93:e188a91d3eaa 4400 __I uint8_t PMSTAT; /**< Power Mode Status Register, offset: 0x3 */
Kojto 93:e188a91d3eaa 4401 } SMC_Type;
Kojto 93:e188a91d3eaa 4402
Kojto 93:e188a91d3eaa 4403 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 4404 -- SMC Register Masks
Kojto 93:e188a91d3eaa 4405 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 4406
Kojto 93:e188a91d3eaa 4407 /**
Kojto 93:e188a91d3eaa 4408 * @addtogroup SMC_Register_Masks SMC Register Masks
Kojto 93:e188a91d3eaa 4409 * @{
Kojto 93:e188a91d3eaa 4410 */
Kojto 93:e188a91d3eaa 4411
Kojto 93:e188a91d3eaa 4412 /* PMPROT Bit Fields */
Kojto 93:e188a91d3eaa 4413 #define SMC_PMPROT_AVLLS_MASK 0x2u
Kojto 93:e188a91d3eaa 4414 #define SMC_PMPROT_AVLLS_SHIFT 1
Kojto 93:e188a91d3eaa 4415 #define SMC_PMPROT_ALLS_MASK 0x8u
Kojto 93:e188a91d3eaa 4416 #define SMC_PMPROT_ALLS_SHIFT 3
Kojto 93:e188a91d3eaa 4417 #define SMC_PMPROT_AVLP_MASK 0x20u
Kojto 93:e188a91d3eaa 4418 #define SMC_PMPROT_AVLP_SHIFT 5
Kojto 93:e188a91d3eaa 4419 /* PMCTRL Bit Fields */
Kojto 93:e188a91d3eaa 4420 #define SMC_PMCTRL_STOPM_MASK 0x7u
Kojto 93:e188a91d3eaa 4421 #define SMC_PMCTRL_STOPM_SHIFT 0
Kojto 93:e188a91d3eaa 4422 #define SMC_PMCTRL_STOPM(x) (((uint8_t)(((uint8_t)(x))<<SMC_PMCTRL_STOPM_SHIFT))&SMC_PMCTRL_STOPM_MASK)
Kojto 93:e188a91d3eaa 4423 #define SMC_PMCTRL_STOPA_MASK 0x8u
Kojto 93:e188a91d3eaa 4424 #define SMC_PMCTRL_STOPA_SHIFT 3
Kojto 93:e188a91d3eaa 4425 #define SMC_PMCTRL_RUNM_MASK 0x60u
Kojto 93:e188a91d3eaa 4426 #define SMC_PMCTRL_RUNM_SHIFT 5
Kojto 93:e188a91d3eaa 4427 #define SMC_PMCTRL_RUNM(x) (((uint8_t)(((uint8_t)(x))<<SMC_PMCTRL_RUNM_SHIFT))&SMC_PMCTRL_RUNM_MASK)
Kojto 93:e188a91d3eaa 4428 #define SMC_PMCTRL_LPWUI_MASK 0x80u
Kojto 93:e188a91d3eaa 4429 #define SMC_PMCTRL_LPWUI_SHIFT 7
Kojto 93:e188a91d3eaa 4430 /* VLLSCTRL Bit Fields */
Kojto 93:e188a91d3eaa 4431 #define SMC_VLLSCTRL_VLLSM_MASK 0x7u
Kojto 93:e188a91d3eaa 4432 #define SMC_VLLSCTRL_VLLSM_SHIFT 0
Kojto 93:e188a91d3eaa 4433 #define SMC_VLLSCTRL_VLLSM(x) (((uint8_t)(((uint8_t)(x))<<SMC_VLLSCTRL_VLLSM_SHIFT))&SMC_VLLSCTRL_VLLSM_MASK)
Kojto 93:e188a91d3eaa 4434 #define SMC_VLLSCTRL_PORPO_MASK 0x20u
Kojto 93:e188a91d3eaa 4435 #define SMC_VLLSCTRL_PORPO_SHIFT 5
Kojto 93:e188a91d3eaa 4436 /* PMSTAT Bit Fields */
Kojto 93:e188a91d3eaa 4437 #define SMC_PMSTAT_PMSTAT_MASK 0x7Fu
Kojto 93:e188a91d3eaa 4438 #define SMC_PMSTAT_PMSTAT_SHIFT 0
Kojto 93:e188a91d3eaa 4439 #define SMC_PMSTAT_PMSTAT(x) (((uint8_t)(((uint8_t)(x))<<SMC_PMSTAT_PMSTAT_SHIFT))&SMC_PMSTAT_PMSTAT_MASK)
Kojto 93:e188a91d3eaa 4440
Kojto 93:e188a91d3eaa 4441 /**
Kojto 93:e188a91d3eaa 4442 * @}
Kojto 93:e188a91d3eaa 4443 */ /* end of group SMC_Register_Masks */
Kojto 93:e188a91d3eaa 4444
Kojto 93:e188a91d3eaa 4445
Kojto 93:e188a91d3eaa 4446 /* SMC - Peripheral instance base addresses */
Kojto 93:e188a91d3eaa 4447 /** Peripheral SMC base address */
Kojto 93:e188a91d3eaa 4448 #define SMC_BASE (0x4007E000u)
Kojto 93:e188a91d3eaa 4449 /** Peripheral SMC base pointer */
Kojto 93:e188a91d3eaa 4450 #define SMC ((SMC_Type *)SMC_BASE)
Kojto 93:e188a91d3eaa 4451
Kojto 93:e188a91d3eaa 4452 /**
Kojto 93:e188a91d3eaa 4453 * @}
Kojto 93:e188a91d3eaa 4454 */ /* end of group SMC_Peripheral_Access_Layer */
Kojto 93:e188a91d3eaa 4455
Kojto 93:e188a91d3eaa 4456
Kojto 93:e188a91d3eaa 4457 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 4458 -- SPI Peripheral Access Layer
Kojto 93:e188a91d3eaa 4459 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 4460
Kojto 93:e188a91d3eaa 4461 /**
Kojto 93:e188a91d3eaa 4462 * @addtogroup SPI_Peripheral_Access_Layer SPI Peripheral Access Layer
Kojto 93:e188a91d3eaa 4463 * @{
Kojto 93:e188a91d3eaa 4464 */
Kojto 93:e188a91d3eaa 4465
Kojto 93:e188a91d3eaa 4466 /** SPI - Register Layout Typedef */
Kojto 93:e188a91d3eaa 4467 typedef struct {
Kojto 93:e188a91d3eaa 4468 __IO uint32_t MCR; /**< DSPI Module Configuration Register, offset: 0x0 */
Kojto 93:e188a91d3eaa 4469 uint8_t RESERVED_0[4];
Kojto 93:e188a91d3eaa 4470 __IO uint32_t TCR; /**< DSPI Transfer Count Register, offset: 0x8 */
Kojto 93:e188a91d3eaa 4471 union { /* offset: 0xC */
Kojto 93:e188a91d3eaa 4472 __IO uint32_t CTAR[2]; /**< DSPI Clock and Transfer Attributes Register (In Master Mode), array offset: 0xC, array step: 0x4 */
Kojto 93:e188a91d3eaa 4473 __IO uint32_t CTAR_SLAVE[1]; /**< DSPI Clock and Transfer Attributes Register (In Slave Mode), array offset: 0xC, array step: 0x4 */
Kojto 93:e188a91d3eaa 4474 };
Kojto 93:e188a91d3eaa 4475 uint8_t RESERVED_1[24];
Kojto 93:e188a91d3eaa 4476 __IO uint32_t SR; /**< DSPI Status Register, offset: 0x2C */
Kojto 93:e188a91d3eaa 4477 __IO uint32_t RSER; /**< DSPI DMA/Interrupt Request Select and Enable Register, offset: 0x30 */
Kojto 93:e188a91d3eaa 4478 union { /* offset: 0x34 */
Kojto 93:e188a91d3eaa 4479 __IO uint32_t PUSHR; /**< DSPI PUSH TX FIFO Register In Master Mode, offset: 0x34 */
Kojto 93:e188a91d3eaa 4480 __IO uint32_t PUSHR_SLAVE; /**< DSPI PUSH TX FIFO Register In Slave Mode, offset: 0x34 */
Kojto 93:e188a91d3eaa 4481 };
Kojto 93:e188a91d3eaa 4482 __I uint32_t POPR; /**< DSPI POP RX FIFO Register, offset: 0x38 */
Kojto 93:e188a91d3eaa 4483 __I uint32_t TXFR0; /**< DSPI Transmit FIFO Registers, offset: 0x3C */
Kojto 93:e188a91d3eaa 4484 __I uint32_t TXFR1; /**< DSPI Transmit FIFO Registers, offset: 0x40 */
Kojto 93:e188a91d3eaa 4485 __I uint32_t TXFR2; /**< DSPI Transmit FIFO Registers, offset: 0x44 */
Kojto 93:e188a91d3eaa 4486 __I uint32_t TXFR3; /**< DSPI Transmit FIFO Registers, offset: 0x48 */
Kojto 93:e188a91d3eaa 4487 uint8_t RESERVED_2[48];
Kojto 93:e188a91d3eaa 4488 __I uint32_t RXFR0; /**< DSPI Receive FIFO Registers, offset: 0x7C */
Kojto 93:e188a91d3eaa 4489 __I uint32_t RXFR1; /**< DSPI Receive FIFO Registers, offset: 0x80 */
Kojto 93:e188a91d3eaa 4490 __I uint32_t RXFR2; /**< DSPI Receive FIFO Registers, offset: 0x84 */
Kojto 93:e188a91d3eaa 4491 __I uint32_t RXFR3; /**< DSPI Receive FIFO Registers, offset: 0x88 */
Kojto 93:e188a91d3eaa 4492 } SPI_Type;
Kojto 93:e188a91d3eaa 4493
Kojto 93:e188a91d3eaa 4494 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 4495 -- SPI Register Masks
Kojto 93:e188a91d3eaa 4496 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 4497
Kojto 93:e188a91d3eaa 4498 /**
Kojto 93:e188a91d3eaa 4499 * @addtogroup SPI_Register_Masks SPI Register Masks
Kojto 93:e188a91d3eaa 4500 * @{
Kojto 93:e188a91d3eaa 4501 */
Kojto 93:e188a91d3eaa 4502
Kojto 93:e188a91d3eaa 4503 /* MCR Bit Fields */
Kojto 93:e188a91d3eaa 4504 #define SPI_MCR_HALT_MASK 0x1u
Kojto 93:e188a91d3eaa 4505 #define SPI_MCR_HALT_SHIFT 0
Kojto 93:e188a91d3eaa 4506 #define SPI_MCR_SMPL_PT_MASK 0x300u
Kojto 93:e188a91d3eaa 4507 #define SPI_MCR_SMPL_PT_SHIFT 8
Kojto 93:e188a91d3eaa 4508 #define SPI_MCR_SMPL_PT(x) (((uint32_t)(((uint32_t)(x))<<SPI_MCR_SMPL_PT_SHIFT))&SPI_MCR_SMPL_PT_MASK)
Kojto 93:e188a91d3eaa 4509 #define SPI_MCR_CLR_RXF_MASK 0x400u
Kojto 93:e188a91d3eaa 4510 #define SPI_MCR_CLR_RXF_SHIFT 10
Kojto 93:e188a91d3eaa 4511 #define SPI_MCR_CLR_TXF_MASK 0x800u
Kojto 93:e188a91d3eaa 4512 #define SPI_MCR_CLR_TXF_SHIFT 11
Kojto 93:e188a91d3eaa 4513 #define SPI_MCR_DIS_RXF_MASK 0x1000u
Kojto 93:e188a91d3eaa 4514 #define SPI_MCR_DIS_RXF_SHIFT 12
Kojto 93:e188a91d3eaa 4515 #define SPI_MCR_DIS_TXF_MASK 0x2000u
Kojto 93:e188a91d3eaa 4516 #define SPI_MCR_DIS_TXF_SHIFT 13
Kojto 93:e188a91d3eaa 4517 #define SPI_MCR_MDIS_MASK 0x4000u
Kojto 93:e188a91d3eaa 4518 #define SPI_MCR_MDIS_SHIFT 14
Kojto 93:e188a91d3eaa 4519 #define SPI_MCR_DOZE_MASK 0x8000u
Kojto 93:e188a91d3eaa 4520 #define SPI_MCR_DOZE_SHIFT 15
Kojto 93:e188a91d3eaa 4521 #define SPI_MCR_PCSIS_MASK 0x3F0000u
Kojto 93:e188a91d3eaa 4522 #define SPI_MCR_PCSIS_SHIFT 16
Kojto 93:e188a91d3eaa 4523 #define SPI_MCR_PCSIS(x) (((uint32_t)(((uint32_t)(x))<<SPI_MCR_PCSIS_SHIFT))&SPI_MCR_PCSIS_MASK)
Kojto 93:e188a91d3eaa 4524 #define SPI_MCR_ROOE_MASK 0x1000000u
Kojto 93:e188a91d3eaa 4525 #define SPI_MCR_ROOE_SHIFT 24
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Kojto 93:e188a91d3eaa 4594 #define SPI_SR_TXNXTPTR_MASK 0xF00u
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Kojto 93:e188a91d3eaa 4597 #define SPI_SR_TXCTR_MASK 0xF000u
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Kojto 93:e188a91d3eaa 4614 /* RSER Bit Fields */
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Kojto 93:e188a91d3eaa 4631 /* PUSHR Bit Fields */
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Kojto 93:e188a91d3eaa 4634 #define SPI_PUSHR_TXDATA(x) (((uint32_t)(((uint32_t)(x))<<SPI_PUSHR_TXDATA_SHIFT))&SPI_PUSHR_TXDATA_MASK)
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Kojto 93:e188a91d3eaa 4637 #define SPI_PUSHR_PCS(x) (((uint32_t)(((uint32_t)(x))<<SPI_PUSHR_PCS_SHIFT))&SPI_PUSHR_PCS_MASK)
Kojto 93:e188a91d3eaa 4638 #define SPI_PUSHR_CTCNT_MASK 0x4000000u
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Kojto 93:e188a91d3eaa 4643 #define SPI_PUSHR_CTAS_SHIFT 28
Kojto 93:e188a91d3eaa 4644 #define SPI_PUSHR_CTAS(x) (((uint32_t)(((uint32_t)(x))<<SPI_PUSHR_CTAS_SHIFT))&SPI_PUSHR_CTAS_MASK)
Kojto 93:e188a91d3eaa 4645 #define SPI_PUSHR_CONT_MASK 0x80000000u
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Kojto 93:e188a91d3eaa 4647 /* PUSHR_SLAVE Bit Fields */
Kojto 93:e188a91d3eaa 4648 #define SPI_PUSHR_SLAVE_TXDATA_MASK 0xFFFFFFFFu
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Kojto 93:e188a91d3eaa 4651 /* POPR Bit Fields */
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Kojto 93:e188a91d3eaa 4655 /* TXFR0 Bit Fields */
Kojto 93:e188a91d3eaa 4656 #define SPI_TXFR0_TXDATA_MASK 0xFFFFu
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Kojto 93:e188a91d3eaa 4658 #define SPI_TXFR0_TXDATA(x) (((uint32_t)(((uint32_t)(x))<<SPI_TXFR0_TXDATA_SHIFT))&SPI_TXFR0_TXDATA_MASK)
Kojto 93:e188a91d3eaa 4659 #define SPI_TXFR0_TXCMD_TXDATA_MASK 0xFFFF0000u
Kojto 93:e188a91d3eaa 4660 #define SPI_TXFR0_TXCMD_TXDATA_SHIFT 16
Kojto 93:e188a91d3eaa 4661 #define SPI_TXFR0_TXCMD_TXDATA(x) (((uint32_t)(((uint32_t)(x))<<SPI_TXFR0_TXCMD_TXDATA_SHIFT))&SPI_TXFR0_TXCMD_TXDATA_MASK)
Kojto 93:e188a91d3eaa 4662 /* TXFR1 Bit Fields */
Kojto 93:e188a91d3eaa 4663 #define SPI_TXFR1_TXDATA_MASK 0xFFFFu
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Kojto 93:e188a91d3eaa 4665 #define SPI_TXFR1_TXDATA(x) (((uint32_t)(((uint32_t)(x))<<SPI_TXFR1_TXDATA_SHIFT))&SPI_TXFR1_TXDATA_MASK)
Kojto 93:e188a91d3eaa 4666 #define SPI_TXFR1_TXCMD_TXDATA_MASK 0xFFFF0000u
Kojto 93:e188a91d3eaa 4667 #define SPI_TXFR1_TXCMD_TXDATA_SHIFT 16
Kojto 93:e188a91d3eaa 4668 #define SPI_TXFR1_TXCMD_TXDATA(x) (((uint32_t)(((uint32_t)(x))<<SPI_TXFR1_TXCMD_TXDATA_SHIFT))&SPI_TXFR1_TXCMD_TXDATA_MASK)
Kojto 93:e188a91d3eaa 4669 /* TXFR2 Bit Fields */
Kojto 93:e188a91d3eaa 4670 #define SPI_TXFR2_TXDATA_MASK 0xFFFFu
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Kojto 93:e188a91d3eaa 4672 #define SPI_TXFR2_TXDATA(x) (((uint32_t)(((uint32_t)(x))<<SPI_TXFR2_TXDATA_SHIFT))&SPI_TXFR2_TXDATA_MASK)
Kojto 93:e188a91d3eaa 4673 #define SPI_TXFR2_TXCMD_TXDATA_MASK 0xFFFF0000u
Kojto 93:e188a91d3eaa 4674 #define SPI_TXFR2_TXCMD_TXDATA_SHIFT 16
Kojto 93:e188a91d3eaa 4675 #define SPI_TXFR2_TXCMD_TXDATA(x) (((uint32_t)(((uint32_t)(x))<<SPI_TXFR2_TXCMD_TXDATA_SHIFT))&SPI_TXFR2_TXCMD_TXDATA_MASK)
Kojto 93:e188a91d3eaa 4676 /* TXFR3 Bit Fields */
Kojto 93:e188a91d3eaa 4677 #define SPI_TXFR3_TXDATA_MASK 0xFFFFu
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Kojto 93:e188a91d3eaa 4680 #define SPI_TXFR3_TXCMD_TXDATA_MASK 0xFFFF0000u
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Kojto 93:e188a91d3eaa 4682 #define SPI_TXFR3_TXCMD_TXDATA(x) (((uint32_t)(((uint32_t)(x))<<SPI_TXFR3_TXCMD_TXDATA_SHIFT))&SPI_TXFR3_TXCMD_TXDATA_MASK)
Kojto 93:e188a91d3eaa 4683 /* RXFR0 Bit Fields */
Kojto 93:e188a91d3eaa 4684 #define SPI_RXFR0_RXDATA_MASK 0xFFFFFFFFu
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Kojto 93:e188a91d3eaa 4687 /* RXFR1 Bit Fields */
Kojto 93:e188a91d3eaa 4688 #define SPI_RXFR1_RXDATA_MASK 0xFFFFFFFFu
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Kojto 93:e188a91d3eaa 4691 /* RXFR2 Bit Fields */
Kojto 93:e188a91d3eaa 4692 #define SPI_RXFR2_RXDATA_MASK 0xFFFFFFFFu
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Kojto 93:e188a91d3eaa 4695 /* RXFR3 Bit Fields */
Kojto 93:e188a91d3eaa 4696 #define SPI_RXFR3_RXDATA_MASK 0xFFFFFFFFu
Kojto 93:e188a91d3eaa 4697 #define SPI_RXFR3_RXDATA_SHIFT 0
Kojto 93:e188a91d3eaa 4698 #define SPI_RXFR3_RXDATA(x) (((uint32_t)(((uint32_t)(x))<<SPI_RXFR3_RXDATA_SHIFT))&SPI_RXFR3_RXDATA_MASK)
Kojto 93:e188a91d3eaa 4699
Kojto 93:e188a91d3eaa 4700 /**
Kojto 93:e188a91d3eaa 4701 * @}
Kojto 93:e188a91d3eaa 4702 */ /* end of group SPI_Register_Masks */
Kojto 93:e188a91d3eaa 4703
Kojto 93:e188a91d3eaa 4704
Kojto 93:e188a91d3eaa 4705 /* SPI - Peripheral instance base addresses */
Kojto 93:e188a91d3eaa 4706 /** Peripheral SPI0 base address */
Kojto 93:e188a91d3eaa 4707 #define SPI0_BASE (0x4002C000u)
Kojto 93:e188a91d3eaa 4708 /** Peripheral SPI0 base pointer */
Kojto 93:e188a91d3eaa 4709 #define SPI0 ((SPI_Type *)SPI0_BASE)
Kojto 93:e188a91d3eaa 4710
Kojto 93:e188a91d3eaa 4711 /**
Kojto 93:e188a91d3eaa 4712 * @}
Kojto 93:e188a91d3eaa 4713 */ /* end of group SPI_Peripheral_Access_Layer */
Kojto 93:e188a91d3eaa 4714
Kojto 93:e188a91d3eaa 4715
Kojto 93:e188a91d3eaa 4716 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 4717 -- TSI Peripheral Access Layer
Kojto 93:e188a91d3eaa 4718 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 4719
Kojto 93:e188a91d3eaa 4720 /**
Kojto 93:e188a91d3eaa 4721 * @addtogroup TSI_Peripheral_Access_Layer TSI Peripheral Access Layer
Kojto 93:e188a91d3eaa 4722 * @{
Kojto 93:e188a91d3eaa 4723 */
Kojto 93:e188a91d3eaa 4724
Kojto 93:e188a91d3eaa 4725 /** TSI - Register Layout Typedef */
Kojto 93:e188a91d3eaa 4726 typedef struct {
Kojto 93:e188a91d3eaa 4727 __IO uint32_t GENCS; /**< General Control and Status Register, offset: 0x0 */
Kojto 93:e188a91d3eaa 4728 __IO uint32_t SCANC; /**< SCAN Control Register, offset: 0x4 */
Kojto 93:e188a91d3eaa 4729 __IO uint32_t PEN; /**< Pin Enable Register, offset: 0x8 */
Kojto 93:e188a91d3eaa 4730 __I uint32_t WUCNTR; /**< Wake-Up Channel Counter Register, offset: 0xC */
Kojto 93:e188a91d3eaa 4731 uint8_t RESERVED_0[240];
Kojto 93:e188a91d3eaa 4732 __I uint32_t CNTR1; /**< Counter Register, offset: 0x100 */
Kojto 93:e188a91d3eaa 4733 __I uint32_t CNTR3; /**< Counter Register, offset: 0x104 */
Kojto 93:e188a91d3eaa 4734 __I uint32_t CNTR5; /**< Counter Register, offset: 0x108 */
Kojto 93:e188a91d3eaa 4735 __I uint32_t CNTR7; /**< Counter Register, offset: 0x10C */
Kojto 93:e188a91d3eaa 4736 __I uint32_t CNTR9; /**< Counter Register, offset: 0x110 */
Kojto 93:e188a91d3eaa 4737 __I uint32_t CNTR11; /**< Counter Register, offset: 0x114 */
Kojto 93:e188a91d3eaa 4738 __I uint32_t CNTR13; /**< Counter Register, offset: 0x118 */
Kojto 93:e188a91d3eaa 4739 __I uint32_t CNTR15; /**< Counter Register, offset: 0x11C */
Kojto 93:e188a91d3eaa 4740 __IO uint32_t THRESHOLD; /**< Low Power Channel Threshold Register, offset: 0x120 */
Kojto 93:e188a91d3eaa 4741 } TSI_Type;
Kojto 93:e188a91d3eaa 4742
Kojto 93:e188a91d3eaa 4743 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 4744 -- TSI Register Masks
Kojto 93:e188a91d3eaa 4745 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 4746
Kojto 93:e188a91d3eaa 4747 /**
Kojto 93:e188a91d3eaa 4748 * @addtogroup TSI_Register_Masks TSI Register Masks
Kojto 93:e188a91d3eaa 4749 * @{
Kojto 93:e188a91d3eaa 4750 */
Kojto 93:e188a91d3eaa 4751
Kojto 93:e188a91d3eaa 4752 /* GENCS Bit Fields */
Kojto 93:e188a91d3eaa 4753 #define TSI_GENCS_STPE_MASK 0x1u
Kojto 93:e188a91d3eaa 4754 #define TSI_GENCS_STPE_SHIFT 0
Kojto 93:e188a91d3eaa 4755 #define TSI_GENCS_STM_MASK 0x2u
Kojto 93:e188a91d3eaa 4756 #define TSI_GENCS_STM_SHIFT 1
Kojto 93:e188a91d3eaa 4757 #define TSI_GENCS_ESOR_MASK 0x10u
Kojto 93:e188a91d3eaa 4758 #define TSI_GENCS_ESOR_SHIFT 4
Kojto 93:e188a91d3eaa 4759 #define TSI_GENCS_ERIE_MASK 0x20u
Kojto 93:e188a91d3eaa 4760 #define TSI_GENCS_ERIE_SHIFT 5
Kojto 93:e188a91d3eaa 4761 #define TSI_GENCS_TSIIE_MASK 0x40u
Kojto 93:e188a91d3eaa 4762 #define TSI_GENCS_TSIIE_SHIFT 6
Kojto 93:e188a91d3eaa 4763 #define TSI_GENCS_TSIEN_MASK 0x80u
Kojto 93:e188a91d3eaa 4764 #define TSI_GENCS_TSIEN_SHIFT 7
Kojto 93:e188a91d3eaa 4765 #define TSI_GENCS_SWTS_MASK 0x100u
Kojto 93:e188a91d3eaa 4766 #define TSI_GENCS_SWTS_SHIFT 8
Kojto 93:e188a91d3eaa 4767 #define TSI_GENCS_SCNIP_MASK 0x200u
Kojto 93:e188a91d3eaa 4768 #define TSI_GENCS_SCNIP_SHIFT 9
Kojto 93:e188a91d3eaa 4769 #define TSI_GENCS_OVRF_MASK 0x1000u
Kojto 93:e188a91d3eaa 4770 #define TSI_GENCS_OVRF_SHIFT 12
Kojto 93:e188a91d3eaa 4771 #define TSI_GENCS_EXTERF_MASK 0x2000u
Kojto 93:e188a91d3eaa 4772 #define TSI_GENCS_EXTERF_SHIFT 13
Kojto 93:e188a91d3eaa 4773 #define TSI_GENCS_OUTRGF_MASK 0x4000u
Kojto 93:e188a91d3eaa 4774 #define TSI_GENCS_OUTRGF_SHIFT 14
Kojto 93:e188a91d3eaa 4775 #define TSI_GENCS_EOSF_MASK 0x8000u
Kojto 93:e188a91d3eaa 4776 #define TSI_GENCS_EOSF_SHIFT 15
Kojto 93:e188a91d3eaa 4777 #define TSI_GENCS_PS_MASK 0x70000u
Kojto 93:e188a91d3eaa 4778 #define TSI_GENCS_PS_SHIFT 16
Kojto 93:e188a91d3eaa 4779 #define TSI_GENCS_PS(x) (((uint32_t)(((uint32_t)(x))<<TSI_GENCS_PS_SHIFT))&TSI_GENCS_PS_MASK)
Kojto 93:e188a91d3eaa 4780 #define TSI_GENCS_NSCN_MASK 0xF80000u
Kojto 93:e188a91d3eaa 4781 #define TSI_GENCS_NSCN_SHIFT 19
Kojto 93:e188a91d3eaa 4782 #define TSI_GENCS_NSCN(x) (((uint32_t)(((uint32_t)(x))<<TSI_GENCS_NSCN_SHIFT))&TSI_GENCS_NSCN_MASK)
Kojto 93:e188a91d3eaa 4783 #define TSI_GENCS_LPSCNITV_MASK 0xF000000u
Kojto 93:e188a91d3eaa 4784 #define TSI_GENCS_LPSCNITV_SHIFT 24
Kojto 93:e188a91d3eaa 4785 #define TSI_GENCS_LPSCNITV(x) (((uint32_t)(((uint32_t)(x))<<TSI_GENCS_LPSCNITV_SHIFT))&TSI_GENCS_LPSCNITV_MASK)
Kojto 93:e188a91d3eaa 4786 #define TSI_GENCS_LPCLKS_MASK 0x10000000u
Kojto 93:e188a91d3eaa 4787 #define TSI_GENCS_LPCLKS_SHIFT 28
Kojto 93:e188a91d3eaa 4788 /* SCANC Bit Fields */
Kojto 93:e188a91d3eaa 4789 #define TSI_SCANC_AMPSC_MASK 0x7u
Kojto 93:e188a91d3eaa 4790 #define TSI_SCANC_AMPSC_SHIFT 0
Kojto 93:e188a91d3eaa 4791 #define TSI_SCANC_AMPSC(x) (((uint32_t)(((uint32_t)(x))<<TSI_SCANC_AMPSC_SHIFT))&TSI_SCANC_AMPSC_MASK)
Kojto 93:e188a91d3eaa 4792 #define TSI_SCANC_AMCLKS_MASK 0x18u
Kojto 93:e188a91d3eaa 4793 #define TSI_SCANC_AMCLKS_SHIFT 3
Kojto 93:e188a91d3eaa 4794 #define TSI_SCANC_AMCLKS(x) (((uint32_t)(((uint32_t)(x))<<TSI_SCANC_AMCLKS_SHIFT))&TSI_SCANC_AMCLKS_MASK)
Kojto 93:e188a91d3eaa 4795 #define TSI_SCANC_SMOD_MASK 0xFF00u
Kojto 93:e188a91d3eaa 4796 #define TSI_SCANC_SMOD_SHIFT 8
Kojto 93:e188a91d3eaa 4797 #define TSI_SCANC_SMOD(x) (((uint32_t)(((uint32_t)(x))<<TSI_SCANC_SMOD_SHIFT))&TSI_SCANC_SMOD_MASK)
Kojto 93:e188a91d3eaa 4798 #define TSI_SCANC_EXTCHRG_MASK 0xF0000u
Kojto 93:e188a91d3eaa 4799 #define TSI_SCANC_EXTCHRG_SHIFT 16
Kojto 93:e188a91d3eaa 4800 #define TSI_SCANC_EXTCHRG(x) (((uint32_t)(((uint32_t)(x))<<TSI_SCANC_EXTCHRG_SHIFT))&TSI_SCANC_EXTCHRG_MASK)
Kojto 93:e188a91d3eaa 4801 #define TSI_SCANC_REFCHRG_MASK 0xF000000u
Kojto 93:e188a91d3eaa 4802 #define TSI_SCANC_REFCHRG_SHIFT 24
Kojto 93:e188a91d3eaa 4803 #define TSI_SCANC_REFCHRG(x) (((uint32_t)(((uint32_t)(x))<<TSI_SCANC_REFCHRG_SHIFT))&TSI_SCANC_REFCHRG_MASK)
Kojto 93:e188a91d3eaa 4804 /* PEN Bit Fields */
Kojto 93:e188a91d3eaa 4805 #define TSI_PEN_PEN0_MASK 0x1u
Kojto 93:e188a91d3eaa 4806 #define TSI_PEN_PEN0_SHIFT 0
Kojto 93:e188a91d3eaa 4807 #define TSI_PEN_PEN1_MASK 0x2u
Kojto 93:e188a91d3eaa 4808 #define TSI_PEN_PEN1_SHIFT 1
Kojto 93:e188a91d3eaa 4809 #define TSI_PEN_PEN2_MASK 0x4u
Kojto 93:e188a91d3eaa 4810 #define TSI_PEN_PEN2_SHIFT 2
Kojto 93:e188a91d3eaa 4811 #define TSI_PEN_PEN3_MASK 0x8u
Kojto 93:e188a91d3eaa 4812 #define TSI_PEN_PEN3_SHIFT 3
Kojto 93:e188a91d3eaa 4813 #define TSI_PEN_PEN4_MASK 0x10u
Kojto 93:e188a91d3eaa 4814 #define TSI_PEN_PEN4_SHIFT 4
Kojto 93:e188a91d3eaa 4815 #define TSI_PEN_PEN5_MASK 0x20u
Kojto 93:e188a91d3eaa 4816 #define TSI_PEN_PEN5_SHIFT 5
Kojto 93:e188a91d3eaa 4817 #define TSI_PEN_PEN6_MASK 0x40u
Kojto 93:e188a91d3eaa 4818 #define TSI_PEN_PEN6_SHIFT 6
Kojto 93:e188a91d3eaa 4819 #define TSI_PEN_PEN7_MASK 0x80u
Kojto 93:e188a91d3eaa 4820 #define TSI_PEN_PEN7_SHIFT 7
Kojto 93:e188a91d3eaa 4821 #define TSI_PEN_PEN8_MASK 0x100u
Kojto 93:e188a91d3eaa 4822 #define TSI_PEN_PEN8_SHIFT 8
Kojto 93:e188a91d3eaa 4823 #define TSI_PEN_PEN9_MASK 0x200u
Kojto 93:e188a91d3eaa 4824 #define TSI_PEN_PEN9_SHIFT 9
Kojto 93:e188a91d3eaa 4825 #define TSI_PEN_PEN10_MASK 0x400u
Kojto 93:e188a91d3eaa 4826 #define TSI_PEN_PEN10_SHIFT 10
Kojto 93:e188a91d3eaa 4827 #define TSI_PEN_PEN11_MASK 0x800u
Kojto 93:e188a91d3eaa 4828 #define TSI_PEN_PEN11_SHIFT 11
Kojto 93:e188a91d3eaa 4829 #define TSI_PEN_PEN12_MASK 0x1000u
Kojto 93:e188a91d3eaa 4830 #define TSI_PEN_PEN12_SHIFT 12
Kojto 93:e188a91d3eaa 4831 #define TSI_PEN_PEN13_MASK 0x2000u
Kojto 93:e188a91d3eaa 4832 #define TSI_PEN_PEN13_SHIFT 13
Kojto 93:e188a91d3eaa 4833 #define TSI_PEN_PEN14_MASK 0x4000u
Kojto 93:e188a91d3eaa 4834 #define TSI_PEN_PEN14_SHIFT 14
Kojto 93:e188a91d3eaa 4835 #define TSI_PEN_PEN15_MASK 0x8000u
Kojto 93:e188a91d3eaa 4836 #define TSI_PEN_PEN15_SHIFT 15
Kojto 93:e188a91d3eaa 4837 #define TSI_PEN_LPSP_MASK 0xF0000u
Kojto 93:e188a91d3eaa 4838 #define TSI_PEN_LPSP_SHIFT 16
Kojto 93:e188a91d3eaa 4839 #define TSI_PEN_LPSP(x) (((uint32_t)(((uint32_t)(x))<<TSI_PEN_LPSP_SHIFT))&TSI_PEN_LPSP_MASK)
Kojto 93:e188a91d3eaa 4840 /* WUCNTR Bit Fields */
Kojto 93:e188a91d3eaa 4841 #define TSI_WUCNTR_WUCNT_MASK 0xFFFFu
Kojto 93:e188a91d3eaa 4842 #define TSI_WUCNTR_WUCNT_SHIFT 0
Kojto 93:e188a91d3eaa 4843 #define TSI_WUCNTR_WUCNT(x) (((uint32_t)(((uint32_t)(x))<<TSI_WUCNTR_WUCNT_SHIFT))&TSI_WUCNTR_WUCNT_MASK)
Kojto 93:e188a91d3eaa 4844 /* CNTR1 Bit Fields */
Kojto 93:e188a91d3eaa 4845 #define TSI_CNTR1_CTN1_MASK 0xFFFFu
Kojto 93:e188a91d3eaa 4846 #define TSI_CNTR1_CTN1_SHIFT 0
Kojto 93:e188a91d3eaa 4847 #define TSI_CNTR1_CTN1(x) (((uint32_t)(((uint32_t)(x))<<TSI_CNTR1_CTN1_SHIFT))&TSI_CNTR1_CTN1_MASK)
Kojto 93:e188a91d3eaa 4848 #define TSI_CNTR1_CTN_MASK 0xFFFF0000u
Kojto 93:e188a91d3eaa 4849 #define TSI_CNTR1_CTN_SHIFT 16
Kojto 93:e188a91d3eaa 4850 #define TSI_CNTR1_CTN(x) (((uint32_t)(((uint32_t)(x))<<TSI_CNTR1_CTN_SHIFT))&TSI_CNTR1_CTN_MASK)
Kojto 93:e188a91d3eaa 4851 /* CNTR3 Bit Fields */
Kojto 93:e188a91d3eaa 4852 #define TSI_CNTR3_CTN1_MASK 0xFFFFu
Kojto 93:e188a91d3eaa 4853 #define TSI_CNTR3_CTN1_SHIFT 0
Kojto 93:e188a91d3eaa 4854 #define TSI_CNTR3_CTN1(x) (((uint32_t)(((uint32_t)(x))<<TSI_CNTR3_CTN1_SHIFT))&TSI_CNTR3_CTN1_MASK)
Kojto 93:e188a91d3eaa 4855 #define TSI_CNTR3_CTN_MASK 0xFFFF0000u
Kojto 93:e188a91d3eaa 4856 #define TSI_CNTR3_CTN_SHIFT 16
Kojto 93:e188a91d3eaa 4857 #define TSI_CNTR3_CTN(x) (((uint32_t)(((uint32_t)(x))<<TSI_CNTR3_CTN_SHIFT))&TSI_CNTR3_CTN_MASK)
Kojto 93:e188a91d3eaa 4858 /* CNTR5 Bit Fields */
Kojto 93:e188a91d3eaa 4859 #define TSI_CNTR5_CTN1_MASK 0xFFFFu
Kojto 93:e188a91d3eaa 4860 #define TSI_CNTR5_CTN1_SHIFT 0
Kojto 93:e188a91d3eaa 4861 #define TSI_CNTR5_CTN1(x) (((uint32_t)(((uint32_t)(x))<<TSI_CNTR5_CTN1_SHIFT))&TSI_CNTR5_CTN1_MASK)
Kojto 93:e188a91d3eaa 4862 #define TSI_CNTR5_CTN_MASK 0xFFFF0000u
Kojto 93:e188a91d3eaa 4863 #define TSI_CNTR5_CTN_SHIFT 16
Kojto 93:e188a91d3eaa 4864 #define TSI_CNTR5_CTN(x) (((uint32_t)(((uint32_t)(x))<<TSI_CNTR5_CTN_SHIFT))&TSI_CNTR5_CTN_MASK)
Kojto 93:e188a91d3eaa 4865 /* CNTR7 Bit Fields */
Kojto 93:e188a91d3eaa 4866 #define TSI_CNTR7_CTN1_MASK 0xFFFFu
Kojto 93:e188a91d3eaa 4867 #define TSI_CNTR7_CTN1_SHIFT 0
Kojto 93:e188a91d3eaa 4868 #define TSI_CNTR7_CTN1(x) (((uint32_t)(((uint32_t)(x))<<TSI_CNTR7_CTN1_SHIFT))&TSI_CNTR7_CTN1_MASK)
Kojto 93:e188a91d3eaa 4869 #define TSI_CNTR7_CTN_MASK 0xFFFF0000u
Kojto 93:e188a91d3eaa 4870 #define TSI_CNTR7_CTN_SHIFT 16
Kojto 93:e188a91d3eaa 4871 #define TSI_CNTR7_CTN(x) (((uint32_t)(((uint32_t)(x))<<TSI_CNTR7_CTN_SHIFT))&TSI_CNTR7_CTN_MASK)
Kojto 93:e188a91d3eaa 4872 /* CNTR9 Bit Fields */
Kojto 93:e188a91d3eaa 4873 #define TSI_CNTR9_CTN1_MASK 0xFFFFu
Kojto 93:e188a91d3eaa 4874 #define TSI_CNTR9_CTN1_SHIFT 0
Kojto 93:e188a91d3eaa 4875 #define TSI_CNTR9_CTN1(x) (((uint32_t)(((uint32_t)(x))<<TSI_CNTR9_CTN1_SHIFT))&TSI_CNTR9_CTN1_MASK)
Kojto 93:e188a91d3eaa 4876 #define TSI_CNTR9_CTN_MASK 0xFFFF0000u
Kojto 93:e188a91d3eaa 4877 #define TSI_CNTR9_CTN_SHIFT 16
Kojto 93:e188a91d3eaa 4878 #define TSI_CNTR9_CTN(x) (((uint32_t)(((uint32_t)(x))<<TSI_CNTR9_CTN_SHIFT))&TSI_CNTR9_CTN_MASK)
Kojto 93:e188a91d3eaa 4879 /* CNTR11 Bit Fields */
Kojto 93:e188a91d3eaa 4880 #define TSI_CNTR11_CTN1_MASK 0xFFFFu
Kojto 93:e188a91d3eaa 4881 #define TSI_CNTR11_CTN1_SHIFT 0
Kojto 93:e188a91d3eaa 4882 #define TSI_CNTR11_CTN1(x) (((uint32_t)(((uint32_t)(x))<<TSI_CNTR11_CTN1_SHIFT))&TSI_CNTR11_CTN1_MASK)
Kojto 93:e188a91d3eaa 4883 #define TSI_CNTR11_CTN_MASK 0xFFFF0000u
Kojto 93:e188a91d3eaa 4884 #define TSI_CNTR11_CTN_SHIFT 16
Kojto 93:e188a91d3eaa 4885 #define TSI_CNTR11_CTN(x) (((uint32_t)(((uint32_t)(x))<<TSI_CNTR11_CTN_SHIFT))&TSI_CNTR11_CTN_MASK)
Kojto 93:e188a91d3eaa 4886 /* CNTR13 Bit Fields */
Kojto 93:e188a91d3eaa 4887 #define TSI_CNTR13_CTN1_MASK 0xFFFFu
Kojto 93:e188a91d3eaa 4888 #define TSI_CNTR13_CTN1_SHIFT 0
Kojto 93:e188a91d3eaa 4889 #define TSI_CNTR13_CTN1(x) (((uint32_t)(((uint32_t)(x))<<TSI_CNTR13_CTN1_SHIFT))&TSI_CNTR13_CTN1_MASK)
Kojto 93:e188a91d3eaa 4890 #define TSI_CNTR13_CTN_MASK 0xFFFF0000u
Kojto 93:e188a91d3eaa 4891 #define TSI_CNTR13_CTN_SHIFT 16
Kojto 93:e188a91d3eaa 4892 #define TSI_CNTR13_CTN(x) (((uint32_t)(((uint32_t)(x))<<TSI_CNTR13_CTN_SHIFT))&TSI_CNTR13_CTN_MASK)
Kojto 93:e188a91d3eaa 4893 /* CNTR15 Bit Fields */
Kojto 93:e188a91d3eaa 4894 #define TSI_CNTR15_CTN1_MASK 0xFFFFu
Kojto 93:e188a91d3eaa 4895 #define TSI_CNTR15_CTN1_SHIFT 0
Kojto 93:e188a91d3eaa 4896 #define TSI_CNTR15_CTN1(x) (((uint32_t)(((uint32_t)(x))<<TSI_CNTR15_CTN1_SHIFT))&TSI_CNTR15_CTN1_MASK)
Kojto 93:e188a91d3eaa 4897 #define TSI_CNTR15_CTN_MASK 0xFFFF0000u
Kojto 93:e188a91d3eaa 4898 #define TSI_CNTR15_CTN_SHIFT 16
Kojto 93:e188a91d3eaa 4899 #define TSI_CNTR15_CTN(x) (((uint32_t)(((uint32_t)(x))<<TSI_CNTR15_CTN_SHIFT))&TSI_CNTR15_CTN_MASK)
Kojto 93:e188a91d3eaa 4900 /* THRESHOLD Bit Fields */
Kojto 93:e188a91d3eaa 4901 #define TSI_THRESHOLD_HTHH_MASK 0xFFFFu
Kojto 93:e188a91d3eaa 4902 #define TSI_THRESHOLD_HTHH_SHIFT 0
Kojto 93:e188a91d3eaa 4903 #define TSI_THRESHOLD_HTHH(x) (((uint32_t)(((uint32_t)(x))<<TSI_THRESHOLD_HTHH_SHIFT))&TSI_THRESHOLD_HTHH_MASK)
Kojto 93:e188a91d3eaa 4904 #define TSI_THRESHOLD_LTHH_MASK 0xFFFF0000u
Kojto 93:e188a91d3eaa 4905 #define TSI_THRESHOLD_LTHH_SHIFT 16
Kojto 93:e188a91d3eaa 4906 #define TSI_THRESHOLD_LTHH(x) (((uint32_t)(((uint32_t)(x))<<TSI_THRESHOLD_LTHH_SHIFT))&TSI_THRESHOLD_LTHH_MASK)
Kojto 93:e188a91d3eaa 4907
Kojto 93:e188a91d3eaa 4908 /**
Kojto 93:e188a91d3eaa 4909 * @}
Kojto 93:e188a91d3eaa 4910 */ /* end of group TSI_Register_Masks */
Kojto 93:e188a91d3eaa 4911
Kojto 93:e188a91d3eaa 4912
Kojto 93:e188a91d3eaa 4913 /* TSI - Peripheral instance base addresses */
Kojto 93:e188a91d3eaa 4914 /** Peripheral TSI0 base address */
Kojto 93:e188a91d3eaa 4915 #define TSI0_BASE (0x40045000u)
Kojto 93:e188a91d3eaa 4916 /** Peripheral TSI0 base pointer */
Kojto 93:e188a91d3eaa 4917 #define TSI0 ((TSI_Type *)TSI0_BASE)
Kojto 93:e188a91d3eaa 4918
Kojto 93:e188a91d3eaa 4919 /**
Kojto 93:e188a91d3eaa 4920 * @}
Kojto 93:e188a91d3eaa 4921 */ /* end of group TSI_Peripheral_Access_Layer */
Kojto 93:e188a91d3eaa 4922
Kojto 93:e188a91d3eaa 4923
Kojto 93:e188a91d3eaa 4924 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 4925 -- UART Peripheral Access Layer
Kojto 93:e188a91d3eaa 4926 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 4927
Kojto 93:e188a91d3eaa 4928 /**
Kojto 93:e188a91d3eaa 4929 * @addtogroup UART_Peripheral_Access_Layer UART Peripheral Access Layer
Kojto 93:e188a91d3eaa 4930 * @{
Kojto 93:e188a91d3eaa 4931 */
Kojto 93:e188a91d3eaa 4932
Kojto 93:e188a91d3eaa 4933 /** UART - Register Layout Typedef */
Kojto 93:e188a91d3eaa 4934 typedef struct {
Kojto 93:e188a91d3eaa 4935 __IO uint8_t BDH; /**< UART Baud Rate Registers:High, offset: 0x0 */
Kojto 93:e188a91d3eaa 4936 __IO uint8_t BDL; /**< UART Baud Rate Registers: Low, offset: 0x1 */
Kojto 93:e188a91d3eaa 4937 __IO uint8_t C1; /**< UART Control Register 1, offset: 0x2 */
Kojto 93:e188a91d3eaa 4938 __IO uint8_t C2; /**< UART Control Register 2, offset: 0x3 */
Kojto 93:e188a91d3eaa 4939 __I uint8_t S1; /**< UART Status Register 1, offset: 0x4 */
Kojto 93:e188a91d3eaa 4940 __IO uint8_t S2; /**< UART Status Register 2, offset: 0x5 */
Kojto 93:e188a91d3eaa 4941 __IO uint8_t C3; /**< UART Control Register 3, offset: 0x6 */
Kojto 93:e188a91d3eaa 4942 __IO uint8_t D; /**< UART Data Register, offset: 0x7 */
Kojto 93:e188a91d3eaa 4943 __IO uint8_t MA1; /**< UART Match Address Registers 1, offset: 0x8 */
Kojto 93:e188a91d3eaa 4944 __IO uint8_t MA2; /**< UART Match Address Registers 2, offset: 0x9 */
Kojto 93:e188a91d3eaa 4945 __IO uint8_t C4; /**< UART Control Register 4, offset: 0xA */
Kojto 93:e188a91d3eaa 4946 __IO uint8_t C5; /**< UART Control Register 5, offset: 0xB */
Kojto 93:e188a91d3eaa 4947 __I uint8_t ED; /**< UART Extended Data Register, offset: 0xC */
Kojto 93:e188a91d3eaa 4948 __IO uint8_t MODEM; /**< UART Modem Register, offset: 0xD */
Kojto 93:e188a91d3eaa 4949 __IO uint8_t IR; /**< UART Infrared Register, offset: 0xE */
Kojto 93:e188a91d3eaa 4950 uint8_t RESERVED_0[1];
Kojto 93:e188a91d3eaa 4951 __IO uint8_t PFIFO; /**< UART FIFO Parameters, offset: 0x10 */
Kojto 93:e188a91d3eaa 4952 __IO uint8_t CFIFO; /**< UART FIFO Control Register, offset: 0x11 */
Kojto 93:e188a91d3eaa 4953 __IO uint8_t SFIFO; /**< UART FIFO Status Register, offset: 0x12 */
Kojto 93:e188a91d3eaa 4954 __IO uint8_t TWFIFO; /**< UART FIFO Transmit Watermark, offset: 0x13 */
Kojto 93:e188a91d3eaa 4955 __I uint8_t TCFIFO; /**< UART FIFO Transmit Count, offset: 0x14 */
Kojto 93:e188a91d3eaa 4956 __IO uint8_t RWFIFO; /**< UART FIFO Receive Watermark, offset: 0x15 */
Kojto 93:e188a91d3eaa 4957 __I uint8_t RCFIFO; /**< UART FIFO Receive Count, offset: 0x16 */
Kojto 93:e188a91d3eaa 4958 uint8_t RESERVED_1[1];
Kojto 93:e188a91d3eaa 4959 __IO uint8_t C7816; /**< UART 7816 Control Register, offset: 0x18 */
Kojto 93:e188a91d3eaa 4960 __IO uint8_t IE7816; /**< UART 7816 Interrupt Enable Register, offset: 0x19 */
Kojto 93:e188a91d3eaa 4961 __IO uint8_t IS7816; /**< UART 7816 Interrupt Status Register, offset: 0x1A */
Kojto 93:e188a91d3eaa 4962 union { /* offset: 0x1B */
Kojto 93:e188a91d3eaa 4963 __IO uint8_t WP7816_T_TYPE0; /**< UART 7816 Wait Parameter Register, offset: 0x1B */
Kojto 93:e188a91d3eaa 4964 __IO uint8_t WP7816_T_TYPE1; /**< UART 7816 Wait Parameter Register, offset: 0x1B */
Kojto 93:e188a91d3eaa 4965 };
Kojto 93:e188a91d3eaa 4966 __IO uint8_t WN7816; /**< UART 7816 Wait N Register, offset: 0x1C */
Kojto 93:e188a91d3eaa 4967 __IO uint8_t WF7816; /**< UART 7816 Wait FD Register, offset: 0x1D */
Kojto 93:e188a91d3eaa 4968 __IO uint8_t ET7816; /**< UART 7816 Error Threshold Register, offset: 0x1E */
Kojto 93:e188a91d3eaa 4969 __IO uint8_t TL7816; /**< UART 7816 Transmit Length Register, offset: 0x1F */
Kojto 93:e188a91d3eaa 4970 uint8_t RESERVED_2[1];
Kojto 93:e188a91d3eaa 4971 __IO uint8_t C6; /**< UART CEA709.1-B Control Register 6, offset: 0x21 */
Kojto 93:e188a91d3eaa 4972 __IO uint8_t PCTH; /**< UART CEA709.1-B Packet Cycle Time Counter High, offset: 0x22 */
Kojto 93:e188a91d3eaa 4973 __IO uint8_t PCTL; /**< UART CEA709.1-B Packet Cycle Time Counter Low, offset: 0x23 */
Kojto 93:e188a91d3eaa 4974 __IO uint8_t B1T; /**< UART CEA709.1-B Beta1 Timer, offset: 0x24 */
Kojto 93:e188a91d3eaa 4975 __IO uint8_t SDTH; /**< UART CEA709.1-B Secondary Delay Timer High, offset: 0x25 */
Kojto 93:e188a91d3eaa 4976 __IO uint8_t SDTL; /**< UART CEA709.1-B Secondary Delay Timer Low, offset: 0x26 */
Kojto 93:e188a91d3eaa 4977 __IO uint8_t PRE; /**< UART CEA709.1-B Preamble, offset: 0x27 */
Kojto 93:e188a91d3eaa 4978 __IO uint8_t TPL; /**< UART CEA709.1-B Transmit Packet Length, offset: 0x28 */
Kojto 93:e188a91d3eaa 4979 __IO uint8_t IE; /**< UART CEA709.1-B Interrupt Enable Register, offset: 0x29 */
Kojto 93:e188a91d3eaa 4980 __IO uint8_t WB; /**< UART CEA709.1-B WBASE, offset: 0x2A */
Kojto 93:e188a91d3eaa 4981 __IO uint8_t S3; /**< UART CEA709.1-B Status Register, offset: 0x2B */
Kojto 93:e188a91d3eaa 4982 __IO uint8_t S4; /**< UART CEA709.1-B Status Register, offset: 0x2C */
Kojto 93:e188a91d3eaa 4983 __I uint8_t RPL; /**< UART CEA709.1-B Received Packet Length, offset: 0x2D */
Kojto 93:e188a91d3eaa 4984 __I uint8_t RPREL; /**< UART CEA709.1-B Received Preamble Length, offset: 0x2E */
Kojto 93:e188a91d3eaa 4985 __IO uint8_t CPW; /**< UART CEA709.1-B Collision Pulse Width, offset: 0x2F */
Kojto 93:e188a91d3eaa 4986 __IO uint8_t RIDT; /**< UART CEA709.1-B Receive Indeterminate Time, offset: 0x30 */
Kojto 93:e188a91d3eaa 4987 __IO uint8_t TIDT; /**< UART CEA709.1-B Transmit Indeterminate Time, offset: 0x31 */
Kojto 93:e188a91d3eaa 4988 } UART_Type;
Kojto 93:e188a91d3eaa 4989
Kojto 93:e188a91d3eaa 4990 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 4991 -- UART Register Masks
Kojto 93:e188a91d3eaa 4992 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 4993
Kojto 93:e188a91d3eaa 4994 /**
Kojto 93:e188a91d3eaa 4995 * @addtogroup UART_Register_Masks UART Register Masks
Kojto 93:e188a91d3eaa 4996 * @{
Kojto 93:e188a91d3eaa 4997 */
Kojto 93:e188a91d3eaa 4998
Kojto 93:e188a91d3eaa 4999 /* BDH Bit Fields */
Kojto 93:e188a91d3eaa 5000 #define UART_BDH_SBR_MASK 0x1Fu
Kojto 93:e188a91d3eaa 5001 #define UART_BDH_SBR_SHIFT 0
Kojto 93:e188a91d3eaa 5002 #define UART_BDH_SBR(x) (((uint8_t)(((uint8_t)(x))<<UART_BDH_SBR_SHIFT))&UART_BDH_SBR_MASK)
Kojto 93:e188a91d3eaa 5003 #define UART_BDH_RXEDGIE_MASK 0x40u
Kojto 93:e188a91d3eaa 5004 #define UART_BDH_RXEDGIE_SHIFT 6
Kojto 93:e188a91d3eaa 5005 #define UART_BDH_LBKDIE_MASK 0x80u
Kojto 93:e188a91d3eaa 5006 #define UART_BDH_LBKDIE_SHIFT 7
Kojto 93:e188a91d3eaa 5007 /* BDL Bit Fields */
Kojto 93:e188a91d3eaa 5008 #define UART_BDL_SBR_MASK 0xFFu
Kojto 93:e188a91d3eaa 5009 #define UART_BDL_SBR_SHIFT 0
Kojto 93:e188a91d3eaa 5010 #define UART_BDL_SBR(x) (((uint8_t)(((uint8_t)(x))<<UART_BDL_SBR_SHIFT))&UART_BDL_SBR_MASK)
Kojto 93:e188a91d3eaa 5011 /* C1 Bit Fields */
Kojto 93:e188a91d3eaa 5012 #define UART_C1_PT_MASK 0x1u
Kojto 93:e188a91d3eaa 5013 #define UART_C1_PT_SHIFT 0
Kojto 93:e188a91d3eaa 5014 #define UART_C1_PE_MASK 0x2u
Kojto 93:e188a91d3eaa 5015 #define UART_C1_PE_SHIFT 1
Kojto 93:e188a91d3eaa 5016 #define UART_C1_ILT_MASK 0x4u
Kojto 93:e188a91d3eaa 5017 #define UART_C1_ILT_SHIFT 2
Kojto 93:e188a91d3eaa 5018 #define UART_C1_WAKE_MASK 0x8u
Kojto 93:e188a91d3eaa 5019 #define UART_C1_WAKE_SHIFT 3
Kojto 93:e188a91d3eaa 5020 #define UART_C1_M_MASK 0x10u
Kojto 93:e188a91d3eaa 5021 #define UART_C1_M_SHIFT 4
Kojto 93:e188a91d3eaa 5022 #define UART_C1_RSRC_MASK 0x20u
Kojto 93:e188a91d3eaa 5023 #define UART_C1_RSRC_SHIFT 5
Kojto 93:e188a91d3eaa 5024 #define UART_C1_UARTSWAI_MASK 0x40u
Kojto 93:e188a91d3eaa 5025 #define UART_C1_UARTSWAI_SHIFT 6
Kojto 93:e188a91d3eaa 5026 #define UART_C1_LOOPS_MASK 0x80u
Kojto 93:e188a91d3eaa 5027 #define UART_C1_LOOPS_SHIFT 7
Kojto 93:e188a91d3eaa 5028 /* C2 Bit Fields */
Kojto 93:e188a91d3eaa 5029 #define UART_C2_SBK_MASK 0x1u
Kojto 93:e188a91d3eaa 5030 #define UART_C2_SBK_SHIFT 0
Kojto 93:e188a91d3eaa 5031 #define UART_C2_RWU_MASK 0x2u
Kojto 93:e188a91d3eaa 5032 #define UART_C2_RWU_SHIFT 1
Kojto 93:e188a91d3eaa 5033 #define UART_C2_RE_MASK 0x4u
Kojto 93:e188a91d3eaa 5034 #define UART_C2_RE_SHIFT 2
Kojto 93:e188a91d3eaa 5035 #define UART_C2_TE_MASK 0x8u
Kojto 93:e188a91d3eaa 5036 #define UART_C2_TE_SHIFT 3
Kojto 93:e188a91d3eaa 5037 #define UART_C2_ILIE_MASK 0x10u
Kojto 93:e188a91d3eaa 5038 #define UART_C2_ILIE_SHIFT 4
Kojto 93:e188a91d3eaa 5039 #define UART_C2_RIE_MASK 0x20u
Kojto 93:e188a91d3eaa 5040 #define UART_C2_RIE_SHIFT 5
Kojto 93:e188a91d3eaa 5041 #define UART_C2_TCIE_MASK 0x40u
Kojto 93:e188a91d3eaa 5042 #define UART_C2_TCIE_SHIFT 6
Kojto 93:e188a91d3eaa 5043 #define UART_C2_TIE_MASK 0x80u
Kojto 93:e188a91d3eaa 5044 #define UART_C2_TIE_SHIFT 7
Kojto 93:e188a91d3eaa 5045 /* S1 Bit Fields */
Kojto 93:e188a91d3eaa 5046 #define UART_S1_PF_MASK 0x1u
Kojto 93:e188a91d3eaa 5047 #define UART_S1_PF_SHIFT 0
Kojto 93:e188a91d3eaa 5048 #define UART_S1_FE_MASK 0x2u
Kojto 93:e188a91d3eaa 5049 #define UART_S1_FE_SHIFT 1
Kojto 93:e188a91d3eaa 5050 #define UART_S1_NF_MASK 0x4u
Kojto 93:e188a91d3eaa 5051 #define UART_S1_NF_SHIFT 2
Kojto 93:e188a91d3eaa 5052 #define UART_S1_OR_MASK 0x8u
Kojto 93:e188a91d3eaa 5053 #define UART_S1_OR_SHIFT 3
Kojto 93:e188a91d3eaa 5054 #define UART_S1_IDLE_MASK 0x10u
Kojto 93:e188a91d3eaa 5055 #define UART_S1_IDLE_SHIFT 4
Kojto 93:e188a91d3eaa 5056 #define UART_S1_RDRF_MASK 0x20u
Kojto 93:e188a91d3eaa 5057 #define UART_S1_RDRF_SHIFT 5
Kojto 93:e188a91d3eaa 5058 #define UART_S1_TC_MASK 0x40u
Kojto 93:e188a91d3eaa 5059 #define UART_S1_TC_SHIFT 6
Kojto 93:e188a91d3eaa 5060 #define UART_S1_TDRE_MASK 0x80u
Kojto 93:e188a91d3eaa 5061 #define UART_S1_TDRE_SHIFT 7
Kojto 93:e188a91d3eaa 5062 /* S2 Bit Fields */
Kojto 93:e188a91d3eaa 5063 #define UART_S2_RAF_MASK 0x1u
Kojto 93:e188a91d3eaa 5064 #define UART_S2_RAF_SHIFT 0
Kojto 93:e188a91d3eaa 5065 #define UART_S2_LBKDE_MASK 0x2u
Kojto 93:e188a91d3eaa 5066 #define UART_S2_LBKDE_SHIFT 1
Kojto 93:e188a91d3eaa 5067 #define UART_S2_BRK13_MASK 0x4u
Kojto 93:e188a91d3eaa 5068 #define UART_S2_BRK13_SHIFT 2
Kojto 93:e188a91d3eaa 5069 #define UART_S2_RWUID_MASK 0x8u
Kojto 93:e188a91d3eaa 5070 #define UART_S2_RWUID_SHIFT 3
Kojto 93:e188a91d3eaa 5071 #define UART_S2_RXINV_MASK 0x10u
Kojto 93:e188a91d3eaa 5072 #define UART_S2_RXINV_SHIFT 4
Kojto 93:e188a91d3eaa 5073 #define UART_S2_MSBF_MASK 0x20u
Kojto 93:e188a91d3eaa 5074 #define UART_S2_MSBF_SHIFT 5
Kojto 93:e188a91d3eaa 5075 #define UART_S2_RXEDGIF_MASK 0x40u
Kojto 93:e188a91d3eaa 5076 #define UART_S2_RXEDGIF_SHIFT 6
Kojto 93:e188a91d3eaa 5077 #define UART_S2_LBKDIF_MASK 0x80u
Kojto 93:e188a91d3eaa 5078 #define UART_S2_LBKDIF_SHIFT 7
Kojto 93:e188a91d3eaa 5079 /* C3 Bit Fields */
Kojto 93:e188a91d3eaa 5080 #define UART_C3_PEIE_MASK 0x1u
Kojto 93:e188a91d3eaa 5081 #define UART_C3_PEIE_SHIFT 0
Kojto 93:e188a91d3eaa 5082 #define UART_C3_FEIE_MASK 0x2u
Kojto 93:e188a91d3eaa 5083 #define UART_C3_FEIE_SHIFT 1
Kojto 93:e188a91d3eaa 5084 #define UART_C3_NEIE_MASK 0x4u
Kojto 93:e188a91d3eaa 5085 #define UART_C3_NEIE_SHIFT 2
Kojto 93:e188a91d3eaa 5086 #define UART_C3_ORIE_MASK 0x8u
Kojto 93:e188a91d3eaa 5087 #define UART_C3_ORIE_SHIFT 3
Kojto 93:e188a91d3eaa 5088 #define UART_C3_TXINV_MASK 0x10u
Kojto 93:e188a91d3eaa 5089 #define UART_C3_TXINV_SHIFT 4
Kojto 93:e188a91d3eaa 5090 #define UART_C3_TXDIR_MASK 0x20u
Kojto 93:e188a91d3eaa 5091 #define UART_C3_TXDIR_SHIFT 5
Kojto 93:e188a91d3eaa 5092 #define UART_C3_T8_MASK 0x40u
Kojto 93:e188a91d3eaa 5093 #define UART_C3_T8_SHIFT 6
Kojto 93:e188a91d3eaa 5094 #define UART_C3_R8_MASK 0x80u
Kojto 93:e188a91d3eaa 5095 #define UART_C3_R8_SHIFT 7
Kojto 93:e188a91d3eaa 5096 /* D Bit Fields */
Kojto 93:e188a91d3eaa 5097 #define UART_D_RT_MASK 0xFFu
Kojto 93:e188a91d3eaa 5098 #define UART_D_RT_SHIFT 0
Kojto 93:e188a91d3eaa 5099 #define UART_D_RT(x) (((uint8_t)(((uint8_t)(x))<<UART_D_RT_SHIFT))&UART_D_RT_MASK)
Kojto 93:e188a91d3eaa 5100 /* MA1 Bit Fields */
Kojto 93:e188a91d3eaa 5101 #define UART_MA1_MA_MASK 0xFFu
Kojto 93:e188a91d3eaa 5102 #define UART_MA1_MA_SHIFT 0
Kojto 93:e188a91d3eaa 5103 #define UART_MA1_MA(x) (((uint8_t)(((uint8_t)(x))<<UART_MA1_MA_SHIFT))&UART_MA1_MA_MASK)
Kojto 93:e188a91d3eaa 5104 /* MA2 Bit Fields */
Kojto 93:e188a91d3eaa 5105 #define UART_MA2_MA_MASK 0xFFu
Kojto 93:e188a91d3eaa 5106 #define UART_MA2_MA_SHIFT 0
Kojto 93:e188a91d3eaa 5107 #define UART_MA2_MA(x) (((uint8_t)(((uint8_t)(x))<<UART_MA2_MA_SHIFT))&UART_MA2_MA_MASK)
Kojto 93:e188a91d3eaa 5108 /* C4 Bit Fields */
Kojto 93:e188a91d3eaa 5109 #define UART_C4_BRFA_MASK 0x1Fu
Kojto 93:e188a91d3eaa 5110 #define UART_C4_BRFA_SHIFT 0
Kojto 93:e188a91d3eaa 5111 #define UART_C4_BRFA(x) (((uint8_t)(((uint8_t)(x))<<UART_C4_BRFA_SHIFT))&UART_C4_BRFA_MASK)
Kojto 93:e188a91d3eaa 5112 #define UART_C4_M10_MASK 0x20u
Kojto 93:e188a91d3eaa 5113 #define UART_C4_M10_SHIFT 5
Kojto 93:e188a91d3eaa 5114 #define UART_C4_MAEN2_MASK 0x40u
Kojto 93:e188a91d3eaa 5115 #define UART_C4_MAEN2_SHIFT 6
Kojto 93:e188a91d3eaa 5116 #define UART_C4_MAEN1_MASK 0x80u
Kojto 93:e188a91d3eaa 5117 #define UART_C4_MAEN1_SHIFT 7
Kojto 93:e188a91d3eaa 5118 /* C5 Bit Fields */
Kojto 93:e188a91d3eaa 5119 #define UART_C5_RDMAS_MASK 0x20u
Kojto 93:e188a91d3eaa 5120 #define UART_C5_RDMAS_SHIFT 5
Kojto 93:e188a91d3eaa 5121 #define UART_C5_TDMAS_MASK 0x80u
Kojto 93:e188a91d3eaa 5122 #define UART_C5_TDMAS_SHIFT 7
Kojto 93:e188a91d3eaa 5123 /* ED Bit Fields */
Kojto 93:e188a91d3eaa 5124 #define UART_ED_PARITYE_MASK 0x40u
Kojto 93:e188a91d3eaa 5125 #define UART_ED_PARITYE_SHIFT 6
Kojto 93:e188a91d3eaa 5126 #define UART_ED_NOISY_MASK 0x80u
Kojto 93:e188a91d3eaa 5127 #define UART_ED_NOISY_SHIFT 7
Kojto 93:e188a91d3eaa 5128 /* MODEM Bit Fields */
Kojto 93:e188a91d3eaa 5129 #define UART_MODEM_TXCTSE_MASK 0x1u
Kojto 93:e188a91d3eaa 5130 #define UART_MODEM_TXCTSE_SHIFT 0
Kojto 93:e188a91d3eaa 5131 #define UART_MODEM_TXRTSE_MASK 0x2u
Kojto 93:e188a91d3eaa 5132 #define UART_MODEM_TXRTSE_SHIFT 1
Kojto 93:e188a91d3eaa 5133 #define UART_MODEM_TXRTSPOL_MASK 0x4u
Kojto 93:e188a91d3eaa 5134 #define UART_MODEM_TXRTSPOL_SHIFT 2
Kojto 93:e188a91d3eaa 5135 #define UART_MODEM_RXRTSE_MASK 0x8u
Kojto 93:e188a91d3eaa 5136 #define UART_MODEM_RXRTSE_SHIFT 3
Kojto 93:e188a91d3eaa 5137 /* IR Bit Fields */
Kojto 93:e188a91d3eaa 5138 #define UART_IR_TNP_MASK 0x3u
Kojto 93:e188a91d3eaa 5139 #define UART_IR_TNP_SHIFT 0
Kojto 93:e188a91d3eaa 5140 #define UART_IR_TNP(x) (((uint8_t)(((uint8_t)(x))<<UART_IR_TNP_SHIFT))&UART_IR_TNP_MASK)
Kojto 93:e188a91d3eaa 5141 #define UART_IR_IREN_MASK 0x4u
Kojto 93:e188a91d3eaa 5142 #define UART_IR_IREN_SHIFT 2
Kojto 93:e188a91d3eaa 5143 /* PFIFO Bit Fields */
Kojto 93:e188a91d3eaa 5144 #define UART_PFIFO_RXFIFOSIZE_MASK 0x7u
Kojto 93:e188a91d3eaa 5145 #define UART_PFIFO_RXFIFOSIZE_SHIFT 0
Kojto 93:e188a91d3eaa 5146 #define UART_PFIFO_RXFIFOSIZE(x) (((uint8_t)(((uint8_t)(x))<<UART_PFIFO_RXFIFOSIZE_SHIFT))&UART_PFIFO_RXFIFOSIZE_MASK)
Kojto 93:e188a91d3eaa 5147 #define UART_PFIFO_RXFE_MASK 0x8u
Kojto 93:e188a91d3eaa 5148 #define UART_PFIFO_RXFE_SHIFT 3
Kojto 93:e188a91d3eaa 5149 #define UART_PFIFO_TXFIFOSIZE_MASK 0x70u
Kojto 93:e188a91d3eaa 5150 #define UART_PFIFO_TXFIFOSIZE_SHIFT 4
Kojto 93:e188a91d3eaa 5151 #define UART_PFIFO_TXFIFOSIZE(x) (((uint8_t)(((uint8_t)(x))<<UART_PFIFO_TXFIFOSIZE_SHIFT))&UART_PFIFO_TXFIFOSIZE_MASK)
Kojto 93:e188a91d3eaa 5152 #define UART_PFIFO_TXFE_MASK 0x80u
Kojto 93:e188a91d3eaa 5153 #define UART_PFIFO_TXFE_SHIFT 7
Kojto 93:e188a91d3eaa 5154 /* CFIFO Bit Fields */
Kojto 93:e188a91d3eaa 5155 #define UART_CFIFO_RXUFE_MASK 0x1u
Kojto 93:e188a91d3eaa 5156 #define UART_CFIFO_RXUFE_SHIFT 0
Kojto 93:e188a91d3eaa 5157 #define UART_CFIFO_TXOFE_MASK 0x2u
Kojto 93:e188a91d3eaa 5158 #define UART_CFIFO_TXOFE_SHIFT 1
Kojto 93:e188a91d3eaa 5159 #define UART_CFIFO_RXFLUSH_MASK 0x40u
Kojto 93:e188a91d3eaa 5160 #define UART_CFIFO_RXFLUSH_SHIFT 6
Kojto 93:e188a91d3eaa 5161 #define UART_CFIFO_TXFLUSH_MASK 0x80u
Kojto 93:e188a91d3eaa 5162 #define UART_CFIFO_TXFLUSH_SHIFT 7
Kojto 93:e188a91d3eaa 5163 /* SFIFO Bit Fields */
Kojto 93:e188a91d3eaa 5164 #define UART_SFIFO_RXUF_MASK 0x1u
Kojto 93:e188a91d3eaa 5165 #define UART_SFIFO_RXUF_SHIFT 0
Kojto 93:e188a91d3eaa 5166 #define UART_SFIFO_TXOF_MASK 0x2u
Kojto 93:e188a91d3eaa 5167 #define UART_SFIFO_TXOF_SHIFT 1
Kojto 93:e188a91d3eaa 5168 #define UART_SFIFO_RXEMPT_MASK 0x40u
Kojto 93:e188a91d3eaa 5169 #define UART_SFIFO_RXEMPT_SHIFT 6
Kojto 93:e188a91d3eaa 5170 #define UART_SFIFO_TXEMPT_MASK 0x80u
Kojto 93:e188a91d3eaa 5171 #define UART_SFIFO_TXEMPT_SHIFT 7
Kojto 93:e188a91d3eaa 5172 /* TWFIFO Bit Fields */
Kojto 93:e188a91d3eaa 5173 #define UART_TWFIFO_TXWATER_MASK 0xFFu
Kojto 93:e188a91d3eaa 5174 #define UART_TWFIFO_TXWATER_SHIFT 0
Kojto 93:e188a91d3eaa 5175 #define UART_TWFIFO_TXWATER(x) (((uint8_t)(((uint8_t)(x))<<UART_TWFIFO_TXWATER_SHIFT))&UART_TWFIFO_TXWATER_MASK)
Kojto 93:e188a91d3eaa 5176 /* TCFIFO Bit Fields */
Kojto 93:e188a91d3eaa 5177 #define UART_TCFIFO_TXCOUNT_MASK 0xFFu
Kojto 93:e188a91d3eaa 5178 #define UART_TCFIFO_TXCOUNT_SHIFT 0
Kojto 93:e188a91d3eaa 5179 #define UART_TCFIFO_TXCOUNT(x) (((uint8_t)(((uint8_t)(x))<<UART_TCFIFO_TXCOUNT_SHIFT))&UART_TCFIFO_TXCOUNT_MASK)
Kojto 93:e188a91d3eaa 5180 /* RWFIFO Bit Fields */
Kojto 93:e188a91d3eaa 5181 #define UART_RWFIFO_RXWATER_MASK 0xFFu
Kojto 93:e188a91d3eaa 5182 #define UART_RWFIFO_RXWATER_SHIFT 0
Kojto 93:e188a91d3eaa 5183 #define UART_RWFIFO_RXWATER(x) (((uint8_t)(((uint8_t)(x))<<UART_RWFIFO_RXWATER_SHIFT))&UART_RWFIFO_RXWATER_MASK)
Kojto 93:e188a91d3eaa 5184 /* RCFIFO Bit Fields */
Kojto 93:e188a91d3eaa 5185 #define UART_RCFIFO_RXCOUNT_MASK 0xFFu
Kojto 93:e188a91d3eaa 5186 #define UART_RCFIFO_RXCOUNT_SHIFT 0
Kojto 93:e188a91d3eaa 5187 #define UART_RCFIFO_RXCOUNT(x) (((uint8_t)(((uint8_t)(x))<<UART_RCFIFO_RXCOUNT_SHIFT))&UART_RCFIFO_RXCOUNT_MASK)
Kojto 93:e188a91d3eaa 5188 /* C7816 Bit Fields */
Kojto 93:e188a91d3eaa 5189 #define UART_C7816_ISO_7816E_MASK 0x1u
Kojto 93:e188a91d3eaa 5190 #define UART_C7816_ISO_7816E_SHIFT 0
Kojto 93:e188a91d3eaa 5191 #define UART_C7816_TTYPE_MASK 0x2u
Kojto 93:e188a91d3eaa 5192 #define UART_C7816_TTYPE_SHIFT 1
Kojto 93:e188a91d3eaa 5193 #define UART_C7816_INIT_MASK 0x4u
Kojto 93:e188a91d3eaa 5194 #define UART_C7816_INIT_SHIFT 2
Kojto 93:e188a91d3eaa 5195 #define UART_C7816_ANACK_MASK 0x8u
Kojto 93:e188a91d3eaa 5196 #define UART_C7816_ANACK_SHIFT 3
Kojto 93:e188a91d3eaa 5197 #define UART_C7816_ONACK_MASK 0x10u
Kojto 93:e188a91d3eaa 5198 #define UART_C7816_ONACK_SHIFT 4
Kojto 93:e188a91d3eaa 5199 /* IE7816 Bit Fields */
Kojto 93:e188a91d3eaa 5200 #define UART_IE7816_RXTE_MASK 0x1u
Kojto 93:e188a91d3eaa 5201 #define UART_IE7816_RXTE_SHIFT 0
Kojto 93:e188a91d3eaa 5202 #define UART_IE7816_TXTE_MASK 0x2u
Kojto 93:e188a91d3eaa 5203 #define UART_IE7816_TXTE_SHIFT 1
Kojto 93:e188a91d3eaa 5204 #define UART_IE7816_GTVE_MASK 0x4u
Kojto 93:e188a91d3eaa 5205 #define UART_IE7816_GTVE_SHIFT 2
Kojto 93:e188a91d3eaa 5206 #define UART_IE7816_INITDE_MASK 0x10u
Kojto 93:e188a91d3eaa 5207 #define UART_IE7816_INITDE_SHIFT 4
Kojto 93:e188a91d3eaa 5208 #define UART_IE7816_BWTE_MASK 0x20u
Kojto 93:e188a91d3eaa 5209 #define UART_IE7816_BWTE_SHIFT 5
Kojto 93:e188a91d3eaa 5210 #define UART_IE7816_CWTE_MASK 0x40u
Kojto 93:e188a91d3eaa 5211 #define UART_IE7816_CWTE_SHIFT 6
Kojto 93:e188a91d3eaa 5212 #define UART_IE7816_WTE_MASK 0x80u
Kojto 93:e188a91d3eaa 5213 #define UART_IE7816_WTE_SHIFT 7
Kojto 93:e188a91d3eaa 5214 /* IS7816 Bit Fields */
Kojto 93:e188a91d3eaa 5215 #define UART_IS7816_RXT_MASK 0x1u
Kojto 93:e188a91d3eaa 5216 #define UART_IS7816_RXT_SHIFT 0
Kojto 93:e188a91d3eaa 5217 #define UART_IS7816_TXT_MASK 0x2u
Kojto 93:e188a91d3eaa 5218 #define UART_IS7816_TXT_SHIFT 1
Kojto 93:e188a91d3eaa 5219 #define UART_IS7816_GTV_MASK 0x4u
Kojto 93:e188a91d3eaa 5220 #define UART_IS7816_GTV_SHIFT 2
Kojto 93:e188a91d3eaa 5221 #define UART_IS7816_INITD_MASK 0x10u
Kojto 93:e188a91d3eaa 5222 #define UART_IS7816_INITD_SHIFT 4
Kojto 93:e188a91d3eaa 5223 #define UART_IS7816_BWT_MASK 0x20u
Kojto 93:e188a91d3eaa 5224 #define UART_IS7816_BWT_SHIFT 5
Kojto 93:e188a91d3eaa 5225 #define UART_IS7816_CWT_MASK 0x40u
Kojto 93:e188a91d3eaa 5226 #define UART_IS7816_CWT_SHIFT 6
Kojto 93:e188a91d3eaa 5227 #define UART_IS7816_WT_MASK 0x80u
Kojto 93:e188a91d3eaa 5228 #define UART_IS7816_WT_SHIFT 7
Kojto 93:e188a91d3eaa 5229 /* WP7816_T_TYPE0 Bit Fields */
Kojto 93:e188a91d3eaa 5230 #define UART_WP7816_T_TYPE0_WI_MASK 0xFFu
Kojto 93:e188a91d3eaa 5231 #define UART_WP7816_T_TYPE0_WI_SHIFT 0
Kojto 93:e188a91d3eaa 5232 #define UART_WP7816_T_TYPE0_WI(x) (((uint8_t)(((uint8_t)(x))<<UART_WP7816_T_TYPE0_WI_SHIFT))&UART_WP7816_T_TYPE0_WI_MASK)
Kojto 93:e188a91d3eaa 5233 /* WP7816_T_TYPE1 Bit Fields */
Kojto 93:e188a91d3eaa 5234 #define UART_WP7816_T_TYPE1_BWI_MASK 0xFu
Kojto 93:e188a91d3eaa 5235 #define UART_WP7816_T_TYPE1_BWI_SHIFT 0
Kojto 93:e188a91d3eaa 5236 #define UART_WP7816_T_TYPE1_BWI(x) (((uint8_t)(((uint8_t)(x))<<UART_WP7816_T_TYPE1_BWI_SHIFT))&UART_WP7816_T_TYPE1_BWI_MASK)
Kojto 93:e188a91d3eaa 5237 #define UART_WP7816_T_TYPE1_CWI_MASK 0xF0u
Kojto 93:e188a91d3eaa 5238 #define UART_WP7816_T_TYPE1_CWI_SHIFT 4
Kojto 93:e188a91d3eaa 5239 #define UART_WP7816_T_TYPE1_CWI(x) (((uint8_t)(((uint8_t)(x))<<UART_WP7816_T_TYPE1_CWI_SHIFT))&UART_WP7816_T_TYPE1_CWI_MASK)
Kojto 93:e188a91d3eaa 5240 /* WN7816 Bit Fields */
Kojto 93:e188a91d3eaa 5241 #define UART_WN7816_GTN_MASK 0xFFu
Kojto 93:e188a91d3eaa 5242 #define UART_WN7816_GTN_SHIFT 0
Kojto 93:e188a91d3eaa 5243 #define UART_WN7816_GTN(x) (((uint8_t)(((uint8_t)(x))<<UART_WN7816_GTN_SHIFT))&UART_WN7816_GTN_MASK)
Kojto 93:e188a91d3eaa 5244 /* WF7816 Bit Fields */
Kojto 93:e188a91d3eaa 5245 #define UART_WF7816_GTFD_MASK 0xFFu
Kojto 93:e188a91d3eaa 5246 #define UART_WF7816_GTFD_SHIFT 0
Kojto 93:e188a91d3eaa 5247 #define UART_WF7816_GTFD(x) (((uint8_t)(((uint8_t)(x))<<UART_WF7816_GTFD_SHIFT))&UART_WF7816_GTFD_MASK)
Kojto 93:e188a91d3eaa 5248 /* ET7816 Bit Fields */
Kojto 93:e188a91d3eaa 5249 #define UART_ET7816_RXTHRESHOLD_MASK 0xFu
Kojto 93:e188a91d3eaa 5250 #define UART_ET7816_RXTHRESHOLD_SHIFT 0
Kojto 93:e188a91d3eaa 5251 #define UART_ET7816_RXTHRESHOLD(x) (((uint8_t)(((uint8_t)(x))<<UART_ET7816_RXTHRESHOLD_SHIFT))&UART_ET7816_RXTHRESHOLD_MASK)
Kojto 93:e188a91d3eaa 5252 #define UART_ET7816_TXTHRESHOLD_MASK 0xF0u
Kojto 93:e188a91d3eaa 5253 #define UART_ET7816_TXTHRESHOLD_SHIFT 4
Kojto 93:e188a91d3eaa 5254 #define UART_ET7816_TXTHRESHOLD(x) (((uint8_t)(((uint8_t)(x))<<UART_ET7816_TXTHRESHOLD_SHIFT))&UART_ET7816_TXTHRESHOLD_MASK)
Kojto 93:e188a91d3eaa 5255 /* TL7816 Bit Fields */
Kojto 93:e188a91d3eaa 5256 #define UART_TL7816_TLEN_MASK 0xFFu
Kojto 93:e188a91d3eaa 5257 #define UART_TL7816_TLEN_SHIFT 0
Kojto 93:e188a91d3eaa 5258 #define UART_TL7816_TLEN(x) (((uint8_t)(((uint8_t)(x))<<UART_TL7816_TLEN_SHIFT))&UART_TL7816_TLEN_MASK)
Kojto 93:e188a91d3eaa 5259 /* C6 Bit Fields */
Kojto 93:e188a91d3eaa 5260 #define UART_C6_CP_MASK 0x10u
Kojto 93:e188a91d3eaa 5261 #define UART_C6_CP_SHIFT 4
Kojto 93:e188a91d3eaa 5262 #define UART_C6_CE_MASK 0x20u
Kojto 93:e188a91d3eaa 5263 #define UART_C6_CE_SHIFT 5
Kojto 93:e188a91d3eaa 5264 #define UART_C6_TX709_MASK 0x40u
Kojto 93:e188a91d3eaa 5265 #define UART_C6_TX709_SHIFT 6
Kojto 93:e188a91d3eaa 5266 #define UART_C6_EN709_MASK 0x80u
Kojto 93:e188a91d3eaa 5267 #define UART_C6_EN709_SHIFT 7
Kojto 93:e188a91d3eaa 5268 /* PCTH Bit Fields */
Kojto 93:e188a91d3eaa 5269 #define UART_PCTH_PCTH_MASK 0xFFu
Kojto 93:e188a91d3eaa 5270 #define UART_PCTH_PCTH_SHIFT 0
Kojto 93:e188a91d3eaa 5271 #define UART_PCTH_PCTH(x) (((uint8_t)(((uint8_t)(x))<<UART_PCTH_PCTH_SHIFT))&UART_PCTH_PCTH_MASK)
Kojto 93:e188a91d3eaa 5272 /* PCTL Bit Fields */
Kojto 93:e188a91d3eaa 5273 #define UART_PCTL_PCTL_MASK 0xFFu
Kojto 93:e188a91d3eaa 5274 #define UART_PCTL_PCTL_SHIFT 0
Kojto 93:e188a91d3eaa 5275 #define UART_PCTL_PCTL(x) (((uint8_t)(((uint8_t)(x))<<UART_PCTL_PCTL_SHIFT))&UART_PCTL_PCTL_MASK)
Kojto 93:e188a91d3eaa 5276 /* B1T Bit Fields */
Kojto 93:e188a91d3eaa 5277 #define UART_B1T_B1T_MASK 0xFFu
Kojto 93:e188a91d3eaa 5278 #define UART_B1T_B1T_SHIFT 0
Kojto 93:e188a91d3eaa 5279 #define UART_B1T_B1T(x) (((uint8_t)(((uint8_t)(x))<<UART_B1T_B1T_SHIFT))&UART_B1T_B1T_MASK)
Kojto 93:e188a91d3eaa 5280 /* SDTH Bit Fields */
Kojto 93:e188a91d3eaa 5281 #define UART_SDTH_SDTH_MASK 0xFFu
Kojto 93:e188a91d3eaa 5282 #define UART_SDTH_SDTH_SHIFT 0
Kojto 93:e188a91d3eaa 5283 #define UART_SDTH_SDTH(x) (((uint8_t)(((uint8_t)(x))<<UART_SDTH_SDTH_SHIFT))&UART_SDTH_SDTH_MASK)
Kojto 93:e188a91d3eaa 5284 /* SDTL Bit Fields */
Kojto 93:e188a91d3eaa 5285 #define UART_SDTL_SDTL_MASK 0xFFu
Kojto 93:e188a91d3eaa 5286 #define UART_SDTL_SDTL_SHIFT 0
Kojto 93:e188a91d3eaa 5287 #define UART_SDTL_SDTL(x) (((uint8_t)(((uint8_t)(x))<<UART_SDTL_SDTL_SHIFT))&UART_SDTL_SDTL_MASK)
Kojto 93:e188a91d3eaa 5288 /* PRE Bit Fields */
Kojto 93:e188a91d3eaa 5289 #define UART_PRE_PREAMBLE_MASK 0xFFu
Kojto 93:e188a91d3eaa 5290 #define UART_PRE_PREAMBLE_SHIFT 0
Kojto 93:e188a91d3eaa 5291 #define UART_PRE_PREAMBLE(x) (((uint8_t)(((uint8_t)(x))<<UART_PRE_PREAMBLE_SHIFT))&UART_PRE_PREAMBLE_MASK)
Kojto 93:e188a91d3eaa 5292 /* TPL Bit Fields */
Kojto 93:e188a91d3eaa 5293 #define UART_TPL_TPL_MASK 0xFFu
Kojto 93:e188a91d3eaa 5294 #define UART_TPL_TPL_SHIFT 0
Kojto 93:e188a91d3eaa 5295 #define UART_TPL_TPL(x) (((uint8_t)(((uint8_t)(x))<<UART_TPL_TPL_SHIFT))&UART_TPL_TPL_MASK)
Kojto 93:e188a91d3eaa 5296 /* IE Bit Fields */
Kojto 93:e188a91d3eaa 5297 #define UART_IE_TXFIE_MASK 0x1u
Kojto 93:e188a91d3eaa 5298 #define UART_IE_TXFIE_SHIFT 0
Kojto 93:e188a91d3eaa 5299 #define UART_IE_PSIE_MASK 0x2u
Kojto 93:e188a91d3eaa 5300 #define UART_IE_PSIE_SHIFT 1
Kojto 93:e188a91d3eaa 5301 #define UART_IE_PCTEIE_MASK 0x4u
Kojto 93:e188a91d3eaa 5302 #define UART_IE_PCTEIE_SHIFT 2
Kojto 93:e188a91d3eaa 5303 #define UART_IE_PTXIE_MASK 0x8u
Kojto 93:e188a91d3eaa 5304 #define UART_IE_PTXIE_SHIFT 3
Kojto 93:e188a91d3eaa 5305 #define UART_IE_PRXIE_MASK 0x10u
Kojto 93:e188a91d3eaa 5306 #define UART_IE_PRXIE_SHIFT 4
Kojto 93:e188a91d3eaa 5307 #define UART_IE_ISDIE_MASK 0x20u
Kojto 93:e188a91d3eaa 5308 #define UART_IE_ISDIE_SHIFT 5
Kojto 93:e188a91d3eaa 5309 #define UART_IE_WBEIE_MASK 0x40u
Kojto 93:e188a91d3eaa 5310 #define UART_IE_WBEIE_SHIFT 6
Kojto 93:e188a91d3eaa 5311 /* WB Bit Fields */
Kojto 93:e188a91d3eaa 5312 #define UART_WB_WBASE_MASK 0xFFu
Kojto 93:e188a91d3eaa 5313 #define UART_WB_WBASE_SHIFT 0
Kojto 93:e188a91d3eaa 5314 #define UART_WB_WBASE(x) (((uint8_t)(((uint8_t)(x))<<UART_WB_WBASE_SHIFT))&UART_WB_WBASE_MASK)
Kojto 93:e188a91d3eaa 5315 /* S3 Bit Fields */
Kojto 93:e188a91d3eaa 5316 #define UART_S3_TXFF_MASK 0x1u
Kojto 93:e188a91d3eaa 5317 #define UART_S3_TXFF_SHIFT 0
Kojto 93:e188a91d3eaa 5318 #define UART_S3_PSF_MASK 0x2u
Kojto 93:e188a91d3eaa 5319 #define UART_S3_PSF_SHIFT 1
Kojto 93:e188a91d3eaa 5320 #define UART_S3_PCTEF_MASK 0x4u
Kojto 93:e188a91d3eaa 5321 #define UART_S3_PCTEF_SHIFT 2
Kojto 93:e188a91d3eaa 5322 #define UART_S3_PTXF_MASK 0x8u
Kojto 93:e188a91d3eaa 5323 #define UART_S3_PTXF_SHIFT 3
Kojto 93:e188a91d3eaa 5324 #define UART_S3_PRXF_MASK 0x10u
Kojto 93:e188a91d3eaa 5325 #define UART_S3_PRXF_SHIFT 4
Kojto 93:e188a91d3eaa 5326 #define UART_S3_ISD_MASK 0x20u
Kojto 93:e188a91d3eaa 5327 #define UART_S3_ISD_SHIFT 5
Kojto 93:e188a91d3eaa 5328 #define UART_S3_WBEF_MASK 0x40u
Kojto 93:e188a91d3eaa 5329 #define UART_S3_WBEF_SHIFT 6
Kojto 93:e188a91d3eaa 5330 #define UART_S3_PEF_MASK 0x80u
Kojto 93:e188a91d3eaa 5331 #define UART_S3_PEF_SHIFT 7
Kojto 93:e188a91d3eaa 5332 /* S4 Bit Fields */
Kojto 93:e188a91d3eaa 5333 #define UART_S4_FE_MASK 0x1u
Kojto 93:e188a91d3eaa 5334 #define UART_S4_FE_SHIFT 0
Kojto 93:e188a91d3eaa 5335 #define UART_S4_ILCV_MASK 0x2u
Kojto 93:e188a91d3eaa 5336 #define UART_S4_ILCV_SHIFT 1
Kojto 93:e188a91d3eaa 5337 #define UART_S4_CDET_MASK 0xCu
Kojto 93:e188a91d3eaa 5338 #define UART_S4_CDET_SHIFT 2
Kojto 93:e188a91d3eaa 5339 #define UART_S4_CDET(x) (((uint8_t)(((uint8_t)(x))<<UART_S4_CDET_SHIFT))&UART_S4_CDET_MASK)
Kojto 93:e188a91d3eaa 5340 #define UART_S4_INITF_MASK 0x10u
Kojto 93:e188a91d3eaa 5341 #define UART_S4_INITF_SHIFT 4
Kojto 93:e188a91d3eaa 5342 /* RPL Bit Fields */
Kojto 93:e188a91d3eaa 5343 #define UART_RPL_RPL_MASK 0xFFu
Kojto 93:e188a91d3eaa 5344 #define UART_RPL_RPL_SHIFT 0
Kojto 93:e188a91d3eaa 5345 #define UART_RPL_RPL(x) (((uint8_t)(((uint8_t)(x))<<UART_RPL_RPL_SHIFT))&UART_RPL_RPL_MASK)
Kojto 93:e188a91d3eaa 5346 /* RPREL Bit Fields */
Kojto 93:e188a91d3eaa 5347 #define UART_RPREL_RPREL_MASK 0xFFu
Kojto 93:e188a91d3eaa 5348 #define UART_RPREL_RPREL_SHIFT 0
Kojto 93:e188a91d3eaa 5349 #define UART_RPREL_RPREL(x) (((uint8_t)(((uint8_t)(x))<<UART_RPREL_RPREL_SHIFT))&UART_RPREL_RPREL_MASK)
Kojto 93:e188a91d3eaa 5350 /* CPW Bit Fields */
Kojto 93:e188a91d3eaa 5351 #define UART_CPW_CPW_MASK 0xFFu
Kojto 93:e188a91d3eaa 5352 #define UART_CPW_CPW_SHIFT 0
Kojto 93:e188a91d3eaa 5353 #define UART_CPW_CPW(x) (((uint8_t)(((uint8_t)(x))<<UART_CPW_CPW_SHIFT))&UART_CPW_CPW_MASK)
Kojto 93:e188a91d3eaa 5354 /* RIDT Bit Fields */
Kojto 93:e188a91d3eaa 5355 #define UART_RIDT_RIDT_MASK 0xFFu
Kojto 93:e188a91d3eaa 5356 #define UART_RIDT_RIDT_SHIFT 0
Kojto 93:e188a91d3eaa 5357 #define UART_RIDT_RIDT(x) (((uint8_t)(((uint8_t)(x))<<UART_RIDT_RIDT_SHIFT))&UART_RIDT_RIDT_MASK)
Kojto 93:e188a91d3eaa 5358 /* TIDT Bit Fields */
Kojto 93:e188a91d3eaa 5359 #define UART_TIDT_TIDT_MASK 0xFFu
Kojto 93:e188a91d3eaa 5360 #define UART_TIDT_TIDT_SHIFT 0
Kojto 93:e188a91d3eaa 5361 #define UART_TIDT_TIDT(x) (((uint8_t)(((uint8_t)(x))<<UART_TIDT_TIDT_SHIFT))&UART_TIDT_TIDT_MASK)
Kojto 93:e188a91d3eaa 5362
Kojto 93:e188a91d3eaa 5363 /**
Kojto 93:e188a91d3eaa 5364 * @}
Kojto 93:e188a91d3eaa 5365 */ /* end of group UART_Register_Masks */
Kojto 93:e188a91d3eaa 5366
Kojto 93:e188a91d3eaa 5367
Kojto 93:e188a91d3eaa 5368 /* UART - Peripheral instance base addresses */
Kojto 93:e188a91d3eaa 5369 /** Peripheral UART0 base address */
Kojto 93:e188a91d3eaa 5370 #define UART0_BASE (0x4006A000u)
Kojto 93:e188a91d3eaa 5371 /** Peripheral UART0 base pointer */
Kojto 93:e188a91d3eaa 5372 #define UART0 ((UART_Type *)UART0_BASE)
Kojto 93:e188a91d3eaa 5373 /** Peripheral UART1 base address */
Kojto 93:e188a91d3eaa 5374 #define UART1_BASE (0x4006B000u)
Kojto 93:e188a91d3eaa 5375 /** Peripheral UART1 base pointer */
Kojto 93:e188a91d3eaa 5376 #define UART1 ((UART_Type *)UART1_BASE)
Kojto 93:e188a91d3eaa 5377 /** Peripheral UART2 base address */
Kojto 93:e188a91d3eaa 5378 #define UART2_BASE (0x4006C000u)
Kojto 93:e188a91d3eaa 5379 /** Peripheral UART2 base pointer */
Kojto 93:e188a91d3eaa 5380 #define UART2 ((UART_Type *)UART2_BASE)
Kojto 93:e188a91d3eaa 5381
Kojto 93:e188a91d3eaa 5382 /**
Kojto 93:e188a91d3eaa 5383 * @}
Kojto 93:e188a91d3eaa 5384 */ /* end of group UART_Peripheral_Access_Layer */
Kojto 93:e188a91d3eaa 5385
Kojto 93:e188a91d3eaa 5386
Kojto 93:e188a91d3eaa 5387 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 5388 -- USB Peripheral Access Layer
Kojto 93:e188a91d3eaa 5389 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 5390
Kojto 93:e188a91d3eaa 5391 /**
Kojto 93:e188a91d3eaa 5392 * @addtogroup USB_Peripheral_Access_Layer USB Peripheral Access Layer
Kojto 93:e188a91d3eaa 5393 * @{
Kojto 93:e188a91d3eaa 5394 */
Kojto 93:e188a91d3eaa 5395
Kojto 93:e188a91d3eaa 5396 /** USB - Register Layout Typedef */
Kojto 93:e188a91d3eaa 5397 typedef struct {
Kojto 93:e188a91d3eaa 5398 __I uint8_t PERID; /**< Peripheral ID Register, offset: 0x0 */
Kojto 93:e188a91d3eaa 5399 uint8_t RESERVED_0[3];
Kojto 93:e188a91d3eaa 5400 __I uint8_t IDCOMP; /**< Peripheral ID Complement Register, offset: 0x4 */
Kojto 93:e188a91d3eaa 5401 uint8_t RESERVED_1[3];
Kojto 93:e188a91d3eaa 5402 __I uint8_t REV; /**< Peripheral Revision Register, offset: 0x8 */
Kojto 93:e188a91d3eaa 5403 uint8_t RESERVED_2[3];
Kojto 93:e188a91d3eaa 5404 __I uint8_t ADDINFO; /**< Peripheral Additional Info Register, offset: 0xC */
Kojto 93:e188a91d3eaa 5405 uint8_t RESERVED_3[3];
Kojto 93:e188a91d3eaa 5406 __IO uint8_t OTGISTAT; /**< OTG Interrupt Status Register, offset: 0x10 */
Kojto 93:e188a91d3eaa 5407 uint8_t RESERVED_4[3];
Kojto 93:e188a91d3eaa 5408 __IO uint8_t OTGICR; /**< OTG Interrupt Control Register, offset: 0x14 */
Kojto 93:e188a91d3eaa 5409 uint8_t RESERVED_5[3];
Kojto 93:e188a91d3eaa 5410 __IO uint8_t OTGSTAT; /**< OTG Status Register, offset: 0x18 */
Kojto 93:e188a91d3eaa 5411 uint8_t RESERVED_6[3];
Kojto 93:e188a91d3eaa 5412 __IO uint8_t OTGCTL; /**< OTG Control Register, offset: 0x1C */
Kojto 93:e188a91d3eaa 5413 uint8_t RESERVED_7[99];
Kojto 93:e188a91d3eaa 5414 __IO uint8_t ISTAT; /**< Interrupt Status Register, offset: 0x80 */
Kojto 93:e188a91d3eaa 5415 uint8_t RESERVED_8[3];
Kojto 93:e188a91d3eaa 5416 __IO uint8_t INTEN; /**< Interrupt Enable Register, offset: 0x84 */
Kojto 93:e188a91d3eaa 5417 uint8_t RESERVED_9[3];
Kojto 93:e188a91d3eaa 5418 __IO uint8_t ERRSTAT; /**< Error Interrupt Status Register, offset: 0x88 */
Kojto 93:e188a91d3eaa 5419 uint8_t RESERVED_10[3];
Kojto 93:e188a91d3eaa 5420 __IO uint8_t ERREN; /**< Error Interrupt Enable Register, offset: 0x8C */
Kojto 93:e188a91d3eaa 5421 uint8_t RESERVED_11[3];
Kojto 93:e188a91d3eaa 5422 __I uint8_t STAT; /**< Status Register, offset: 0x90 */
Kojto 93:e188a91d3eaa 5423 uint8_t RESERVED_12[3];
Kojto 93:e188a91d3eaa 5424 __IO uint8_t CTL; /**< Control Register, offset: 0x94 */
Kojto 93:e188a91d3eaa 5425 uint8_t RESERVED_13[3];
Kojto 93:e188a91d3eaa 5426 __IO uint8_t ADDR; /**< Address Register, offset: 0x98 */
Kojto 93:e188a91d3eaa 5427 uint8_t RESERVED_14[3];
Kojto 93:e188a91d3eaa 5428 __IO uint8_t BDTPAGE1; /**< BDT Page Register 1, offset: 0x9C */
Kojto 93:e188a91d3eaa 5429 uint8_t RESERVED_15[3];
Kojto 93:e188a91d3eaa 5430 __IO uint8_t FRMNUML; /**< Frame Number Register Low, offset: 0xA0 */
Kojto 93:e188a91d3eaa 5431 uint8_t RESERVED_16[3];
Kojto 93:e188a91d3eaa 5432 __IO uint8_t FRMNUMH; /**< Frame Number Register High, offset: 0xA4 */
Kojto 93:e188a91d3eaa 5433 uint8_t RESERVED_17[3];
Kojto 93:e188a91d3eaa 5434 __IO uint8_t TOKEN; /**< Token Register, offset: 0xA8 */
Kojto 93:e188a91d3eaa 5435 uint8_t RESERVED_18[3];
Kojto 93:e188a91d3eaa 5436 __IO uint8_t SOFTHLD; /**< SOF Threshold Register, offset: 0xAC */
Kojto 93:e188a91d3eaa 5437 uint8_t RESERVED_19[3];
Kojto 93:e188a91d3eaa 5438 __IO uint8_t BDTPAGE2; /**< BDT Page Register 2, offset: 0xB0 */
Kojto 93:e188a91d3eaa 5439 uint8_t RESERVED_20[3];
Kojto 93:e188a91d3eaa 5440 __IO uint8_t BDTPAGE3; /**< BDT Page Register 3, offset: 0xB4 */
Kojto 93:e188a91d3eaa 5441 uint8_t RESERVED_21[11];
Kojto 93:e188a91d3eaa 5442 struct { /* offset: 0xC0, array step: 0x4 */
Kojto 93:e188a91d3eaa 5443 __IO uint8_t ENDPT; /**< Endpoint Control Register, array offset: 0xC0, array step: 0x4 */
Kojto 93:e188a91d3eaa 5444 uint8_t RESERVED_0[3];
Kojto 93:e188a91d3eaa 5445 } ENDPOINT[16];
Kojto 93:e188a91d3eaa 5446 __IO uint8_t USBCTRL; /**< USB Control Register, offset: 0x100 */
Kojto 93:e188a91d3eaa 5447 uint8_t RESERVED_22[3];
Kojto 93:e188a91d3eaa 5448 __I uint8_t OBSERVE; /**< USB OTG Observe Register, offset: 0x104 */
Kojto 93:e188a91d3eaa 5449 uint8_t RESERVED_23[3];
Kojto 93:e188a91d3eaa 5450 __IO uint8_t CONTROL; /**< USB OTG Control Register, offset: 0x108 */
Kojto 93:e188a91d3eaa 5451 uint8_t RESERVED_24[3];
Kojto 93:e188a91d3eaa 5452 __IO uint8_t USBTRC0; /**< USB Transceiver Control Register 0, offset: 0x10C */
Kojto 93:e188a91d3eaa 5453 uint8_t RESERVED_25[7];
Kojto 93:e188a91d3eaa 5454 __IO uint8_t USBFRMADJUST; /**< Frame Adjust Register, offset: 0x114 */
Kojto 93:e188a91d3eaa 5455 } USB_Type;
Kojto 93:e188a91d3eaa 5456
Kojto 93:e188a91d3eaa 5457 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 5458 -- USB Register Masks
Kojto 93:e188a91d3eaa 5459 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 5460
Kojto 93:e188a91d3eaa 5461 /**
Kojto 93:e188a91d3eaa 5462 * @addtogroup USB_Register_Masks USB Register Masks
Kojto 93:e188a91d3eaa 5463 * @{
Kojto 93:e188a91d3eaa 5464 */
Kojto 93:e188a91d3eaa 5465
Kojto 93:e188a91d3eaa 5466 /* PERID Bit Fields */
Kojto 93:e188a91d3eaa 5467 #define USB_PERID_ID_MASK 0x3Fu
Kojto 93:e188a91d3eaa 5468 #define USB_PERID_ID_SHIFT 0
Kojto 93:e188a91d3eaa 5469 #define USB_PERID_ID(x) (((uint8_t)(((uint8_t)(x))<<USB_PERID_ID_SHIFT))&USB_PERID_ID_MASK)
Kojto 93:e188a91d3eaa 5470 /* IDCOMP Bit Fields */
Kojto 93:e188a91d3eaa 5471 #define USB_IDCOMP_NID_MASK 0x3Fu
Kojto 93:e188a91d3eaa 5472 #define USB_IDCOMP_NID_SHIFT 0
Kojto 93:e188a91d3eaa 5473 #define USB_IDCOMP_NID(x) (((uint8_t)(((uint8_t)(x))<<USB_IDCOMP_NID_SHIFT))&USB_IDCOMP_NID_MASK)
Kojto 93:e188a91d3eaa 5474 /* REV Bit Fields */
Kojto 93:e188a91d3eaa 5475 #define USB_REV_REV_MASK 0xFFu
Kojto 93:e188a91d3eaa 5476 #define USB_REV_REV_SHIFT 0
Kojto 93:e188a91d3eaa 5477 #define USB_REV_REV(x) (((uint8_t)(((uint8_t)(x))<<USB_REV_REV_SHIFT))&USB_REV_REV_MASK)
Kojto 93:e188a91d3eaa 5478 /* ADDINFO Bit Fields */
Kojto 93:e188a91d3eaa 5479 #define USB_ADDINFO_IEHOST_MASK 0x1u
Kojto 93:e188a91d3eaa 5480 #define USB_ADDINFO_IEHOST_SHIFT 0
Kojto 93:e188a91d3eaa 5481 #define USB_ADDINFO_IRQNUM_MASK 0xF8u
Kojto 93:e188a91d3eaa 5482 #define USB_ADDINFO_IRQNUM_SHIFT 3
Kojto 93:e188a91d3eaa 5483 #define USB_ADDINFO_IRQNUM(x) (((uint8_t)(((uint8_t)(x))<<USB_ADDINFO_IRQNUM_SHIFT))&USB_ADDINFO_IRQNUM_MASK)
Kojto 93:e188a91d3eaa 5484 /* OTGISTAT Bit Fields */
Kojto 93:e188a91d3eaa 5485 #define USB_OTGISTAT_AVBUSCHG_MASK 0x1u
Kojto 93:e188a91d3eaa 5486 #define USB_OTGISTAT_AVBUSCHG_SHIFT 0
Kojto 93:e188a91d3eaa 5487 #define USB_OTGISTAT_B_SESS_CHG_MASK 0x4u
Kojto 93:e188a91d3eaa 5488 #define USB_OTGISTAT_B_SESS_CHG_SHIFT 2
Kojto 93:e188a91d3eaa 5489 #define USB_OTGISTAT_SESSVLDCHG_MASK 0x8u
Kojto 93:e188a91d3eaa 5490 #define USB_OTGISTAT_SESSVLDCHG_SHIFT 3
Kojto 93:e188a91d3eaa 5491 #define USB_OTGISTAT_LINE_STATE_CHG_MASK 0x20u
Kojto 93:e188a91d3eaa 5492 #define USB_OTGISTAT_LINE_STATE_CHG_SHIFT 5
Kojto 93:e188a91d3eaa 5493 #define USB_OTGISTAT_ONEMSEC_MASK 0x40u
Kojto 93:e188a91d3eaa 5494 #define USB_OTGISTAT_ONEMSEC_SHIFT 6
Kojto 93:e188a91d3eaa 5495 #define USB_OTGISTAT_IDCHG_MASK 0x80u
Kojto 93:e188a91d3eaa 5496 #define USB_OTGISTAT_IDCHG_SHIFT 7
Kojto 93:e188a91d3eaa 5497 /* OTGICR Bit Fields */
Kojto 93:e188a91d3eaa 5498 #define USB_OTGICR_AVBUSEN_MASK 0x1u
Kojto 93:e188a91d3eaa 5499 #define USB_OTGICR_AVBUSEN_SHIFT 0
Kojto 93:e188a91d3eaa 5500 #define USB_OTGICR_BSESSEN_MASK 0x4u
Kojto 93:e188a91d3eaa 5501 #define USB_OTGICR_BSESSEN_SHIFT 2
Kojto 93:e188a91d3eaa 5502 #define USB_OTGICR_SESSVLDEN_MASK 0x8u
Kojto 93:e188a91d3eaa 5503 #define USB_OTGICR_SESSVLDEN_SHIFT 3
Kojto 93:e188a91d3eaa 5504 #define USB_OTGICR_LINESTATEEN_MASK 0x20u
Kojto 93:e188a91d3eaa 5505 #define USB_OTGICR_LINESTATEEN_SHIFT 5
Kojto 93:e188a91d3eaa 5506 #define USB_OTGICR_ONEMSECEN_MASK 0x40u
Kojto 93:e188a91d3eaa 5507 #define USB_OTGICR_ONEMSECEN_SHIFT 6
Kojto 93:e188a91d3eaa 5508 #define USB_OTGICR_IDEN_MASK 0x80u
Kojto 93:e188a91d3eaa 5509 #define USB_OTGICR_IDEN_SHIFT 7
Kojto 93:e188a91d3eaa 5510 /* OTGSTAT Bit Fields */
Kojto 93:e188a91d3eaa 5511 #define USB_OTGSTAT_AVBUSVLD_MASK 0x1u
Kojto 93:e188a91d3eaa 5512 #define USB_OTGSTAT_AVBUSVLD_SHIFT 0
Kojto 93:e188a91d3eaa 5513 #define USB_OTGSTAT_BSESSEND_MASK 0x4u
Kojto 93:e188a91d3eaa 5514 #define USB_OTGSTAT_BSESSEND_SHIFT 2
Kojto 93:e188a91d3eaa 5515 #define USB_OTGSTAT_SESS_VLD_MASK 0x8u
Kojto 93:e188a91d3eaa 5516 #define USB_OTGSTAT_SESS_VLD_SHIFT 3
Kojto 93:e188a91d3eaa 5517 #define USB_OTGSTAT_LINESTATESTABLE_MASK 0x20u
Kojto 93:e188a91d3eaa 5518 #define USB_OTGSTAT_LINESTATESTABLE_SHIFT 5
Kojto 93:e188a91d3eaa 5519 #define USB_OTGSTAT_ONEMSECEN_MASK 0x40u
Kojto 93:e188a91d3eaa 5520 #define USB_OTGSTAT_ONEMSECEN_SHIFT 6
Kojto 93:e188a91d3eaa 5521 #define USB_OTGSTAT_ID_MASK 0x80u
Kojto 93:e188a91d3eaa 5522 #define USB_OTGSTAT_ID_SHIFT 7
Kojto 93:e188a91d3eaa 5523 /* OTGCTL Bit Fields */
Kojto 93:e188a91d3eaa 5524 #define USB_OTGCTL_OTGEN_MASK 0x4u
Kojto 93:e188a91d3eaa 5525 #define USB_OTGCTL_OTGEN_SHIFT 2
Kojto 93:e188a91d3eaa 5526 #define USB_OTGCTL_DMLOW_MASK 0x10u
Kojto 93:e188a91d3eaa 5527 #define USB_OTGCTL_DMLOW_SHIFT 4
Kojto 93:e188a91d3eaa 5528 #define USB_OTGCTL_DPLOW_MASK 0x20u
Kojto 93:e188a91d3eaa 5529 #define USB_OTGCTL_DPLOW_SHIFT 5
Kojto 93:e188a91d3eaa 5530 #define USB_OTGCTL_DPHIGH_MASK 0x80u
Kojto 93:e188a91d3eaa 5531 #define USB_OTGCTL_DPHIGH_SHIFT 7
Kojto 93:e188a91d3eaa 5532 /* ISTAT Bit Fields */
Kojto 93:e188a91d3eaa 5533 #define USB_ISTAT_USBRST_MASK 0x1u
Kojto 93:e188a91d3eaa 5534 #define USB_ISTAT_USBRST_SHIFT 0
Kojto 93:e188a91d3eaa 5535 #define USB_ISTAT_ERROR_MASK 0x2u
Kojto 93:e188a91d3eaa 5536 #define USB_ISTAT_ERROR_SHIFT 1
Kojto 93:e188a91d3eaa 5537 #define USB_ISTAT_SOFTOK_MASK 0x4u
Kojto 93:e188a91d3eaa 5538 #define USB_ISTAT_SOFTOK_SHIFT 2
Kojto 93:e188a91d3eaa 5539 #define USB_ISTAT_TOKDNE_MASK 0x8u
Kojto 93:e188a91d3eaa 5540 #define USB_ISTAT_TOKDNE_SHIFT 3
Kojto 93:e188a91d3eaa 5541 #define USB_ISTAT_SLEEP_MASK 0x10u
Kojto 93:e188a91d3eaa 5542 #define USB_ISTAT_SLEEP_SHIFT 4
Kojto 93:e188a91d3eaa 5543 #define USB_ISTAT_RESUME_MASK 0x20u
Kojto 93:e188a91d3eaa 5544 #define USB_ISTAT_RESUME_SHIFT 5
Kojto 93:e188a91d3eaa 5545 #define USB_ISTAT_ATTACH_MASK 0x40u
Kojto 93:e188a91d3eaa 5546 #define USB_ISTAT_ATTACH_SHIFT 6
Kojto 93:e188a91d3eaa 5547 #define USB_ISTAT_STALL_MASK 0x80u
Kojto 93:e188a91d3eaa 5548 #define USB_ISTAT_STALL_SHIFT 7
Kojto 93:e188a91d3eaa 5549 /* INTEN Bit Fields */
Kojto 93:e188a91d3eaa 5550 #define USB_INTEN_USBRSTEN_MASK 0x1u
Kojto 93:e188a91d3eaa 5551 #define USB_INTEN_USBRSTEN_SHIFT 0
Kojto 93:e188a91d3eaa 5552 #define USB_INTEN_ERROREN_MASK 0x2u
Kojto 93:e188a91d3eaa 5553 #define USB_INTEN_ERROREN_SHIFT 1
Kojto 93:e188a91d3eaa 5554 #define USB_INTEN_SOFTOKEN_MASK 0x4u
Kojto 93:e188a91d3eaa 5555 #define USB_INTEN_SOFTOKEN_SHIFT 2
Kojto 93:e188a91d3eaa 5556 #define USB_INTEN_TOKDNEEN_MASK 0x8u
Kojto 93:e188a91d3eaa 5557 #define USB_INTEN_TOKDNEEN_SHIFT 3
Kojto 93:e188a91d3eaa 5558 #define USB_INTEN_SLEEPEN_MASK 0x10u
Kojto 93:e188a91d3eaa 5559 #define USB_INTEN_SLEEPEN_SHIFT 4
Kojto 93:e188a91d3eaa 5560 #define USB_INTEN_RESUMEEN_MASK 0x20u
Kojto 93:e188a91d3eaa 5561 #define USB_INTEN_RESUMEEN_SHIFT 5
Kojto 93:e188a91d3eaa 5562 #define USB_INTEN_ATTACHEN_MASK 0x40u
Kojto 93:e188a91d3eaa 5563 #define USB_INTEN_ATTACHEN_SHIFT 6
Kojto 93:e188a91d3eaa 5564 #define USB_INTEN_STALLEN_MASK 0x80u
Kojto 93:e188a91d3eaa 5565 #define USB_INTEN_STALLEN_SHIFT 7
Kojto 93:e188a91d3eaa 5566 /* ERRSTAT Bit Fields */
Kojto 93:e188a91d3eaa 5567 #define USB_ERRSTAT_PIDERR_MASK 0x1u
Kojto 93:e188a91d3eaa 5568 #define USB_ERRSTAT_PIDERR_SHIFT 0
Kojto 93:e188a91d3eaa 5569 #define USB_ERRSTAT_CRC5EOF_MASK 0x2u
Kojto 93:e188a91d3eaa 5570 #define USB_ERRSTAT_CRC5EOF_SHIFT 1
Kojto 93:e188a91d3eaa 5571 #define USB_ERRSTAT_CRC16_MASK 0x4u
Kojto 93:e188a91d3eaa 5572 #define USB_ERRSTAT_CRC16_SHIFT 2
Kojto 93:e188a91d3eaa 5573 #define USB_ERRSTAT_DFN8_MASK 0x8u
Kojto 93:e188a91d3eaa 5574 #define USB_ERRSTAT_DFN8_SHIFT 3
Kojto 93:e188a91d3eaa 5575 #define USB_ERRSTAT_BTOERR_MASK 0x10u
Kojto 93:e188a91d3eaa 5576 #define USB_ERRSTAT_BTOERR_SHIFT 4
Kojto 93:e188a91d3eaa 5577 #define USB_ERRSTAT_DMAERR_MASK 0x20u
Kojto 93:e188a91d3eaa 5578 #define USB_ERRSTAT_DMAERR_SHIFT 5
Kojto 93:e188a91d3eaa 5579 #define USB_ERRSTAT_BTSERR_MASK 0x80u
Kojto 93:e188a91d3eaa 5580 #define USB_ERRSTAT_BTSERR_SHIFT 7
Kojto 93:e188a91d3eaa 5581 /* ERREN Bit Fields */
Kojto 93:e188a91d3eaa 5582 #define USB_ERREN_PIDERREN_MASK 0x1u
Kojto 93:e188a91d3eaa 5583 #define USB_ERREN_PIDERREN_SHIFT 0
Kojto 93:e188a91d3eaa 5584 #define USB_ERREN_CRC5EOFEN_MASK 0x2u
Kojto 93:e188a91d3eaa 5585 #define USB_ERREN_CRC5EOFEN_SHIFT 1
Kojto 93:e188a91d3eaa 5586 #define USB_ERREN_CRC16EN_MASK 0x4u
Kojto 93:e188a91d3eaa 5587 #define USB_ERREN_CRC16EN_SHIFT 2
Kojto 93:e188a91d3eaa 5588 #define USB_ERREN_DFN8EN_MASK 0x8u
Kojto 93:e188a91d3eaa 5589 #define USB_ERREN_DFN8EN_SHIFT 3
Kojto 93:e188a91d3eaa 5590 #define USB_ERREN_BTOERREN_MASK 0x10u
Kojto 93:e188a91d3eaa 5591 #define USB_ERREN_BTOERREN_SHIFT 4
Kojto 93:e188a91d3eaa 5592 #define USB_ERREN_DMAERREN_MASK 0x20u
Kojto 93:e188a91d3eaa 5593 #define USB_ERREN_DMAERREN_SHIFT 5
Kojto 93:e188a91d3eaa 5594 #define USB_ERREN_BTSERREN_MASK 0x80u
Kojto 93:e188a91d3eaa 5595 #define USB_ERREN_BTSERREN_SHIFT 7
Kojto 93:e188a91d3eaa 5596 /* STAT Bit Fields */
Kojto 93:e188a91d3eaa 5597 #define USB_STAT_ODD_MASK 0x4u
Kojto 93:e188a91d3eaa 5598 #define USB_STAT_ODD_SHIFT 2
Kojto 93:e188a91d3eaa 5599 #define USB_STAT_TX_MASK 0x8u
Kojto 93:e188a91d3eaa 5600 #define USB_STAT_TX_SHIFT 3
Kojto 93:e188a91d3eaa 5601 #define USB_STAT_ENDP_MASK 0xF0u
Kojto 93:e188a91d3eaa 5602 #define USB_STAT_ENDP_SHIFT 4
Kojto 93:e188a91d3eaa 5603 #define USB_STAT_ENDP(x) (((uint8_t)(((uint8_t)(x))<<USB_STAT_ENDP_SHIFT))&USB_STAT_ENDP_MASK)
Kojto 93:e188a91d3eaa 5604 /* CTL Bit Fields */
Kojto 93:e188a91d3eaa 5605 #define USB_CTL_USBENSOFEN_MASK 0x1u
Kojto 93:e188a91d3eaa 5606 #define USB_CTL_USBENSOFEN_SHIFT 0
Kojto 93:e188a91d3eaa 5607 #define USB_CTL_ODDRST_MASK 0x2u
Kojto 93:e188a91d3eaa 5608 #define USB_CTL_ODDRST_SHIFT 1
Kojto 93:e188a91d3eaa 5609 #define USB_CTL_RESUME_MASK 0x4u
Kojto 93:e188a91d3eaa 5610 #define USB_CTL_RESUME_SHIFT 2
Kojto 93:e188a91d3eaa 5611 #define USB_CTL_HOSTMODEEN_MASK 0x8u
Kojto 93:e188a91d3eaa 5612 #define USB_CTL_HOSTMODEEN_SHIFT 3
Kojto 93:e188a91d3eaa 5613 #define USB_CTL_RESET_MASK 0x10u
Kojto 93:e188a91d3eaa 5614 #define USB_CTL_RESET_SHIFT 4
Kojto 93:e188a91d3eaa 5615 #define USB_CTL_TXSUSPENDTOKENBUSY_MASK 0x20u
Kojto 93:e188a91d3eaa 5616 #define USB_CTL_TXSUSPENDTOKENBUSY_SHIFT 5
Kojto 93:e188a91d3eaa 5617 #define USB_CTL_SE0_MASK 0x40u
Kojto 93:e188a91d3eaa 5618 #define USB_CTL_SE0_SHIFT 6
Kojto 93:e188a91d3eaa 5619 #define USB_CTL_JSTATE_MASK 0x80u
Kojto 93:e188a91d3eaa 5620 #define USB_CTL_JSTATE_SHIFT 7
Kojto 93:e188a91d3eaa 5621 /* ADDR Bit Fields */
Kojto 93:e188a91d3eaa 5622 #define USB_ADDR_ADDR_MASK 0x7Fu
Kojto 93:e188a91d3eaa 5623 #define USB_ADDR_ADDR_SHIFT 0
Kojto 93:e188a91d3eaa 5624 #define USB_ADDR_ADDR(x) (((uint8_t)(((uint8_t)(x))<<USB_ADDR_ADDR_SHIFT))&USB_ADDR_ADDR_MASK)
Kojto 93:e188a91d3eaa 5625 #define USB_ADDR_LSEN_MASK 0x80u
Kojto 93:e188a91d3eaa 5626 #define USB_ADDR_LSEN_SHIFT 7
Kojto 93:e188a91d3eaa 5627 /* BDTPAGE1 Bit Fields */
Kojto 93:e188a91d3eaa 5628 #define USB_BDTPAGE1_BDTBA_MASK 0xFEu
Kojto 93:e188a91d3eaa 5629 #define USB_BDTPAGE1_BDTBA_SHIFT 1
Kojto 93:e188a91d3eaa 5630 #define USB_BDTPAGE1_BDTBA(x) (((uint8_t)(((uint8_t)(x))<<USB_BDTPAGE1_BDTBA_SHIFT))&USB_BDTPAGE1_BDTBA_MASK)
Kojto 93:e188a91d3eaa 5631 /* FRMNUML Bit Fields */
Kojto 93:e188a91d3eaa 5632 #define USB_FRMNUML_FRM_MASK 0xFFu
Kojto 93:e188a91d3eaa 5633 #define USB_FRMNUML_FRM_SHIFT 0
Kojto 93:e188a91d3eaa 5634 #define USB_FRMNUML_FRM(x) (((uint8_t)(((uint8_t)(x))<<USB_FRMNUML_FRM_SHIFT))&USB_FRMNUML_FRM_MASK)
Kojto 93:e188a91d3eaa 5635 /* FRMNUMH Bit Fields */
Kojto 93:e188a91d3eaa 5636 #define USB_FRMNUMH_FRM_MASK 0x7u
Kojto 93:e188a91d3eaa 5637 #define USB_FRMNUMH_FRM_SHIFT 0
Kojto 93:e188a91d3eaa 5638 #define USB_FRMNUMH_FRM(x) (((uint8_t)(((uint8_t)(x))<<USB_FRMNUMH_FRM_SHIFT))&USB_FRMNUMH_FRM_MASK)
Kojto 93:e188a91d3eaa 5639 /* TOKEN Bit Fields */
Kojto 93:e188a91d3eaa 5640 #define USB_TOKEN_TOKENENDPT_MASK 0xFu
Kojto 93:e188a91d3eaa 5641 #define USB_TOKEN_TOKENENDPT_SHIFT 0
Kojto 93:e188a91d3eaa 5642 #define USB_TOKEN_TOKENENDPT(x) (((uint8_t)(((uint8_t)(x))<<USB_TOKEN_TOKENENDPT_SHIFT))&USB_TOKEN_TOKENENDPT_MASK)
Kojto 93:e188a91d3eaa 5643 #define USB_TOKEN_TOKENPID_MASK 0xF0u
Kojto 93:e188a91d3eaa 5644 #define USB_TOKEN_TOKENPID_SHIFT 4
Kojto 93:e188a91d3eaa 5645 #define USB_TOKEN_TOKENPID(x) (((uint8_t)(((uint8_t)(x))<<USB_TOKEN_TOKENPID_SHIFT))&USB_TOKEN_TOKENPID_MASK)
Kojto 93:e188a91d3eaa 5646 /* SOFTHLD Bit Fields */
Kojto 93:e188a91d3eaa 5647 #define USB_SOFTHLD_CNT_MASK 0xFFu
Kojto 93:e188a91d3eaa 5648 #define USB_SOFTHLD_CNT_SHIFT 0
Kojto 93:e188a91d3eaa 5649 #define USB_SOFTHLD_CNT(x) (((uint8_t)(((uint8_t)(x))<<USB_SOFTHLD_CNT_SHIFT))&USB_SOFTHLD_CNT_MASK)
Kojto 93:e188a91d3eaa 5650 /* BDTPAGE2 Bit Fields */
Kojto 93:e188a91d3eaa 5651 #define USB_BDTPAGE2_BDTBA_MASK 0xFFu
Kojto 93:e188a91d3eaa 5652 #define USB_BDTPAGE2_BDTBA_SHIFT 0
Kojto 93:e188a91d3eaa 5653 #define USB_BDTPAGE2_BDTBA(x) (((uint8_t)(((uint8_t)(x))<<USB_BDTPAGE2_BDTBA_SHIFT))&USB_BDTPAGE2_BDTBA_MASK)
Kojto 93:e188a91d3eaa 5654 /* BDTPAGE3 Bit Fields */
Kojto 93:e188a91d3eaa 5655 #define USB_BDTPAGE3_BDTBA_MASK 0xFFu
Kojto 93:e188a91d3eaa 5656 #define USB_BDTPAGE3_BDTBA_SHIFT 0
Kojto 93:e188a91d3eaa 5657 #define USB_BDTPAGE3_BDTBA(x) (((uint8_t)(((uint8_t)(x))<<USB_BDTPAGE3_BDTBA_SHIFT))&USB_BDTPAGE3_BDTBA_MASK)
Kojto 93:e188a91d3eaa 5658 /* ENDPT Bit Fields */
Kojto 93:e188a91d3eaa 5659 #define USB_ENDPT_EPHSHK_MASK 0x1u
Kojto 93:e188a91d3eaa 5660 #define USB_ENDPT_EPHSHK_SHIFT 0
Kojto 93:e188a91d3eaa 5661 #define USB_ENDPT_EPSTALL_MASK 0x2u
Kojto 93:e188a91d3eaa 5662 #define USB_ENDPT_EPSTALL_SHIFT 1
Kojto 93:e188a91d3eaa 5663 #define USB_ENDPT_EPTXEN_MASK 0x4u
Kojto 93:e188a91d3eaa 5664 #define USB_ENDPT_EPTXEN_SHIFT 2
Kojto 93:e188a91d3eaa 5665 #define USB_ENDPT_EPRXEN_MASK 0x8u
Kojto 93:e188a91d3eaa 5666 #define USB_ENDPT_EPRXEN_SHIFT 3
Kojto 93:e188a91d3eaa 5667 #define USB_ENDPT_EPCTLDIS_MASK 0x10u
Kojto 93:e188a91d3eaa 5668 #define USB_ENDPT_EPCTLDIS_SHIFT 4
Kojto 93:e188a91d3eaa 5669 #define USB_ENDPT_RETRYDIS_MASK 0x40u
Kojto 93:e188a91d3eaa 5670 #define USB_ENDPT_RETRYDIS_SHIFT 6
Kojto 93:e188a91d3eaa 5671 #define USB_ENDPT_HOSTWOHUB_MASK 0x80u
Kojto 93:e188a91d3eaa 5672 #define USB_ENDPT_HOSTWOHUB_SHIFT 7
Kojto 93:e188a91d3eaa 5673 /* USBCTRL Bit Fields */
Kojto 93:e188a91d3eaa 5674 #define USB_USBCTRL_PDE_MASK 0x40u
Kojto 93:e188a91d3eaa 5675 #define USB_USBCTRL_PDE_SHIFT 6
Kojto 93:e188a91d3eaa 5676 #define USB_USBCTRL_SUSP_MASK 0x80u
Kojto 93:e188a91d3eaa 5677 #define USB_USBCTRL_SUSP_SHIFT 7
Kojto 93:e188a91d3eaa 5678 /* OBSERVE Bit Fields */
Kojto 93:e188a91d3eaa 5679 #define USB_OBSERVE_DMPD_MASK 0x10u
Kojto 93:e188a91d3eaa 5680 #define USB_OBSERVE_DMPD_SHIFT 4
Kojto 93:e188a91d3eaa 5681 #define USB_OBSERVE_DPPD_MASK 0x40u
Kojto 93:e188a91d3eaa 5682 #define USB_OBSERVE_DPPD_SHIFT 6
Kojto 93:e188a91d3eaa 5683 #define USB_OBSERVE_DPPU_MASK 0x80u
Kojto 93:e188a91d3eaa 5684 #define USB_OBSERVE_DPPU_SHIFT 7
Kojto 93:e188a91d3eaa 5685 /* CONTROL Bit Fields */
Kojto 93:e188a91d3eaa 5686 #define USB_CONTROL_DPPULLUPNONOTG_MASK 0x10u
Kojto 93:e188a91d3eaa 5687 #define USB_CONTROL_DPPULLUPNONOTG_SHIFT 4
Kojto 93:e188a91d3eaa 5688 /* USBTRC0 Bit Fields */
Kojto 93:e188a91d3eaa 5689 #define USB_USBTRC0_USB_RESUME_INT_MASK 0x1u
Kojto 93:e188a91d3eaa 5690 #define USB_USBTRC0_USB_RESUME_INT_SHIFT 0
Kojto 93:e188a91d3eaa 5691 #define USB_USBTRC0_SYNC_DET_MASK 0x2u
Kojto 93:e188a91d3eaa 5692 #define USB_USBTRC0_SYNC_DET_SHIFT 1
Kojto 93:e188a91d3eaa 5693 #define USB_USBTRC0_USBRESMEN_MASK 0x20u
Kojto 93:e188a91d3eaa 5694 #define USB_USBTRC0_USBRESMEN_SHIFT 5
Kojto 93:e188a91d3eaa 5695 #define USB_USBTRC0_USBRESET_MASK 0x80u
Kojto 93:e188a91d3eaa 5696 #define USB_USBTRC0_USBRESET_SHIFT 7
Kojto 93:e188a91d3eaa 5697 /* USBFRMADJUST Bit Fields */
Kojto 93:e188a91d3eaa 5698 #define USB_USBFRMADJUST_ADJ_MASK 0xFFu
Kojto 93:e188a91d3eaa 5699 #define USB_USBFRMADJUST_ADJ_SHIFT 0
Kojto 93:e188a91d3eaa 5700 #define USB_USBFRMADJUST_ADJ(x) (((uint8_t)(((uint8_t)(x))<<USB_USBFRMADJUST_ADJ_SHIFT))&USB_USBFRMADJUST_ADJ_MASK)
Kojto 93:e188a91d3eaa 5701
Kojto 93:e188a91d3eaa 5702 /**
Kojto 93:e188a91d3eaa 5703 * @}
Kojto 93:e188a91d3eaa 5704 */ /* end of group USB_Register_Masks */
Kojto 93:e188a91d3eaa 5705
Kojto 93:e188a91d3eaa 5706
Kojto 93:e188a91d3eaa 5707 /* USB - Peripheral instance base addresses */
Kojto 93:e188a91d3eaa 5708 /** Peripheral USB0 base address */
Kojto 93:e188a91d3eaa 5709 #define USB0_BASE (0x40072000u)
Kojto 93:e188a91d3eaa 5710 /** Peripheral USB0 base pointer */
Kojto 93:e188a91d3eaa 5711 #define USB0 ((USB_Type *)USB0_BASE)
Kojto 93:e188a91d3eaa 5712
Kojto 93:e188a91d3eaa 5713 /**
Kojto 93:e188a91d3eaa 5714 * @}
Kojto 93:e188a91d3eaa 5715 */ /* end of group USB_Peripheral_Access_Layer */
Kojto 93:e188a91d3eaa 5716
Kojto 93:e188a91d3eaa 5717
Kojto 93:e188a91d3eaa 5718 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 5719 -- USBDCD Peripheral Access Layer
Kojto 93:e188a91d3eaa 5720 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 5721
Kojto 93:e188a91d3eaa 5722 /**
Kojto 93:e188a91d3eaa 5723 * @addtogroup USBDCD_Peripheral_Access_Layer USBDCD Peripheral Access Layer
Kojto 93:e188a91d3eaa 5724 * @{
Kojto 93:e188a91d3eaa 5725 */
Kojto 93:e188a91d3eaa 5726
Kojto 93:e188a91d3eaa 5727 /** USBDCD - Register Layout Typedef */
Kojto 93:e188a91d3eaa 5728 typedef struct {
Kojto 93:e188a91d3eaa 5729 __IO uint32_t CONTROL; /**< Control Register, offset: 0x0 */
Kojto 93:e188a91d3eaa 5730 __IO uint32_t CLOCK; /**< Clock Register, offset: 0x4 */
Kojto 93:e188a91d3eaa 5731 __I uint32_t STATUS; /**< Status Register, offset: 0x8 */
Kojto 93:e188a91d3eaa 5732 uint8_t RESERVED_0[4];
Kojto 93:e188a91d3eaa 5733 __IO uint32_t TIMER0; /**< TIMER0 Register, offset: 0x10 */
Kojto 93:e188a91d3eaa 5734 __IO uint32_t TIMER1; /**< , offset: 0x14 */
Kojto 93:e188a91d3eaa 5735 __IO uint32_t TIMER2; /**< , offset: 0x18 */
Kojto 93:e188a91d3eaa 5736 } USBDCD_Type;
Kojto 93:e188a91d3eaa 5737
Kojto 93:e188a91d3eaa 5738 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 5739 -- USBDCD Register Masks
Kojto 93:e188a91d3eaa 5740 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 5741
Kojto 93:e188a91d3eaa 5742 /**
Kojto 93:e188a91d3eaa 5743 * @addtogroup USBDCD_Register_Masks USBDCD Register Masks
Kojto 93:e188a91d3eaa 5744 * @{
Kojto 93:e188a91d3eaa 5745 */
Kojto 93:e188a91d3eaa 5746
Kojto 93:e188a91d3eaa 5747 /* CONTROL Bit Fields */
Kojto 93:e188a91d3eaa 5748 #define USBDCD_CONTROL_IACK_MASK 0x1u
Kojto 93:e188a91d3eaa 5749 #define USBDCD_CONTROL_IACK_SHIFT 0
Kojto 93:e188a91d3eaa 5750 #define USBDCD_CONTROL_IF_MASK 0x100u
Kojto 93:e188a91d3eaa 5751 #define USBDCD_CONTROL_IF_SHIFT 8
Kojto 93:e188a91d3eaa 5752 #define USBDCD_CONTROL_IE_MASK 0x10000u
Kojto 93:e188a91d3eaa 5753 #define USBDCD_CONTROL_IE_SHIFT 16
Kojto 93:e188a91d3eaa 5754 #define USBDCD_CONTROL_START_MASK 0x1000000u
Kojto 93:e188a91d3eaa 5755 #define USBDCD_CONTROL_START_SHIFT 24
Kojto 93:e188a91d3eaa 5756 #define USBDCD_CONTROL_SR_MASK 0x2000000u
Kojto 93:e188a91d3eaa 5757 #define USBDCD_CONTROL_SR_SHIFT 25
Kojto 93:e188a91d3eaa 5758 /* CLOCK Bit Fields */
Kojto 93:e188a91d3eaa 5759 #define USBDCD_CLOCK_CLOCK_UNIT_MASK 0x1u
Kojto 93:e188a91d3eaa 5760 #define USBDCD_CLOCK_CLOCK_UNIT_SHIFT 0
Kojto 93:e188a91d3eaa 5761 #define USBDCD_CLOCK_CLOCK_SPEED_MASK 0xFFCu
Kojto 93:e188a91d3eaa 5762 #define USBDCD_CLOCK_CLOCK_SPEED_SHIFT 2
Kojto 93:e188a91d3eaa 5763 #define USBDCD_CLOCK_CLOCK_SPEED(x) (((uint32_t)(((uint32_t)(x))<<USBDCD_CLOCK_CLOCK_SPEED_SHIFT))&USBDCD_CLOCK_CLOCK_SPEED_MASK)
Kojto 93:e188a91d3eaa 5764 /* STATUS Bit Fields */
Kojto 93:e188a91d3eaa 5765 #define USBDCD_STATUS_SEQ_RES_MASK 0x30000u
Kojto 93:e188a91d3eaa 5766 #define USBDCD_STATUS_SEQ_RES_SHIFT 16
Kojto 93:e188a91d3eaa 5767 #define USBDCD_STATUS_SEQ_RES(x) (((uint32_t)(((uint32_t)(x))<<USBDCD_STATUS_SEQ_RES_SHIFT))&USBDCD_STATUS_SEQ_RES_MASK)
Kojto 93:e188a91d3eaa 5768 #define USBDCD_STATUS_SEQ_STAT_MASK 0xC0000u
Kojto 93:e188a91d3eaa 5769 #define USBDCD_STATUS_SEQ_STAT_SHIFT 18
Kojto 93:e188a91d3eaa 5770 #define USBDCD_STATUS_SEQ_STAT(x) (((uint32_t)(((uint32_t)(x))<<USBDCD_STATUS_SEQ_STAT_SHIFT))&USBDCD_STATUS_SEQ_STAT_MASK)
Kojto 93:e188a91d3eaa 5771 #define USBDCD_STATUS_ERR_MASK 0x100000u
Kojto 93:e188a91d3eaa 5772 #define USBDCD_STATUS_ERR_SHIFT 20
Kojto 93:e188a91d3eaa 5773 #define USBDCD_STATUS_TO_MASK 0x200000u
Kojto 93:e188a91d3eaa 5774 #define USBDCD_STATUS_TO_SHIFT 21
Kojto 93:e188a91d3eaa 5775 #define USBDCD_STATUS_ACTIVE_MASK 0x400000u
Kojto 93:e188a91d3eaa 5776 #define USBDCD_STATUS_ACTIVE_SHIFT 22
Kojto 93:e188a91d3eaa 5777 /* TIMER0 Bit Fields */
Kojto 93:e188a91d3eaa 5778 #define USBDCD_TIMER0_TUNITCON_MASK 0xFFFu
Kojto 93:e188a91d3eaa 5779 #define USBDCD_TIMER0_TUNITCON_SHIFT 0
Kojto 93:e188a91d3eaa 5780 #define USBDCD_TIMER0_TUNITCON(x) (((uint32_t)(((uint32_t)(x))<<USBDCD_TIMER0_TUNITCON_SHIFT))&USBDCD_TIMER0_TUNITCON_MASK)
Kojto 93:e188a91d3eaa 5781 #define USBDCD_TIMER0_TSEQ_INIT_MASK 0x3FF0000u
Kojto 93:e188a91d3eaa 5782 #define USBDCD_TIMER0_TSEQ_INIT_SHIFT 16
Kojto 93:e188a91d3eaa 5783 #define USBDCD_TIMER0_TSEQ_INIT(x) (((uint32_t)(((uint32_t)(x))<<USBDCD_TIMER0_TSEQ_INIT_SHIFT))&USBDCD_TIMER0_TSEQ_INIT_MASK)
Kojto 93:e188a91d3eaa 5784 /* TIMER1 Bit Fields */
Kojto 93:e188a91d3eaa 5785 #define USBDCD_TIMER1_TVDPSRC_ON_MASK 0x3FFu
Kojto 93:e188a91d3eaa 5786 #define USBDCD_TIMER1_TVDPSRC_ON_SHIFT 0
Kojto 93:e188a91d3eaa 5787 #define USBDCD_TIMER1_TVDPSRC_ON(x) (((uint32_t)(((uint32_t)(x))<<USBDCD_TIMER1_TVDPSRC_ON_SHIFT))&USBDCD_TIMER1_TVDPSRC_ON_MASK)
Kojto 93:e188a91d3eaa 5788 #define USBDCD_TIMER1_TDCD_DBNC_MASK 0x3FF0000u
Kojto 93:e188a91d3eaa 5789 #define USBDCD_TIMER1_TDCD_DBNC_SHIFT 16
Kojto 93:e188a91d3eaa 5790 #define USBDCD_TIMER1_TDCD_DBNC(x) (((uint32_t)(((uint32_t)(x))<<USBDCD_TIMER1_TDCD_DBNC_SHIFT))&USBDCD_TIMER1_TDCD_DBNC_MASK)
Kojto 93:e188a91d3eaa 5791 /* TIMER2 Bit Fields */
Kojto 93:e188a91d3eaa 5792 #define USBDCD_TIMER2_CHECK_DM_MASK 0xFu
Kojto 93:e188a91d3eaa 5793 #define USBDCD_TIMER2_CHECK_DM_SHIFT 0
Kojto 93:e188a91d3eaa 5794 #define USBDCD_TIMER2_CHECK_DM(x) (((uint32_t)(((uint32_t)(x))<<USBDCD_TIMER2_CHECK_DM_SHIFT))&USBDCD_TIMER2_CHECK_DM_MASK)
Kojto 93:e188a91d3eaa 5795 #define USBDCD_TIMER2_TVDPSRC_CON_MASK 0x3FF0000u
Kojto 93:e188a91d3eaa 5796 #define USBDCD_TIMER2_TVDPSRC_CON_SHIFT 16
Kojto 93:e188a91d3eaa 5797 #define USBDCD_TIMER2_TVDPSRC_CON(x) (((uint32_t)(((uint32_t)(x))<<USBDCD_TIMER2_TVDPSRC_CON_SHIFT))&USBDCD_TIMER2_TVDPSRC_CON_MASK)
Kojto 93:e188a91d3eaa 5798
Kojto 93:e188a91d3eaa 5799 /**
Kojto 93:e188a91d3eaa 5800 * @}
Kojto 93:e188a91d3eaa 5801 */ /* end of group USBDCD_Register_Masks */
Kojto 93:e188a91d3eaa 5802
Kojto 93:e188a91d3eaa 5803
Kojto 93:e188a91d3eaa 5804 /* USBDCD - Peripheral instance base addresses */
Kojto 93:e188a91d3eaa 5805 /** Peripheral USBDCD base address */
Kojto 93:e188a91d3eaa 5806 #define USBDCD_BASE (0x40035000u)
Kojto 93:e188a91d3eaa 5807 /** Peripheral USBDCD base pointer */
Kojto 93:e188a91d3eaa 5808 #define USBDCD ((USBDCD_Type *)USBDCD_BASE)
Kojto 93:e188a91d3eaa 5809
Kojto 93:e188a91d3eaa 5810 /**
Kojto 93:e188a91d3eaa 5811 * @}
Kojto 93:e188a91d3eaa 5812 */ /* end of group USBDCD_Peripheral_Access_Layer */
Kojto 93:e188a91d3eaa 5813
Kojto 93:e188a91d3eaa 5814
Kojto 93:e188a91d3eaa 5815 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 5816 -- VREF Peripheral Access Layer
Kojto 93:e188a91d3eaa 5817 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 5818
Kojto 93:e188a91d3eaa 5819 /**
Kojto 93:e188a91d3eaa 5820 * @addtogroup VREF_Peripheral_Access_Layer VREF Peripheral Access Layer
Kojto 93:e188a91d3eaa 5821 * @{
Kojto 93:e188a91d3eaa 5822 */
Kojto 93:e188a91d3eaa 5823
Kojto 93:e188a91d3eaa 5824 /** VREF - Register Layout Typedef */
Kojto 93:e188a91d3eaa 5825 typedef struct {
Kojto 93:e188a91d3eaa 5826 __IO uint8_t TRM; /**< VREF Trim Register, offset: 0x0 */
Kojto 93:e188a91d3eaa 5827 __IO uint8_t SC; /**< VREF Status and Control Register, offset: 0x1 */
Kojto 93:e188a91d3eaa 5828 } VREF_Type;
Kojto 93:e188a91d3eaa 5829
Kojto 93:e188a91d3eaa 5830 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 5831 -- VREF Register Masks
Kojto 93:e188a91d3eaa 5832 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 5833
Kojto 93:e188a91d3eaa 5834 /**
Kojto 93:e188a91d3eaa 5835 * @addtogroup VREF_Register_Masks VREF Register Masks
Kojto 93:e188a91d3eaa 5836 * @{
Kojto 93:e188a91d3eaa 5837 */
Kojto 93:e188a91d3eaa 5838
Kojto 93:e188a91d3eaa 5839 /* TRM Bit Fields */
Kojto 93:e188a91d3eaa 5840 #define VREF_TRM_TRIM_MASK 0x3Fu
Kojto 93:e188a91d3eaa 5841 #define VREF_TRM_TRIM_SHIFT 0
Kojto 93:e188a91d3eaa 5842 #define VREF_TRM_TRIM(x) (((uint8_t)(((uint8_t)(x))<<VREF_TRM_TRIM_SHIFT))&VREF_TRM_TRIM_MASK)
Kojto 93:e188a91d3eaa 5843 #define VREF_TRM_CHOPEN_MASK 0x40u
Kojto 93:e188a91d3eaa 5844 #define VREF_TRM_CHOPEN_SHIFT 6
Kojto 93:e188a91d3eaa 5845 /* SC Bit Fields */
Kojto 93:e188a91d3eaa 5846 #define VREF_SC_MODE_LV_MASK 0x3u
Kojto 93:e188a91d3eaa 5847 #define VREF_SC_MODE_LV_SHIFT 0
Kojto 93:e188a91d3eaa 5848 #define VREF_SC_MODE_LV(x) (((uint8_t)(((uint8_t)(x))<<VREF_SC_MODE_LV_SHIFT))&VREF_SC_MODE_LV_MASK)
Kojto 93:e188a91d3eaa 5849 #define VREF_SC_VREFST_MASK 0x4u
Kojto 93:e188a91d3eaa 5850 #define VREF_SC_VREFST_SHIFT 2
Kojto 93:e188a91d3eaa 5851 #define VREF_SC_REGEN_MASK 0x40u
Kojto 93:e188a91d3eaa 5852 #define VREF_SC_REGEN_SHIFT 6
Kojto 93:e188a91d3eaa 5853 #define VREF_SC_VREFEN_MASK 0x80u
Kojto 93:e188a91d3eaa 5854 #define VREF_SC_VREFEN_SHIFT 7
Kojto 93:e188a91d3eaa 5855
Kojto 93:e188a91d3eaa 5856 /**
Kojto 93:e188a91d3eaa 5857 * @}
Kojto 93:e188a91d3eaa 5858 */ /* end of group VREF_Register_Masks */
Kojto 93:e188a91d3eaa 5859
Kojto 93:e188a91d3eaa 5860
Kojto 93:e188a91d3eaa 5861 /* VREF - Peripheral instance base addresses */
Kojto 93:e188a91d3eaa 5862 /** Peripheral VREF base address */
Kojto 93:e188a91d3eaa 5863 #define VREF_BASE (0x40074000u)
Kojto 93:e188a91d3eaa 5864 /** Peripheral VREF base pointer */
Kojto 93:e188a91d3eaa 5865 #define VREF ((VREF_Type *)VREF_BASE)
Kojto 93:e188a91d3eaa 5866
Kojto 93:e188a91d3eaa 5867 /**
Kojto 93:e188a91d3eaa 5868 * @}
Kojto 93:e188a91d3eaa 5869 */ /* end of group VREF_Peripheral_Access_Layer */
Kojto 93:e188a91d3eaa 5870
Kojto 93:e188a91d3eaa 5871
Kojto 93:e188a91d3eaa 5872 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 5873 -- WDOG Peripheral Access Layer
Kojto 93:e188a91d3eaa 5874 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 5875
Kojto 93:e188a91d3eaa 5876 /**
Kojto 93:e188a91d3eaa 5877 * @addtogroup WDOG_Peripheral_Access_Layer WDOG Peripheral Access Layer
Kojto 93:e188a91d3eaa 5878 * @{
Kojto 93:e188a91d3eaa 5879 */
Kojto 93:e188a91d3eaa 5880
Kojto 93:e188a91d3eaa 5881 /** WDOG - Register Layout Typedef */
Kojto 93:e188a91d3eaa 5882 typedef struct {
Kojto 93:e188a91d3eaa 5883 __IO uint16_t STCTRLH; /**< Watchdog Status and Control Register High, offset: 0x0 */
Kojto 93:e188a91d3eaa 5884 __IO uint16_t STCTRLL; /**< Watchdog Status and Control Register Low, offset: 0x2 */
Kojto 93:e188a91d3eaa 5885 __IO uint16_t TOVALH; /**< Watchdog Time-out Value Register High, offset: 0x4 */
Kojto 93:e188a91d3eaa 5886 __IO uint16_t TOVALL; /**< Watchdog Time-out Value Register Low, offset: 0x6 */
Kojto 93:e188a91d3eaa 5887 __IO uint16_t WINH; /**< Watchdog Window Register High, offset: 0x8 */
Kojto 93:e188a91d3eaa 5888 __IO uint16_t WINL; /**< Watchdog Window Register Low, offset: 0xA */
Kojto 93:e188a91d3eaa 5889 __IO uint16_t REFRESH; /**< Watchdog Refresh Register, offset: 0xC */
Kojto 93:e188a91d3eaa 5890 __IO uint16_t UNLOCK; /**< Watchdog Unlock Register, offset: 0xE */
Kojto 93:e188a91d3eaa 5891 __IO uint16_t TMROUTH; /**< Watchdog Timer Output Register High, offset: 0x10 */
Kojto 93:e188a91d3eaa 5892 __IO uint16_t TMROUTL; /**< Watchdog Timer Output Register Low, offset: 0x12 */
Kojto 93:e188a91d3eaa 5893 __IO uint16_t RSTCNT; /**< Watchdog Reset Count Register, offset: 0x14 */
Kojto 93:e188a91d3eaa 5894 __IO uint16_t PRESC; /**< Watchdog Prescaler Register, offset: 0x16 */
Kojto 93:e188a91d3eaa 5895 } WDOG_Type;
Kojto 93:e188a91d3eaa 5896
Kojto 93:e188a91d3eaa 5897 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 5898 -- WDOG Register Masks
Kojto 93:e188a91d3eaa 5899 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 5900
Kojto 93:e188a91d3eaa 5901 /**
Kojto 93:e188a91d3eaa 5902 * @addtogroup WDOG_Register_Masks WDOG Register Masks
Kojto 93:e188a91d3eaa 5903 * @{
Kojto 93:e188a91d3eaa 5904 */
Kojto 93:e188a91d3eaa 5905
Kojto 93:e188a91d3eaa 5906 /* STCTRLH Bit Fields */
Kojto 93:e188a91d3eaa 5907 #define WDOG_STCTRLH_WDOGEN_MASK 0x1u
Kojto 93:e188a91d3eaa 5908 #define WDOG_STCTRLH_WDOGEN_SHIFT 0
Kojto 93:e188a91d3eaa 5909 #define WDOG_STCTRLH_CLKSRC_MASK 0x2u
Kojto 93:e188a91d3eaa 5910 #define WDOG_STCTRLH_CLKSRC_SHIFT 1
Kojto 93:e188a91d3eaa 5911 #define WDOG_STCTRLH_IRQRSTEN_MASK 0x4u
Kojto 93:e188a91d3eaa 5912 #define WDOG_STCTRLH_IRQRSTEN_SHIFT 2
Kojto 93:e188a91d3eaa 5913 #define WDOG_STCTRLH_WINEN_MASK 0x8u
Kojto 93:e188a91d3eaa 5914 #define WDOG_STCTRLH_WINEN_SHIFT 3
Kojto 93:e188a91d3eaa 5915 #define WDOG_STCTRLH_ALLOWUPDATE_MASK 0x10u
Kojto 93:e188a91d3eaa 5916 #define WDOG_STCTRLH_ALLOWUPDATE_SHIFT 4
Kojto 93:e188a91d3eaa 5917 #define WDOG_STCTRLH_DBGEN_MASK 0x20u
Kojto 93:e188a91d3eaa 5918 #define WDOG_STCTRLH_DBGEN_SHIFT 5
Kojto 93:e188a91d3eaa 5919 #define WDOG_STCTRLH_STOPEN_MASK 0x40u
Kojto 93:e188a91d3eaa 5920 #define WDOG_STCTRLH_STOPEN_SHIFT 6
Kojto 93:e188a91d3eaa 5921 #define WDOG_STCTRLH_WAITEN_MASK 0x80u
Kojto 93:e188a91d3eaa 5922 #define WDOG_STCTRLH_WAITEN_SHIFT 7
Kojto 93:e188a91d3eaa 5923 #define WDOG_STCTRLH_TESTWDOG_MASK 0x400u
Kojto 93:e188a91d3eaa 5924 #define WDOG_STCTRLH_TESTWDOG_SHIFT 10
Kojto 93:e188a91d3eaa 5925 #define WDOG_STCTRLH_TESTSEL_MASK 0x800u
Kojto 93:e188a91d3eaa 5926 #define WDOG_STCTRLH_TESTSEL_SHIFT 11
Kojto 93:e188a91d3eaa 5927 #define WDOG_STCTRLH_BYTESEL_MASK 0x3000u
Kojto 93:e188a91d3eaa 5928 #define WDOG_STCTRLH_BYTESEL_SHIFT 12
Kojto 93:e188a91d3eaa 5929 #define WDOG_STCTRLH_BYTESEL(x) (((uint16_t)(((uint16_t)(x))<<WDOG_STCTRLH_BYTESEL_SHIFT))&WDOG_STCTRLH_BYTESEL_MASK)
Kojto 93:e188a91d3eaa 5930 #define WDOG_STCTRLH_DISTESTWDOG_MASK 0x4000u
Kojto 93:e188a91d3eaa 5931 #define WDOG_STCTRLH_DISTESTWDOG_SHIFT 14
Kojto 93:e188a91d3eaa 5932 /* STCTRLL Bit Fields */
Kojto 93:e188a91d3eaa 5933 #define WDOG_STCTRLL_INTFLG_MASK 0x8000u
Kojto 93:e188a91d3eaa 5934 #define WDOG_STCTRLL_INTFLG_SHIFT 15
Kojto 93:e188a91d3eaa 5935 /* TOVALH Bit Fields */
Kojto 93:e188a91d3eaa 5936 #define WDOG_TOVALH_TOVALHIGH_MASK 0xFFFFu
Kojto 93:e188a91d3eaa 5937 #define WDOG_TOVALH_TOVALHIGH_SHIFT 0
Kojto 93:e188a91d3eaa 5938 #define WDOG_TOVALH_TOVALHIGH(x) (((uint16_t)(((uint16_t)(x))<<WDOG_TOVALH_TOVALHIGH_SHIFT))&WDOG_TOVALH_TOVALHIGH_MASK)
Kojto 93:e188a91d3eaa 5939 /* TOVALL Bit Fields */
Kojto 93:e188a91d3eaa 5940 #define WDOG_TOVALL_TOVALLOW_MASK 0xFFFFu
Kojto 93:e188a91d3eaa 5941 #define WDOG_TOVALL_TOVALLOW_SHIFT 0
Kojto 93:e188a91d3eaa 5942 #define WDOG_TOVALL_TOVALLOW(x) (((uint16_t)(((uint16_t)(x))<<WDOG_TOVALL_TOVALLOW_SHIFT))&WDOG_TOVALL_TOVALLOW_MASK)
Kojto 93:e188a91d3eaa 5943 /* WINH Bit Fields */
Kojto 93:e188a91d3eaa 5944 #define WDOG_WINH_WINHIGH_MASK 0xFFFFu
Kojto 93:e188a91d3eaa 5945 #define WDOG_WINH_WINHIGH_SHIFT 0
Kojto 93:e188a91d3eaa 5946 #define WDOG_WINH_WINHIGH(x) (((uint16_t)(((uint16_t)(x))<<WDOG_WINH_WINHIGH_SHIFT))&WDOG_WINH_WINHIGH_MASK)
Kojto 93:e188a91d3eaa 5947 /* WINL Bit Fields */
Kojto 93:e188a91d3eaa 5948 #define WDOG_WINL_WINLOW_MASK 0xFFFFu
Kojto 93:e188a91d3eaa 5949 #define WDOG_WINL_WINLOW_SHIFT 0
Kojto 93:e188a91d3eaa 5950 #define WDOG_WINL_WINLOW(x) (((uint16_t)(((uint16_t)(x))<<WDOG_WINL_WINLOW_SHIFT))&WDOG_WINL_WINLOW_MASK)
Kojto 93:e188a91d3eaa 5951 /* REFRESH Bit Fields */
Kojto 93:e188a91d3eaa 5952 #define WDOG_REFRESH_WDOGREFRESH_MASK 0xFFFFu
Kojto 93:e188a91d3eaa 5953 #define WDOG_REFRESH_WDOGREFRESH_SHIFT 0
Kojto 93:e188a91d3eaa 5954 #define WDOG_REFRESH_WDOGREFRESH(x) (((uint16_t)(((uint16_t)(x))<<WDOG_REFRESH_WDOGREFRESH_SHIFT))&WDOG_REFRESH_WDOGREFRESH_MASK)
Kojto 93:e188a91d3eaa 5955 /* UNLOCK Bit Fields */
Kojto 93:e188a91d3eaa 5956 #define WDOG_UNLOCK_WDOGUNLOCK_MASK 0xFFFFu
Kojto 93:e188a91d3eaa 5957 #define WDOG_UNLOCK_WDOGUNLOCK_SHIFT 0
Kojto 93:e188a91d3eaa 5958 #define WDOG_UNLOCK_WDOGUNLOCK(x) (((uint16_t)(((uint16_t)(x))<<WDOG_UNLOCK_WDOGUNLOCK_SHIFT))&WDOG_UNLOCK_WDOGUNLOCK_MASK)
Kojto 93:e188a91d3eaa 5959 /* TMROUTH Bit Fields */
Kojto 93:e188a91d3eaa 5960 #define WDOG_TMROUTH_TIMEROUTHIGH_MASK 0xFFFFu
Kojto 93:e188a91d3eaa 5961 #define WDOG_TMROUTH_TIMEROUTHIGH_SHIFT 0
Kojto 93:e188a91d3eaa 5962 #define WDOG_TMROUTH_TIMEROUTHIGH(x) (((uint16_t)(((uint16_t)(x))<<WDOG_TMROUTH_TIMEROUTHIGH_SHIFT))&WDOG_TMROUTH_TIMEROUTHIGH_MASK)
Kojto 93:e188a91d3eaa 5963 /* TMROUTL Bit Fields */
Kojto 93:e188a91d3eaa 5964 #define WDOG_TMROUTL_TIMEROUTLOW_MASK 0xFFFFu
Kojto 93:e188a91d3eaa 5965 #define WDOG_TMROUTL_TIMEROUTLOW_SHIFT 0
Kojto 93:e188a91d3eaa 5966 #define WDOG_TMROUTL_TIMEROUTLOW(x) (((uint16_t)(((uint16_t)(x))<<WDOG_TMROUTL_TIMEROUTLOW_SHIFT))&WDOG_TMROUTL_TIMEROUTLOW_MASK)
Kojto 93:e188a91d3eaa 5967 /* RSTCNT Bit Fields */
Kojto 93:e188a91d3eaa 5968 #define WDOG_RSTCNT_RSTCNT_MASK 0xFFFFu
Kojto 93:e188a91d3eaa 5969 #define WDOG_RSTCNT_RSTCNT_SHIFT 0
Kojto 93:e188a91d3eaa 5970 #define WDOG_RSTCNT_RSTCNT(x) (((uint16_t)(((uint16_t)(x))<<WDOG_RSTCNT_RSTCNT_SHIFT))&WDOG_RSTCNT_RSTCNT_MASK)
Kojto 93:e188a91d3eaa 5971 /* PRESC Bit Fields */
Kojto 93:e188a91d3eaa 5972 #define WDOG_PRESC_PRESCVAL_MASK 0x700u
Kojto 93:e188a91d3eaa 5973 #define WDOG_PRESC_PRESCVAL_SHIFT 8
Kojto 93:e188a91d3eaa 5974 #define WDOG_PRESC_PRESCVAL(x) (((uint16_t)(((uint16_t)(x))<<WDOG_PRESC_PRESCVAL_SHIFT))&WDOG_PRESC_PRESCVAL_MASK)
Kojto 93:e188a91d3eaa 5975
Kojto 93:e188a91d3eaa 5976 /**
Kojto 93:e188a91d3eaa 5977 * @}
Kojto 93:e188a91d3eaa 5978 */ /* end of group WDOG_Register_Masks */
Kojto 93:e188a91d3eaa 5979
Kojto 93:e188a91d3eaa 5980
Kojto 93:e188a91d3eaa 5981 /* WDOG - Peripheral instance base addresses */
Kojto 93:e188a91d3eaa 5982 /** Peripheral WDOG base address */
Kojto 93:e188a91d3eaa 5983 #define WDOG_BASE (0x40052000u)
Kojto 93:e188a91d3eaa 5984 /** Peripheral WDOG base pointer */
Kojto 93:e188a91d3eaa 5985 #define WDOG ((WDOG_Type *)WDOG_BASE)
Kojto 93:e188a91d3eaa 5986
Kojto 93:e188a91d3eaa 5987 /**
Kojto 93:e188a91d3eaa 5988 * @}
Kojto 93:e188a91d3eaa 5989 */ /* end of group WDOG_Peripheral_Access_Layer */
Kojto 93:e188a91d3eaa 5990
Kojto 93:e188a91d3eaa 5991
Kojto 93:e188a91d3eaa 5992 /*
Kojto 93:e188a91d3eaa 5993 ** End of section using anonymous unions
Kojto 93:e188a91d3eaa 5994 */
Kojto 93:e188a91d3eaa 5995
Kojto 93:e188a91d3eaa 5996 #if defined(__ARMCC_VERSION)
Kojto 93:e188a91d3eaa 5997 #pragma pop
Kojto 93:e188a91d3eaa 5998 #elif defined(__CWCC__)
Kojto 93:e188a91d3eaa 5999 #pragma pop
Kojto 93:e188a91d3eaa 6000 #elif defined(__GNUC__)
Kojto 93:e188a91d3eaa 6001 /* leave anonymous unions enabled */
Kojto 93:e188a91d3eaa 6002 #elif defined(__IAR_SYSTEMS_ICC__)
Kojto 93:e188a91d3eaa 6003 #pragma language=default
Kojto 93:e188a91d3eaa 6004 #else
Kojto 93:e188a91d3eaa 6005 #error Not supported compiler type
Kojto 93:e188a91d3eaa 6006 #endif
Kojto 93:e188a91d3eaa 6007
Kojto 93:e188a91d3eaa 6008 /**
Kojto 93:e188a91d3eaa 6009 * @}
Kojto 93:e188a91d3eaa 6010 */ /* end of group Peripheral_access_layer */
Kojto 93:e188a91d3eaa 6011
Kojto 93:e188a91d3eaa 6012
Kojto 93:e188a91d3eaa 6013 /* ----------------------------------------------------------------------------
Kojto 93:e188a91d3eaa 6014 -- Backward Compatibility
Kojto 93:e188a91d3eaa 6015 ---------------------------------------------------------------------------- */
Kojto 93:e188a91d3eaa 6016
Kojto 93:e188a91d3eaa 6017 /**
Kojto 93:e188a91d3eaa 6018 * @addtogroup Backward_Compatibility_Symbols Backward Compatibility
Kojto 93:e188a91d3eaa 6019 * @{
Kojto 93:e188a91d3eaa 6020 */
Kojto 93:e188a91d3eaa 6021
Kojto 93:e188a91d3eaa 6022 /* No backward compatibility issues. */
Kojto 93:e188a91d3eaa 6023
Kojto 93:e188a91d3eaa 6024 /**
Kojto 93:e188a91d3eaa 6025 * @}
Kojto 93:e188a91d3eaa 6026 */ /* end of group Backward_Compatibility_Symbols */
Kojto 93:e188a91d3eaa 6027
Kojto 93:e188a91d3eaa 6028
Kojto 93:e188a91d3eaa 6029 #endif /* #if !defined(MK20D5_H_) */
Kojto 93:e188a91d3eaa 6030
Kojto 93:e188a91d3eaa 6031 /* MK20D5.h, eof. */
Kojto 93:e188a91d3eaa 6032