li lei
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registers/sx1276Regs-LoRa.h@0:7e14d7c443f1, 2016-10-08 (annotated)
- Committer:
- floatlei
- Date:
- Sat Oct 08 02:35:14 2016 +0000
- Revision:
- 0:7e14d7c443f1
11
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| floatlei | 0:7e14d7c443f1 | 5 | _____) ) ____| | | || |_| ____( (___| | | | |
| floatlei | 0:7e14d7c443f1 | 6 | (______/|_____)_|_|_| \__)_____)\____)_| |_| |
| floatlei | 0:7e14d7c443f1 | 7 | (C) 2014 Semtech |
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| floatlei | 0:7e14d7c443f1 | 9 | Description: SX1276 LoRa modem registers and bits definitions |
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| floatlei | 0:7e14d7c443f1 | 11 | License: Revised BSD License, see LICENSE.TXT file include in the project |
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| floatlei | 0:7e14d7c443f1 | 13 | Maintainer: Miguel Luis and Gregory Cristian |
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| floatlei | 0:7e14d7c443f1 | 15 | #ifndef __SX1276_REGS_LORA_H__ |
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| floatlei | 0:7e14d7c443f1 | 19 | * ============================================================================ |
| floatlei | 0:7e14d7c443f1 | 20 | * SX1276 Internal registers Address |
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| floatlei | 0:7e14d7c443f1 | 23 | #define REG_LR_FIFO 0x00 |
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| floatlei | 0:7e14d7c443f1 | 27 | #define REG_LR_FRFMID 0x07 |
| floatlei | 0:7e14d7c443f1 | 28 | #define REG_LR_FRFLSB 0x08 |
| floatlei | 0:7e14d7c443f1 | 29 | // Tx settings |
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| floatlei | 0:7e14d7c443f1 | 31 | #define REG_LR_PARAMP 0x0A |
| floatlei | 0:7e14d7c443f1 | 32 | #define REG_LR_OCP 0x0B |
| floatlei | 0:7e14d7c443f1 | 33 | // Rx settings |
| floatlei | 0:7e14d7c443f1 | 34 | #define REG_LR_LNA 0x0C |
| floatlei | 0:7e14d7c443f1 | 35 | // LoRa registers |
| floatlei | 0:7e14d7c443f1 | 36 | #define REG_LR_FIFOADDRPTR 0x0D |
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| floatlei | 0:7e14d7c443f1 | 41 | #define REG_LR_IRQFLAGS 0x12 |
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| floatlei | 0:7e14d7c443f1 | 56 | #define REG_LR_PREAMBLELSB 0x21 |
| floatlei | 0:7e14d7c443f1 | 57 | #define REG_LR_PAYLOADLENGTH 0x22 |
| floatlei | 0:7e14d7c443f1 | 58 | #define REG_LR_PAYLOADMAXLENGTH 0x23 |
| floatlei | 0:7e14d7c443f1 | 59 | #define REG_LR_HOPPERIOD 0x24 |
| floatlei | 0:7e14d7c443f1 | 60 | #define REG_LR_FIFORXBYTEADDR 0x25 |
| floatlei | 0:7e14d7c443f1 | 61 | #define REG_LR_MODEMCONFIG3 0x26 |
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| floatlei | 0:7e14d7c443f1 | 66 | #define REG_LR_TEST2F 0x2F |
| floatlei | 0:7e14d7c443f1 | 67 | #define REG_LR_TEST30 0x30 |
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| floatlei | 0:7e14d7c443f1 | 69 | #define REG_LR_INVERTIQ 0x33 |
| floatlei | 0:7e14d7c443f1 | 70 | #define REG_LR_TEST36 0x36 |
| floatlei | 0:7e14d7c443f1 | 71 | #define REG_LR_DETECTIONTHRESHOLD 0x37 |
| floatlei | 0:7e14d7c443f1 | 72 | #define REG_LR_SYNCWORD 0x39 |
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| floatlei | 0:7e14d7c443f1 | 74 | #define REG_LR_INVERTIQ2 0x3B |
| floatlei | 0:7e14d7c443f1 | 75 | |
| floatlei | 0:7e14d7c443f1 | 76 | // end of documented register in datasheet |
| floatlei | 0:7e14d7c443f1 | 77 | // I/O settings |
| floatlei | 0:7e14d7c443f1 | 78 | #define REG_LR_DIOMAPPING1 0x40 |
| floatlei | 0:7e14d7c443f1 | 79 | #define REG_LR_DIOMAPPING2 0x41 |
| floatlei | 0:7e14d7c443f1 | 80 | // Version |
| floatlei | 0:7e14d7c443f1 | 81 | #define REG_LR_VERSION 0x42 |
| floatlei | 0:7e14d7c443f1 | 82 | // Additional settings |
| floatlei | 0:7e14d7c443f1 | 83 | #define REG_LR_PLLHOP 0x44 |
| floatlei | 0:7e14d7c443f1 | 84 | #define REG_LR_TCXO 0x4B |
| floatlei | 0:7e14d7c443f1 | 85 | #define REG_LR_PADAC 0x4D |
| floatlei | 0:7e14d7c443f1 | 86 | #define REG_LR_FORMERTEMP 0x5B |
| floatlei | 0:7e14d7c443f1 | 87 | #define REG_LR_BITRATEFRAC 0x5D |
| floatlei | 0:7e14d7c443f1 | 88 | #define REG_LR_AGCREF 0x61 |
| floatlei | 0:7e14d7c443f1 | 89 | #define REG_LR_AGCTHRESH1 0x62 |
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| floatlei | 0:7e14d7c443f1 | 95 | * ============================================================================ |
| floatlei | 0:7e14d7c443f1 | 96 | * SX1276 LoRa bits control definition |
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| floatlei | 0:7e14d7c443f1 | 101 | * RegFifo |
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| floatlei | 0:7e14d7c443f1 | 113 | #define RFLR_OPMODE_ACCESSSHAREDREG_DISABLE 0x00 // Default |
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| floatlei | 0:7e14d7c443f1 | 115 | #define RFLR_OPMODE_FREQMODE_ACCESS_MASK 0xF7 |
| floatlei | 0:7e14d7c443f1 | 116 | #define RFLR_OPMODE_FREQMODE_ACCESS_LF 0x08 // Default |
| floatlei | 0:7e14d7c443f1 | 117 | #define RFLR_OPMODE_FREQMODE_ACCESS_HF 0x00 |
| floatlei | 0:7e14d7c443f1 | 118 | |
| floatlei | 0:7e14d7c443f1 | 119 | #define RFLR_OPMODE_MASK 0xF8 |
| floatlei | 0:7e14d7c443f1 | 120 | #define RFLR_OPMODE_SLEEP 0x00 |
| floatlei | 0:7e14d7c443f1 | 121 | #define RFLR_OPMODE_STANDBY 0x01 // Default |
| floatlei | 0:7e14d7c443f1 | 122 | #define RFLR_OPMODE_SYNTHESIZER_TX 0x02 |
| floatlei | 0:7e14d7c443f1 | 123 | #define RFLR_OPMODE_TRANSMITTER 0x03 |
| floatlei | 0:7e14d7c443f1 | 124 | #define RFLR_OPMODE_SYNTHESIZER_RX 0x04 |
| floatlei | 0:7e14d7c443f1 | 125 | #define RFLR_OPMODE_RECEIVER 0x05 |
| floatlei | 0:7e14d7c443f1 | 126 | // LoRa specific modes |
| floatlei | 0:7e14d7c443f1 | 127 | #define RFLR_OPMODE_RECEIVER_SINGLE 0x06 |
| floatlei | 0:7e14d7c443f1 | 128 | #define RFLR_OPMODE_CAD 0x07 |
| floatlei | 0:7e14d7c443f1 | 129 | |
| floatlei | 0:7e14d7c443f1 | 130 | /*! |
| floatlei | 0:7e14d7c443f1 | 131 | * RegFrf (MHz) |
| floatlei | 0:7e14d7c443f1 | 132 | */ |
| floatlei | 0:7e14d7c443f1 | 133 | #define RFLR_FRFMSB_434_MHZ 0x6C // Default |
| floatlei | 0:7e14d7c443f1 | 134 | #define RFLR_FRFMID_434_MHZ 0x80 // Default |
| floatlei | 0:7e14d7c443f1 | 135 | #define RFLR_FRFLSB_434_MHZ 0x00 // Default |
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| floatlei | 0:7e14d7c443f1 | 138 | * RegPaConfig |
| floatlei | 0:7e14d7c443f1 | 139 | */ |
| floatlei | 0:7e14d7c443f1 | 140 | #define RFLR_PACONFIG_PASELECT_MASK 0x7F |
| floatlei | 0:7e14d7c443f1 | 141 | #define RFLR_PACONFIG_PASELECT_PABOOST 0x80 |
| floatlei | 0:7e14d7c443f1 | 142 | #define RFLR_PACONFIG_PASELECT_RFO 0x00 // Default |
| floatlei | 0:7e14d7c443f1 | 143 | |
| floatlei | 0:7e14d7c443f1 | 144 | #define RFLR_PACONFIG_MAX_POWER_MASK 0x8F |
| floatlei | 0:7e14d7c443f1 | 145 | |
| floatlei | 0:7e14d7c443f1 | 146 | #define RFLR_PACONFIG_OUTPUTPOWER_MASK 0xF0 |
| floatlei | 0:7e14d7c443f1 | 147 | |
| floatlei | 0:7e14d7c443f1 | 148 | /*! |
| floatlei | 0:7e14d7c443f1 | 149 | * RegPaRamp |
| floatlei | 0:7e14d7c443f1 | 150 | */ |
| floatlei | 0:7e14d7c443f1 | 151 | #define RFLR_PARAMP_TXBANDFORCE_MASK 0xEF |
| floatlei | 0:7e14d7c443f1 | 152 | #define RFLR_PARAMP_TXBANDFORCE_BAND_SEL 0x10 |
| floatlei | 0:7e14d7c443f1 | 153 | #define RFLR_PARAMP_TXBANDFORCE_AUTO 0x00 // Default |
| floatlei | 0:7e14d7c443f1 | 154 | |
| floatlei | 0:7e14d7c443f1 | 155 | #define RFLR_PARAMP_MASK 0xF0 |
| floatlei | 0:7e14d7c443f1 | 156 | #define RFLR_PARAMP_3400_US 0x00 |
| floatlei | 0:7e14d7c443f1 | 157 | #define RFLR_PARAMP_2000_US 0x01 |
| floatlei | 0:7e14d7c443f1 | 158 | #define RFLR_PARAMP_1000_US 0x02 |
| floatlei | 0:7e14d7c443f1 | 159 | #define RFLR_PARAMP_0500_US 0x03 |
| floatlei | 0:7e14d7c443f1 | 160 | #define RFLR_PARAMP_0250_US 0x04 |
| floatlei | 0:7e14d7c443f1 | 161 | #define RFLR_PARAMP_0125_US 0x05 |
| floatlei | 0:7e14d7c443f1 | 162 | #define RFLR_PARAMP_0100_US 0x06 |
| floatlei | 0:7e14d7c443f1 | 163 | #define RFLR_PARAMP_0062_US 0x07 |
| floatlei | 0:7e14d7c443f1 | 164 | #define RFLR_PARAMP_0050_US 0x08 |
| floatlei | 0:7e14d7c443f1 | 165 | #define RFLR_PARAMP_0040_US 0x09 // Default |
| floatlei | 0:7e14d7c443f1 | 166 | #define RFLR_PARAMP_0031_US 0x0A |
| floatlei | 0:7e14d7c443f1 | 167 | #define RFLR_PARAMP_0025_US 0x0B |
| floatlei | 0:7e14d7c443f1 | 168 | #define RFLR_PARAMP_0020_US 0x0C |
| floatlei | 0:7e14d7c443f1 | 169 | #define RFLR_PARAMP_0015_US 0x0D |
| floatlei | 0:7e14d7c443f1 | 170 | #define RFLR_PARAMP_0012_US 0x0E |
| floatlei | 0:7e14d7c443f1 | 171 | #define RFLR_PARAMP_0010_US 0x0F |
| floatlei | 0:7e14d7c443f1 | 172 | |
| floatlei | 0:7e14d7c443f1 | 173 | /*! |
| floatlei | 0:7e14d7c443f1 | 174 | * RegOcp |
| floatlei | 0:7e14d7c443f1 | 175 | */ |
| floatlei | 0:7e14d7c443f1 | 176 | #define RFLR_OCP_MASK 0xDF |
| floatlei | 0:7e14d7c443f1 | 177 | #define RFLR_OCP_ON 0x20 // Default |
| floatlei | 0:7e14d7c443f1 | 178 | #define RFLR_OCP_OFF 0x00 |
| floatlei | 0:7e14d7c443f1 | 179 | |
| floatlei | 0:7e14d7c443f1 | 180 | #define RFLR_OCP_TRIM_MASK 0xE0 |
| floatlei | 0:7e14d7c443f1 | 181 | #define RFLR_OCP_TRIM_045_MA 0x00 |
| floatlei | 0:7e14d7c443f1 | 182 | #define RFLR_OCP_TRIM_050_MA 0x01 |
| floatlei | 0:7e14d7c443f1 | 183 | #define RFLR_OCP_TRIM_055_MA 0x02 |
| floatlei | 0:7e14d7c443f1 | 184 | #define RFLR_OCP_TRIM_060_MA 0x03 |
| floatlei | 0:7e14d7c443f1 | 185 | #define RFLR_OCP_TRIM_065_MA 0x04 |
| floatlei | 0:7e14d7c443f1 | 186 | #define RFLR_OCP_TRIM_070_MA 0x05 |
| floatlei | 0:7e14d7c443f1 | 187 | #define RFLR_OCP_TRIM_075_MA 0x06 |
| floatlei | 0:7e14d7c443f1 | 188 | #define RFLR_OCP_TRIM_080_MA 0x07 |
| floatlei | 0:7e14d7c443f1 | 189 | #define RFLR_OCP_TRIM_085_MA 0x08 |
| floatlei | 0:7e14d7c443f1 | 190 | #define RFLR_OCP_TRIM_090_MA 0x09 |
| floatlei | 0:7e14d7c443f1 | 191 | #define RFLR_OCP_TRIM_095_MA 0x0A |
| floatlei | 0:7e14d7c443f1 | 192 | #define RFLR_OCP_TRIM_100_MA 0x0B // Default |
| floatlei | 0:7e14d7c443f1 | 193 | #define RFLR_OCP_TRIM_105_MA 0x0C |
| floatlei | 0:7e14d7c443f1 | 194 | #define RFLR_OCP_TRIM_110_MA 0x0D |
| floatlei | 0:7e14d7c443f1 | 195 | #define RFLR_OCP_TRIM_115_MA 0x0E |
| floatlei | 0:7e14d7c443f1 | 196 | #define RFLR_OCP_TRIM_120_MA 0x0F |
| floatlei | 0:7e14d7c443f1 | 197 | #define RFLR_OCP_TRIM_130_MA 0x10 |
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| floatlei | 0:7e14d7c443f1 | 199 | #define RFLR_OCP_TRIM_150_MA 0x12 |
| floatlei | 0:7e14d7c443f1 | 200 | #define RFLR_OCP_TRIM_160_MA 0x13 |
| floatlei | 0:7e14d7c443f1 | 201 | #define RFLR_OCP_TRIM_170_MA 0x14 |
| floatlei | 0:7e14d7c443f1 | 202 | #define RFLR_OCP_TRIM_180_MA 0x15 |
| floatlei | 0:7e14d7c443f1 | 203 | #define RFLR_OCP_TRIM_190_MA 0x16 |
| floatlei | 0:7e14d7c443f1 | 204 | #define RFLR_OCP_TRIM_200_MA 0x17 |
| floatlei | 0:7e14d7c443f1 | 205 | #define RFLR_OCP_TRIM_210_MA 0x18 |
| floatlei | 0:7e14d7c443f1 | 206 | #define RFLR_OCP_TRIM_220_MA 0x19 |
| floatlei | 0:7e14d7c443f1 | 207 | #define RFLR_OCP_TRIM_230_MA 0x1A |
| floatlei | 0:7e14d7c443f1 | 208 | #define RFLR_OCP_TRIM_240_MA 0x1B |
| floatlei | 0:7e14d7c443f1 | 209 | |
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| floatlei | 0:7e14d7c443f1 | 211 | * RegLna |
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| floatlei | 0:7e14d7c443f1 | 213 | #define RFLR_LNA_GAIN_MASK 0x1F |
| floatlei | 0:7e14d7c443f1 | 214 | #define RFLR_LNA_GAIN_G1 0x20 // Default |
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| floatlei | 0:7e14d7c443f1 | 220 | |
| floatlei | 0:7e14d7c443f1 | 221 | #define RFLR_LNA_BOOST_LF_MASK 0xE7 |
| floatlei | 0:7e14d7c443f1 | 222 | #define RFLR_LNA_BOOST_LF_DEFAULT 0x00 // Default |
| floatlei | 0:7e14d7c443f1 | 223 | |
| floatlei | 0:7e14d7c443f1 | 224 | #define RFLR_LNA_BOOST_HF_MASK 0xFC |
| floatlei | 0:7e14d7c443f1 | 225 | #define RFLR_LNA_BOOST_HF_OFF 0x00 // Default |
| floatlei | 0:7e14d7c443f1 | 226 | #define RFLR_LNA_BOOST_HF_ON 0x03 |
| floatlei | 0:7e14d7c443f1 | 227 | |
| floatlei | 0:7e14d7c443f1 | 228 | /*! |
| floatlei | 0:7e14d7c443f1 | 229 | * RegFifoAddrPtr |
| floatlei | 0:7e14d7c443f1 | 230 | */ |
| floatlei | 0:7e14d7c443f1 | 231 | #define RFLR_FIFOADDRPTR 0x00 // Default |
| floatlei | 0:7e14d7c443f1 | 232 | |
| floatlei | 0:7e14d7c443f1 | 233 | /*! |
| floatlei | 0:7e14d7c443f1 | 234 | * RegFifoTxBaseAddr |
| floatlei | 0:7e14d7c443f1 | 235 | */ |
| floatlei | 0:7e14d7c443f1 | 236 | #define RFLR_FIFOTXBASEADDR 0x80 // Default |
| floatlei | 0:7e14d7c443f1 | 237 | |
| floatlei | 0:7e14d7c443f1 | 238 | /*! |
| floatlei | 0:7e14d7c443f1 | 239 | * RegFifoTxBaseAddr |
| floatlei | 0:7e14d7c443f1 | 240 | */ |
| floatlei | 0:7e14d7c443f1 | 241 | #define RFLR_FIFORXBASEADDR 0x00 // Default |
| floatlei | 0:7e14d7c443f1 | 242 | |
| floatlei | 0:7e14d7c443f1 | 243 | /*! |
| floatlei | 0:7e14d7c443f1 | 244 | * RegFifoRxCurrentAddr (Read Only) |
| floatlei | 0:7e14d7c443f1 | 245 | */ |
| floatlei | 0:7e14d7c443f1 | 246 | |
| floatlei | 0:7e14d7c443f1 | 247 | /*! |
| floatlei | 0:7e14d7c443f1 | 248 | * RegIrqFlagsMask |
| floatlei | 0:7e14d7c443f1 | 249 | */ |
| floatlei | 0:7e14d7c443f1 | 250 | #define RFLR_IRQFLAGS_RXTIMEOUT_MASK 0x80 |
| floatlei | 0:7e14d7c443f1 | 251 | #define RFLR_IRQFLAGS_RXDONE_MASK 0x40 |
| floatlei | 0:7e14d7c443f1 | 252 | #define RFLR_IRQFLAGS_PAYLOADCRCERROR_MASK 0x20 |
| floatlei | 0:7e14d7c443f1 | 253 | #define RFLR_IRQFLAGS_VALIDHEADER_MASK 0x10 |
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| floatlei | 0:7e14d7c443f1 | 255 | #define RFLR_IRQFLAGS_CADDONE_MASK 0x04 |
| floatlei | 0:7e14d7c443f1 | 256 | #define RFLR_IRQFLAGS_FHSSCHANGEDCHANNEL_MASK 0x02 |
| floatlei | 0:7e14d7c443f1 | 257 | #define RFLR_IRQFLAGS_CADDETECTED_MASK 0x01 |
| floatlei | 0:7e14d7c443f1 | 258 | |
| floatlei | 0:7e14d7c443f1 | 259 | /*! |
| floatlei | 0:7e14d7c443f1 | 260 | * RegIrqFlags |
| floatlei | 0:7e14d7c443f1 | 261 | */ |
| floatlei | 0:7e14d7c443f1 | 262 | #define RFLR_IRQFLAGS_RXTIMEOUT 0x80 |
| floatlei | 0:7e14d7c443f1 | 263 | #define RFLR_IRQFLAGS_RXDONE 0x40 |
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| floatlei | 0:7e14d7c443f1 | 265 | #define RFLR_IRQFLAGS_VALIDHEADER 0x10 |
| floatlei | 0:7e14d7c443f1 | 266 | #define RFLR_IRQFLAGS_TXDONE 0x08 |
| floatlei | 0:7e14d7c443f1 | 267 | #define RFLR_IRQFLAGS_CADDONE 0x04 |
| floatlei | 0:7e14d7c443f1 | 268 | #define RFLR_IRQFLAGS_FHSSCHANGEDCHANNEL 0x02 |
| floatlei | 0:7e14d7c443f1 | 269 | #define RFLR_IRQFLAGS_CADDETECTED 0x01 |
| floatlei | 0:7e14d7c443f1 | 270 | |
| floatlei | 0:7e14d7c443f1 | 271 | /*! |
| floatlei | 0:7e14d7c443f1 | 272 | * RegFifoRxNbBytes (Read Only) |
| floatlei | 0:7e14d7c443f1 | 273 | */ |
| floatlei | 0:7e14d7c443f1 | 274 | |
| floatlei | 0:7e14d7c443f1 | 275 | /*! |
| floatlei | 0:7e14d7c443f1 | 276 | * RegRxHeaderCntValueMsb (Read Only) |
| floatlei | 0:7e14d7c443f1 | 277 | */ |
| floatlei | 0:7e14d7c443f1 | 278 | |
| floatlei | 0:7e14d7c443f1 | 279 | /*! |
| floatlei | 0:7e14d7c443f1 | 280 | * RegRxHeaderCntValueLsb (Read Only) |
| floatlei | 0:7e14d7c443f1 | 281 | */ |
| floatlei | 0:7e14d7c443f1 | 282 | |
| floatlei | 0:7e14d7c443f1 | 283 | /*! |
| floatlei | 0:7e14d7c443f1 | 284 | * RegRxPacketCntValueMsb (Read Only) |
| floatlei | 0:7e14d7c443f1 | 285 | */ |
| floatlei | 0:7e14d7c443f1 | 286 | |
| floatlei | 0:7e14d7c443f1 | 287 | /*! |
| floatlei | 0:7e14d7c443f1 | 288 | * RegRxPacketCntValueLsb (Read Only) |
| floatlei | 0:7e14d7c443f1 | 289 | */ |
| floatlei | 0:7e14d7c443f1 | 290 | |
| floatlei | 0:7e14d7c443f1 | 291 | /*! |
| floatlei | 0:7e14d7c443f1 | 292 | * RegModemStat (Read Only) |
| floatlei | 0:7e14d7c443f1 | 293 | */ |
| floatlei | 0:7e14d7c443f1 | 294 | #define RFLR_MODEMSTAT_RX_CR_MASK 0x1F |
| floatlei | 0:7e14d7c443f1 | 295 | #define RFLR_MODEMSTAT_MODEM_STATUS_MASK 0xE0 |
| floatlei | 0:7e14d7c443f1 | 296 | |
| floatlei | 0:7e14d7c443f1 | 297 | /*! |
| floatlei | 0:7e14d7c443f1 | 298 | * RegPktSnrValue (Read Only) |
| floatlei | 0:7e14d7c443f1 | 299 | */ |
| floatlei | 0:7e14d7c443f1 | 300 | |
| floatlei | 0:7e14d7c443f1 | 301 | /*! |
| floatlei | 0:7e14d7c443f1 | 302 | * RegPktRssiValue (Read Only) |
| floatlei | 0:7e14d7c443f1 | 303 | */ |
| floatlei | 0:7e14d7c443f1 | 304 | |
| floatlei | 0:7e14d7c443f1 | 305 | /*! |
| floatlei | 0:7e14d7c443f1 | 306 | * RegRssiValue (Read Only) |
| floatlei | 0:7e14d7c443f1 | 307 | */ |
| floatlei | 0:7e14d7c443f1 | 308 | |
| floatlei | 0:7e14d7c443f1 | 309 | /*! |
| floatlei | 0:7e14d7c443f1 | 310 | * RegHopChannel (Read Only) |
| floatlei | 0:7e14d7c443f1 | 311 | */ |
| floatlei | 0:7e14d7c443f1 | 312 | #define RFLR_HOPCHANNEL_PLL_LOCK_TIMEOUT_MASK 0x7F |
| floatlei | 0:7e14d7c443f1 | 313 | #define RFLR_HOPCHANNEL_PLL_LOCK_FAIL 0x80 |
| floatlei | 0:7e14d7c443f1 | 314 | #define RFLR_HOPCHANNEL_PLL_LOCK_SUCCEED 0x00 // Default |
| floatlei | 0:7e14d7c443f1 | 315 | |
| floatlei | 0:7e14d7c443f1 | 316 | #define RFLR_HOPCHANNEL_CRCONPAYLOAD_MASK 0xBF |
| floatlei | 0:7e14d7c443f1 | 317 | #define RFLR_HOPCHANNEL_CRCONPAYLOAD_ON 0x40 |
| floatlei | 0:7e14d7c443f1 | 318 | #define RFLR_HOPCHANNEL_CRCONPAYLOAD_OFF 0x00 // Default |
| floatlei | 0:7e14d7c443f1 | 319 | |
| floatlei | 0:7e14d7c443f1 | 320 | #define RFLR_HOPCHANNEL_CHANNEL_MASK 0x3F |
| floatlei | 0:7e14d7c443f1 | 321 | |
| floatlei | 0:7e14d7c443f1 | 322 | /*! |
| floatlei | 0:7e14d7c443f1 | 323 | * RegModemConfig1 |
| floatlei | 0:7e14d7c443f1 | 324 | */ |
| floatlei | 0:7e14d7c443f1 | 325 | #define RFLR_MODEMCONFIG1_BW_MASK 0x0F |
| floatlei | 0:7e14d7c443f1 | 326 | #define RFLR_MODEMCONFIG1_BW_7_81_KHZ 0x00 |
| floatlei | 0:7e14d7c443f1 | 327 | #define RFLR_MODEMCONFIG1_BW_10_41_KHZ 0x10 |
| floatlei | 0:7e14d7c443f1 | 328 | #define RFLR_MODEMCONFIG1_BW_15_62_KHZ 0x20 |
| floatlei | 0:7e14d7c443f1 | 329 | #define RFLR_MODEMCONFIG1_BW_20_83_KHZ 0x30 |
| floatlei | 0:7e14d7c443f1 | 330 | #define RFLR_MODEMCONFIG1_BW_31_25_KHZ 0x40 |
| floatlei | 0:7e14d7c443f1 | 331 | #define RFLR_MODEMCONFIG1_BW_41_66_KHZ 0x50 |
| floatlei | 0:7e14d7c443f1 | 332 | #define RFLR_MODEMCONFIG1_BW_62_50_KHZ 0x60 |
| floatlei | 0:7e14d7c443f1 | 333 | #define RFLR_MODEMCONFIG1_BW_125_KHZ 0x70 // Default |
| floatlei | 0:7e14d7c443f1 | 334 | #define RFLR_MODEMCONFIG1_BW_250_KHZ 0x80 |
| floatlei | 0:7e14d7c443f1 | 335 | #define RFLR_MODEMCONFIG1_BW_500_KHZ 0x90 |
| floatlei | 0:7e14d7c443f1 | 336 | |
| floatlei | 0:7e14d7c443f1 | 337 | #define RFLR_MODEMCONFIG1_CODINGRATE_MASK 0xF1 |
| floatlei | 0:7e14d7c443f1 | 338 | #define RFLR_MODEMCONFIG1_CODINGRATE_4_5 0x02 |
| floatlei | 0:7e14d7c443f1 | 339 | #define RFLR_MODEMCONFIG1_CODINGRATE_4_6 0x04 // Default |
| floatlei | 0:7e14d7c443f1 | 340 | #define RFLR_MODEMCONFIG1_CODINGRATE_4_7 0x06 |
| floatlei | 0:7e14d7c443f1 | 341 | #define RFLR_MODEMCONFIG1_CODINGRATE_4_8 0x08 |
| floatlei | 0:7e14d7c443f1 | 342 | |
| floatlei | 0:7e14d7c443f1 | 343 | #define RFLR_MODEMCONFIG1_IMPLICITHEADER_MASK 0xFE |
| floatlei | 0:7e14d7c443f1 | 344 | #define RFLR_MODEMCONFIG1_IMPLICITHEADER_ON 0x01 |
| floatlei | 0:7e14d7c443f1 | 345 | #define RFLR_MODEMCONFIG1_IMPLICITHEADER_OFF 0x00 // Default |
| floatlei | 0:7e14d7c443f1 | 346 | |
| floatlei | 0:7e14d7c443f1 | 347 | /*! |
| floatlei | 0:7e14d7c443f1 | 348 | * RegModemConfig2 |
| floatlei | 0:7e14d7c443f1 | 349 | */ |
| floatlei | 0:7e14d7c443f1 | 350 | #define RFLR_MODEMCONFIG2_SF_MASK 0x0F |
| floatlei | 0:7e14d7c443f1 | 351 | #define RFLR_MODEMCONFIG2_SF_6 0x60 |
| floatlei | 0:7e14d7c443f1 | 352 | #define RFLR_MODEMCONFIG2_SF_7 0x70 // Default |
| floatlei | 0:7e14d7c443f1 | 353 | #define RFLR_MODEMCONFIG2_SF_8 0x80 |
| floatlei | 0:7e14d7c443f1 | 354 | #define RFLR_MODEMCONFIG2_SF_9 0x90 |
| floatlei | 0:7e14d7c443f1 | 355 | #define RFLR_MODEMCONFIG2_SF_10 0xA0 |
| floatlei | 0:7e14d7c443f1 | 356 | #define RFLR_MODEMCONFIG2_SF_11 0xB0 |
| floatlei | 0:7e14d7c443f1 | 357 | #define RFLR_MODEMCONFIG2_SF_12 0xC0 |
| floatlei | 0:7e14d7c443f1 | 358 | |
| floatlei | 0:7e14d7c443f1 | 359 | #define RFLR_MODEMCONFIG2_TXCONTINUOUSMODE_MASK 0xF7 |
| floatlei | 0:7e14d7c443f1 | 360 | #define RFLR_MODEMCONFIG2_TXCONTINUOUSMODE_ON 0x08 |
| floatlei | 0:7e14d7c443f1 | 361 | #define RFLR_MODEMCONFIG2_TXCONTINUOUSMODE_OFF 0x00 |
| floatlei | 0:7e14d7c443f1 | 362 | |
| floatlei | 0:7e14d7c443f1 | 363 | #define RFLR_MODEMCONFIG2_RXPAYLOADCRC_MASK 0xFB |
| floatlei | 0:7e14d7c443f1 | 364 | #define RFLR_MODEMCONFIG2_RXPAYLOADCRC_ON 0x04 |
| floatlei | 0:7e14d7c443f1 | 365 | #define RFLR_MODEMCONFIG2_RXPAYLOADCRC_OFF 0x00 // Default |
| floatlei | 0:7e14d7c443f1 | 366 | |
| floatlei | 0:7e14d7c443f1 | 367 | #define RFLR_MODEMCONFIG2_SYMBTIMEOUTMSB_MASK 0xFC |
| floatlei | 0:7e14d7c443f1 | 368 | #define RFLR_MODEMCONFIG2_SYMBTIMEOUTMSB 0x00 // Default |
| floatlei | 0:7e14d7c443f1 | 369 | |
| floatlei | 0:7e14d7c443f1 | 370 | /*! |
| floatlei | 0:7e14d7c443f1 | 371 | * RegSymbTimeoutLsb |
| floatlei | 0:7e14d7c443f1 | 372 | */ |
| floatlei | 0:7e14d7c443f1 | 373 | #define RFLR_SYMBTIMEOUTLSB_SYMBTIMEOUT 0x64 // Default |
| floatlei | 0:7e14d7c443f1 | 374 | |
| floatlei | 0:7e14d7c443f1 | 375 | /*! |
| floatlei | 0:7e14d7c443f1 | 376 | * RegPreambleLengthMsb |
| floatlei | 0:7e14d7c443f1 | 377 | */ |
| floatlei | 0:7e14d7c443f1 | 378 | #define RFLR_PREAMBLELENGTHMSB 0x00 // Default |
| floatlei | 0:7e14d7c443f1 | 379 | |
| floatlei | 0:7e14d7c443f1 | 380 | /*! |
| floatlei | 0:7e14d7c443f1 | 381 | * RegPreambleLengthLsb |
| floatlei | 0:7e14d7c443f1 | 382 | */ |
| floatlei | 0:7e14d7c443f1 | 383 | #define RFLR_PREAMBLELENGTHLSB 0x08 // Default |
| floatlei | 0:7e14d7c443f1 | 384 | |
| floatlei | 0:7e14d7c443f1 | 385 | /*! |
| floatlei | 0:7e14d7c443f1 | 386 | * RegPayloadLength |
| floatlei | 0:7e14d7c443f1 | 387 | */ |
| floatlei | 0:7e14d7c443f1 | 388 | #define RFLR_PAYLOADLENGTH 0x0E // Default |
| floatlei | 0:7e14d7c443f1 | 389 | |
| floatlei | 0:7e14d7c443f1 | 390 | /*! |
| floatlei | 0:7e14d7c443f1 | 391 | * RegPayloadMaxLength |
| floatlei | 0:7e14d7c443f1 | 392 | */ |
| floatlei | 0:7e14d7c443f1 | 393 | #define RFLR_PAYLOADMAXLENGTH 0xFF // Default |
| floatlei | 0:7e14d7c443f1 | 394 | |
| floatlei | 0:7e14d7c443f1 | 395 | /*! |
| floatlei | 0:7e14d7c443f1 | 396 | * RegHopPeriod |
| floatlei | 0:7e14d7c443f1 | 397 | */ |
| floatlei | 0:7e14d7c443f1 | 398 | #define RFLR_HOPPERIOD_FREQFOPPINGPERIOD 0x00 // Default |
| floatlei | 0:7e14d7c443f1 | 399 | |
| floatlei | 0:7e14d7c443f1 | 400 | /*! |
| floatlei | 0:7e14d7c443f1 | 401 | * RegFifoRxByteAddr (Read Only) |
| floatlei | 0:7e14d7c443f1 | 402 | */ |
| floatlei | 0:7e14d7c443f1 | 403 | |
| floatlei | 0:7e14d7c443f1 | 404 | /*! |
| floatlei | 0:7e14d7c443f1 | 405 | * RegModemConfig3 |
| floatlei | 0:7e14d7c443f1 | 406 | */ |
| floatlei | 0:7e14d7c443f1 | 407 | #define RFLR_MODEMCONFIG3_LOWDATARATEOPTIMIZE_MASK 0xF7 |
| floatlei | 0:7e14d7c443f1 | 408 | #define RFLR_MODEMCONFIG3_LOWDATARATEOPTIMIZE_ON 0x08 |
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| floatlei | 0:7e14d7c443f1 | 420 | * RegFeiMid (Read Only) |
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| floatlei | 0:7e14d7c443f1 | 424 | * RegFeiLsb (Read Only) |
| floatlei | 0:7e14d7c443f1 | 425 | */ |
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| floatlei | 0:7e14d7c443f1 | 427 | /*! |
| floatlei | 0:7e14d7c443f1 | 428 | * RegRssiWideband (Read Only) |
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| floatlei | 0:7e14d7c443f1 | 449 | * RegDetectionThreshold |
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| floatlei | 0:7e14d7c443f1 | 451 | #define RFLR_DETECTIONTHRESH_SF7_TO_SF12 0x0A // Default |
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| floatlei | 0:7e14d7c443f1 | 455 | * RegInvertIQ2 |
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| floatlei | 0:7e14d7c443f1 | 470 | #define RFLR_DIOMAPPING1_DIO1_00 0x00 // Default |
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| floatlei | 0:7e14d7c443f1 | 489 | */ |
| floatlei | 0:7e14d7c443f1 | 490 | #define RFLR_DIOMAPPING2_DIO4_MASK 0x3F |
| floatlei | 0:7e14d7c443f1 | 491 | #define RFLR_DIOMAPPING2_DIO4_00 0x00 // Default |
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| floatlei | 0:7e14d7c443f1 | 494 | #define RFLR_DIOMAPPING2_DIO4_11 0xC0 |
| floatlei | 0:7e14d7c443f1 | 495 | |
| floatlei | 0:7e14d7c443f1 | 496 | #define RFLR_DIOMAPPING2_DIO5_MASK 0xCF |
| floatlei | 0:7e14d7c443f1 | 497 | #define RFLR_DIOMAPPING2_DIO5_00 0x00 // Default |
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| floatlei | 0:7e14d7c443f1 | 499 | #define RFLR_DIOMAPPING2_DIO5_10 0x20 |
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| floatlei | 0:7e14d7c443f1 | 507 | * RegVersion (Read Only) |
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| floatlei | 0:7e14d7c443f1 | 518 | * RegTcxo |
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| floatlei | 0:7e14d7c443f1 | 520 | #define RFLR_TCXO_TCXOINPUT_MASK 0xEF |
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| floatlei | 0:7e14d7c443f1 | 522 | #define RFLR_TCXO_TCXOINPUT_OFF 0x00 // Default |
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| floatlei | 0:7e14d7c443f1 | 525 | * RegPaDac |
| floatlei | 0:7e14d7c443f1 | 526 | */ |
| floatlei | 0:7e14d7c443f1 | 527 | #define RFLR_PADAC_20DBM_MASK 0xF8 |
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| floatlei | 0:7e14d7c443f1 | 531 | /*! |
| floatlei | 0:7e14d7c443f1 | 532 | * RegFormerTemp |
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| floatlei | 0:7e14d7c443f1 | 536 | * RegBitrateFrac |
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| floatlei | 0:7e14d7c443f1 | 538 | #define RF_BITRATEFRAC_MASK 0xF0 |
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| floatlei | 0:7e14d7c443f1 | 541 | * RegAgcRef |
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| floatlei | 0:7e14d7c443f1 | 549 | * RegAgcThresh2 |
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| floatlei | 0:7e14d7c443f1 | 560 | #define RF_PLL_BANDWIDTH_75 0x00 |
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| floatlei | 0:7e14d7c443f1 | 565 | #endif // __SX1276_REGS_LORA_H__ |